JPH09282102A - 磁気ディスク制御装置 - Google Patents
磁気ディスク制御装置Info
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- JPH09282102A JPH09282102A JP9663696A JP9663696A JPH09282102A JP H09282102 A JPH09282102 A JP H09282102A JP 9663696 A JP9663696 A JP 9663696A JP 9663696 A JP9663696 A JP 9663696A JP H09282102 A JPH09282102 A JP H09282102A
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- memory
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Abstract
(57)【要約】
【課題】 ＣＰＵから磁気ディスク制御装置に対するア
クセスをメモリに対するアクセスのみとすることによ
り、磁気ディスク制御装置に対するアクセスを高速にす
る。 【解決手段】 入出力制御回路がＣＰＵから指令信号を
入力したときメモリ制御回路に対してモード信号を送出
し、モード信号を入力したメモリ制御回路は、磁気ディ
スク制御回路に対して制御信号を出力して磁気ディスク
制御回路とメモリとの間で直接にデータの授受を行わせ
ることによって磁気ディスク装置のデータの書込み動作
または読出し動作の制御を行う。
クセスをメモリに対するアクセスのみとすることによ
り、磁気ディスク制御装置に対するアクセスを高速にす
る。 【解決手段】 入出力制御回路がＣＰＵから指令信号を
入力したときメモリ制御回路に対してモード信号を送出
し、モード信号を入力したメモリ制御回路は、磁気ディ
スク制御回路に対して制御信号を出力して磁気ディスク
制御回路とメモリとの間で直接にデータの授受を行わせ
ることによって磁気ディスク装置のデータの書込み動作
または読出し動作の制御を行う。
Description
【０００１】
【発明の属する技術分野】本発明は磁気ディスク装置に
対するデータの書込み動作や読出し動作の制御を行うた
めの磁気ディスク制御装置に関し、特にデータの書込み
動作または読出し動作のためのアクセスの高速化を実現
するための手段に関する。
対するデータの書込み動作や読出し動作の制御を行うた
めの磁気ディスク制御装置に関し、特にデータの書込み
動作または読出し動作のためのアクセスの高速化を実現
するための手段に関する。
【０００２】
【従来の技術】図２は従来の磁気ディスク制御装置の一
例を示すブロック図である。
例を示すブロック図である。
【０００３】磁気ディスク装置を接続しているパーソナ
ルコンピュータ（パソコン）等の従来の磁気ディスク装
置の制御方式は、中央制御装置（ＣＰＵ）が、磁気ディ
スク制御用の入出力制御回路および磁気ディスク制御回
路を介して磁気ディスク装置の動作の制御を行い、メモ
リ制御回路によって制御されるメモリとＣＰＵのバッフ
ァとの間でデータを転送を行うことにより、磁気ディス
ク装置のデータの書込み動作または読出し動作の制御を
行っている。
ルコンピュータ（パソコン）等の従来の磁気ディスク装
置の制御方式は、中央制御装置（ＣＰＵ）が、磁気ディ
スク制御用の入出力制御回路および磁気ディスク制御回
路を介して磁気ディスク装置の動作の制御を行い、メモ
リ制御回路によって制御されるメモリとＣＰＵのバッフ
ァとの間でデータを転送を行うことにより、磁気ディス
ク装置のデータの書込み動作または読出し動作の制御を
行っている。
【０００４】すなわち、図２に示すように、磁気ディス
ク制御装置２１は、書込みまたは読出しのときにデータ
を格納するメモリ２５と、磁気ディスク装置２０のデー
タの書込み動作または読出し動作を制御する磁気ディス
ク制御回路２４と、磁気ディスク制御回路２４に対して
制御信号３５を出力して磁気ディスク装置２０のデータ
の書込み動作または読出し動作の制御を行うように指令
する入出力制御回路２２と、メモリ２５に対して指令信
号３６を送って磁気ディスク制御回路２４が磁気ディス
ク装置２０に対して書込みまたは読出しを行うデータを
格納させるメモリ制御回路２３とを備えており、入出力
制御回路２２およびメモリ制御回路２３は、アドレスバ
ス１およびコントロールバス３によって中央制御装置
（ＣＰＵ）１０と接続されており、メモリ２５および磁
気ディスク制御回路２４は、データバス２によって中央
制御装置（ＣＰＵ）１０と接続されている。
ク制御装置２１は、書込みまたは読出しのときにデータ
を格納するメモリ２５と、磁気ディスク装置２０のデー
タの書込み動作または読出し動作を制御する磁気ディス
ク制御回路２４と、磁気ディスク制御回路２４に対して
制御信号３５を出力して磁気ディスク装置２０のデータ
の書込み動作または読出し動作の制御を行うように指令
する入出力制御回路２２と、メモリ２５に対して指令信
号３６を送って磁気ディスク制御回路２４が磁気ディス
ク装置２０に対して書込みまたは読出しを行うデータを
格納させるメモリ制御回路２３とを備えており、入出力
制御回路２２およびメモリ制御回路２３は、アドレスバ
ス１およびコントロールバス３によって中央制御装置
（ＣＰＵ）１０と接続されており、メモリ２５および磁
気ディスク制御回路２４は、データバス２によって中央
制御装置（ＣＰＵ）１０と接続されている。
【０００５】上述のように構成された従来の磁気ディス
ク制御装置２１は、磁気ディスク装置２０に記憶させて
いるデータを読出してＣＰＵ１０に送るときは、コント
ロールバス３を介してＣＰＵ１０から入出力制御回路２
２に読出し指令が送られると同時に、アドレスバス１を
介してＣＰＵ１０から入出力制御回路２２に読出すべき
データを記憶している磁気ディスク装置２０のアドレス
が指定されるので、入出力制御回路２２は、磁気ディス
ク制御回路２４にアドレスを送り、磁気ディスク制御回
路２４は、磁気ディスク装置２０の指定されたアドレス
からデータを読出してデータバス２を介してＣＰＵ１０
に送る。ＣＰＵ１０は、磁気ディスク制御回路２４から
送られてきたデータを自己のバッフアメモリに格納する
が、送られてきたデータの量が多くて自己のバッフアメ
モリに格納しきれないときは、コントロールバス３を介
してメモリ制御回路２３に対して格納指令を送ると共に
アドレスバス１を介してメモリ制御回路２３に対してデ
ータを格納すべきメモリ２５のアドレスを指定すると同
時に、データバス２を介してメモリ２５にデータを送信
する。メモリ制御回路２３は、ＣＰＵ１０からの格納指
令を受取ると、メモリ２５に対して指令信号３６を送
り、メモリ２５は、ＣＰＵ１０から送られてきたデータ
を指定されたアドレスに格納する。ＣＰＵ１０は、自己
のバッフアメモリに格納したデータを処理してバッフア
メモリをあけ、メモリ２５に格納したデータを順次読出
して処理する。
ク制御装置２１は、磁気ディスク装置２０に記憶させて
いるデータを読出してＣＰＵ１０に送るときは、コント
ロールバス３を介してＣＰＵ１０から入出力制御回路２
２に読出し指令が送られると同時に、アドレスバス１を
介してＣＰＵ１０から入出力制御回路２２に読出すべき
データを記憶している磁気ディスク装置２０のアドレス
が指定されるので、入出力制御回路２２は、磁気ディス
ク制御回路２４にアドレスを送り、磁気ディスク制御回
路２４は、磁気ディスク装置２０の指定されたアドレス
からデータを読出してデータバス２を介してＣＰＵ１０
に送る。ＣＰＵ１０は、磁気ディスク制御回路２４から
送られてきたデータを自己のバッフアメモリに格納する
が、送られてきたデータの量が多くて自己のバッフアメ
モリに格納しきれないときは、コントロールバス３を介
してメモリ制御回路２３に対して格納指令を送ると共に
アドレスバス１を介してメモリ制御回路２３に対してデ
ータを格納すべきメモリ２５のアドレスを指定すると同
時に、データバス２を介してメモリ２５にデータを送信
する。メモリ制御回路２３は、ＣＰＵ１０からの格納指
令を受取ると、メモリ２５に対して指令信号３６を送
り、メモリ２５は、ＣＰＵ１０から送られてきたデータ
を指定されたアドレスに格納する。ＣＰＵ１０は、自己
のバッフアメモリに格納したデータを処理してバッフア
メモリをあけ、メモリ２５に格納したデータを順次読出
して処理する。
【０００６】磁気ディスク装置２０にデータを書込むと
きは、ＣＰＵ１０は、コントロールバス３を介してメモ
リ制御回路２３に対して格納指令を送ると共に、アドレ
スバス１を介してメモリ制御回路２３に対してデータを
格納すべきメモリ２５のアドレスを指定すると同時に、
データバス２を介してメモリ２５にデータを送信する。
メモリ制御回路２３は、ＣＰＵ１０からの格納指令を受
取ると、メモリ２５に対して指令信号３６を送り、メモ
リ２５は、ＣＰＵ１０から送られてきたデータをメモリ
制御回路２３によって指定されたアドレスに格納する。
メモリ２５に対する書込みデータの格納が終ると、ＣＰ
Ｕ１０は、メモリ２５からその書込みデータを読出し、
コントロールバス３を介して入出力制御回路２２に書込
み指令を送ると同時に、アドレスバス１を介してＣＰＵ
１０から入出力制御回路２２に磁気ディスク装置２０の
データを書込むべきアドレスを指定し、メモリ１５から
読出した書込みデータをデータバス２を介して磁気ディ
スク制御回路２４に送る。入出力制御回路２２は、磁気
ディスク制御回路２４にアドレスを送り、磁気ディスク
制御回路２４は、磁気ディスク装置２０にその指定され
たアドレスにＣＰＵ１０から送られてきた書込みデータ
を書込むように制御する。
きは、ＣＰＵ１０は、コントロールバス３を介してメモ
リ制御回路２３に対して格納指令を送ると共に、アドレ
スバス１を介してメモリ制御回路２３に対してデータを
格納すべきメモリ２５のアドレスを指定すると同時に、
データバス２を介してメモリ２５にデータを送信する。
メモリ制御回路２３は、ＣＰＵ１０からの格納指令を受
取ると、メモリ２５に対して指令信号３６を送り、メモ
リ２５は、ＣＰＵ１０から送られてきたデータをメモリ
制御回路２３によって指定されたアドレスに格納する。
メモリ２５に対する書込みデータの格納が終ると、ＣＰ
Ｕ１０は、メモリ２５からその書込みデータを読出し、
コントロールバス３を介して入出力制御回路２２に書込
み指令を送ると同時に、アドレスバス１を介してＣＰＵ
１０から入出力制御回路２２に磁気ディスク装置２０の
データを書込むべきアドレスを指定し、メモリ１５から
読出した書込みデータをデータバス２を介して磁気ディ
スク制御回路２４に送る。入出力制御回路２２は、磁気
ディスク制御回路２４にアドレスを送り、磁気ディスク
制御回路２４は、磁気ディスク装置２０にその指定され
たアドレスにＣＰＵ１０から送られてきた書込みデータ
を書込むように制御する。
【０００７】
【発明が解決しようとする課題】上述したように、従来
の磁気ディスク装置の制御方式は、ＣＰＵが磁気ディス
ク制御用の入出力制御回路および磁気ディスク制御回路
を介し、メモリ制御回路によって制御されるメモリとＣ
ＰＵのバッファとの間でデータの転送を行うことによ
り、磁気ディスク装置に対するデータの書込みまたは読
出しを行っているため、入出力制御回路を介する磁気デ
ィスク装置に対するデータの入出力のためのアクセス時
間と、メモリ制御回路を介するメモリに対するデータの
書込みや読出しを行うためのアクセス時間とを加算した
処理時間が必要であり、このため、磁気ディスク装置に
対して行うアクセスの高速化を実現するためには、磁気
ディスク装置自身のアクセス性能を向上させるか、また
は磁気ディスク制御装置の入出力のアクセス性能を向上
させるか、またはメモリのアクセス性能を向上させる必
要があり、これらは何れも実現が容易でないという問題
点を有している。
の磁気ディスク装置の制御方式は、ＣＰＵが磁気ディス
ク制御用の入出力制御回路および磁気ディスク制御回路
を介し、メモリ制御回路によって制御されるメモリとＣ
ＰＵのバッファとの間でデータの転送を行うことによ
り、磁気ディスク装置に対するデータの書込みまたは読
出しを行っているため、入出力制御回路を介する磁気デ
ィスク装置に対するデータの入出力のためのアクセス時
間と、メモリ制御回路を介するメモリに対するデータの
書込みや読出しを行うためのアクセス時間とを加算した
処理時間が必要であり、このため、磁気ディスク装置に
対して行うアクセスの高速化を実現するためには、磁気
ディスク装置自身のアクセス性能を向上させるか、また
は磁気ディスク制御装置の入出力のアクセス性能を向上
させるか、またはメモリのアクセス性能を向上させる必
要があり、これらは何れも実現が容易でないという問題
点を有している。
【０００８】
【課題を解決するための手段】本磁気ディスク制御装置
は、磁気ディスク装置に対する書込みまたは読出しのた
めにデータを記憶するメモリと、前記磁気ディスク装置
のデータの書込み動作または読出し動作を制御する磁気
ディスク制御回路と、前記磁気ディスク制御回路に対し
て第一の制御信号を出力する入出力制御回路と、前記メ
モリの動作を制御するメモリ制御回路とを備え、前記メ
モリ制御回路が前記入出力制御回路からモード信号を入
力したとき、前記メモリ制御回路から前記磁気ディスク
制御回路に対して前記磁気ディスク装置の動作を制御す
るための指令を与える第二の制御信号を送出し、前記磁
気ディスク制御回路は、前記メモリ制御回路からの前記
第二の制御信号によって前記磁気ディスク装置のデータ
の書込み動作または読出し動作の制御を行って前記メモ
リとの間でデータの授受を行うことを含むものである。
は、磁気ディスク装置に対する書込みまたは読出しのた
めにデータを記憶するメモリと、前記磁気ディスク装置
のデータの書込み動作または読出し動作を制御する磁気
ディスク制御回路と、前記磁気ディスク制御回路に対し
て第一の制御信号を出力する入出力制御回路と、前記メ
モリの動作を制御するメモリ制御回路とを備え、前記メ
モリ制御回路が前記入出力制御回路からモード信号を入
力したとき、前記メモリ制御回路から前記磁気ディスク
制御回路に対して前記磁気ディスク装置の動作を制御す
るための指令を与える第二の制御信号を送出し、前記磁
気ディスク制御回路は、前記メモリ制御回路からの前記
第二の制御信号によって前記磁気ディスク装置のデータ
の書込み動作または読出し動作の制御を行って前記メモ
リとの間でデータの授受を行うことを含むものである。
【０００９】すなわち、本発明の磁気ディスク制御装置
は、磁気ディスク装置に対する書込みまたは読出しのた
めのデータを記憶するメモリと、前記磁気ディスク装置
のデータの書込み動作または読出し動作を制御する磁気
ディスク制御回路と、前記磁気ディスク制御回路に対し
て第一の制御信号を出力して前記磁気ディスク装置のデ
ータの書込み動作または読出し動作の制御を指令し上位
装置から指令があったときモード信号を出力する入出力
制御回路と、前記メモリに対して指令信号を送って前記
磁気ディスク制御回路が前記磁気ディスク装置に対して
書込みまたは読出しを行うデータを格納させ前記入出力
制御回路から前記モード信号を入力したとき前記磁気デ
ィスク制御回路に対して第二の制御信号を送出して前記
磁気ディスク装置のデータの書込み動作または読出し動
作の制御を行って前記メモリとの間でデータの授受を行
わせる指令を与えるメモリ制御回路とを備えたものであ
る。
は、磁気ディスク装置に対する書込みまたは読出しのた
めのデータを記憶するメモリと、前記磁気ディスク装置
のデータの書込み動作または読出し動作を制御する磁気
ディスク制御回路と、前記磁気ディスク制御回路に対し
て第一の制御信号を出力して前記磁気ディスク装置のデ
ータの書込み動作または読出し動作の制御を指令し上位
装置から指令があったときモード信号を出力する入出力
制御回路と、前記メモリに対して指令信号を送って前記
磁気ディスク制御回路が前記磁気ディスク装置に対して
書込みまたは読出しを行うデータを格納させ前記入出力
制御回路から前記モード信号を入力したとき前記磁気デ
ィスク制御回路に対して第二の制御信号を送出して前記
磁気ディスク装置のデータの書込み動作または読出し動
作の制御を行って前記メモリとの間でデータの授受を行
わせる指令を与えるメモリ制御回路とを備えたものであ
る。
【００１０】
【発明の実施の形態】以下、本発明の実施の形態につい
て図面を参照して説明する。
て図面を参照して説明する。
【００１１】図１は、本発明の磁気ディスク制御装置の
一実施形態を示すブロック図である。
一実施形態を示すブロック図である。
【００１２】図１の磁気ディスク制御装置１１は、磁気
ディスク装置２０に対するデータの書込みまたは読出し
のときに、そのデータを格納するメモリ１５と、磁気デ
ィスク装置２０におけるデータの書込み動作または読出
し動作の制御を行う磁気ディスク制御回路１４と、磁気
ディスク制御回路１４に対して制御信号５を出力してそ
の磁気ディスク装置２０に対するデータの書込み動作ま
たは読出し動作の制御を指令し、また、中央制御装置
（ＣＰＵ）１０からデータバス２を介して指令があった
とき、モード信号４を出力する入出力制御回路１２と、
メモリ１５におけるデータの格納動作または読出し動作
を制御し、また入出力制御回路１２からモード信号４を
入力したとき、磁気ディスク制御回路１４に対して制御
信号６を出力して磁気ディスク制御回路１４の磁気ディ
スク装置２０におけるデータの書込み動作または読出し
動作の制御を指令するメモリ制御回路１３とを備えてお
り、入出力制御回路１２は、アドレスバス１およびデー
タバス２およびコントロールバス３によってＣＰＵ１０
と接続されており、メモリ制御回路１３は、アドレスバ
ス１およびコントロールバス３によってＣＰＵ１０と接
続されており、メモリ１５および磁気ディスク制御回路
１４は、データバス２によってＣＰＵ１０と接続されて
いる。
ディスク装置２０に対するデータの書込みまたは読出し
のときに、そのデータを格納するメモリ１５と、磁気デ
ィスク装置２０におけるデータの書込み動作または読出
し動作の制御を行う磁気ディスク制御回路１４と、磁気
ディスク制御回路１４に対して制御信号５を出力してそ
の磁気ディスク装置２０に対するデータの書込み動作ま
たは読出し動作の制御を指令し、また、中央制御装置
（ＣＰＵ）１０からデータバス２を介して指令があった
とき、モード信号４を出力する入出力制御回路１２と、
メモリ１５におけるデータの格納動作または読出し動作
を制御し、また入出力制御回路１２からモード信号４を
入力したとき、磁気ディスク制御回路１４に対して制御
信号６を出力して磁気ディスク制御回路１４の磁気ディ
スク装置２０におけるデータの書込み動作または読出し
動作の制御を指令するメモリ制御回路１３とを備えてお
り、入出力制御回路１２は、アドレスバス１およびデー
タバス２およびコントロールバス３によってＣＰＵ１０
と接続されており、メモリ制御回路１３は、アドレスバ
ス１およびコントロールバス３によってＣＰＵ１０と接
続されており、メモリ１５および磁気ディスク制御回路
１４は、データバス２によってＣＰＵ１０と接続されて
いる。
【００１３】次に上述のように構成した磁気ディスク制
御装置の動作について説明する。
御装置の動作について説明する。
【００１４】磁気ディスク装置２０に対する通常のデー
タの書込み動作は、図２の従来の磁気ディスク制御装置
２１の動作と同じである。すなわち、ＣＰＵ１０からメ
モリ１５に書込みデータを送って格納させた後その書込
みデータを読出し、磁気ディスク制御装置１１の入出力
制御回路１２に対してデータ書込み命令を発行してメモ
リ１５から読出したデータを磁気ディスク制御回路１４
に送り、磁気ディスク制御回路１４は、入出力制御回路
１２からの制御信号５によってＣＰＵ１０から送られて
きた書込みデータを磁気ディスク装置２０に送って書込
ませる。
タの書込み動作は、図２の従来の磁気ディスク制御装置
２１の動作と同じである。すなわち、ＣＰＵ１０からメ
モリ１５に書込みデータを送って格納させた後その書込
みデータを読出し、磁気ディスク制御装置１１の入出力
制御回路１２に対してデータ書込み命令を発行してメモ
リ１５から読出したデータを磁気ディスク制御回路１４
に送り、磁気ディスク制御回路１４は、入出力制御回路
１２からの制御信号５によってＣＰＵ１０から送られて
きた書込みデータを磁気ディスク装置２０に送って書込
ませる。
【００１５】磁気ディスク装置２０からの通常のデータ
の読出し動作も図２の従来の磁気ディスク制御装置２１
の動作と同じである。すなわちＣＰＵ１０から磁気ディ
スク制御装置１１の入出力制御回路１２に対してデータ
読出み命令を発行し、これを受けた入出力制御回路１２
は、磁気ディスク制御回路１４に対して制御信号５を出
力して磁気ディスク装置２０からデータを読出させる。
磁気ディスク装置２０から読出したデータは、ＣＰＵ１
０に送られてそのバッファメモリに格納される。読出し
データがバッファメモリに格納しきれないときは、その
データをメモリ１５に送って格納させた後、バッファメ
モリがあき次第、メモリ１５に格納したデータを読出
す。
の読出し動作も図２の従来の磁気ディスク制御装置２１
の動作と同じである。すなわちＣＰＵ１０から磁気ディ
スク制御装置１１の入出力制御回路１２に対してデータ
読出み命令を発行し、これを受けた入出力制御回路１２
は、磁気ディスク制御回路１４に対して制御信号５を出
力して磁気ディスク装置２０からデータを読出させる。
磁気ディスク装置２０から読出したデータは、ＣＰＵ１
０に送られてそのバッファメモリに格納される。読出し
データがバッファメモリに格納しきれないときは、その
データをメモリ１５に送って格納させた後、バッファメ
モリがあき次第、メモリ１５に格納したデータを読出
す。
【００１６】高速アクセスを必要とする場合は、ＣＰＵ
１０は、磁気ディスク制御装置１１の入出力制御回路１
２に対して指令信号を送出する。その指令信号を入力し
た入出力制御回路１２は、メモリ制御回路１３に対して
モード信号４を送出し、モード信号４を入力したメモリ
制御回路１３は、磁気ディスク制御回路１４に対して制
御信号６を出力し、磁気ディスク制御回路１４は、磁気
ディスク装置２０のデータの書込み動作または読出し動
作の制御を行い、書込みまたは読出しデータは、メモリ
１５と直接に授受を行う。このように、内蔵するメモリ
１５にデータを格納し、磁気ディスク装置２０のデータ
の書込み動作または読出し動作の制御のときは、メモリ
１５と磁気ディスク制御装置１４の間で直接にデータの
授受を行うようにすることにより、高速にアクセスを終
了することができる。
１０は、磁気ディスク制御装置１１の入出力制御回路１
２に対して指令信号を送出する。その指令信号を入力し
た入出力制御回路１２は、メモリ制御回路１３に対して
モード信号４を送出し、モード信号４を入力したメモリ
制御回路１３は、磁気ディスク制御回路１４に対して制
御信号６を出力し、磁気ディスク制御回路１４は、磁気
ディスク装置２０のデータの書込み動作または読出し動
作の制御を行い、書込みまたは読出しデータは、メモリ
１５と直接に授受を行う。このように、内蔵するメモリ
１５にデータを格納し、磁気ディスク装置２０のデータ
の書込み動作または読出し動作の制御のときは、メモリ
１５と磁気ディスク制御装置１４の間で直接にデータの
授受を行うようにすることにより、高速にアクセスを終
了することができる。
【００１７】
【発明の効果】以上説明したように、本発明の磁気ディ
スク制御装置は、入出力制御回路がＣＰＵから指令信号
を入力したときメモリ制御回路に対してモード信号を送
出し、モード信号を入力したメモリ制御回路は、磁気デ
ィスク制御回路に対して制御信号を出力して磁気ディス
ク制御回路とメモリとの間で直接にデータの授受を行っ
て磁気ディスク装置にデータの書込み動作または読出し
動作を行わせるように制御することにより、ＣＰＵから
磁気ディスク制御装置に対するアクセスはメモリに対す
るアクセスのみとなるため、高速にアクセスを終了させ
ることが可能になるという効果がある。
スク制御装置は、入出力制御回路がＣＰＵから指令信号
を入力したときメモリ制御回路に対してモード信号を送
出し、モード信号を入力したメモリ制御回路は、磁気デ
ィスク制御回路に対して制御信号を出力して磁気ディス
ク制御回路とメモリとの間で直接にデータの授受を行っ
て磁気ディスク装置にデータの書込み動作または読出し
動作を行わせるように制御することにより、ＣＰＵから
磁気ディスク制御装置に対するアクセスはメモリに対す
るアクセスのみとなるため、高速にアクセスを終了させ
ることが可能になるという効果がある。
【図１】本発明の磁気ディスク制御装置の一実施形態を
示すブロック図である。
示すブロック図である。
【図２】従来の磁気ディスク制御装置の一例を示すブロ
ック図である。
ック図である。
１ アドレスバス ２ データバス ３ コントロールバス ４ モード信号 ５ 制御信号 ６ 制御信号 １０ 中央制御装置（ＣＰＵ） １１・２１ 磁気ディスク制御装置 １２・２２ 入出力制御回路 １３・２３ メモリ制御回路 １４・２４ 磁気ディスク制御回路 １５・２５ メモリ ２０ 磁気ディスク装置
Claims (2)
- 【請求項１】 磁気ディスク装置に対する書込みまたは
読出しのためにデータを記憶するメモリと、前記磁気デ
ィスク装置のデータの書込み動作または読出し動作を制
御する磁気ディスク制御回路と、前記磁気ディスク制御
回路に対して第一の制御信号を出力する入出力制御回路
と、前記メモリの動作を制御するメモリ制御回路とを備
え、前記メモリ制御回路が前記入出力制御回路からモー
ド信号を入力したとき、前記メモリ制御回路から前記磁
気ディスク制御回路に対して前記磁気ディスク装置の動
作を制御するための指令を与える第二の制御信号を送出
し、前記磁気ディスク制御回路は、前記メモリ制御回路
からの前記第二の制御信号によって前記磁気ディスク装
置のデータの書込み動作または読出し動作の制御を行っ
て前記メモリとの間でデータの授受を行うことを含むこ
とを特徴とする磁気ディスク制御装置。 - 【請求項２】 磁気ディスク装置に対する書込みまたは
読出しのためのデータを記憶するメモリと、前記磁気デ
ィスク装置のデータの書込み動作または読出し動作を制
御する磁気ディスク制御回路と、前記磁気ディスク制御
回路に対して第一の制御信号を出力して前記磁気ディス
ク装置のデータの書込み動作または読出し動作の制御を
指令し上位装置から指令があったときモード信号を出力
する入出力制御回路と、前記メモリに対して指令信号を
送って前記磁気ディスク制御回路が前記磁気ディスク装
置に対して書込みまたは読出しを行うデータを格納させ
前記入出力制御回路から前記モード信号を入力したとき
前記磁気ディスク制御回路に対して第二の制御信号を送
出して前記磁気ディスク装置のデータの書込み動作また
は読出し動作の制御を行って前記メモリとの間でデータ
の授受を行わせる指令を与えるメモリ制御回路とを備え
ることを特徴とする磁気ディスク制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9663696A JPH09282102A (ja) | 1996-04-18 | 1996-04-18 | 磁気ディスク制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9663696A JPH09282102A (ja) | 1996-04-18 | 1996-04-18 | 磁気ディスク制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09282102A true JPH09282102A (ja) | 1997-10-31 |
Family
ID=14170327
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9663696A Pending JPH09282102A (ja) | 1996-04-18 | 1996-04-18 | 磁気ディスク制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09282102A (ja) |
-
1996
- 1996-04-18 JP JP9663696A patent/JPH09282102A/ja active Pending
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19980908 |