JP2000099392A - メモリ制御システム - Google Patents
メモリ制御システムInfo
- Publication number
- JP2000099392A JP2000099392A JP10265878A JP26587898A JP2000099392A JP 2000099392 A JP2000099392 A JP 2000099392A JP 10265878 A JP10265878 A JP 10265878A JP 26587898 A JP26587898 A JP 26587898A JP 2000099392 A JP2000099392 A JP 2000099392A
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- JP
- Japan
- Prior art keywords
- computer
- data
- buffer memory
- storage device
- storage medium
- Prior art date
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Abstract
(57)【要約】
【課題】 本発明はメモリ制御装置に関し、各コンピュ
ータのアクセス方法の種類によってバッファメモリの構
成を変更することにより、最適なデータのリード／ライ
トを行なうことができるメモリ制御システムを提供する
ことを目的としている。 【解決手段】 コンピュータと記憶装置とが接続された
システムにおいて、前記記憶装置は、データを記憶する
記憶媒体と、前記コンピュータと接続され、前記記憶媒
体との間のデータの流れを制御する制御装置と、前記記
憶媒体に書き込むデータと、前記記憶媒体から読み出し
たデータの一時記憶を行なうバッファメモリとを具備し
て構成する。
ータのアクセス方法の種類によってバッファメモリの構
成を変更することにより、最適なデータのリード／ライ
トを行なうことができるメモリ制御システムを提供する
ことを目的としている。 【解決手段】 コンピュータと記憶装置とが接続された
システムにおいて、前記記憶装置は、データを記憶する
記憶媒体と、前記コンピュータと接続され、前記記憶媒
体との間のデータの流れを制御する制御装置と、前記記
憶媒体に書き込むデータと、前記記憶媒体から読み出し
たデータの一時記憶を行なうバッファメモリとを具備し
て構成する。
Description
【０００１】
【発明の属する技術分野】本発明はコンピュータと記憶
装置との間でデータのやりとりを行なう場合におけるメ
モリ制御システムに関する。
装置との間でデータのやりとりを行なう場合におけるメ
モリ制御システムに関する。
【０００２】
【従来の技術】コンピュータと記憶装置との間でデータ
のやりとりを行なう場合は極めて多く、各種の方式が採
用されている。通常は、コンピュータのデータ処理の速
度と、記憶装置とのアクセス速度との差に基づく時間調
整を行なうために、記憶装置内にバッファメモリを設け
る場合が通常である。そして、記憶装置へのリード／ラ
イト方法は各コンピュータにより異なっている。
のやりとりを行なう場合は極めて多く、各種の方式が採
用されている。通常は、コンピュータのデータ処理の速
度と、記憶装置とのアクセス速度との差に基づく時間調
整を行なうために、記憶装置内にバッファメモリを設け
る場合が通常である。そして、記憶装置へのリード／ラ
イト方法は各コンピュータにより異なっている。
【０００３】
【発明が解決しようとする課題】この場合、コンピュー
タの種類毎に記憶装置へのリード／ライトの方法が異な
るため、その都度バッファメモリの構成を使用するオペ
レーティングシステム（ＯＳ）の種類に対応したものを
用いる必要があった。
タの種類毎に記憶装置へのリード／ライトの方法が異な
るため、その都度バッファメモリの構成を使用するオペ
レーティングシステム（ＯＳ）の種類に対応したものを
用いる必要があった。
【０００４】本発明はこのような課題に鑑みてなされた
ものであって、各コンピュータのアクセス方法の種類に
よってバッファメモリの構成を変更することにより、最
適なデータのリード／ライトを行なうことができるメモ
リ制御システムを提供することを目的としている。
ものであって、各コンピュータのアクセス方法の種類に
よってバッファメモリの構成を変更することにより、最
適なデータのリード／ライトを行なうことができるメモ
リ制御システムを提供することを目的としている。
【０００５】
【課題を解決するための手段】（１）前記した課題を解
決する本発明は、コンピュータと記憶装置とが接続され
たシステムにおいて、前記記憶装置は、データを記憶す
る記憶媒体と、前記コンピュータと接続され、前記記憶
媒体との間のデータの流れを制御する制御装置と、前記
記憶媒体に書き込むデータと、前記記憶媒体から読み出
したデータの一時記憶を行なうバッファメモリとを具備
して構成されることを特徴としている。
決する本発明は、コンピュータと記憶装置とが接続され
たシステムにおいて、前記記憶装置は、データを記憶す
る記憶媒体と、前記コンピュータと接続され、前記記憶
媒体との間のデータの流れを制御する制御装置と、前記
記憶媒体に書き込むデータと、前記記憶媒体から読み出
したデータの一時記憶を行なうバッファメモリとを具備
して構成されることを特徴としている。
【０００６】この発明の構成によれば、バッファメモリ
へのアクセス方法を判断してバッファメモリの構造を変
更して、最適なデータのリード／ライトを行なうことが
可能となる。
へのアクセス方法を判断してバッファメモリの構造を変
更して、最適なデータのリード／ライトを行なうことが
可能となる。
【０００７】（２）この場合において、前記システム
は、コンピュータに対応したバッファメモリの構造をコ
ンピュータに対して最適化することを特徴としている。
この発明の構成によれば、バッファメモリの内容をコン
ピュータのアクセス方法に応じて変更し、最適化するこ
とで、コンピュータと記憶装置間のデータのやりとりを
スムーズに行なうことができる。
は、コンピュータに対応したバッファメモリの構造をコ
ンピュータに対して最適化することを特徴としている。
この発明の構成によれば、バッファメモリの内容をコン
ピュータのアクセス方法に応じて変更し、最適化するこ
とで、コンピュータと記憶装置間のデータのやりとりを
スムーズに行なうことができる。
【０００８】
【発明の実施の形態】以下、図面を参照して本発明の実
施の形態例を詳細に説明する。図１は本発明の一実施の
形態例を示すブロック図である。図において、１０はコ
ンピュータであり、記憶装置２０とケーブル１で接続さ
れている。コンピュータ１０にはそのオペレーティング
システムの違いにより種々の種類がある。記憶装置２０
において、２１はデータのコンピュータ１０の処理速度
と記憶装置２０間のアクセス時間の差を吸収するために
設けられて、データの一時記憶を行なうバッファメモ
リ、２２はデータの記憶を行なう記憶媒体で、例えばデ
ィスク装置が用いられる。２３はバッファメモリ２１の
内部構造をコンピュータ１０からのアクセスコマンドに
応じて変更する制御装置である。該制御装置２３にはＣ
ＰＵ（図示せず）が含まれているものとする。２は記憶
装置２０内の各装置間を接続するバスである。このよう
に構成されたシステムの動作を図２のフローチャートを
参照しつつ説明すれば、以下の通りである。
施の形態例を詳細に説明する。図１は本発明の一実施の
形態例を示すブロック図である。図において、１０はコ
ンピュータであり、記憶装置２０とケーブル１で接続さ
れている。コンピュータ１０にはそのオペレーティング
システムの違いにより種々の種類がある。記憶装置２０
において、２１はデータのコンピュータ１０の処理速度
と記憶装置２０間のアクセス時間の差を吸収するために
設けられて、データの一時記憶を行なうバッファメモ
リ、２２はデータの記憶を行なう記憶媒体で、例えばデ
ィスク装置が用いられる。２３はバッファメモリ２１の
内部構造をコンピュータ１０からのアクセスコマンドに
応じて変更する制御装置である。該制御装置２３にはＣ
ＰＵ（図示せず）が含まれているものとする。２は記憶
装置２０内の各装置間を接続するバスである。このよう
に構成されたシステムの動作を図２のフローチャートを
参照しつつ説明すれば、以下の通りである。
【０００９】本発明は、記憶装置側で、コンピュータ１
０からのアクセスコマンドを解析してバッファメモリ２
１の構造をコンピュータ１０に応じたものに変更するの
で、バッファメモリの構造を変更して、最適なデータの
リード／ライトを行なうことが可能となる。
０からのアクセスコマンドを解析してバッファメモリ２
１の構造をコンピュータ１０に応じたものに変更するの
で、バッファメモリの構造を変更して、最適なデータの
リード／ライトを行なうことが可能となる。
【００１０】コンピュータ１０から記憶装置２０に対し
てアクセスコマンドが送出されると、制御装置２３はア
クセスコマンドを解析する（Ｓ１）。制御装置２３は受
信したアクセスコマンドを解析する（Ｓ２）。そして、
解析した結果として現構造を変更した方がよいと判断さ
れたならば、制御装置２３はバッファメモリ２１の内部
構造をアクセスコマンドに対応したものに変更する（Ｓ
３）。これにより、記憶媒体２２へのリード／ライトの
回数を減らすことができる。
てアクセスコマンドが送出されると、制御装置２３はア
クセスコマンドを解析する（Ｓ１）。制御装置２３は受
信したアクセスコマンドを解析する（Ｓ２）。そして、
解析した結果として現構造を変更した方がよいと判断さ
れたならば、制御装置２３はバッファメモリ２１の内部
構造をアクセスコマンドに対応したものに変更する（Ｓ
３）。これにより、記憶媒体２２へのリード／ライトの
回数を減らすことができる。
【００１１】その後は、通常の動作に移る（Ｓ４）。ス
テップＳ２において、アクセスコマンドの解析の結果、
その内容を判断できなかった場合、又はバッファメモリ
の内容を変更する必要がなかった場合にも、通常動作に
移る（Ｓ４）。
テップＳ２において、アクセスコマンドの解析の結果、
その内容を判断できなかった場合、又はバッファメモリ
の内容を変更する必要がなかった場合にも、通常動作に
移る（Ｓ４）。
【００１２】この実施の形態例によれば、バッファメモ
リ２１の内容をコンピュータ１０のアクセス方法に応じ
て変更し、最適化することで、コンピュータと記憶装置
間のデータのやりとりをスムーズに行なうことができ
る。
リ２１の内容をコンピュータ１０のアクセス方法に応じ
て変更し、最適化することで、コンピュータと記憶装置
間のデータのやりとりをスムーズに行なうことができ
る。
【００１３】ここでいう通常動作とは、コンピュータ１
０と記憶装置２０間でデータのやりとりを行なう場合を
意味し、コンピュータ１０から記憶媒体２２へのデータ
の書き込みと、記憶媒体２２からのデータの読み出しの
態様がある。
０と記憶装置２０間でデータのやりとりを行なう場合を
意味し、コンピュータ１０から記憶媒体２２へのデータ
の書き込みと、記憶媒体２２からのデータの読み出しの
態様がある。
【００１４】次に、データの書き込みと読み出しについ
て説明する。ライト動作が入った時にはバッファメモリ
２１に一旦蓄積された後記憶媒体へ転送され、リード動
作が入った時には、記憶媒体２２から読み出されたデー
タがバッファメモリ２１に一旦入り、その後読み出され
てコンピュータ１０側に転送される。
て説明する。ライト動作が入った時にはバッファメモリ
２１に一旦蓄積された後記憶媒体へ転送され、リード動
作が入った時には、記憶媒体２２から読み出されたデー
タがバッファメモリ２１に一旦入り、その後読み出され
てコンピュータ１０側に転送される。
【００１５】データ書き込みモード コンピュータ１０からデータの書き込み要求があると、
コンピュータ１０からケーブル１を介して送られてきた
データは一旦バッファメモリ２１に蓄積され、その後、
記憶媒体２２に書き込まれる。
コンピュータ１０からケーブル１を介して送られてきた
データは一旦バッファメモリ２１に蓄積され、その後、
記憶媒体２２に書き込まれる。
【００１６】データ読み出しモード コンピュータ１０から記憶媒体２２からのデータの読み
出し要求があると、制御装置２３は記憶媒体２２からデ
ータを読出して、一旦バッファメモリ２１に蓄積し、そ
の後、コンピュータ１０に対して読みだしデータを転送
する。この場合において、バッファ２１に同じデータが
蓄積されている時には、制御装置２３は次回の読み出し
命令から記憶媒体２２にはアクセスせず、バッファメモ
リ２１に記憶されているデータを読出してコンピュータ
１０に転送する。つまり、この場合には、バッファメモ
リ２１をキャッシュメモリとしても使用することができ
て都合がよい。
出し要求があると、制御装置２３は記憶媒体２２からデ
ータを読出して、一旦バッファメモリ２１に蓄積し、そ
の後、コンピュータ１０に対して読みだしデータを転送
する。この場合において、バッファ２１に同じデータが
蓄積されている時には、制御装置２３は次回の読み出し
命令から記憶媒体２２にはアクセスせず、バッファメモ
リ２１に記憶されているデータを読出してコンピュータ
１０に転送する。つまり、この場合には、バッファメモ
リ２１をキャッシュメモリとしても使用することができ
て都合がよい。
【００１７】
【発明の効果】以上、詳細に説明したように、本発明に
よれば、 （１）コンピュータと記憶装置とが接続されたシステム
において、前記記憶装置は、データを記憶する記憶媒体
と、前記コンピュータと接続され、前記記憶媒体との間
のデータの流れを制御する制御装置と、前記記憶媒体に
書き込むデータと、前記記憶媒体から読み出したデータ
の一時記憶を行なうバッファメモリとを具備して構成さ
れることにより、バッファメモリへのアクセス方法を判
断してバッファメモリの構造を変更して、最適なデータ
のリード／ライトを行なうことが可能となる。
よれば、 （１）コンピュータと記憶装置とが接続されたシステム
において、前記記憶装置は、データを記憶する記憶媒体
と、前記コンピュータと接続され、前記記憶媒体との間
のデータの流れを制御する制御装置と、前記記憶媒体に
書き込むデータと、前記記憶媒体から読み出したデータ
の一時記憶を行なうバッファメモリとを具備して構成さ
れることにより、バッファメモリへのアクセス方法を判
断してバッファメモリの構造を変更して、最適なデータ
のリード／ライトを行なうことが可能となる。
【００１８】（２）この場合において、前記システム
は、コンピュータに対応したバッファメモリの構造をコ
ンピュータに対して最適化することにより、バッファメ
モリの内容をコンピュータのアクセス方法に応じて変更
し、最適化することで、コンピュータと記憶装置間のデ
ータのやりとりをスムーズに行なうことができる。
は、コンピュータに対応したバッファメモリの構造をコ
ンピュータに対して最適化することにより、バッファメ
モリの内容をコンピュータのアクセス方法に応じて変更
し、最適化することで、コンピュータと記憶装置間のデ
ータのやりとりをスムーズに行なうことができる。
【００１９】このように、本発明によれば、各コンピュ
ータのアクセス方法の種類によってバッファメモリの構
成を変更することにより、最適なデータのリード／ライ
トを行なうことができるメモリ制御システムを提供する
ことができる。
ータのアクセス方法の種類によってバッファメモリの構
成を変更することにより、最適なデータのリード／ライ
トを行なうことができるメモリ制御システムを提供する
ことができる。
【図１】本発明の一実施の形態例を示すブロック図であ
る。
る。
【図２】本発明の動作を示すフローチャートである。
１ ケーブル ２ バス １０ コンピュータ ２０ 記憶装置 ２１ バッファメモリ ２２ 記憶媒体 ２３ 制御装置
Claims (2)
- 【請求項１】 コンピュータと記憶装置とが接続された
システムにおいて、 前記記憶装置は、 データを記憶する記憶媒体と、 前記コンピュータと接続され、前記記憶媒体との間のデ
ータの流れを制御する制御装置と、 前記記憶媒体に書き込むデータと、前記記憶媒体から読
み出したデータの一時記憶を行なうバッファメモリとを
具備して構成されるメモリ制御システム。 - 【請求項２】 前記システムは、コンピュータに対応し
たバッファメモリの構造をコンピュータに対して最適化
することを特徴とする請求項１記載のメモリ制御システ
ム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10265878A JP2000099392A (ja) | 1998-09-21 | 1998-09-21 | メモリ制御システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10265878A JP2000099392A (ja) | 1998-09-21 | 1998-09-21 | メモリ制御システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JP2000099392A true JP2000099392A (ja) | 2000-04-07 |
Family
ID=17423361
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10265878A Pending JP2000099392A (ja) | 1998-09-21 | 1998-09-21 | メモリ制御システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2000099392A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007164342A (ja) * | 2005-12-12 | 2007-06-28 | Konica Minolta Opto Inc | メモリ制御装置及びメモリ制御方法 |
-
1998
- 1998-09-21 JP JP10265878A patent/JP2000099392A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007164342A (ja) * | 2005-12-12 | 2007-06-28 | Konica Minolta Opto Inc | メモリ制御装置及びメモリ制御方法 |
| JP4715493B2 (ja) * | 2005-12-12 | 2011-07-06 | コニカミノルタオプト株式会社 | メモリ制御装置及びメモリ制御方法 |
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