JPH09232637A - リードフレームおよび発光素子の製法 - Google Patents

リードフレームおよび発光素子の製法

Info

Publication number
JPH09232637A
JPH09232637A JP8039661A JP3966196A JPH09232637A JP H09232637 A JPH09232637 A JP H09232637A JP 8039661 A JP8039661 A JP 8039661A JP 3966196 A JP3966196 A JP 3966196A JP H09232637 A JPH09232637 A JP H09232637A
Authority
JP
Japan
Prior art keywords
die pad
lead frame
lead
light emitting
bonded
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP8039661A
Other languages
English (en)
Other versions
JP3571450B2 (ja
Inventor
Shinichi Suzuki
慎一 鈴木
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Rohm Co Ltd
Original Assignee
Rohm Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Rohm Co Ltd filed Critical Rohm Co Ltd
Priority to JP03966196A priority Critical patent/JP3571450B2/ja
Publication of JPH09232637A publication Critical patent/JPH09232637A/ja
Application granted granted Critical
Publication of JP3571450B2 publication Critical patent/JP3571450B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/48Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor body packages
    • H01L33/62Arrangements for conducting electric current to or from the semiconductor body, e.g. lead-frames, wire-bonds or solder balls
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/10Details of semiconductor or other solid state devices to be connected
    • H01L2924/11Device type
    • H01L2924/12Passive devices, e.g. 2 terminal devices
    • H01L2924/1204Optical Diode
    • H01L2924/12041LED
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L33/00Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof
    • H01L33/48Semiconductor devices having potential barriers specially adapted for light emission; Processes or apparatus specially adapted for the manufacture or treatment thereof or of parts thereof; Details thereof characterised by the semiconductor body packages
    • H01L33/58Optical field-shaping elements
    • H01L33/60Reflective elements

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Power Engineering (AREA)
  • Led Device Packages (AREA)

Abstract

(57)【要約】 【課題】 LEDの側面からの光を集光するパラボラを
形成してもその周囲が変形せず、ワイヤのタッチが生ぜ
ず、しかもリードフレームの裏面は平らで各素子共用の
ボンディング用機台により簡単にボンディングをするこ
とができるリードフレームの製法およびそれを用いた発
光素子を提供する。 【解決手段】 半導体チップ(LEDチップ3)をボン
ディングするダイパッド1と、該ダイパッドにボンディ
ングされる半導体チップとワイヤ5により電気的に接続
されるリード4とを有するリードフレームの製法であっ
て、板状体で、前記ダイパッドが形成され半導体チップ
がボンディングされる部分にエッチングにより貫通しな
いエッチング穴2aを形成し、ついで金型により前記エ
ッチング穴を整形することにより凹部2を形成する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は発光素子チップなど
の半導体チップがボンディングされ、発光素子や半導体
装置を組み立てる際に用いられるリードフレームの製法
に関する。さらに詳しくは、半導体チップをボンディン
グするダイパッドに凹部を形成する場合に、リードフレ
ームの他の部分を変形させないリードフレームおよび発
光素子の製法ならびにそのリードフレームを用いた発光
素子および半導体装置に関する。
【0002】
【従来の技術】たとえば発光ダイオード(以下、LED
という)のチップはそのpn接合部で発光し、表面だけ
ではなく、裏面や側面からも光が放射される。この側面
から放射される光も有効に利用するため、LEDチップ
は通常凹面形状にされたパラボラ内にボンディングされ
る。これらの発光素子は最近では組立工程の容易さおよ
びコストダウンの点から薄い板状体から形成されたリー
ドフレームを用いて製造される。リードフレームは通常
0.2〜0.4mm程度の薄い板材からなっており、図4
に斜視図およびそのB4 −B4 線断面図が示されるよう
に、薄い板材が打ち抜かれてダイパッド1やリード4が
形成される際に、同時にダイパッド1の中心部を板材ご
と下側に押し下げる成形により凹部(パラボラ)20が
形成されている。そしてその凹部20にLEDチップ3
がダイボンディングされ、リード4の端部とワイヤ5に
より電気的に接続されている。その後図示しない透明樹
脂などにより被覆されて発光素子が形成される。
【0003】
【発明が解決しようとする課題】従来のダイパッド1に
凹部20を形成する場合、前述のように、板材ごと押し
下げる成形がなされている。そのため、板材が薄いとい
えども板材にストレスがかかり、凹部20の周囲やその
近傍に変形が生じやすい。その結果、LEDチップ3の
電極端子とリード4とを電気的に接続するワイヤ5がダ
イパッド1の端部と接触しやすい(図4(b)のA参
照)という問題がある。
【0004】さらに、ダイパッド1の下面がリードフレ
ームの面より下側に突出するため、従来のダイボンディ
ングやワイヤボンディングの共通の機台ではボンディン
グをすることができず、その素子専用の機台で行わなけ
ればならないという問題がある。
【0005】本発明はこのような問題を解決し、LED
の側面からの光を集光するパラボラを形成してもその周
囲が変形せず、ワイヤのタッチ不良のおそれがなく、し
かもリードフレームの裏面は平らで各素子共用の機台に
より簡単にボンディングをすることができるリードフレ
ームおよび発光素子の製法ならびにそれを用いた発光素
子および半導体装置を提供することを目的とする。
【0006】
【課題を解決するための手段】本発明によるリードフレ
ームの製法は、半導体チップをボンディングするダイパ
ッドと、該ダイパッドにボンディングされる半導体チッ
プとワイヤにより電気的に接続されるリードとを有する
リードフレームの製法であって、板状体で、前記ダイパ
ッドが形成され半導体チップがボンディングされる部分
にエッチングにより貫通しないエッチング穴を形成し、
ついで金型により前記エッチング穴を整形することによ
り凹部を形成するものである。
【0007】前記エッチング穴の整形を、前記ダイパッ
ドおよびリードを形成するために前記板状体を打ち抜く
際に同時に行うことが特別の工程を必要とせず、きれい
な形状のパラボラを形成することができるため好まし
い。
【0008】前記板状体のダイパッドが形成される部分
に前記エッチング穴を形成するためのエッチングをする
際に、形成されるダイパッドの端部となる部分で前記リ
ードと隣接する側の部分を同時にエッチングすることに
よりダイパッドの端部に切欠部を形成することが、凹部
の形成によりLEDチップなどの半導体チップの表面と
リードの端部の表面とが同程度の高さになっても両者を
接続するワイヤがダイパッドの端部と接触するおそれが
なくて好ましい。
【0009】本発明の発光素子の製法は、請求項1記載
のリードフレームの該ダイパッドに発光素子チップをボ
ンディングし、該発光素子チップと前記リードをワイヤ
で電気的に接続し、前記発光素子チップおよび前記リー
ドの端部の部分を透明樹脂で被覆した後、リードフレー
ムから切断分離するものである。
【0010】本発明の発光素子は、板状体の裏面が平ら
で表面側に凹部が形成されたダイパッドと、該ダイパッ
ドの凹部にボンディングされた発光素子チップと、前記
ダイパッドと隣接して設けられたリードと、前記発光素
子チップの電極端子と前記リードとを電気的に接続する
ワイヤとからなり、前記ダイパッドの前記リード側の端
部に切欠部が形成されている。
【0011】本発明の半導体装置は、高さの異なる半導
体チップがそれぞれダイパッドにボンディングされ、1
つのパッケージに包含される半導体装置であって、前記
半導体チップのうちの背の高いチップがボンディングさ
れるダイパッドに予め凹部が形成され、各半導体チップ
の表面の高さが実質的に同じ高さに形成されている。
【0012】ここで、実質的に同じ高さとは、ワイヤボ
ンディングをする場合の画像認識のときに、焦点のずれ
によりボンディング位置がずれるなどの不都合が生じな
い程度の高さにそろっていることを意味する。
【0013】
【発明の実施の形態】つぎに、図面を参照しながら本発
明のリードフレームおよび発光素子の製法ならびに発光
素子および半導体装置について説明をする。
【0014】図1の(a)は本発明の発光素子の製法で
チップのボンディングを終わった状態の斜視説明図、
(b)はそのB1 −B1 線断面説明図、(c)はそのリ
ードフレームの製造工程の要部の断面説明図である。
【0015】図1において、1はダイパッドで、その中
心部に凹部2が形成されており、その凹部2内にLED
チップ3がダイボンディングされると共に、その一方の
電極がリード4の端部とワイヤ5により接続されてい
る。図1では発光素子の1個分だけが図示されている
が、このボンディングがなされる状態では、このダイパ
ッド1およびリード4の部分がたくさん連結されたリー
ドフレームの状態になっており、この後、透明なエポキ
シ樹脂などにより被覆されてリードフレームから切り離
されることにより発光素子が大量に製造される。
【0016】本発明のリードフレームおよび発光素子の
製法は、リードフレームのダイパッド1の中心部に形成
される凹部2を、まずエッチングにより板状体の一部を
えぐり取ることにより貫通しないエッチング穴2aを形
成し、その後金型により整形してきれいなパラボラ形状
にすることより形成していることに特徴がある。
【0017】すなわち、板状体の一部をエッチングする
ことにより凹部2を形成しているため、リードフレーム
の下側に突出することがなく、裏面は平らでダイボンデ
ィングやワイヤボンディングをする場合、リードフレー
ムを各素子共用のボンディング用機台に載置することに
より簡単にボンディングをすることができる。この場
合、板材の一部をエッチングすることなく、直接金型で
押し潰して裏面に突出させないで凹部を形成することも
できるが、凹部の肉が周辺に移動しリードフレームが一
層変形し、また歪みが残り後からも変形し、ワイヤボン
ディングに支障を来す。また、機械加工や放電加工によ
り板状体の一部を削りとることにより凹部を形成すれば
金型整形をしなくてもきれいな形状のパラボラを形成す
ることができるが、これらの加工はコストアップとなる
ため大量生産品には採用できない。
【0018】このリードフレームを製造するには、図1
(c)に示されるように、まず板状体10の状態で、ダ
イパッド1が形成される部分に塩化第二鉄溶液などのエ
ッチング液によりエッチングを施し、たとえば0.25
mm程度の厚さの板材の70%程度の厚さを除去し、そ
の後、板状体10からダイパッド1やリード4を形成す
るためのパンチングの際に、エッチング穴2aを金型2
2により整形して底面が平らな凹部2とすることにより
形成する。その結果、金型22で凹部2が形成されても
整形だけで板状体10の変形は殆どなく、したがって歪
みも殆ど生じない。
【0019】本発明の発光素子の製法は、このリードフ
レームを用いて前述のように、ダイパッド1の凹部2内
にLEDチップ3をダイボンディングし、ワイヤボンデ
ィングをし、さらにLEDチップ3およびリード4の端
部部分を透明樹脂で被覆することにより発光素子を形成
するものである。
【0020】図2は本発明の発光素子の他の例を示す図
で、図1と同様に示されている。図2に示される例で
は、LEDチップ3の電極端子とリード4とを連結する
ワイヤ5の下のダイパッド1の端部、すなわちリード4
と隣接するダイパッド1の部分の端部に切欠部6が形成
されていることに特徴がある。このように切欠部6が形
成されていることにより、LEDチップ3の電極端子と
リード4とがほぼ同じ高さの状態でワイヤ5により連結
されてワイヤ5が少々垂れ下がってもワイヤ5とダイパ
ッド1とが接触することがない。その結果、ショート不
良が発生することがなく、信頼性の高い発光素子が得ら
れる。この切欠部の形成は発光素子に限らず、他の半導
体装置についても同様の効果がある。
【0021】この切欠部6の形成は、図2(c)にリー
ドフレームの製造工程が示されるように、図1に示され
る製法と同じ工程で、エッチング穴2aを形成する際に
切欠部6を形成する部分のマスクを除去しておくだけで
同時にエッチングされ、余計な工数を必要とするこよな
く簡単に形成される。ここで、切欠部6の形状は余り問
題にならないため、切欠部6を金型整形する必要はな
い。なお、切欠部6以外は図1に示される例と同じで、
同じ部分に同じ符号を付してその説明を省略する。
【0022】図3は本発明の方法により製造するリード
フレームのさらに他の応用例を示す図である。図3はた
とえばICチップ(以下、単にICという)7、8など
を同じパッケージ内に組み込むため、同じリードフレー
ム上に異なる高さのIC7、8をボンディングする半導
体装置の例で、リードフレームの一部を予めエッチング
しておくことによりIC7、8の高さを実質的に同じ高
さにするものである。すなわち、ダイボンディング後に
ワイヤボンディングをする場合に、画像認識によりボン
ディング位置を特定するが、IC7、8の表面同志で高
さが異なると焦点距離が異なり、ボケにより位置ずれが
生じやすいという問題がある。
【0023】しかし、本発明では高さが高いIC7がボ
ンディングされるダイパッド9にあらかじめ凹部12を
形成しておくことによりIC7、8の表面を実質的に同
じ高さに合わせることができ、ボンディング時の画像認
識の不都合をなくしたものである。たとえばIC7の高
さが0.4mmで、IC8の高さが0.23mmでリード
フレームの板厚が0.25mmの場合、IC7、8の表
面の高さはリードフレームの底面からそれぞれ0.65
mmおよび0.48mmと0.17mmの高さの差があ
る。このIC7の方のダイパッド9をエッチングにより
0.18mm程度除去して凹部12を形成すればIC
7、8の表面の高さをほぼ同じ高さにすることができ
る。
【0024】この凹部12の形成は、図1に示されるパ
ラボラのための凹部2と同様に、予めエッチングをして
おき、リードフレームの打抜き形成の際に金型で整形を
することにより簡単に形成することができる。なお、こ
の例では光を反射させるパラボラにする必要がないた
め、図3に示されるように、ダイパッド9に打ち抜く際
に凹部の側壁をなくして、ダイパッド9の端面が薄いま
まで終端していても構わない。また、その意味で金型に
よる完全な整形がなされていなくてもよい。図3におい
て、11はIC8側のダイパッド、13はIC7の電極
端子と接続されるリード、14はIC7の電極端子とリ
ード13とを電気的に接続するワイヤである。
【0025】
【発明の効果】本発明の製法によれば、リードフレーム
のダイパッドに凹部を形成する場合に、予めエッチング
をしておきその後金型により整形して形成しているた
め、リードフレームに歪みが加わることがなく、変形が
生じない。しかもダイパッドの底面が突出せずに平らな
状態で凹部を形成することができる。
【0026】その結果、リードフレームの変形は最小限
に抑えられると共に、半導体チップをダイボンディング
したり、ワイヤボンディングする際に特定の素子用にボ
ンディング用機台を改造し、専用化しなければならない
という不都合が生じない。
【0027】また、本発明の方法により製造したリード
フレームを用いた発光素子によれば、リードフレームに
歪みがなく、きれいな形状のパラボラが形成されるた
め、発光効率が向上すると共に、ワイヤの接触不良の発
生も殆どない。その結果、高品質で信頼性の高い発光素
子が得られる。
【0028】さらに、本発明の半導体装置によれば、I
Cのチップの高さの異なるものを同一パッケージに組み
込む場合でも、ワイヤボンディング不良が発生すること
がなく信頼性の高い半導体装置が得られる。
【図面の簡単な説明】
【図1】本発明の発光素子およびリードフレームの製法
を説明する図である。
【図2】本発明の発光素子の改良された例を示す図であ
る。
【図3】本発明のリードフレームの製法の応用例を示す
図である。
【図4】従来の発光素子のダイパッド部の形状を示す図
である。
【符号の説明】
1 ダイパッド 2 凹部 2a エッチング穴 3 LEDチップ 4 リード 5 ワイヤ 6 切欠部

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】 半導体チップをボンディングするダイパ
    ッドと、該ダイパッドにボンディングされる半導体チッ
    プとワイヤにより電気的に接続されるリードとを有する
    リードフレームの製法であって、板状体で、前記ダイパ
    ッドが形成され半導体チップがボンディングされる部分
    にエッチングにより貫通しないエッチング穴を形成し、
    ついで金型により前記エッチング穴を整形することによ
    り凹部を形成するリードフレームの製法。
  2. 【請求項2】 前記エッチング穴の整形を、前記ダイパ
    ッドおよびリードを形成するために前記板状体を打ち抜
    く際に同時に行う請求項1記載のリードフレームの製
    法。
  3. 【請求項3】 前記板状体のダイパッドが形成される部
    分に前記エッチング穴を形成するためのエッチングをす
    る際に、形成されるダイパッドの端部となる部分で前記
    リードと隣接する側の部分を同時にエッチングすること
    によりダイパッドの端部に切欠部を形成する請求項1ま
    たは2記載のリードフレームの製法。
  4. 【請求項4】 請求項1記載のリードフレームの該ダイ
    パッドに発光素子チップをボンディングし、該発光素子
    チップと前記リードをワイヤで電気的に接続し、前記発
    光素子チップおよび前記リードの端部の部分を透明樹脂
    で被覆した後、リードフレームから切断分離する発光素
    子の製法。
  5. 【請求項5】 板状体の裏面が平らで表面側に凹部が形
    成されたダイパッドと、該ダイパッドの凹部にボンディ
    ングされた発光素子チップと、前記ダイパッドと隣接し
    て設けられたリードと、前記発光素子チップの電極端子
    と前記リードの端部とを電気的に接続するワイヤとから
    なり、前記ダイパッドの前記リード側の端部に切欠部が
    形成されてなる発光素子。
  6. 【請求項6】 高さの異なる半導体チップがそれぞれダ
    イパッドにボンディングされ、1つのパッケージに包含
    される半導体装置であって、前記半導体チップのうちの
    背の高いチップがボンディングされるダイパッドの少な
    くとも半導体チップがボンディングされる部分が予め薄
    く形成され、前記ダイパッドの裏面からの各半導体チッ
    プの表面の高さが実質的に同じ高さに形成されてなる半
    導体装置。
JP03966196A 1996-02-27 1996-02-27 リードフレームの製法および発光素子の製法 Expired - Fee Related JP3571450B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP03966196A JP3571450B2 (ja) 1996-02-27 1996-02-27 リードフレームの製法および発光素子の製法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP03966196A JP3571450B2 (ja) 1996-02-27 1996-02-27 リードフレームの製法および発光素子の製法

Related Child Applications (1)

Application Number Title Priority Date Filing Date
JP2003414222A Division JP3967314B2 (ja) 2003-12-12 2003-12-12 発光素子

Publications (2)

Publication Number Publication Date
JPH09232637A true JPH09232637A (ja) 1997-09-05
JP3571450B2 JP3571450B2 (ja) 2004-09-29

Family

ID=12559278

Family Applications (1)

Application Number Title Priority Date Filing Date
JP03966196A Expired - Fee Related JP3571450B2 (ja) 1996-02-27 1996-02-27 リードフレームの製法および発光素子の製法

Country Status (1)

Country Link
JP (1) JP3571450B2 (ja)

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1928033A3 (en) * 2006-11-30 2010-09-01 Nichia Corporation Light-emitting apparatus and method of producing the same
JP2011233928A (ja) * 2006-07-13 2011-11-17 Cree Inc 固体発光デバイス用のリードフレームベースのパッケージ、および固体発光デバイス用のリードフレームベースのパッケージを形成する方法
CN102655201A (zh) * 2012-05-15 2012-09-05 湖北匡通电子股份有限公司 一种带反射腔的smd型led支架
US8941134B2 (en) 2006-07-13 2015-01-27 Cree, Inc. Leadframe-based packages for solid state light emitting devices having heat dissipating regions in packaging
JP2019511128A (ja) * 2016-05-17 2019-04-18 オスラム オプト セミコンダクターズ ゲゼルシャフト ミット ベシュレンクテル ハフツングOsram Opto Semiconductors GmbH 電気デバイスを備えるアセンブリ

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011233928A (ja) * 2006-07-13 2011-11-17 Cree Inc 固体発光デバイス用のリードフレームベースのパッケージ、および固体発光デバイス用のリードフレームベースのパッケージを形成する方法
US8941134B2 (en) 2006-07-13 2015-01-27 Cree, Inc. Leadframe-based packages for solid state light emitting devices having heat dissipating regions in packaging
EP1928033A3 (en) * 2006-11-30 2010-09-01 Nichia Corporation Light-emitting apparatus and method of producing the same
CN102655201A (zh) * 2012-05-15 2012-09-05 湖北匡通电子股份有限公司 一种带反射腔的smd型led支架
JP2019511128A (ja) * 2016-05-17 2019-04-18 オスラム オプト セミコンダクターズ ゲゼルシャフト ミット ベシュレンクテル ハフツングOsram Opto Semiconductors GmbH 電気デバイスを備えるアセンブリ
US10637206B2 (en) * 2016-05-17 2020-04-28 Osram Oled Gmbh Assembly comprising an electric component
US11177628B2 (en) * 2016-05-17 2021-11-16 Osram Oled Gmbh Assembly comprising an electric component

Also Published As

Publication number Publication date
JP3571450B2 (ja) 2004-09-29

Similar Documents

Publication Publication Date Title
US8097937B2 (en) Leadframe and housing for radiation-emitting component, radiation-emitting component, and a method for producing the component
US8394675B2 (en) Manufacturing light emitting diode (LED) packages
EP1970968B1 (en) Light emitting semiconductor device
JP2005294736A (ja) 半導体発光装置の製造方法
CN101997075A (zh) 发光装置以及发光装置的制造方法
JPH10242526A (ja) 表面実装型発光ダイオード及びその製造方法
JP4952126B2 (ja) 発光ダイオードパッケージ用プリモールド部品の製造方法
JP4242194B2 (ja) 半導体発光装置およびその製造方法
JP3356068B2 (ja) 光電変換素子の製造方法
JP2003179292A (ja) 半導体レーザ装置およびその製造方法
KR20050039588A (ko) 고체 촬상 장치
JP3571450B2 (ja) リードフレームの製法および発光素子の製法
JP3967314B2 (ja) 発光素子
JP2001035985A (ja) 樹脂封止半導体装置
JP4389263B2 (ja) 半導体発光装置の製法
JP2002076234A (ja) 樹脂封止型半導体装置
JPH098360A (ja) 発光ダイオード
JP2859057B2 (ja) リードフレーム
KR101509228B1 (ko) 내부 리드에 비해 얇은 외부 리드를 갖는 측면 발광 다이오드 패키지 및 그것을 제조하는 방법
US20240072222A1 (en) Method for producing an optoelectronic component, and optoelectronic component
JP2913578B2 (ja) 樹脂封止形半導体発光装置
US20060220196A1 (en) Semiconductor device and method of manufacturing the same, metal component and method of manufacturing the same
JP2632767B2 (ja) 積層型リードフレームおよびその製造方法
JPS6028140Y2 (ja) 光結合器
JP2527503B2 (ja) リ―ドフレ―ムおよびその製造方法

Legal Events

Date Code Title Description
TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20040608

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20040624

R150 Certificate of patent (=grant) or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20100702

Year of fee payment: 6

FPAY Renewal fee payment (prs date is renewal date of database)

Free format text: PAYMENT UNTIL: 20110702

Year of fee payment: 7

LAPS Cancellation because of no payment of annual fees