JPH09180377A - Ｅｆｍ信号送出装置 - Google Patents
Ｅｆｍ信号送出装置Info
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- JPH09180377A JPH09180377A JP34974595A JP34974595A JPH09180377A JP H09180377 A JPH09180377 A JP H09180377A JP 34974595 A JP34974595 A JP 34974595A JP 34974595 A JP34974595 A JP 34974595A JP H09180377 A JPH09180377 A JP H09180377A
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- efm signal
- efm
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Abstract
(57)【要約】
【課題】 ＥＦＭ信号の出力が高速で且つ正確に行われ
るようにした、ＥＦＭ信号送出装置及び送出方法を提供
すること。 【解決手段】 ＥＦＭ信号の基準クロックとなるパルス
列を出力する発振手段１１と、発振手段からのパルス列
のタイミングで、メインデータを出力するデータ再生装
置１２と、サブコード生成情報に基づいて演算して、サ
ブコードを生成する演算手段１３と、データ再生装置か
らのメインデータと演算手段により生成されたサブコー
ドとから、ＥＦＭ信号を生成する信号生成手段１４と、
前以て演算手段により生成されたサブコードを記憶し、
上記発振手段からのパルス列のタイミングで、対応する
サブコードを信号生成手段に出力する記憶手段１５を備
えるように、ＥＦＭ信号送出装置１０を構成する。
るようにした、ＥＦＭ信号送出装置及び送出方法を提供
すること。 【解決手段】 ＥＦＭ信号の基準クロックとなるパルス
列を出力する発振手段１１と、発振手段からのパルス列
のタイミングで、メインデータを出力するデータ再生装
置１２と、サブコード生成情報に基づいて演算して、サ
ブコードを生成する演算手段１３と、データ再生装置か
らのメインデータと演算手段により生成されたサブコー
ドとから、ＥＦＭ信号を生成する信号生成手段１４と、
前以て演算手段により生成されたサブコードを記憶し、
上記発振手段からのパルス列のタイミングで、対応する
サブコードを信号生成手段に出力する記憶手段１５を備
えるように、ＥＦＭ信号送出装置１０を構成する。
Description
【０００１】
【発明の属する技術分野】本発明は、ＣＤ（コンパクト
ディスク）システムの原盤作製の際に使用される所謂Ｅ
ＦＭ（Ｅｉｇｈｔ ｔｏ Ｆｏｕｒｔｅｅｎ Ｍｏｄｕ
ｌａｔｉｏｎ）信号送出装置及び送出方法に関するもの
である。
ディスク）システムの原盤作製の際に使用される所謂Ｅ
ＦＭ（Ｅｉｇｈｔ ｔｏ Ｆｏｕｒｔｅｅｎ Ｍｏｄｕ
ｌａｔｉｏｎ）信号送出装置及び送出方法に関するもの
である。
【０００２】
【従来の技術】一般に、ＣＤシステムにおいては、所望
の情報を正確に記録するために、誤り訂正及び変調が行
なわれている。誤り訂正は、８ビットのデータを１シン
ボルとして、１フレームが３２個のシンボルから成る信
号に関して、処理を行ない、パリティを付加している。
そして、変調は、所謂ＥＦＭ（Ｅｉｇｈｔ ｔｏ Ｆｏ
ｕｒｔｅｅｎ Ｍｏｄｕｌａｔｉｏｎ）方式が採用され
ており、ＥＦＭ信号送出装置によって、これにより誤り
訂正により得られた各シンボルの８ビットのデータを、
１４ビットのデータに変換するようになっている。これ
により、各シンボルが１４ビット化された１フレームの
信号が、メインデータとして、送出されるようになって
いる。このようにして得られた各シンボルが１４ビット
化されたメインデータは、さらに、曲の頭出しやプログ
ラム再生等の機能を実現するために、１フレームにつき
一つのサブコードと呼ばれる８ビットから成る１シンボ
ルのデータが同様に１４ビット化されて付加される。
の情報を正確に記録するために、誤り訂正及び変調が行
なわれている。誤り訂正は、８ビットのデータを１シン
ボルとして、１フレームが３２個のシンボルから成る信
号に関して、処理を行ない、パリティを付加している。
そして、変調は、所謂ＥＦＭ（Ｅｉｇｈｔ ｔｏ Ｆｏ
ｕｒｔｅｅｎ Ｍｏｄｕｌａｔｉｏｎ）方式が採用され
ており、ＥＦＭ信号送出装置によって、これにより誤り
訂正により得られた各シンボルの８ビットのデータを、
１４ビットのデータに変換するようになっている。これ
により、各シンボルが１４ビット化された１フレームの
信号が、メインデータとして、送出されるようになって
いる。このようにして得られた各シンボルが１４ビット
化されたメインデータは、さらに、曲の頭出しやプログ
ラム再生等の機能を実現するために、１フレームにつき
一つのサブコードと呼ばれる８ビットから成る１シンボ
ルのデータが同様に１４ビット化されて付加される。
【０００３】ここで、従来のＥＦＭ信号送出装置によれ
ば、例えばＣＰＵ（中央演算ユニット）を有する演算回
路によってサブコード生成が行なわれると同時に、メイ
ンデータ及びサブコードの１４ビット化作業とが行なわ
れるようになっている。
ば、例えばＣＰＵ（中央演算ユニット）を有する演算回
路によってサブコード生成が行なわれると同時に、メイ
ンデータ及びサブコードの１４ビット化作業とが行なわ
れるようになっている。
【０００４】
【発明が解決しようとする課題】しかしながら、このよ
うなＥＦＭ信号送出装置においては、サブコード生成と
１４ビット化が同時に行なわれることから、ＥＦＭ信号
の送出速度は、ＣＰＵがサブコードを生成（演算）する
最大速度によって制限されることになる。また、ＥＦＭ
信号の出力と同時に、ＣＰＵによるサブコードの演算が
行なわれることから、このＣＰＵの動作クロック等がノ
イズとなって、ＥＦＭ信号に混入することがあり、ＣＤ
変調に悪影響を与えることになってしまうという問題が
あった。
うなＥＦＭ信号送出装置においては、サブコード生成と
１４ビット化が同時に行なわれることから、ＥＦＭ信号
の送出速度は、ＣＰＵがサブコードを生成（演算）する
最大速度によって制限されることになる。また、ＥＦＭ
信号の出力と同時に、ＣＰＵによるサブコードの演算が
行なわれることから、このＣＰＵの動作クロック等がノ
イズとなって、ＥＦＭ信号に混入することがあり、ＣＤ
変調に悪影響を与えることになってしまうという問題が
あった。
【０００５】本発明は、以上の点に鑑み、ＥＦＭ信号の
出力が高速で且つ正確に行われるようにした、ＥＦＭ信
号送出装置及び送出方法を提供することを目的としてい
る。
出力が高速で且つ正確に行われるようにした、ＥＦＭ信
号送出装置及び送出方法を提供することを目的としてい
る。
【０００６】
【課題を解決するための手段】上記目的は、本発明によ
れば、ＥＦＭ信号の基準クロックとなるパルス列を出力
する発振手段と、発振手段からのパルス列のタイミング
で、メインデータを出力するデータ再生装置と、サブコ
ード生成情報に基づいて演算して、サブコードを生成す
る演算手段と、データ再生装置からのメインデータと演
算手段により生成されたサブコードとから、ＥＦＭ信号
を生成する信号生成手段と、前以て演算手段により生成
されたサブコードを記憶し、上記発振手段からのパルス
列のタイミングで、対応するサブコードを信号生成手段
に出力する記憶手段を備えている、ＥＦＭ信号送出装置
により、達成される。
れば、ＥＦＭ信号の基準クロックとなるパルス列を出力
する発振手段と、発振手段からのパルス列のタイミング
で、メインデータを出力するデータ再生装置と、サブコ
ード生成情報に基づいて演算して、サブコードを生成す
る演算手段と、データ再生装置からのメインデータと演
算手段により生成されたサブコードとから、ＥＦＭ信号
を生成する信号生成手段と、前以て演算手段により生成
されたサブコードを記憶し、上記発振手段からのパルス
列のタイミングで、対応するサブコードを信号生成手段
に出力する記憶手段を備えている、ＥＦＭ信号送出装置
により、達成される。
【０００７】また、上記目的は、本発明によれば、前以
てサブコード生成情報に基づいて演算手段により演算し
て、サブコードを生成する段階と、生成されたサブコー
ドを記憶手段に記憶する段階と、メインデータを再生す
る段階と、記録手段から読み出したサブコード及び再生
されたメインデータとから、ＥＦＭ信号を生成する段階
とを備えている、ＥＦＭ信号送出方法により達成され
る。
てサブコード生成情報に基づいて演算手段により演算し
て、サブコードを生成する段階と、生成されたサブコー
ドを記憶手段に記憶する段階と、メインデータを再生す
る段階と、記録手段から読み出したサブコード及び再生
されたメインデータとから、ＥＦＭ信号を生成する段階
とを備えている、ＥＦＭ信号送出方法により達成され
る。
【０００８】上記構成によれば、サブコードが前以て演
算手段により演算されることにより生成され、記憶手段
に記憶されているので、ＥＦＭ信号生成の際には、信号
生成手段により、データ再生装置からのメインデータと
記憶手段から読み出されたサブコードから、ＥＦＭ信号
が生成されることになる。この場合、ＥＦＭ信号生成の
際には、前以て演算手段により演算され、記憶手段に記
憶されたサブコードを読み出すようにしているので、演
算手段はサブコードの演算を行なっていない。
算手段により演算されることにより生成され、記憶手段
に記憶されているので、ＥＦＭ信号生成の際には、信号
生成手段により、データ再生装置からのメインデータと
記憶手段から読み出されたサブコードから、ＥＦＭ信号
が生成されることになる。この場合、ＥＦＭ信号生成の
際には、前以て演算手段により演算され、記憶手段に記
憶されたサブコードを読み出すようにしているので、演
算手段はサブコードの演算を行なっていない。
【０００９】
【発明の実施の形態】以下、この発明の好適な実施形態
を図１乃至図２を参照しながら、詳細に説明する。尚、
以下に述べる実施形態は、本発明の好適な具体例である
から、技術的に好ましい種々の限定が付されているが、
本発明の範囲は、以下の説明において特に本発明を限定
する旨の記載がない限り、これらの態様に限られるもの
ではない。
を図１乃至図２を参照しながら、詳細に説明する。尚、
以下に述べる実施形態は、本発明の好適な具体例である
から、技術的に好ましい種々の限定が付されているが、
本発明の範囲は、以下の説明において特に本発明を限定
する旨の記載がない限り、これらの態様に限られるもの
ではない。
【００１０】図１は、本発明によるＥＦＭ信号送出装置
の一実施形態の構成を示している。図１において、ＥＦ
Ｍ信号送出装置１０は、発振器１１，データ再生装置１
２，サブコードを生成する演算手段としてのＣＰＵ１
３，ＥＦＭ信号を生成する信号生成手段としてＥＦＭ生
成回路１４，サブコードを記憶する記憶手段としてのデ
ュアルポートメモリ１５及びデュアルポートメモリ１５
のメモリ格納位置を示すメモリポインタ１６とから構成
されている。
の一実施形態の構成を示している。図１において、ＥＦ
Ｍ信号送出装置１０は、発振器１１，データ再生装置１
２，サブコードを生成する演算手段としてのＣＰＵ１
３，ＥＦＭ信号を生成する信号生成手段としてＥＦＭ生
成回路１４，サブコードを記憶する記憶手段としてのデ
ュアルポートメモリ１５及びデュアルポートメモリ１５
のメモリ格納位置を示すメモリポインタ１６とから構成
されている。
【００１１】発振器１１は、ＥＦＭ信号生成時の基準ク
ロックとしてのパルス列を出力するものであり、その出
力パルス列は、ＥＦＭ生成回路１４及びメモリポインタ
１６に出力されるようになっている。
ロックとしてのパルス列を出力するものであり、その出
力パルス列は、ＥＦＭ生成回路１４及びメモリポインタ
１６に出力されるようになっている。
【００１２】データ再生装置１２は、発振器１１からの
パルス列が入力されることにより、図示しない記憶媒体
から情報信号を読み出して、このパルス列のタイミング
で、メインデータをＥＦＭ生成回路１４に出力するよう
になっている。
パルス列が入力されることにより、図示しない記憶媒体
から情報信号を読み出して、このパルス列のタイミング
で、メインデータをＥＦＭ生成回路１４に出力するよう
になっている。
【００１３】ＣＰＵ１３は、サブコード生成情報に基づ
いて演算を行なうことにより、サブコードを生成して、
デュアルポートメモリ１５に出力するようになってい
る。
いて演算を行なうことにより、サブコードを生成して、
デュアルポートメモリ１５に出力するようになってい
る。
【００１４】ＥＦＭ生成回路１４は、データ再生装置１
２からのメインデータと、デュアルポートメモリ１５か
らのサブコードとから、発振器１１からのパルス列に基
づいて、これらを合成し、変調（１４ビット化）して、
ＥＦＭ信号を出力するようになっている。
２からのメインデータと、デュアルポートメモリ１５か
らのサブコードとから、発振器１１からのパルス列に基
づいて、これらを合成し、変調（１４ビット化）して、
ＥＦＭ信号を出力するようになっている。
【００１５】デュアルポートメモリ１５は、二つのポー
トを備えており、一つのポートは前記ＣＰＵ１３に接続
されると共に、他方のポートはＥＦＭ生成回路１４及び
メモリポインタ１６に接続されている。これにより、Ｃ
ＰＵ１３からのサブコードを記憶し、メモリポインタ１
６が指定する位置に記憶されたサブコードをＥＦＭ生成
回路１４に出力するようになっている。
トを備えており、一つのポートは前記ＣＰＵ１３に接続
されると共に、他方のポートはＥＦＭ生成回路１４及び
メモリポインタ１６に接続されている。これにより、Ｃ
ＰＵ１３からのサブコードを記憶し、メモリポインタ１
６が指定する位置に記憶されたサブコードをＥＦＭ生成
回路１４に出力するようになっている。
【００１６】メモリポインタ１６は、発振器１１からの
パルス列に基づいて、パルス列による基準クロック毎
に、次のサブコードが記憶されたメモリ格納位置を指定
するようになっている。
パルス列に基づいて、パルス列による基準クロック毎
に、次のサブコードが記憶されたメモリ格納位置を指定
するようになっている。
【００１７】本実施形態によるＥＦＭ信号送出装置１０
は、以上のように構成されており、図２に示したフロー
チャートに従って、以下のように動作する。即ち、図２
において、ステップＳＴ１にて、ＣＰＵ１３が動作開始
する。そしてステップＳＴ２にて、ＣＰＵ１３は、図示
しない手段により受け取ったサブコード生成情報に基づ
いて、演算を行ない、サブコードを生成し、デュアルポ
ートメモリ１５に出力する。ここで、サブコード生成情
報は、サブコードの生成に必要なすべての情報が含まれ
ており、生成されたサブコードは、ステップＳＴ３に
て、デュアルポートメモリ１５に記憶される。そして、
サブコード生成が終了すると、ステップＳＴ４にて、Ｃ
ＰＵ１３は、その動作を停止する。
は、以上のように構成されており、図２に示したフロー
チャートに従って、以下のように動作する。即ち、図２
において、ステップＳＴ１にて、ＣＰＵ１３が動作開始
する。そしてステップＳＴ２にて、ＣＰＵ１３は、図示
しない手段により受け取ったサブコード生成情報に基づ
いて、演算を行ない、サブコードを生成し、デュアルポ
ートメモリ１５に出力する。ここで、サブコード生成情
報は、サブコードの生成に必要なすべての情報が含まれ
ており、生成されたサブコードは、ステップＳＴ３に
て、デュアルポートメモリ１５に記憶される。そして、
サブコード生成が終了すると、ステップＳＴ４にて、Ｃ
ＰＵ１３は、その動作を停止する。
【００１８】次に、ＥＦＭ信号の生成が行なわれるが、
先づステップＳＴ５にて、メモリポインタ１６は、デュ
アルポートメモリ１５に記憶された最初のサブコードの
先頭位置または次のサブコードの先頭位置を示すように
セットされる。そして、ステップＳＴ６にて、発振器１
１からのパルス列による基準クロック毎に、データ再生
装置１２がメインデータをＥＦＭ生成回路１４に出力す
ると共に、デュアルポートメモリ１５が、メモリポイン
タ１６により指定された格納位置に記憶されたサブコー
ドをＥＦＭ生成回路１４に出力する。
先づステップＳＴ５にて、メモリポインタ１６は、デュ
アルポートメモリ１５に記憶された最初のサブコードの
先頭位置または次のサブコードの先頭位置を示すように
セットされる。そして、ステップＳＴ６にて、発振器１
１からのパルス列による基準クロック毎に、データ再生
装置１２がメインデータをＥＦＭ生成回路１４に出力す
ると共に、デュアルポートメモリ１５が、メモリポイン
タ１６により指定された格納位置に記憶されたサブコー
ドをＥＦＭ生成回路１４に出力する。
【００１９】これにより、ステップＳＴ７にて、ＥＦＭ
生成回路１４は、入力されたメインデータ及びサブコー
ドを合成し、ＥＦＭ変調（１４ビット化）を行なって、
ステップＳＴ８にて、生成されたＥＦＭ信号を出力す
る。
生成回路１４は、入力されたメインデータ及びサブコー
ドを合成し、ＥＦＭ変調（１４ビット化）を行なって、
ステップＳＴ８にて、生成されたＥＦＭ信号を出力す
る。
【００２０】このようにして、基準クロック毎に、メモ
リポインタ１６が次のサブコードの先頭位置を示すよう
にセットされ、ＥＦＭ生成回路１４により、メインデー
タ及びサブコードの合成・変調が行なわれて、ＥＦＭ信
号が出力されることになる。最後に、メインデータがな
くなったときには、ステップＳＴ９にて、データ終了の
判定が行なわれて、ＥＦＭ信号生成が終了する。
リポインタ１６が次のサブコードの先頭位置を示すよう
にセットされ、ＥＦＭ生成回路１４により、メインデー
タ及びサブコードの合成・変調が行なわれて、ＥＦＭ信
号が出力されることになる。最後に、メインデータがな
くなったときには、ステップＳＴ９にて、データ終了の
判定が行なわれて、ＥＦＭ信号生成が終了する。
【００２１】このように、以上の実施形態によれば、Ｅ
ＦＭ信号生成の際には、信号生成手段により、データ再
生装置からのメインデータと記憶手段から読み出された
サブコードから、ＥＦＭ信号が生成されることになる。
従って、ＥＦＭ信号生成の際には、演算手段はサブコー
ドの演算を行なっていないので、ＥＦＭ信号生成が、サ
ブコードの演算を行なう演算手段の最大能力によって制
限されるようなことはなく、高速で行われることになる
と共に、演算手段の動作クロック等が不要であることか
ら、これらがノイズとなって、ＥＦＭ信号に混入するよ
うなこともなく、ＣＤ変調による正確なＥＦＭ信号が得
られることになる。
ＦＭ信号生成の際には、信号生成手段により、データ再
生装置からのメインデータと記憶手段から読み出された
サブコードから、ＥＦＭ信号が生成されることになる。
従って、ＥＦＭ信号生成の際には、演算手段はサブコー
ドの演算を行なっていないので、ＥＦＭ信号生成が、サ
ブコードの演算を行なう演算手段の最大能力によって制
限されるようなことはなく、高速で行われることになる
と共に、演算手段の動作クロック等が不要であることか
ら、これらがノイズとなって、ＥＦＭ信号に混入するよ
うなこともなく、ＣＤ変調による正確なＥＦＭ信号が得
られることになる。
【００２２】尚、上述した実施形態においては、ＣＤの
ＥＦＭ変調におけるＥＦＭ信号の生成に関して説明した
が、これに限らずメインデータとサブコードを合成・変
調するような任意の変調方式に本発明を適用することが
可能である。
ＥＦＭ変調におけるＥＦＭ信号の生成に関して説明した
が、これに限らずメインデータとサブコードを合成・変
調するような任意の変調方式に本発明を適用することが
可能である。
【００２３】
【発明の効果】以上述べたように、本発明によれば、Ｅ
ＦＭ信号の出力が高速で且つ正確に行われるようにし
た、ＥＦＭ信号送出装置と送出方法が提供されることに
なる。
ＦＭ信号の出力が高速で且つ正確に行われるようにし
た、ＥＦＭ信号送出装置と送出方法が提供されることに
なる。
【図面の簡単な説明】
【図１】本発明を適用したＥＦＭ信号送出装置の一実施
形態を示すブロック図である。
形態を示すブロック図である。
【図２】図１のＥＦＭ信号送出装置における動作を示す
フローチャートである。
フローチャートである。
１０ ＥＦＭ信号送出装置 １１ 発振器（発振手段） １２ データ再生装置 １３ ＣＰＵ（演算手段） １４ ＥＦＭ生成回路（信号生成手段） １５ デュアルポートメモリ（記憶手段） １６ メモリポインタ
Claims (2)
- 【請求項１】 ＥＦＭ信号の基準クロックとなるパルス
列を出力する発振手段と、 発振手段からのパルス列のタイミングで、メインデータ
を出力するデータ再生装置と、 サブコード生成情報に基づいて演算して、サブコードを
生成する演算手段と、 データ再生装置からのメインデータと演算手段により生
成されたサブコードとから、ＥＦＭ信号を生成する信号
生成手段と、 前以て演算手段により生成されたサブコードを記憶し、
上記発振手段からのパルス列のタイミングで、対応する
サブコードを信号生成手段に出力する記憶手段を備えて
いることを特徴とするＥＦＭ信号送出装置。 - 【請求項２】 前以てサブコード生成情報に基づいて演
算手段により演算して、サブコードを生成する段階と、 生成されたサブコードを記憶手段に記憶する段階と、 メインデータを再生する段階と、 記録手段から読み出したサブコード及び再生されたメイ
ンデータとから、ＥＦＭ信号を生成する段階とを備えて
いることを特徴とするＥＦＭ信号送出方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34974595A JP3634912B2 (ja) | 1995-12-21 | 1995-12-21 | Ｅｆｍ信号送出装置およびｅｆｍ信号送出方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP34974595A JP3634912B2 (ja) | 1995-12-21 | 1995-12-21 | Ｅｆｍ信号送出装置およびｅｆｍ信号送出方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09180377A true JPH09180377A (ja) | 1997-07-11 |
| JP3634912B2 JP3634912B2 (ja) | 2005-03-30 |
Family
ID=18405820
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP34974595A Expired - Fee Related JP3634912B2 (ja) | 1995-12-21 | 1995-12-21 | Ｅｆｍ信号送出装置およびｅｆｍ信号送出方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3634912B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100674930B1 (ko) * | 2004-12-31 | 2007-01-26 | 삼성전자주식회사 | 접선 푸시-풀 신호를 이용하여 ｅｆｍ 신호를 발생하는장치 및 방법 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6404584B2 (en) | 1997-10-01 | 2002-06-11 | Brad A. Armstrong | Analog controls housed with electronic displays for voice recorders |
-
1995
- 1995-12-21 JP JP34974595A patent/JP3634912B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100674930B1 (ko) * | 2004-12-31 | 2007-01-26 | 삼성전자주식회사 | 접선 푸시-풀 신호를 이용하여 ｅｆｍ 신호를 발생하는장치 및 방법 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3634912B2 (ja) | 2005-03-30 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040830 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040907 |
|
| A521 | Written amendment |
Effective date: 20041108 Free format text: JAPANESE INTERMEDIATE CODE: A523 |
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