JPH08507908A - バス上の隣接デバイス間のインタフェースに設けられたアイソレーション・バリヤを通してnrzデータ信号を伝送する方法及び装置 - Google Patents
バス上の隣接デバイス間のインタフェースに設けられたアイソレーション・バリヤを通してnrzデータ信号を伝送する方法及び装置Info
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Abstract
Description
Claims (1)
- 【特許請求の範囲】 1.バスを介して相互接続された2つの装置の間のインタフェースを通してNR Zデータ信号を伝送する方法において、 クロック信号に応答して信号微分器により上記データ信号を微分して微分信号 を得るステップと、 上記データ信号を第1の入力としてトライステート・ゲートよりなるドライバ に供給するステップと、 上記微分信号を第2の入力としてトライステート・ゲートに供給して、上記微 分信号がハイのとき上記トライステート・ゲートをイネーブル化するステップと 、 上記トライステート・ゲートの出力にバイアス電圧を印加して、上記インタフ ェースを通して伝送される送信信号を上記トライステート・ゲートからの出力と して得るステップと、 上記送信信号を上記2つの装置の間の上記インタフェースを通して伝送するス テップと、 上記送信信号を、、 (1)上記電子部品の入力が実質的に上記電圧バイアスより高い値に達したとき のハイのデータ信号と、 (2)上記電子部品の入力が実質的に上記電圧バイアスより低い値に達したとき のローのデータ信号と、 からなる再構成データ信号を出力として有する電子部品に入力として供給するス テップと、 を具備した方法。 2.バスを介して相互接続された第1の装置と第2の装置の間に配置されたアイ ソレーション・バリヤからなるインタフェースを通してNRZデータ信号を伝送 する方法において、 クロック信号に応答して信号微分器により上記データ信号を微分して微分信号 を得るステップと、 上記データ信号を第1の入力としてトライステート・ゲートよりなるドライバ に供給するステップと、 上記微分信号を第2の入力としてトライステート・ゲートに供給して、上記微 分信号がハイのとき上記トライステート・ゲートをイネーブル化するステップと 、 上記トライステート・ゲートの出力にバイアス電圧を印加して、 (1)上記トライステート・ゲートがディスエーブル化されているときの上記電 圧バイアスに相当する中間の送信信号と、 (2)上記トライステート・ゲートがイネーブル化され、上記トライステート・ ゲートの第1の入力がハイのときにおけるハイの送信信号と、 (3)上記トライステート・ゲートがイネーブル化され、上記トライステート・ ゲートの第1の入力がローのときにおけるローの送信信号と、 とからなる送信信号を上記トライステート・ゲートからの出力として得るステッ プと、 上記トライステート・ゲートの出力から得られる上記送信信号を上記第1の装 置から上記アイソレーション・バリヤを通して上記第2の装置に伝送するステッ プと、 上記送信信号をシュミット・トリガ回路に供給して、上記データ信号に相当す る再構成データ信号を上記シュミット・トリガ回路の出力として得るステップと 、を具備した方法。 3.バスを介して相互接続された第1の装置と第2の装置の間に配置されたアイ ソレーション・バリヤからなるインタフェースを通してNRZデータ信号を伝送 する方法において、 上記データ信号をクロック信号に同期させて同期データ信号を得るステップと 、 上記クロック信号に応答して上記同期データ信号をフリップフロップに供給し て、1クロック周期だけ遅延した遅延同期データ信号を出力するステップと、 上記同期データ信号を排他的ORゲートに第1の入力として供給するステップ と、 上記遅延同期データ信号を上記排他的ORゲートに第2の入力として供給して 微分信号を出力するするステップと、 上記同期データ信号をトライステート・ゲートからなるドライバに第1の入力 として供給するステップと、 上記微分信号をトライステート・ゲートに第2の入力として供給して、上記微 分信号がハイのとき上記トライステート・ゲートをイネーブル化するステップと 、 上記トライステート・ゲートの出力にバイアス電圧を印加して、 (1)上記トライステート・ゲートがディスエーブル化されているときの上記電 圧バイアスに相当する中間の送信信号と、 (2)上記トライステート・ゲートがイネーブル化され、上記トライステート・ ゲートの第1の入力がハイのときにおけるハイの送信信号と、 (3)上記トライステート・ゲートがイネーブル化され、上記トライステート・ ゲートの第1の入力がローのときにおけるローの送信信号と、 からなる第1の送信信号を上記トライステート・ゲートからの出力として得るス テップと、 上記トライステート・ゲートの出力から得られる第1の送信信号を上記第1の 装置から上記アイソレーション・バリヤへ送信して、上記第1の送信信号と電気 的に分離された第2の送信信号を上記アイソレーション・バリヤの出力として発 生させるステップと、 上記第2の送信信号を2つのスレッショルドを有するシュミット・トリガ回路 へ伝送して、上記同期データ信号に相当する再構成データ信号を上記シュミット ・トリガ回路の出力として得るステップで、上記トライステート・ゲートの出力 に印加されたバイアス電圧が、上記シュミット・トリガ回路の上記2つのスレッ ショルド間の電圧差の中心の値になる上記第1及び第2の送信信号のDCレベル を設定するステップと、 を具備した方法。 4.上記第1の送信信号を上記アイソレーション・バリヤへ送信するステップが 、さらに、上記アイソレーション・バリヤによる上記第1の送信信号の受信より 前に第1のブロックコンデンサと第1の抵抗器を通して上記第1の送信信号を伝 送するステップを具備し、かつ、上記第2の送信信号をシュミット・トリガ回路 へ伝送するステップが、さらに、上記シュミット・トリガ回路による上記第2の 送信信号の受信より前に第2のブロックコンデンサと第2の抵抗器を通して上記 第 2の送信信号を伝送するステップを具備したことを特徴とする請求項3記載の方 法。 5.バスを介して相互接続された2つの装置の間のインタフェースを通してNR Zデータ信号を伝送するための装置において、 クロック信号に応答して上記データ信号を受け取り、微分信号を出力するため の信号微分器と、 第1の入力として上記データ信号を有するトライステート・ゲートからなるド ライバで、上記トライステート・ゲートが、さらに、上記微分信号を第2の入力 として有し、上記微分信号がハイのときとき上記トライステート・ゲートをイネ ーブル化するドライバと、 バスを介し、上記2つの装置の間のインタフェースを通して伝送される送信信 号を上記トライステート・ゲートの出力として得るために、上記トライステート ・ゲートの出力に印加するバイアス電圧と、 送信信号を受け取って、 (1)上記電子部品の入力が実質的に上記電圧バイアスより高い値に達したとき のハイのデータ信号と、 (2)上記電子部品の入力が実質的に上記電圧バイアスより低い値に達したとき のローのデータ信号と、 からなる再構成データ信号を出力する電子部品と を具備した装置。 6.バスを介して相互接続された第1の装置と第2の装置の間に配置されたアイ ソレーション・バリヤからなるインタフェースを通してNRZデータ信号を伝送 するための装置において、 クロック信号に応答して上記データ信号を受け取り、同期データ信号を出力す る第1のフリップフロップと、 上記クロック信号に応答して上記同期データ信号を受け取り、1クロック周期 だけ遅延した遅延同期データ信号を出力する第2のフリップフロップと、 上記遅延同期データ信号及び上記同期データ信号を入力として受け取り、微分 信号を出力する排他的ORゲートと、 上記同期データ信号を第1の入力として受け取り、上記微分信号を第2の入力 として受け取り、上記微分信号がハイのときイネーブル化されるトライステート ・ゲートと、 (1)上記トライステート・ゲートがディスエーブル化されているときの上記 電圧バイアスに相当する中間の送信信号と、 (2)上記トライステート・ゲートがイネーブル化され、上記トライステート ・ゲートの第1の入力がハイのときにおけるハイの送信信号と、 (3)上記トライステート・ゲートがイネーブル化され、上記トライステート ・ゲートの第1の入力がローのときにおけるローの送信信号と、からなる第1の 送信信号を出力するために上記トライステート・ゲートの出力に加えるバイアス 電圧と、 上記第1の装置と上記アイソレーション・バリヤとの間のバス中に配置された 第1のブロックコンデンサと、 上記第1のブロックコンデンサとアイソレーション・バリヤとの間のバス中に 配置された第1の抵抗器と、 上記第1の送信信号を受け取って、上記第1の送信信号と電気的に分離された 第2の送信信号を出力する上記アイソレーション・バリヤと、 上記アイソレーション・バリヤと上記第2の装置の間のバス中に配置された第 2の抵抗器と、 上記第2の抵抗器と上記第2の装置の間のバス中に配置された第2のブロック コンデンサと、 上記第2の送信信号を入力として受け取り、上記同期データ信号に相当する再 構成データ信号を出力するシュミット・トリガ回路と、 を具備した装置。
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