JPH083720B2 - 適応予測形ａｄｐｃｍ符復号回路 - Google Patents
適応予測形ａｄｐｃｍ符復号回路Info
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- JPH083720B2 JPH083720B2 JP62037631A JP3763187A JPH083720B2 JP H083720 B2 JPH083720 B2 JP H083720B2 JP 62037631 A JP62037631 A JP 62037631A JP 3763187 A JP3763187 A JP 3763187A JP H083720 B2 JPH083720 B2 JP H083720B2
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- circuit
- adpcm
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、音声処理伝送に用いられる適応予測形ADPC
M方式に関し、特に、アルゴリズムの異なる多種の適応
予測形ADPCMの符号回路と対向可能にする選択回路を有
する適応予測形ADPCM符復号回路に関する。
M方式に関し、特に、アルゴリズムの異なる多種の適応
予測形ADPCMの符号回路と対向可能にする選択回路を有
する適応予測形ADPCM符復号回路に関する。
同一入力PCM信号をアルゴリズムの異なる二つの適応
予測形ADPCMの符号回路にてそれぞれADPCM信号に符号化
し、そのいずれか一つを選択して出力ADPCM信号とする
符号化回路を含む適応予測形ADPCM符復号回路におい
て、 入力ADPCM信号と、この入力ADPCM信号を復号化した後
再び同じアルゴリズムで復号化して得られるADPCM信号
とを比較し、その差分の小さい方の復号回路および符号
回路を選択することにより、 自動的に対向局と同じアルゴリズムの復号回路および
符号回路を選択できるようにしたものである。
予測形ADPCMの符号回路にてそれぞれADPCM信号に符号化
し、そのいずれか一つを選択して出力ADPCM信号とする
符号化回路を含む適応予測形ADPCM符復号回路におい
て、 入力ADPCM信号と、この入力ADPCM信号を復号化した後
再び同じアルゴリズムで復号化して得られるADPCM信号
とを比較し、その差分の小さい方の復号回路および符号
回路を選択することにより、 自動的に対向局と同じアルゴリズムの復号回路および
符号回路を選択できるようにしたものである。
第３図は、従来の選択回路を有する適応予測形ADPCM
復号回路の一例を示すブロック構成図である。受信入力
端子31より入力したADPCM信号33はアルゴリズムの異な
る適応予測形ADPCMの復号回路41および42に入力され、
復号化されて出力信号34および35として選択回路43に出
力される。選択回路43には信号検出回路44の出力が接続
され、選択回路43の出力PCM信号36の性質を信号検出回
路44にて検出した結果により出力される選択信号37に適
応したアルゴリズムの復号回路41または42の出力信号34
または35を選択し、出力PCM信号36として受信出力端子3
2へ出力される。
復号回路の一例を示すブロック構成図である。受信入力
端子31より入力したADPCM信号33はアルゴリズムの異な
る適応予測形ADPCMの復号回路41および42に入力され、
復号化されて出力信号34および35として選択回路43に出
力される。選択回路43には信号検出回路44の出力が接続
され、選択回路43の出力PCM信号36の性質を信号検出回
路44にて検出した結果により出力される選択信号37に適
応したアルゴリズムの復号回路41または42の出力信号34
または35を選択し、出力PCM信号36として受信出力端子3
2へ出力される。
第４図は従来の選択回路を有する適応予測形ADPCM符
復号回路の一例を示すブロック構成図である。この従来
例の適応予測形ADPCM符復号回路は、第３図に示した適
応予測形ADPCM復号回路に、符号化回路を付加したもの
である。送信入力端子38に入力された入力PCM入力PCM信
号36aは、アルゴリズムの異なる適応予測形ADPCMの符号
回路45および46に入力され、符号化されてADPCM信号に
なり選択回路47に出力される。そして信号検出回路44か
らの選択信号37により、符号回路45と46のいずれか一方
が選択される。このとき、選択される符号回路45または
46と復号回路41または42とはそれぞれ同じアルゴリズム
となっている。そして、選択回路47の出力信号が出力AD
PCM信号33aとして送信出力端子39を経て対向局に送出さ
れる。
復号回路の一例を示すブロック構成図である。この従来
例の適応予測形ADPCM符復号回路は、第３図に示した適
応予測形ADPCM復号回路に、符号化回路を付加したもの
である。送信入力端子38に入力された入力PCM入力PCM信
号36aは、アルゴリズムの異なる適応予測形ADPCMの符号
回路45および46に入力され、符号化されてADPCM信号に
なり選択回路47に出力される。そして信号検出回路44か
らの選択信号37により、符号回路45と46のいずれか一方
が選択される。このとき、選択される符号回路45または
46と復号回路41または42とはそれぞれ同じアルゴリズム
となっている。そして、選択回路47の出力信号が出力AD
PCM信号33aとして送信出力端子39を経て対向局に送出さ
れる。
上述した従来の適応予測形ADPCM復号回路および符復
号回路は、復号化されたPCM信号の性質（例えば、音声
信号またはモデム信号など）を識別して復号回路および
符号回路を選択しているので、特定な信号の場合にしか
切り換えを行うことができない。このため、対向局の適
応予測形ADPCMの符号回路および復号回路のアルゴリズ
ムと同じアルゴリズムの復号回路および符号回路を選択
することができず、システム性能が制限される欠点があ
った。
号回路は、復号化されたPCM信号の性質（例えば、音声
信号またはモデム信号など）を識別して復号回路および
符号回路を選択しているので、特定な信号の場合にしか
切り換えを行うことができない。このため、対向局の適
応予測形ADPCMの符号回路および復号回路のアルゴリズ
ムと同じアルゴリズムの復号回路および符号回路を選択
することができず、システム性能が制限される欠点があ
った。
本発明は、上記の欠点を除去することにより、対向局
の符号回路および復号回路のアルゴリズムと同じアルゴ
リズムの復号回路および符号回路を選択できる、適応予
測形ADPCM符復号回路を提供することにある。
の符号回路および復号回路のアルゴリズムと同じアルゴ
リズムの復号回路および符号回路を選択できる、適応予
測形ADPCM符復号回路を提供することにある。
本発明の適応予測形ADPCM符復号回路は、同一入力ADP
CM信号をそれぞれ異なるアルゴリズムに従いPCM信号に
復号化する二つの適応予測形ADPCMの復号回路と、選択
信号により前記二つの復号回路の出力信号のいずれか一
つを選択して出力PCM信号として出力する第１の選択回
路と、前記選択信号を発生する選択信号発生手段と、同
一入力PCM信号をそれぞれ前記二つの復号回路と同じア
ルゴリズムに従いADPCM信号に符号化する第三および第
四の適応予測形ADPCMの符号回路と、前記選択信号によ
り前記第三または第四の符号回路の出力信号を選択して
出力ADPCM信号として出力する第二の選択回路とを含む
適応予測形ADPCM符復号回路において、前記選択信号発
生手段が、前記二つの復号回路の出力信号をそれぞれ前
記二つの復号回路と同じアルゴリズムに従いADPCM信号
に符号化する第一および第二の適応予測形ADPCMの符号
回路と、前記第一および第二の符号回路の出力信号と前
記入力ADPCM信号との差分をとりそれぞれ出力する二つ
の差分出力手段と、前記二つの差分出力手段からそれぞ
れ出力される差分を比較し小さい差分を示す前記復号回
路からの出力信号を出力PCM信号として選択する前記選
択信号を出力する比較回路とを含むことを特徴とする。
CM信号をそれぞれ異なるアルゴリズムに従いPCM信号に
復号化する二つの適応予測形ADPCMの復号回路と、選択
信号により前記二つの復号回路の出力信号のいずれか一
つを選択して出力PCM信号として出力する第１の選択回
路と、前記選択信号を発生する選択信号発生手段と、同
一入力PCM信号をそれぞれ前記二つの復号回路と同じア
ルゴリズムに従いADPCM信号に符号化する第三および第
四の適応予測形ADPCMの符号回路と、前記選択信号によ
り前記第三または第四の符号回路の出力信号を選択して
出力ADPCM信号として出力する第二の選択回路とを含む
適応予測形ADPCM符復号回路において、前記選択信号発
生手段が、前記二つの復号回路の出力信号をそれぞれ前
記二つの復号回路と同じアルゴリズムに従いADPCM信号
に符号化する第一および第二の適応予測形ADPCMの符号
回路と、前記第一および第二の符号回路の出力信号と前
記入力ADPCM信号との差分をとりそれぞれ出力する二つ
の差分出力手段と、前記二つの差分出力手段からそれぞ
れ出力される差分を比較し小さい差分を示す前記復号回
路からの出力信号を出力PCM信号として選択する前記選
択信号を出力する比較回路とを含むことを特徴とする。
入力ADPCM信号は二つの復号回路でその有するアルゴ
リズムに従ってPCM信号に復号化される。この復号化さ
れたPCM信号を前記復号回路と同じアルゴリズムを有す
る二つの符号回路でそれぞれADPCM信号に符号化する。
そして差分手段により、それぞれにこの再度符号化され
たADPCM信号と入力ADPCM信号との引算を行い差分を求め
る。いま、入力ADPCM信号か一方の復号回路と同じアル
ゴリズムによるものであるとすると、再度符号化された
ADPCM信号は入力ADPCM信号とほぼ等しいのとなりその差
分は小となる。一方、他方の復号回路のアルゴリズムは
これと異なるため、その差分は大となる。そこで比較回
路により前記差分を比較し、差分の小さい前記復号回路
を選択する選択信号を第一および第二の選択回路に出力
する。そしてこの選択信号により、第一の選択回路は示
された復号回路の出力信号を出力PCM信号として受信出
力端子へ送出し、第二の選択回路は指示された符号回路
の出力信号を出力ADPCM信号として送信出力端子を介し
て対向局へ送出する。
リズムに従ってPCM信号に復号化される。この復号化さ
れたPCM信号を前記復号回路と同じアルゴリズムを有す
る二つの符号回路でそれぞれADPCM信号に符号化する。
そして差分手段により、それぞれにこの再度符号化され
たADPCM信号と入力ADPCM信号との引算を行い差分を求め
る。いま、入力ADPCM信号か一方の復号回路と同じアル
ゴリズムによるものであるとすると、再度符号化された
ADPCM信号は入力ADPCM信号とほぼ等しいのとなりその差
分は小となる。一方、他方の復号回路のアルゴリズムは
これと異なるため、その差分は大となる。そこで比較回
路により前記差分を比較し、差分の小さい前記復号回路
を選択する選択信号を第一および第二の選択回路に出力
する。そしてこの選択信号により、第一の選択回路は示
された復号回路の出力信号を出力PCM信号として受信出
力端子へ送出し、第二の選択回路は指示された符号回路
の出力信号を出力ADPCM信号として送信出力端子を介し
て対向局へ送出する。
従って、自動的に、対向局の符号回路と同じアルゴリ
ズムの復号回路および対向局とアルゴリズムの適応予測
形ADPCM符復号回路を実現することができる。
ズムの復号回路および対向局とアルゴリズムの適応予測
形ADPCM符復号回路を実現することができる。
以下、本発明の実施例について図面を参照して説明す
る。
る。
第１図は本発明の符復号回路における適応予測形ADPC
M復号回路の一実施例を示すブロック構成図である。本
実施例の適応予測形ADPCM復号回路は、入力が受信入力
端子１にそれぞれ接続され、入力されるADPCM信号３を
それぞれ復号化し出力信号４および５を出力するアルゴ
リズムの異なる適応予測形ADPCMの復号回路11および12
と、復号回路11および12からの出力信号４および５をそ
れぞれ復号回路11および12と同じアルゴリズムで符号化
する適応予測形ADPCMの符号回路15および16と、受信入
力端子１に入力される入力ADPCM信号３をそれぞれ遅延
させる遅延回路13および14と、それぞれ遅延回路13およ
び14で遅延されたADPCM信号と符号回路15および16で符
号化されたADPCM信号との差分をとる引算回路18および1
9と、それぞれ引算回路18および19の出力信号の絶対値
をとる絶対値回路20および21と、それぞれ絶対値回路20
および21の出力信号を平滑化する平滑回路22および23
と、平滑回路22および23の出力信号を互いに比較する選
択信号７を出力する比較回路24と、この比較回路24から
の選択信号７により、復号回路11または12の出力信号４
または５を選択し、出力PCM信号６として受信出力端子
２へ出力する選択回路17とを含んでいる。
M復号回路の一実施例を示すブロック構成図である。本
実施例の適応予測形ADPCM復号回路は、入力が受信入力
端子１にそれぞれ接続され、入力されるADPCM信号３を
それぞれ復号化し出力信号４および５を出力するアルゴ
リズムの異なる適応予測形ADPCMの復号回路11および12
と、復号回路11および12からの出力信号４および５をそ
れぞれ復号回路11および12と同じアルゴリズムで符号化
する適応予測形ADPCMの符号回路15および16と、受信入
力端子１に入力される入力ADPCM信号３をそれぞれ遅延
させる遅延回路13および14と、それぞれ遅延回路13およ
び14で遅延されたADPCM信号と符号回路15および16で符
号化されたADPCM信号との差分をとる引算回路18および1
9と、それぞれ引算回路18および19の出力信号の絶対値
をとる絶対値回路20および21と、それぞれ絶対値回路20
および21の出力信号を平滑化する平滑回路22および23
と、平滑回路22および23の出力信号を互いに比較する選
択信号７を出力する比較回路24と、この比較回路24から
の選択信号７により、復号回路11または12の出力信号４
または５を選択し、出力PCM信号６として受信出力端子
２へ出力する選択回路17とを含んでいる。
本発明の適応予測形ADPCM復号回路での特徴は、第１
図において、遅延回路13および14と、符号回路15および
16と、引算回路18および19と、絶対値回路20および21
と、平滑回路22および23とかならる二つの差分手段と、
比較回路24とを含む選択信号発生手段28を設けたことに
ある。
図において、遅延回路13および14と、符号回路15および
16と、引算回路18および19と、絶対値回路20および21
と、平滑回路22および23とかならる二つの差分手段と、
比較回路24とを含む選択信号発生手段28を設けたことに
ある。
次に、本実施例の動作について説明する。受信入力端
子１より入力された入力ADPCM信号３は、アルゴリズム
の異なる復号回路11および12と遅延回路13および14とに
入力される。復号回路11および12の出力信号４および５
は、それぞれ復号回路11および12と同じアルゴリズムを
有する符号回路15および16と、選択回路17とに入力され
る。そしてそれぞれ、符号回路15および16の出力信号か
ら遅延回路13および14の出力信号を引算回路18および19
にて引算し差分をとり、絶対値回路20および21にて絶対
値をとり、平滑回路22および23にて平滑化して、比較回
路24に送出する。比較回路24にて平滑回路22および23の
出力信号を比較し、その比較結果により選択信号７を出
力し、選択回路17を制御する。この選択信号７により選
択回路は復号回路11の出力信号４または復号回路12の出
力信号５のいずれか一つを選択して出力PCM信号として
受信出力端子２へ送出する。
子１より入力された入力ADPCM信号３は、アルゴリズム
の異なる復号回路11および12と遅延回路13および14とに
入力される。復号回路11および12の出力信号４および５
は、それぞれ復号回路11および12と同じアルゴリズムを
有する符号回路15および16と、選択回路17とに入力され
る。そしてそれぞれ、符号回路15および16の出力信号か
ら遅延回路13および14の出力信号を引算回路18および19
にて引算し差分をとり、絶対値回路20および21にて絶対
値をとり、平滑回路22および23にて平滑化して、比較回
路24に送出する。比較回路24にて平滑回路22および23の
出力信号を比較し、その比較結果により選択信号７を出
力し、選択回路17を制御する。この選択信号７により選
択回路は復号回路11の出力信号４または復号回路12の出
力信号５のいずれか一つを選択して出力PCM信号として
受信出力端子２へ送出する。
いま、受信入力端子１より復号回路11または12と同じ
アルゴリズムで符号化された入力ADPCM信号３が入力し
たとする。ここで入力ADPCM信号３は、復号回路11と同
じアルゴリズムで符号化されたものとする。
アルゴリズムで符号化された入力ADPCM信号３が入力し
たとする。ここで入力ADPCM信号３は、復号回路11と同
じアルゴリズムで符号化されたものとする。
そのときには、復号回路11によりもとのPCM信号が再
生される。一方、復号回路12ではアルゴリズムが異なる
ため、もとのPCM信号は再生されない。それゆえ、復号
回路11の出力信号４を再び符号回路15にて符号化する
と、入力端子１より入力した入力ADPCM信号３と同じ符
号のADPCM信号が得られるが、復号回路12の出力信号５
を符号回路16にて符号化しても、入力ADPCM信号３と同
じ符号のADPCM信号は得られない。そこでそれぞれ、符
号回路15および16の出力信号より、入力ADPCM信号３を
復号回路11、12および符号回路15、16による遅延分だけ
遅延回路13および14にて遅延させたADPCM信号を引算
し、それぞれ絶対値回路20および21にて絶対値を取り、
平滑回路22および23にて平滑化すると、平滑回路22の出
力は平滑回路23の出力より小さくなる。その結果を比較
回路24にて比較して、比較回路24は選択信号７として復
号回路11の出力信号４を選択するよう指示する。選択回
路17は選択信号７に基づき復号回路11の出力信号４を選
択する。かくして、受信入力端子１より入力した入力AD
PCM符号をもとのPCM符号に復号化した出力PCM信号６
を、受信出力端子２より出力することができる。
生される。一方、復号回路12ではアルゴリズムが異なる
ため、もとのPCM信号は再生されない。それゆえ、復号
回路11の出力信号４を再び符号回路15にて符号化する
と、入力端子１より入力した入力ADPCM信号３と同じ符
号のADPCM信号が得られるが、復号回路12の出力信号５
を符号回路16にて符号化しても、入力ADPCM信号３と同
じ符号のADPCM信号は得られない。そこでそれぞれ、符
号回路15および16の出力信号より、入力ADPCM信号３を
復号回路11、12および符号回路15、16による遅延分だけ
遅延回路13および14にて遅延させたADPCM信号を引算
し、それぞれ絶対値回路20および21にて絶対値を取り、
平滑回路22および23にて平滑化すると、平滑回路22の出
力は平滑回路23の出力より小さくなる。その結果を比較
回路24にて比較して、比較回路24は選択信号７として復
号回路11の出力信号４を選択するよう指示する。選択回
路17は選択信号７に基づき復号回路11の出力信号４を選
択する。かくして、受信入力端子１より入力した入力AD
PCM符号をもとのPCM符号に復号化した出力PCM信号６
を、受信出力端子２より出力することができる。
次に、復号回路12と同じアルゴリズムで符号化された
入力ADPCM信号３が入力した場合には、同様に復号回路1
2の出力信号５が選択され、もとのPCM符号に復号化され
た出力PCM信号６が受信出力端子２より出力される。
入力ADPCM信号３が入力した場合には、同様に復号回路1
2の出力信号５が選択され、もとのPCM符号に復号化され
た出力PCM信号６が受信出力端子２より出力される。
第２図は、本発明の適応予測形ADPCM符復号回路の一
実施例を示すブロック構成図である。
実施例を示すブロック構成図である。
本実施例は、第１図に示した本発明の適応予測形ADPC
M復号回路の一実施例の回路に対し、入力が送信入力端
子８に共通接続され、入力されたPCM信号をADPCM符号に
符号化する、それぞれ復号回路11および12と同じアルゴ
リズムを有する適応予測形ADPCMの符号回路25および26
と、符号回路25および26からの出力信号を入力し、比較
回路24からの選択信号７によりそのいずれか一方を選択
して、出力ADPCM信号3aとして送信出力端子９へ送出す
る選択回路27とを付加したものである。
M復号回路の一実施例の回路に対し、入力が送信入力端
子８に共通接続され、入力されたPCM信号をADPCM符号に
符号化する、それぞれ復号回路11および12と同じアルゴ
リズムを有する適応予測形ADPCMの符号回路25および26
と、符号回路25および26からの出力信号を入力し、比較
回路24からの選択信号７によりそのいずれか一方を選択
して、出力ADPCM信号3aとして送信出力端子９へ送出す
る選択回路27とを付加したものである。
すなわち、本発明の特徴は、選択回路27の選択信号と
して選択信号７を用いたことにある。
して選択信号７を用いたことにある。
次に、本実施例の動作について説明する。送信入力端
子８から入力された入力PCM信号6aは、符号回路25およ
び26でそれぞれのアルゴリズムに従ってADPCM信号に符
号化され、選択回路27に入力される。選択回路27は比較
回路24からの選択信号７により、もしも選択信号７が復
号回路11と同じアルゴリズムを指示している場合には、
符号回路25からの出力信号を選択し、出力ADPCM信号3a
として送信出力端子９より送出する。これにより、送受
とも対向局のアルゴリズムと同じアルゴリズムになり、
対向可能となる。
子８から入力された入力PCM信号6aは、符号回路25およ
び26でそれぞれのアルゴリズムに従ってADPCM信号に符
号化され、選択回路27に入力される。選択回路27は比較
回路24からの選択信号７により、もしも選択信号７が復
号回路11と同じアルゴリズムを指示している場合には、
符号回路25からの出力信号を選択し、出力ADPCM信号3a
として送信出力端子９より送出する。これにより、送受
とも対向局のアルゴリズムと同じアルゴリズムになり、
対向可能となる。
逆に、対向局のアルゴリズムが復号回路12および符号
回路26と同じアルゴリズムであれば、選択回路17および
27は、それぞれ復号回路12および符号回路26を選択し
て、対向局と対向可能となる。
回路26と同じアルゴリズムであれば、選択回路17および
27は、それぞれ復号回路12および符号回路26を選択し
て、対向局と対向可能となる。
上述の説明アルゴリズムの数は２としたが、同一の原
理を３以上のアルゴリズムについても同様に実施するこ
とができる。
理を３以上のアルゴリズムについても同様に実施するこ
とができる。
以上説明したように、本発明によれば、選択回路の選
択信号として、入力ADPCM信号と、この入力ADPCM信号を
復号化した後再び符号化して得られるADPCM信号とを比
較し、その差分の小さい方の復号回路を選択する信号を
用いることにより、自動的に対向局の符号回路と同じア
ルゴリズムの符号回路を選択でき、かつ自動的に対向局
と同じアルゴリズムの適応予測形ADPCM符復号回路を得
ることができ、その効果は大である。
択信号として、入力ADPCM信号と、この入力ADPCM信号を
復号化した後再び符号化して得られるADPCM信号とを比
較し、その差分の小さい方の復号回路を選択する信号を
用いることにより、自動的に対向局の符号回路と同じア
ルゴリズムの符号回路を選択でき、かつ自動的に対向局
と同じアルゴリズムの適応予測形ADPCM符復号回路を得
ることができ、その効果は大である。
第１図は本発明の適応予測形ADPCM復号回路の一実施例
を示すブロック構成図。 第２図は本発明の適応予測形ADPCM符復号回路の一実施
例を示すブロック構成図。 第３図は従来の適応予測形ADPCM復号回路の一例を示す
ブロック構成図。 第４図は従来の適応予測形ADPCM符復号回路の一例を示
すブロック構成図。 １、31、……受信入力端子、２、32、……受信出力端
子、３、33……入力ADPCM信号、3a、33a……出力ADPCM
信号、４、５、34、35……出力信号、６、36……出力PC
M信号、6a、36a……入力PCM信号、７、37……選択信
号、８、38……送信入力端子、９、39……送信出力端
子、11、12、41、42……復号回路、13、14……遅延回
路、15、16、25、26、45、46……符号回路、17、27、4
3、47……選択回路、18、19……引算回路、20、21……
絶対値回路、22、23……平滑回路、24……比較回路、44
……信号検出回路。
を示すブロック構成図。 第２図は本発明の適応予測形ADPCM符復号回路の一実施
例を示すブロック構成図。 第３図は従来の適応予測形ADPCM復号回路の一例を示す
ブロック構成図。 第４図は従来の適応予測形ADPCM符復号回路の一例を示
すブロック構成図。 １、31、……受信入力端子、２、32、……受信出力端
子、３、33……入力ADPCM信号、3a、33a……出力ADPCM
信号、４、５、34、35……出力信号、６、36……出力PC
M信号、6a、36a……入力PCM信号、７、37……選択信
号、８、38……送信入力端子、９、39……送信出力端
子、11、12、41、42……復号回路、13、14……遅延回
路、15、16、25、26、45、46……符号回路、17、27、4
3、47……選択回路、18、19……引算回路、20、21……
絶対値回路、22、23……平滑回路、24……比較回路、44
……信号検出回路。
Claims (1)
- 【請求項１】同一の入力ADPCM信号をそれぞれ異なるア
ルゴリズムに従いPCM信号に復号化する二つの適応予測
形ADPCMの復号回路（11、12）と、 選択信号により前記二つの復号回路の出力信号はいずれ
か一つを選択して出力PCM信号として出力する第一の選
択回路（17）と、 前記選択制御信号を発生する選択信号発生手段（28）
と、 同一入力PCM信号をそれぞれ前記二つの復号回路と同じ
アルゴリズムに従いADPCM信号に符号化する第三および
第四の適応予測形ADPCMの符号回路（25、26）と、 前記選択信号により前記第三または第四の符号回路の出
力信号を選択して出力ADPCM信号として出力する第二の
選択回路（27）と を含む適応予測形ADPCM符復号回路において、 前記選択信号発生手段が 前記二つの復号回路の出力信号をそれぞれ前記二つの復
号回路と同じアルゴリズムに従ってADPCM信号に符号化
する第一および第二適応予測形ADPCMの符号回路（15、1
6）と、 前記第一および第二の符号回路の出力信号と前記入力AD
PCM信号との差分をとりそれぞれ出力する二つの差分出
力手段（18〜23）と、 前記二つの差分出力手段からそれぞれ出力される差分を
比較し小さい差分を示す前記復号回路からの出力信号を
出力PCM信号として選択する選択信号を出力する比較回
路（24）と を含むことを特徴とする適応予測形ADPCM符復号回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62037631A JPH083720B2 (ja) | 1987-02-20 | 1987-02-20 | 適応予測形ａｄｐｃｍ符復号回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62037631A JPH083720B2 (ja) | 1987-02-20 | 1987-02-20 | 適応予測形ａｄｐｃｍ符復号回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63205700A JPS63205700A (ja) | 1988-08-25 |
| JPH083720B2 true JPH083720B2 (ja) | 1996-01-17 |
Family
ID=12502988
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62037631A Expired - Lifetime JPH083720B2 (ja) | 1987-02-20 | 1987-02-20 | 適応予測形ａｄｐｃｍ符復号回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH083720B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6535737B1 (en) * | 1999-04-14 | 2003-03-18 | Telefonaktiebolaget Lm Ericsson (Publ) | Signalling link capacity in a cellular communications system |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS623535A (ja) * | 1985-06-28 | 1987-01-09 | Fujitsu Ltd | 符号化伝送装置 |
-
1987
- 1987-02-20 JP JP62037631A patent/JPH083720B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63205700A (ja) | 1988-08-25 |
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