JPH08115200A - 画像処理システム - Google Patents
画像処理システムInfo
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- JPH08115200A JPH08115200A JP6253296A JP25329694A JPH08115200A JP H08115200 A JPH08115200 A JP H08115200A JP 6253296 A JP6253296 A JP 6253296A JP 25329694 A JP25329694 A JP 25329694A JP H08115200 A JPH08115200 A JP H08115200A
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- area
- data
- image
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- Digital Computer Display Output (AREA)
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Abstract
(57)【要約】
【目的】 ディジタル画像について種々の画像処理を行
う画像処理システムに関し、フレームメモリを有効に用
いることができる画像処理システムを提供する。 【構成】 ＤＲＡＭにより構成され、１フレームのディ
ジタル画像データを記憶するための画像データエリア
（２）とそれ以外の空きエリア（３，４）を含むフレー
ムメモリ（１）と、外部から供給される画像データを受
け付ける画像データ入力手段（７）と、画像データを画
像処理し処理データを生成する画像処理手段（８，９）
と、画像データ入力手段が受け付ける画像データをフレ
ームメモリの画像データエリアに書き込み、画像処理手
段により生成される処理データをフレームメモリの空き
エリアに書き込むためのメモリコントローラ（６，１
０）とを有する。
う画像処理システムに関し、フレームメモリを有効に用
いることができる画像処理システムを提供する。 【構成】 ＤＲＡＭにより構成され、１フレームのディ
ジタル画像データを記憶するための画像データエリア
（２）とそれ以外の空きエリア（３，４）を含むフレー
ムメモリ（１）と、外部から供給される画像データを受
け付ける画像データ入力手段（７）と、画像データを画
像処理し処理データを生成する画像処理手段（８，９）
と、画像データ入力手段が受け付ける画像データをフレ
ームメモリの画像データエリアに書き込み、画像処理手
段により生成される処理データをフレームメモリの空き
エリアに書き込むためのメモリコントローラ（６，１
０）とを有する。
Description
【０００１】
【産業上の利用分野】本発明は、ディジタル画像につい
て種々の画像処理を行う画像処理システムに関する。
て種々の画像処理を行う画像処理システムに関する。
【０００２】
【従来の技術】図４は、従来技術による画像処理システ
ムの構成を示すブロック図である。画像処理システム
は、例えば、入力された画像データに対して、データ圧
縮を行い、圧縮された符号データを出力することができ
る。
ムの構成を示すブロック図である。画像処理システム
は、例えば、入力された画像データに対して、データ圧
縮を行い、圧縮された符号データを出力することができ
る。
【０００３】画像データは、画像処理装置５５に入力さ
れる。画像処理装置５５は、入力された画像データを一
旦フレームメモリ５１内の画像データエリア５２に記憶
させる。
れる。画像処理装置５５は、入力された画像データを一
旦フレームメモリ５１内の画像データエリア５２に記憶
させる。
【０００４】フレームメモリ５１は、１フレームのディ
ジタル画像データを記憶するための記憶媒体である。１
フレームの画像データの大きさは、種々の規格により異
なるが、代表的なＮＴＳＣ ＣＣＩＲ規格では、７２０
×４８０ピクセルである。したがって、フレームメモリ
５１は、画像データの大きさに合わせて、７２０×４８
０×ｎ（ｎは１画素のビット数）のメモリを用いればよ
いが、汎用的なメモリにおいては製造上またはコスト上
の理由から２のべき乗の大きさに限定されてしまう。以
上説明の便宜上、１画素１ビットとして説明する。な
お、ｎビット／１画素の場合はｎ個のメモリの同一アド
レスに１画素分のｎビットデータを収容する等の形態と
すればよい。
ジタル画像データを記憶するための記憶媒体である。１
フレームの画像データの大きさは、種々の規格により異
なるが、代表的なＮＴＳＣ ＣＣＩＲ規格では、７２０
×４８０ピクセルである。したがって、フレームメモリ
５１は、画像データの大きさに合わせて、７２０×４８
０×ｎ（ｎは１画素のビット数）のメモリを用いればよ
いが、汎用的なメモリにおいては製造上またはコスト上
の理由から２のべき乗の大きさに限定されてしまう。以
上説明の便宜上、１画素１ビットとして説明する。な
お、ｎビット／１画素の場合はｎ個のメモリの同一アド
レスに１画素分のｎビットデータを収容する等の形態と
すればよい。
【０００５】そこで、７２０×４８０ピクセルの画像デ
ータを記憶させるためには１０２４×５１２のメモリが
用いられる。また、フレームメモリ５１は、大容量の画
像データを記憶するため、またはコスト上の理由からＤ
ＲＡＭが用いられている。
ータを記憶させるためには１０２４×５１２のメモリが
用いられる。また、フレームメモリ５１は、大容量の画
像データを記憶するため、またはコスト上の理由からＤ
ＲＡＭが用いられている。
【０００６】画像処理装置５５には、ビデオ信号の画像
データが入力されることが多いため、リアルタイムでフ
レームメモリ５１に画像データを書き込む必要がある。
ビデオ信号のリアルタイムでフレームメモリ５１に高速
で画像データを書き込む際には、ＤＲＡＭの高速ページ
モードが用いられる。
データが入力されることが多いため、リアルタイムでフ
レームメモリ５１に画像データを書き込む必要がある。
ビデオ信号のリアルタイムでフレームメモリ５１に高速
で画像データを書き込む際には、ＤＲＡＭの高速ページ
モードが用いられる。
【０００７】ＤＲＡＭは、通常ロウアドレスとカラムア
ドレスをそれぞれ設定した後にデータの書き込みまたは
読み出しを行う。それに対して、高速ページモードは、
ロウアドレスを一定のままにして、カラムアドレスのみ
を指定することにより、高速なアクセスを可能とするも
のである。
ドレスをそれぞれ設定した後にデータの書き込みまたは
読み出しを行う。それに対して、高速ページモードは、
ロウアドレスを一定のままにして、カラムアドレスのみ
を指定することにより、高速なアクセスを可能とするも
のである。
【０００８】ロウアドレスを切り換える際には、高速ペ
ージモードを使用することができず、高速性が失われる
ので、ビデオ信号中の水平同期信号（Ｈシンク）を含む
ブランキング期間にロウアドレスを切り換えている。つ
まり、高速ページモードで１水平走査期間（１Ｈ）の画
像データを書き込み、その後のブランキング期間にロウ
アドレスを切り換えて、次の１Ｈの画像データの書き込
みに備える。ブランキング期間は、画像データを含まな
い期間であり、ロウアドレスを切り換えるのには十分な
時間を有する。
ージモードを使用することができず、高速性が失われる
ので、ビデオ信号中の水平同期信号（Ｈシンク）を含む
ブランキング期間にロウアドレスを切り換えている。つ
まり、高速ページモードで１水平走査期間（１Ｈ）の画
像データを書き込み、その後のブランキング期間にロウ
アドレスを切り換えて、次の１Ｈの画像データの書き込
みに備える。ブランキング期間は、画像データを含まな
い期間であり、ロウアドレスを切り換えるのには十分な
時間を有する。
【０００９】以上の理由により、１フレームの画像デー
タは、１Ｈ毎にロウアドレスを切り換えて、７２０×４
８０の画像データエリア５２に書き込まれる。画像デー
タが画像データエリア５２に書き込まれると、フレーム
メモリ５１には空きエリア５３が生ずる。空きエリア５
３は、データ記憶に用いられない領域である。
タは、１Ｈ毎にロウアドレスを切り換えて、７２０×４
８０の画像データエリア５２に書き込まれる。画像デー
タが画像データエリア５２に書き込まれると、フレーム
メモリ５１には空きエリア５３が生ずる。空きエリア５
３は、データ記憶に用いられない領域である。
【００１０】画像処理装置５５は、画像データエリア５
２から画像データを読み出して、例えば符号化処理を行
い、符号データを生成する。符号データは、入力された
画像データの圧縮データとして、外部に出力される。
２から画像データを読み出して、例えば符号化処理を行
い、符号データを生成する。符号データは、入力された
画像データの圧縮データとして、外部に出力される。
【００１１】ワークメモリ５６は、画像処理装置５５が
符号化処理等を行う際に用いられる。ワークメモリ５６
には、符号化処理の際に生成される中間データ等が一時
記憶され、符号化処理等が終了した後は通常用いられな
い。
符号化処理等を行う際に用いられる。ワークメモリ５６
には、符号化処理の際に生成される中間データ等が一時
記憶され、符号化処理等が終了した後は通常用いられな
い。
【００１２】
【発明が解決しようとする課題】ビデオ信号のリアルタ
イム処理でフレームメモリ５１に画像データを書き込む
際には、画像データエリア５２が用いられる。フレーム
メモリ１内の空きエリア５３は、データ記憶に用いられ
ないので、資源の無駄である。
イム処理でフレームメモリ５１に画像データを書き込む
際には、画像データエリア５２が用いられる。フレーム
メモリ１内の空きエリア５３は、データ記憶に用いられ
ないので、資源の無駄である。
【００１３】本発明の目的は、フレームメモリを有効に
用いることができる画像処理システムを提供することで
ある。
用いることができる画像処理システムを提供することで
ある。
【００１４】
【課題を解決するための手段】本発明の画像処理システ
ムは、ＤＲＡＭにより構成され、１フレームのディジタ
ル画像データを記憶するための画像データエリアとそれ
以外の空きエリアを含むフレームメモリと、外部から供
給される画像データを受け付ける画像データ入力手段
と、画像データを画像処理し処理データを生成する画像
処理手段と、画像データ入力手段が受け付ける画像デー
タをフレームメモリの画像データエリアに書き込み、画
像処理手段により生成される処理データをフレームメモ
リの空きエリアに書き込むためのメモリコントローラと
を有する。
ムは、ＤＲＡＭにより構成され、１フレームのディジタ
ル画像データを記憶するための画像データエリアとそれ
以外の空きエリアを含むフレームメモリと、外部から供
給される画像データを受け付ける画像データ入力手段
と、画像データを画像処理し処理データを生成する画像
処理手段と、画像データ入力手段が受け付ける画像デー
タをフレームメモリの画像データエリアに書き込み、画
像処理手段により生成される処理データをフレームメモ
リの空きエリアに書き込むためのメモリコントローラと
を有する。
【００１５】
【作用】フレームメモリ中の画像データエリアには、１
フレーム分の画像データが記憶され、フレームメモリ中
の空きエリアには、画像処理手段により生成される処理
データが記憶される。
フレーム分の画像データが記憶され、フレームメモリ中
の空きエリアには、画像処理手段により生成される処理
データが記憶される。
【００１６】
【実施例】図１は、本発明の実施例による画像処理シス
テムの構成を示すブロック図である。画像処理装置５
は、画像データＤ１が入力されると、データ圧縮を行
い、符号データＤ３を出力する。
テムの構成を示すブロック図である。画像処理装置５
は、画像データＤ１が入力されると、データ圧縮を行
い、符号データＤ３を出力する。
【００１７】図２は、画像データの圧縮を行うための処
理の流れを示すフローチャートである。まず、画像デー
タＤ１が入力されると、ステップＳ１において、離散コ
サイン変換（ＤＣＴ）の処理を行い、ＤＣＴ係数Ｄ２を
生成する。
理の流れを示すフローチャートである。まず、画像デー
タＤ１が入力されると、ステップＳ１において、離散コ
サイン変換（ＤＣＴ）の処理を行い、ＤＣＴ係数Ｄ２を
生成する。
【００１８】ステップＳ２では、ＤＣＴ係数Ｄ２に対し
て符号化処理を行い、符号データＤ３を生成する。符号
化処理は、例えば量子化処理やハフマン符号化処理を含
む。生成された符号データは、圧縮データとして外部に
出力される。
て符号化処理を行い、符号データＤ３を生成する。符号
化処理は、例えば量子化処理やハフマン符号化処理を含
む。生成された符号データは、圧縮データとして外部に
出力される。
【００１９】以上の画像データ圧縮処理は、画像のブロ
ックデータ毎に行われる。ブロックデータは、７２０×
４８０の画像データをブロック分割したデータであり、
例えば８×８のデータである。
ックデータ毎に行われる。ブロックデータは、７２０×
４８０の画像データをブロック分割したデータであり、
例えば８×８のデータである。
【００２０】図１において、画像処理装置５は、画像デ
ータ入出力ブロック７とＤＣＴ処理ブロック８と符号化
処理ブロック９を有する。画像入出力ブロック７は、外
部から入力されるビデオ信号等の画像データＤ１をフレ
ームメモリ１に供給したり、フレームメモリ１内の画像
データを外部に出力することができる。
ータ入出力ブロック７とＤＣＴ処理ブロック８と符号化
処理ブロック９を有する。画像入出力ブロック７は、外
部から入力されるビデオ信号等の画像データＤ１をフレ
ームメモリ１に供給したり、フレームメモリ１内の画像
データを外部に出力することができる。
【００２１】ＤＣＴ処理ブロック８は、画像データの入
力により、ＤＣＴ処理を行い、ＤＣＴ係数を出力するブ
ロックである。符号化処理ブロック９は、ＤＣＴ係数の
入力により、量子化またはハフマン符号化等の符号化処
理を行い、符号データを出力するブロックである。
力により、ＤＣＴ処理を行い、ＤＣＴ係数を出力するブ
ロックである。符号化処理ブロック９は、ＤＣＴ係数の
入力により、量子化またはハフマン符号化等の符号化処
理を行い、符号データを出力するブロックである。
【００２２】メインコントローラ１０は、画像データ入
出力ブロック７、ＤＣＴ処理ブロック８および符号化処
理ブロック９に制御信号ＣＴＬを供給し、各ブロックが
行う処理を制御する。
出力ブロック７、ＤＣＴ処理ブロック８および符号化処
理ブロック９に制御信号ＣＴＬを供給し、各ブロックが
行う処理を制御する。
【００２３】フレームメモリ１は、画像データエリア２
の他に、ＤＣＴ係数エリア３および符号データエリア４
を有する。画像データエリア２は、画像データ入出力ブ
ロック７から供給される画像データを記憶するための領
域である。ＤＣＴ係数エリア３は、ＤＣＴ処理ブロック
８にて生成されるＤＣＴ係数を記憶するための領域であ
る。符号データエリア４は、符号化処理ブロック９にて
生成される符号データを記憶するための領域である。
の他に、ＤＣＴ係数エリア３および符号データエリア４
を有する。画像データエリア２は、画像データ入出力ブ
ロック７から供給される画像データを記憶するための領
域である。ＤＣＴ係数エリア３は、ＤＣＴ処理ブロック
８にて生成されるＤＣＴ係数を記憶するための領域であ
る。符号データエリア４は、符号化処理ブロック９にて
生成される符号データを記憶するための領域である。
【００２４】フレームメモリコントローラ６は、画像デ
ータ入出力ブロック７、ＤＣＴ処理ブロック８、符号化
処理ブロック９からそれぞれ供給される画像データ、Ｄ
ＣＴ係数、符号データをフレームメモリ１内の所定のエ
リアに書き込む。メインコントローラ１０は、フレーム
メモリコントローラ６にエリア設定信号ＥＲＡを供給
し、フレームメモリ１内の領域を指定する。
ータ入出力ブロック７、ＤＣＴ処理ブロック８、符号化
処理ブロック９からそれぞれ供給される画像データ、Ｄ
ＣＴ係数、符号データをフレームメモリ１内の所定のエ
リアに書き込む。メインコントローラ１０は、フレーム
メモリコントローラ６にエリア設定信号ＥＲＡを供給
し、フレームメモリ１内の領域を指定する。
【００２５】フレームメモリ１は、例えば１０２４（カ
ラム）×５１２（ロウ）のＤＲＡＭである。画像データ
エリア２は、１フレームのディジタル画像データを記憶
するための領域であり、７２０（カラム）×４８０（ロ
ウ）である。
ラム）×５１２（ロウ）のＤＲＡＭである。画像データ
エリア２は、１フレームのディジタル画像データを記憶
するための領域であり、７２０（カラム）×４８０（ロ
ウ）である。
【００２６】フレームメモリコントローラ６は、エリア
設定信号ＥＲＡ１が供給されると、カラムアドレス０〜
７１９、ロウアドレス０〜４７９の範囲内のアドレスを
指定し、画像データエリア２にデータの書き込みまたは
読み出しを行う。
設定信号ＥＲＡ１が供給されると、カラムアドレス０〜
７１９、ロウアドレス０〜４７９の範囲内のアドレスを
指定し、画像データエリア２にデータの書き込みまたは
読み出しを行う。
【００２７】エリア設定ＥＲＡ２が供給されると、カラ
ムアドレス０〜１０２３、ロウアドレス４８０〜５１１
の範囲内のアドレスを指定し、ＤＣＴ係数エリア３にデ
ータの書き込みまたは読み出しを行う。
ムアドレス０〜１０２３、ロウアドレス４８０〜５１１
の範囲内のアドレスを指定し、ＤＣＴ係数エリア３にデ
ータの書き込みまたは読み出しを行う。
【００２８】エリア設定信号ＥＲＡ３が供給されると、
カラムアドレス７２０〜１０２３、ロウアドレス０〜４
７９の範囲内のアドレスを指定し、符号データエリア４
にデータの書き込みまたは読み出しを行う。
カラムアドレス７２０〜１０２３、ロウアドレス０〜４
７９の範囲内のアドレスを指定し、符号データエリア４
にデータの書き込みまたは読み出しを行う。
【００２９】図３（Ａ）〜（Ｆ）は、本実施例による画
像処理システムの処理手順を示す概略図である。まず、
図３（Ａ）では、外部から画像データＤ１が画像データ
入出力ブロック７に入力される。画像データ入出力ブロ
ック７は、入力された画像データをフレームメモリコン
トローラ６に供給する。フレームメモリコントローラ６
は、エリア設定信号ＥＲＡ１を受けて、フレームメモリ
１内の画像データエリア２を選択し、画像データを書き
込む。
像処理システムの処理手順を示す概略図である。まず、
図３（Ａ）では、外部から画像データＤ１が画像データ
入出力ブロック７に入力される。画像データ入出力ブロ
ック７は、入力された画像データをフレームメモリコン
トローラ６に供給する。フレームメモリコントローラ６
は、エリア設定信号ＥＲＡ１を受けて、フレームメモリ
１内の画像データエリア２を選択し、画像データを書き
込む。
【００３０】次に、図３（Ｂ）では、エリア設定信号Ｅ
ＲＡ１がフレームメモリコントローラ６に供給される。
フレームメモリコントローラ６は、画像データエリア２
を選択して、画像データを読み出し、ＤＣＴ処理ブロッ
ク８に出力する。ＤＣＴ処理ブロック８は、入力された
画像データを基にＤＣＴ処理を行い、ＤＣＴ係数を生成
する。
ＲＡ１がフレームメモリコントローラ６に供給される。
フレームメモリコントローラ６は、画像データエリア２
を選択して、画像データを読み出し、ＤＣＴ処理ブロッ
ク８に出力する。ＤＣＴ処理ブロック８は、入力された
画像データを基にＤＣＴ処理を行い、ＤＣＴ係数を生成
する。
【００３１】図３（Ｃ）において、ＤＣＴ処理ブロック
８は、生成したＤＣＴ係数をフレームメモリコントロー
ラ６に供給する。フレームメモリコントローラ６は、エ
リア設定信号ＥＲＡ２を受けて、ＤＣＴ係数エリア３を
選択し、ＤＣＴ係数を書き込む。
８は、生成したＤＣＴ係数をフレームメモリコントロー
ラ６に供給する。フレームメモリコントローラ６は、エ
リア設定信号ＥＲＡ２を受けて、ＤＣＴ係数エリア３を
選択し、ＤＣＴ係数を書き込む。
【００３２】図３（Ｄ）では、エリア設定信号ＥＲＡ２
がフレームメモリコントローラ６に供給される。フレー
ムメモリコントローラ６は、ＤＣＴ係数エリア３を選択
して、ＤＣＴ係数を読み出し、符号化処理ブロック９に
出力する。符号化処理ブロック９は、入力されたＤＣＴ
係数を基に量子化、ハフマン符号化等の符号化処理を行
い、符号データを生成する。
がフレームメモリコントローラ６に供給される。フレー
ムメモリコントローラ６は、ＤＣＴ係数エリア３を選択
して、ＤＣＴ係数を読み出し、符号化処理ブロック９に
出力する。符号化処理ブロック９は、入力されたＤＣＴ
係数を基に量子化、ハフマン符号化等の符号化処理を行
い、符号データを生成する。
【００３３】図３（Ｅ）において、符号化処理ブロック
９は、生成した符号データをフレームメモリコントロー
ラ６に供給する。フレームメモリコントローラ６は、エ
リア設定信号ＥＲＡ３を受けて、符号データエリア４を
選択し、符号データを書き込む。
９は、生成した符号データをフレームメモリコントロー
ラ６に供給する。フレームメモリコントローラ６は、エ
リア設定信号ＥＲＡ３を受けて、符号データエリア４を
選択し、符号データを書き込む。
【００３４】図３（Ｆ）では、エリア設定信号ＥＲＡ３
がフレームメモリコントローラ６に供給される。フレー
ムメモリコントローラ６は、符号データエリア４を選択
して、符号データを読み出し、符号化処理ブロック９に
出力する。符号化処理ブロック９は、入力された符号デ
ータを外部に出力する。
がフレームメモリコントローラ６に供給される。フレー
ムメモリコントローラ６は、符号データエリア４を選択
して、符号データを読み出し、符号化処理ブロック９に
出力する。符号化処理ブロック９は、入力された符号デ
ータを外部に出力する。
【００３５】以上のように、フレームメモリ１は、本来
１フレーム分の画像データを記憶するための記憶媒体で
あるが、フレームメモリコントローラ６によりフレーム
メモリ１内のエリア指定をすることにより、空いた領域
にＤＣＴ係数や符号データを記憶させることができる。
１フレーム分の画像データを記憶するための記憶媒体で
あるが、フレームメモリコントローラ６によりフレーム
メモリ１内のエリア指定をすることにより、空いた領域
にＤＣＴ係数や符号データを記憶させることができる。
【００３６】フレームメモリ１内の画像データエリア２
に画像データをアクセスする際には、ビデオ信号に対応
して、高速ページモードでアクセスすることができる。
また、ＤＣＴ処理ブロック８は、例えば８×８の１ブロ
ックの画像データ毎にＤＣＴの行列演算を行い、８×８
のＤＣＴ係数を出力するので、同一ロウアドレスにおい
て８つのＤＣＴ係数毎に高速ページモードでアスセスす
ることができる。
に画像データをアクセスする際には、ビデオ信号に対応
して、高速ページモードでアクセスすることができる。
また、ＤＣＴ処理ブロック８は、例えば８×８の１ブロ
ックの画像データ毎にＤＣＴの行列演算を行い、８×８
のＤＣＴ係数を出力するので、同一ロウアドレスにおい
て８つのＤＣＴ係数毎に高速ページモードでアスセスす
ることができる。
【００３７】本実施例による画像処理システムは、フレ
ームメモリ１にＤＣＴ係数や符号データ等の中間データ
を記憶することができるので、従来のようなワークメモ
リ５６（図４）を設ける必要がないので、ハードウェア
量を削減でき、コストを低減することができる。
ームメモリ１にＤＣＴ係数や符号データ等の中間データ
を記憶することができるので、従来のようなワークメモ
リ５６（図４）を設ける必要がないので、ハードウェア
量を削減でき、コストを低減することができる。
【００３８】なお、本実施例では、ＤＣＴ処理や符号化
処理等の画像データ圧縮を例に説明したが、その他画像
データの伸張、拡大・縮小、回転・移動、輪郭強調等の
画像処理にも適用することができる。画像データエリア
２は、ビデオ信号の制約によるラスタスキャン形式の連
続データをシーケンシャルアクセスすることができる。
一方、ＤＣＴ係数エリア３および符号データエリア４
は、ＤＣＴ係数や符号データのようにランダムアクセス
が可能なデータを記憶するのに適している。
処理等の画像データ圧縮を例に説明したが、その他画像
データの伸張、拡大・縮小、回転・移動、輪郭強調等の
画像処理にも適用することができる。画像データエリア
２は、ビデオ信号の制約によるラスタスキャン形式の連
続データをシーケンシャルアクセスすることができる。
一方、ＤＣＴ係数エリア３および符号データエリア４
は、ＤＣＴ係数や符号データのようにランダムアクセス
が可能なデータを記憶するのに適している。
【００３９】また、１フレームの大きさは、７２０×４
８０ピクセル（ＮＴＳＣ ＣＣＩＲ規格）の場合を例に
説明したが、１フレームの大きさは規格によって決まる
ものであり、他の大きさであってもよい。例えば、コン
ピュータ用では、６４０×４８０ピクセルのものもあ
る。
８０ピクセル（ＮＴＳＣ ＣＣＩＲ規格）の場合を例に
説明したが、１フレームの大きさは規格によって決まる
ものであり、他の大きさであってもよい。例えば、コン
ピュータ用では、６４０×４８０ピクセルのものもあ
る。
【００４０】以上実施例に沿って本発明を説明したが、
本発明はこれらに制限されるものではない。例えば、種
々の変更、改良、組み合わせ等が可能なことは当業者に
自明であろう。
本発明はこれらに制限されるものではない。例えば、種
々の変更、改良、組み合わせ等が可能なことは当業者に
自明であろう。
【００４１】
【発明の効果】以上説明したように、本発明によれば、
フレームメモリ中の画像データエリアに１フレームの画
像データを記憶し、空きエリアに画像処理手段により生
成される処理データを記憶することができるので、フレ
ームメモリを有効に活用することができ、ハードウェア
量の削減およびコストの低減を図ることができる。
フレームメモリ中の画像データエリアに１フレームの画
像データを記憶し、空きエリアに画像処理手段により生
成される処理データを記憶することができるので、フレ
ームメモリを有効に活用することができ、ハードウェア
量の削減およびコストの低減を図ることができる。
【図１】本発明の実施例による画像処理システムの構成
を示すブロック図である。
を示すブロック図である。
【図２】画像データの圧縮を行うための処理の流れを示
すフローチャートである。
すフローチャートである。
【図３】図３（Ａ）〜（Ｆ）は本実施例による画像処理
システムの処理手順を示す概略図である。
システムの処理手順を示す概略図である。
【図４】従来技術による画像処理システムの構成を示す
ブロック図である。
ブロック図である。
１ フレームメモリ ２ 画像データエリア ３ ＤＣＴ係数エリア ４ 符号データエリア ５ 画像処理装置 ６ フレームメモリコントローラ ７ 画像データ入出力ブロック ８ ＤＣＴ処理ブロック ９ 符号化処理ブロック １０ メインコントローラ ＣＴＬ 制御信号 ＥＲＡ エリア設定信号 ５１ フレームメモリ ５２ 画像データエリア ５３ 空きエリア ５５ 画像処理装置 ５６ ワークメモリ
Claims (3)
- 【請求項１】 ＤＲＡＭにより構成され、１フレームの
ディジタル画像データを記憶するための画像データエリ
ア（２）とそれ以外の空きエリア（３，４）を含むフレ
ームメモリ（１）と、 外部から供給される画像データを受け付ける画像データ
入力手段（７）と、 画像データを画像処理し処理データを生成する画像処理
手段（８，９）と、 前記画像データ入力手段が受け付ける画像データを前記
フレームメモリの画像データエリアに書き込み、前記画
像処理手段により生成される処理データを前記フレーム
メモリの空きエリアに書き込むためのメモリコントロー
ラ（６，１０）とを有する画像処理システム。 - 【請求項２】 前記フレームメモリの空きエリアは、第
１の空きエリア（３）と第２の空きエリア（４）を含
み、 前記画像処理手段は、第１の画像処理手段（８）と第２
の画像処理手段（９）を含み、 前記メモリコントローラは、前記第１の画像処理手段に
より生成される処理データを前記第１の空きエリアに書
き込み、前記第２の画像処理手段により生成される処理
データを前記第２の空きエリアに書き込む請求項１記載
の画像処理システム。 - 【請求項３】 前記画像処理手段が画像データの圧縮処
理を行う請求項１または２記載の画像処理システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6253296A JPH08115200A (ja) | 1994-10-19 | 1994-10-19 | 画像処理システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6253296A JPH08115200A (ja) | 1994-10-19 | 1994-10-19 | 画像処理システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08115200A true JPH08115200A (ja) | 1996-05-07 |
Family
ID=17249320
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6253296A Pending JPH08115200A (ja) | 1994-10-19 | 1994-10-19 | 画像処理システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08115200A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008523463A (ja) * | 2004-12-07 | 2008-07-03 | ニューナム リサーチ リミテッド | アドレスベースのグラフィックスプロトコル |
-
1994
- 1994-10-19 JP JP6253296A patent/JPH08115200A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008523463A (ja) * | 2004-12-07 | 2008-07-03 | ニューナム リサーチ リミテッド | アドレスベースのグラフィックスプロトコル |
| JP4839322B2 (ja) * | 2004-12-07 | 2011-12-21 | ディスプレイリンク （ユーケー） リミテッド | アドレスベースのグラフィックスプロトコル |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20031118 |