JPH0794420A - 化合物半導体結晶基板の製造方法 - Google Patents
化合物半導体結晶基板の製造方法Info
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Abstract
(57)【要約】
【目的】 化合物半導体結晶基板の製造方法に関し、S
i基板上に成長したGaAs等のIII−V族化合物半
導体層の結晶欠陥密度を1×106 cm-2以下に低減す
る化合物半導体結晶基板の製造方法を提供する。 【構成】 Si基板1の上にGaAs等のIII−V族
化合物半導体結晶層2をMOCVD等によってエピタキ
シャル成長し、その上に非晶質のGaAs等のIII−
V族化合物半導体層3を成長し、このIII−V族化合
物半導体結晶層2と非晶質のIII−V族化合物半導体
層3を熱アニールした後、この非晶質のIII−V族化
合物半導体層3を含むIII−V族化合物半導体結晶層
2の部分を機械的化学的研磨等によって除去し、その上
に新たなGaAs等のIII−V族化合物半導体結晶層
4をエピタキシャル成長する。
i基板上に成長したGaAs等のIII−V族化合物半
導体層の結晶欠陥密度を1×106 cm-2以下に低減す
る化合物半導体結晶基板の製造方法を提供する。 【構成】 Si基板1の上にGaAs等のIII−V族
化合物半導体結晶層2をMOCVD等によってエピタキ
シャル成長し、その上に非晶質のGaAs等のIII−
V族化合物半導体層3を成長し、このIII−V族化合
物半導体結晶層2と非晶質のIII−V族化合物半導体
層3を熱アニールした後、この非晶質のIII−V族化
合物半導体層3を含むIII−V族化合物半導体結晶層
2の部分を機械的化学的研磨等によって除去し、その上
に新たなGaAs等のIII−V族化合物半導体結晶層
4をエピタキシャル成長する。
Description
【0001】
【産業上の利用分野】本発明は、Si基板上にIII−
V族化合物半導体結晶層、特に、GaAs結晶層を有す
る化合物半導体結晶基板の製造方法に関する。
V族化合物半導体結晶層、特に、GaAs結晶層を有す
る化合物半導体結晶基板の製造方法に関する。
【0002】GaAs等のIII−V族化合物半導体結
晶層を用いた半導体装置は、そのキャリア移動度が大き
いため、Siを用いた半導体装置より高速動作が可能で
あり、バンドギャップの関係で可視光の発光機能を有す
るため、その有用性が広く認識されているが、大口径の
基板を製造することが困難であり、また機械的強度が乏
しいために、半導体装置としての実用化の進展の度合い
からみるとSiに大きく遅れをとっている。
晶層を用いた半導体装置は、そのキャリア移動度が大き
いため、Siを用いた半導体装置より高速動作が可能で
あり、バンドギャップの関係で可視光の発光機能を有す
るため、その有用性が広く認識されているが、大口径の
基板を製造することが困難であり、また機械的強度が乏
しいために、半導体装置としての実用化の進展の度合い
からみるとSiに大きく遅れをとっている。
【0003】そこで、最近、大口径の基板が得やすく、
機械的な強度の面で優れたSi基板の上にGaAs結晶
層を成長し、このGaAs成長層に、LED、レーザ、
FET等を形成する試みが活発になっている。しかしな
がら、この方法で得られるGaAs結晶層等のIII−
V族化合物半導体結晶層には多くの結晶欠陥が存在する
ため、このIII−V族化合物半導体結晶層を用いて良
好な特性のLED、レーザ、FET等を製造することが
できないという難点があった。
機械的な強度の面で優れたSi基板の上にGaAs結晶
層を成長し、このGaAs成長層に、LED、レーザ、
FET等を形成する試みが活発になっている。しかしな
がら、この方法で得られるGaAs結晶層等のIII−
V族化合物半導体結晶層には多くの結晶欠陥が存在する
ため、このIII−V族化合物半導体結晶層を用いて良
好な特性のLED、レーザ、FET等を製造することが
できないという難点があった。
【0004】
【従来の技術】そこで、従来は、Si基板上に形成され
たGaAs結晶層等のIII−V族化合物半導体結晶層
の結晶欠陥を低減するため、Si基板上に目的とする厚
さのIII−V族化合物半導体結晶層を成長した後に熱
サイクルを加えることによって、または、Si基板上に
目的とする厚さの半分程度のGaAs結晶層を成長した
後に熱サイクルアニールを行い、引続き目的とする厚さ
までGaAs結晶層を成長することによって結晶欠陥の
低減を図っていた。
たGaAs結晶層等のIII−V族化合物半導体結晶層
の結晶欠陥を低減するため、Si基板上に目的とする厚
さのIII−V族化合物半導体結晶層を成長した後に熱
サイクルを加えることによって、または、Si基板上に
目的とする厚さの半分程度のGaAs結晶層を成長した
後に熱サイクルアニールを行い、引続き目的とする厚さ
までGaAs結晶層を成長することによって結晶欠陥の
低減を図っていた。
【0005】
【発明が解決しようとする課題】しかしながら、このよ
うな方法では結晶欠陥密度を1×106 cm-2以下に低
減することは困難であった。従って、本発明は、Si基
板上に成長したGaAs等のIII−V族化合物半導体
層の結晶欠陥密度を1×106 cm-2以下に低減する化
合物半導体基板の製造方法を提供することを目的とす
る。
うな方法では結晶欠陥密度を1×106 cm-2以下に低
減することは困難であった。従って、本発明は、Si基
板上に成長したGaAs等のIII−V族化合物半導体
層の結晶欠陥密度を1×106 cm-2以下に低減する化
合物半導体基板の製造方法を提供することを目的とす
る。
【0006】
【課題を解決するための手段】本発明にかかる化合物半
導体結晶基板の製造方法においては、Si基板上にII
I−V族化合物半導体結晶層をエピタキシャル成長する
工程と、該III−V族化合物半導体結晶層の上に非晶
質のIII−V族化合物半導体層を成長する工程と、該
III−V族化合物半導体結晶層と非晶質のIII−V
族化合物半導体層をアニールする工程と、該非結晶のI
II−V族化合物半導体層を含むIII−V族化合物半
導体結晶層の部分を除去する工程と、該III−V族化
合物半導体結晶層の上に、新たなIII−V族化合物半
導体結晶層をエピタキシャル成長する工程を採用した。
導体結晶基板の製造方法においては、Si基板上にII
I−V族化合物半導体結晶層をエピタキシャル成長する
工程と、該III−V族化合物半導体結晶層の上に非晶
質のIII−V族化合物半導体層を成長する工程と、該
III−V族化合物半導体結晶層と非晶質のIII−V
族化合物半導体層をアニールする工程と、該非結晶のI
II−V族化合物半導体層を含むIII−V族化合物半
導体結晶層の部分を除去する工程と、該III−V族化
合物半導体結晶層の上に、新たなIII−V族化合物半
導体結晶層をエピタキシャル成長する工程を採用した。
【0007】この場合、III−V族化合物半導体結晶
層、非結晶のIII−V族化合物半導体層をMOCVD
によって成長することができる。
層、非結晶のIII−V族化合物半導体層をMOCVD
によって成長することができる。
【0008】また、この場合、非晶質のIII−V族化
合物半導体層を、500℃以下の温度で成長して、多結
晶化するのを防ぐことができる。
合物半導体層を、500℃以下の温度で成長して、多結
晶化するのを防ぐことができる。
【0009】また、この場合、700℃以上のアニール
と200℃以下のアニールを複数回行って、非晶質のI
II−V族化合物半導体層への結晶欠陥の吸収効果を高
めることができる。
と200℃以下のアニールを複数回行って、非晶質のI
II−V族化合物半導体層への結晶欠陥の吸収効果を高
めることができる。
【0010】また、この場合、表面の非結晶のIII−
V族化合物半導体層を含むIII−V族化合物半導体結
晶層の部分を機械的化学的研磨を用いて除去した後、新
たなIII−V族化合物半導体結晶層を成長することが
できる。
V族化合物半導体層を含むIII−V族化合物半導体結
晶層の部分を機械的化学的研磨を用いて除去した後、新
たなIII−V族化合物半導体結晶層を成長することが
できる。
【0011】また、これらの場合、III−V族化合物
半導体としてGaAsを用いることができる。
半導体としてGaAsを用いることができる。
【0012】
【作用】Si基板上に成長したGaAs結晶層等のII
I−V族化合物半導体層の結晶欠陥密度を1×106 c
m-2以下に減少させるために、Si基板上に成長したI
II−V族化合物半導体層の上に非晶質のIII−V族
化合物半導体層を成長し、これをアニールすることによ
って、Si基板上に成長したIII−V族化合物半導体
層の結晶欠陥を非晶質のIII−V族化合物半導体層に
吸収した後に、結晶欠陥が多く、アニールによって多結
晶化している非晶質のIII−V族化合物半導体層を含
む部分を除去して、結晶欠陥が少ないIII−V族化合
物半導体層を露出させ、その上に、新たなIII−V族
化合物半導体層を成長することによって、表面の部分に
結晶欠陥が少ないGaAs結晶層等のIII−V族化合
物半導体層を形成して、化合物半導体結晶基板を製造す
る。
I−V族化合物半導体層の結晶欠陥密度を1×106 c
m-2以下に減少させるために、Si基板上に成長したI
II−V族化合物半導体層の上に非晶質のIII−V族
化合物半導体層を成長し、これをアニールすることによ
って、Si基板上に成長したIII−V族化合物半導体
層の結晶欠陥を非晶質のIII−V族化合物半導体層に
吸収した後に、結晶欠陥が多く、アニールによって多結
晶化している非晶質のIII−V族化合物半導体層を含
む部分を除去して、結晶欠陥が少ないIII−V族化合
物半導体層を露出させ、その上に、新たなIII−V族
化合物半導体層を成長することによって、表面の部分に
結晶欠陥が少ないGaAs結晶層等のIII−V族化合
物半導体層を形成して、化合物半導体結晶基板を製造す
る。
【0013】
【実施例】以下、本発明の実施例を説明する。図1は、
本発明の実施例の化合物半導体結晶基板の製造工程説明
図である。この図において、1はSi(100)基板、
2はGaAs結晶層、3は非晶質GaAs層、4は新た
なGaAs結晶層である。
本発明の実施例の化合物半導体結晶基板の製造工程説明
図である。この図において、1はSi(100)基板、
2はGaAs結晶層、3は非晶質GaAs層、4は新た
なGaAs結晶層である。
【0014】この製造工程説明図によって本発明の実施
例の化合物半導体結晶基板の製造方法を説明する。
例の化合物半導体結晶基板の製造方法を説明する。
【0015】第1工程(図1(A)参照) Si(100)基板1の上に、MOCVD法によって、
トリメチルガリウム(TMG)、アルシン(AsH3 )
を用いて、成長温度650℃、成長圧力76torr
で、膜厚3.0μmのGaAs結晶層2を成長させる。
トリメチルガリウム(TMG)、アルシン(AsH3 )
を用いて、成長温度650℃、成長圧力76torr
で、膜厚3.0μmのGaAs結晶層2を成長させる。
【0016】第2工程(図1(B)参照) 第1工程で形成したGaAs結晶層2の上に、MOCV
D法によって、成長温度400℃〜450℃、成長圧力
76torrで、膜厚500〜5000Åの非晶質Ga
As層3を成長させる。次いで、Si(100)基板1
の上にGaAs結晶層2と非晶質GaAs層3を積層し
たものに、下限温度を200℃とし、上限温度を800
℃とする熱サイクルアニールを3回施す。この熱サイク
ルアニールによって、GaAs結晶層2中に存在してい
た結晶欠陥が非晶質GaAs層3中に移行し吸収され
る。
D法によって、成長温度400℃〜450℃、成長圧力
76torrで、膜厚500〜5000Åの非晶質Ga
As層3を成長させる。次いで、Si(100)基板1
の上にGaAs結晶層2と非晶質GaAs層3を積層し
たものに、下限温度を200℃とし、上限温度を800
℃とする熱サイクルアニールを3回施す。この熱サイク
ルアニールによって、GaAs結晶層2中に存在してい
た結晶欠陥が非晶質GaAs層3中に移行し吸収され
る。
【0017】第3工程(図1(C)参照) Si(100)基板1の上にGaAs結晶層2と非晶質
GaAs層3を積層した積層体(GaAs on S
i)を成長炉から取り出し、非晶質GaAs層3側か
ら、非晶質GaAs層3を含む層を1.5μm除去す
る。
GaAs層3を積層した積層体(GaAs on S
i)を成長炉から取り出し、非晶質GaAs層3側か
ら、非晶質GaAs層3を含む層を1.5μm除去す
る。
【0018】第4工程(図1(D)参照) 非晶質GaAs層3を含む層を1.5μm除去すること
によって、結晶欠陥がが低減されたGaAs結晶層2が
形成される。この結晶欠陥が低減されたGaAs結晶層
2の上に再び新たなGaAs結晶層4を第1工程と同様
の条件で厚さ1.5μm成長する。その結果、Si(1
00)基板1の上に、結晶欠陥密度が5×105 cm-2
程度で、膜厚が3μmより厚いGaAs結晶層2と新た
なGaAs結晶層4を有する化合物半導体結晶基板が得
られる。
によって、結晶欠陥がが低減されたGaAs結晶層2が
形成される。この結晶欠陥が低減されたGaAs結晶層
2の上に再び新たなGaAs結晶層4を第1工程と同様
の条件で厚さ1.5μm成長する。その結果、Si(1
00)基板1の上に、結晶欠陥密度が5×105 cm-2
程度で、膜厚が3μmより厚いGaAs結晶層2と新た
なGaAs結晶層4を有する化合物半導体結晶基板が得
られる。
【0019】図2は、本発明の実施例の化合物半導体結
晶基板の製造方法の非晶質GaAs層の欠陥密度と成長
温度の関係図である。この図において、横軸は非晶質G
aAs層の成長温度を示し、縦軸は欠陥密度を示してい
る。この図から、非晶質GaAs層の成長温度が500
℃以下で、欠陥密度が1×106 cm-2以下のGaAs
結晶層が得られることがわかる。
晶基板の製造方法の非晶質GaAs層の欠陥密度と成長
温度の関係図である。この図において、横軸は非晶質G
aAs層の成長温度を示し、縦軸は欠陥密度を示してい
る。この図から、非晶質GaAs層の成長温度が500
℃以下で、欠陥密度が1×106 cm-2以下のGaAs
結晶層が得られることがわかる。
【0020】上記の実施例では、Si基板の上に化合物
半導体としてGaAsを用いる例を説明したが、本発明
は、GaAsの他、AlGaAs等のIII−V族化合
物半導体に適用することができる。
半導体としてGaAsを用いる例を説明したが、本発明
は、GaAsの他、AlGaAs等のIII−V族化合
物半導体に適用することができる。
【0021】
【発明の効果】以上説明したように、本発明によると、
結晶欠陥密度が1×106 cm-2以下のGaAs on
Si基板を形成することができ、化合物半導体LE
D、化合物半導体レーザ、化合物半導体FET等を製造
するための化合物半導体基板を再現性よく製造すること
ができるため、高速動作可能な能動素子や発光素子に関
する技術分野において寄与するところが大きい。
結晶欠陥密度が1×106 cm-2以下のGaAs on
Si基板を形成することができ、化合物半導体LE
D、化合物半導体レーザ、化合物半導体FET等を製造
するための化合物半導体基板を再現性よく製造すること
ができるため、高速動作可能な能動素子や発光素子に関
する技術分野において寄与するところが大きい。
【図1】本発明の実施例の化合物半導体結晶基板の製造
工程説明図である。
工程説明図である。
【図2】本発明の実施例の化合物半導体結晶基板の製造
方法の非晶質GaAs層の欠陥密度と成長温度の関係図
である。
方法の非晶質GaAs層の欠陥密度と成長温度の関係図
である。
1 Si(100)基板 2 GaAs結晶層 3 非晶質GaAs層 4 新たなGaAs結晶層
Claims (5)
- 【請求項1】 Si基板上にIII−V族化合物半導体
結晶層をエピタキシャル成長する工程と、該III−V
族化合物半導体結晶層の上に非晶質のIII−V族化合
物半導体層を成長する工程と、該III−V族化合物半
導体結晶層と非晶質のIII−V族化合物半導体層をア
ニールする工程と、該非結晶のIII−V族化合物半導
体層を含むIII−V族化合物半導体結晶層の部分を除
去する工程と、該III−V族化合物半導体結晶層の上
に、新たなIII−V族化合物半導体結晶層をエピタキ
シャル成長する工程を含むことを特徴とする化合物半導
体結晶基板の製造方法。 - 【請求項2】 III−V族化合物半導体結晶層、非結
晶のIII−V族化合物半導体層をMOCVDによって
成長することを特徴とする請求項1に記載された化合物
半導体結晶基板の製造方法。 - 【請求項3】 非晶質のIII−V族化合物半導体層
を、500℃以下の温度で成長することを特徴とする請
求項1に記載された化合物半導体結晶基板の製造方法。 - 【請求項4】 700℃以上のアニールと200℃以下
のアニールを複数回行うことを特徴する請求項1に記載
された化合物半導体結晶基板の製造方法。 - 【請求項5】 表面の非結晶III−V族化合物半導体
層を含むIII−V族化合物半導体結晶層の部分を機械
的化学的研磨を用いて除去した後、新たなIII−V族
化合物半導体結晶層を成長することを特徴する請求項1
に記載された化合物半導体結晶基板の製造方法。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5233506A JPH0794420A (ja) | 1993-09-20 | 1993-09-20 | 化合物半導体結晶基板の製造方法 |
US08/302,439 US5424243A (en) | 1993-09-20 | 1994-09-09 | Method of making a compound semiconductor crystal-on-substrate structure |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5233506A JPH0794420A (ja) | 1993-09-20 | 1993-09-20 | 化合物半導体結晶基板の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0794420A true JPH0794420A (ja) | 1995-04-07 |
Family
ID=16956101
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5233506A Withdrawn JPH0794420A (ja) | 1993-09-20 | 1993-09-20 | 化合物半導体結晶基板の製造方法 |
Country Status (2)
Country | Link |
---|---|
US (1) | US5424243A (ja) |
JP (1) | JPH0794420A (ja) |
Families Citing this family (29)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3129112B2 (ja) * | 1994-09-08 | 2001-01-29 | 住友電気工業株式会社 | 化合物半導体エピタキシャル成長方法とそのためのInP基板 |
EP0720243A3 (en) * | 1994-12-27 | 1998-07-01 | Fujitsu Limited | Method of fabricating compound semiconductor device and optical semiconductor device |
ATE283549T1 (de) * | 1997-06-24 | 2004-12-15 | Massachusetts Inst Technology | Kontrolle der verspannungsdichte durch verwendung von gradientenschichten und durch planarisierung |
US7227176B2 (en) | 1998-04-10 | 2007-06-05 | Massachusetts Institute Of Technology | Etch stop layer system |
US6290774B1 (en) * | 1999-05-07 | 2001-09-18 | Cbl Technology, Inc. | Sequential hydride vapor phase epitaxy |
JP2003520444A (ja) * | 2000-01-20 | 2003-07-02 | アンバーウェーブ システムズ コーポレイション | 高温成長を不要とする低貫通転位密度格子不整合エピ層 |
US6602613B1 (en) | 2000-01-20 | 2003-08-05 | Amberwave Systems Corporation | Heterointegration of materials using deposition and bonding |
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