JPH0767171A - フレーム同期制御回路 - Google Patents
フレーム同期制御回路Info
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- JPH0767171A JPH0767171A JP21264193A JP21264193A JPH0767171A JP H0767171 A JPH0767171 A JP H0767171A JP 21264193 A JP21264193 A JP 21264193A JP 21264193 A JP21264193 A JP 21264193A JP H0767171 A JPH0767171 A JP H0767171A
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- Japan
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- base station
- timing
- synchronization
- transmission
- control circuit
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Abstract
(57)【要約】
【目的】 ＴＤＭＡ方式を用いた移動通信システムにお
いて、基地局間のＴＤＭＡフレームの同期をとるフレー
ム同期制御回路に関し、ガードタイムを短くかつ消費電
力の増加を最小限に抑えながら、基地局間のフレーム同
期精度を向上させることを目的とする。 【構成】 基地局で使用されるシステムクロックより高
速なクロックを発生する高速クロック発生回路と、周辺
基地局が送信するＴＤＭＡ信号の受信タイミングから検
出される周辺基地局の送信フレームタイミングと、自基
地局のシステムクロックで生成される送信フレームタイ
ミングとの同期誤差を高速クロックの周期精度で検出す
る同期誤差検出手段と、この同期誤差に応じて、自基地
局の送信フレームタイミングを高速クロックの周期精度
で制御する送信タイミング制御手段とを備える。
いて、基地局間のＴＤＭＡフレームの同期をとるフレー
ム同期制御回路に関し、ガードタイムを短くかつ消費電
力の増加を最小限に抑えながら、基地局間のフレーム同
期精度を向上させることを目的とする。 【構成】 基地局で使用されるシステムクロックより高
速なクロックを発生する高速クロック発生回路と、周辺
基地局が送信するＴＤＭＡ信号の受信タイミングから検
出される周辺基地局の送信フレームタイミングと、自基
地局のシステムクロックで生成される送信フレームタイ
ミングとの同期誤差を高速クロックの周期精度で検出す
る同期誤差検出手段と、この同期誤差に応じて、自基地
局の送信フレームタイミングを高速クロックの周期精度
で制御する送信タイミング制御手段とを備える。
Description
【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、ＴＤＭＡ（時分割多元
接続）方式を用いた移動通信システムにおいて、基地局
間のＴＤＭＡフレームの同期をとるフレーム同期制御回
路に関する。
接続）方式を用いた移動通信システムにおいて、基地局
間のＴＤＭＡフレームの同期をとるフレーム同期制御回
路に関する。
【０００２】
【従来の技術】図４は、ＴＤＭＡ方式を用いた移動通信
システムの構成例を示す。図において、複数の基地局１
0 〜１n は、各々の無線ゾーン２0 〜２n 内の移動局
（携帯無線器）３とＴＤＭＡ方式を用いて通信を行って
いる。
システムの構成例を示す。図において、複数の基地局１
0 〜１n は、各々の無線ゾーン２0 〜２n 内の移動局
（携帯無線器）３とＴＤＭＡ方式を用いて通信を行って
いる。
【０００３】ここで、基地局１0 における従来のフレー
ム同期制御について説明する。基地局１0 は、周辺基地
局１i の送信フレームタイミングを検出し、自局の送信
フレームタイミングとの差を同期誤差として検出する。
ただし、周辺基地局１i の送信フレームタイミングは直
接検出できないので、次の方法による。
ム同期制御について説明する。基地局１0 は、周辺基地
局１i の送信フレームタイミングを検出し、自局の送信
フレームタイミングとの差を同期誤差として検出する。
ただし、周辺基地局１i の送信フレームタイミングは直
接検出できないので、次の方法による。
【０００４】周辺基地局１i の信号が基地局１0 に受信
される受信タイミングをｔi 、基地局１0 と周辺基地局
１i との間の伝搬遅延時間をｔ0iとすると、基地局１0
が検出する周辺基地局１i の送信フレームタイミング
は、 ｔi −ｔ0i …(1) と推定される。一方、基地局１0 の送信フレームタイミ
ングをｔ0 とすると、基地局１0 と周辺基地局１i の送
信フレームタイミング差（同期誤差）ΔＴ0iは、 ΔＴ0i＝ｔi −ｔ0i−ｔ0 …(2) となる。
される受信タイミングをｔi 、基地局１0 と周辺基地局
１i との間の伝搬遅延時間をｔ0iとすると、基地局１0
が検出する周辺基地局１i の送信フレームタイミング
は、 ｔi −ｔ0i …(1) と推定される。一方、基地局１0 の送信フレームタイミ
ングをｔ0 とすると、基地局１0 と周辺基地局１i の送
信フレームタイミング差（同期誤差）ΔＴ0iは、 ΔＴ0i＝ｔi −ｔ0i−ｔ0 …(2) となる。
【０００５】いま、周辺基地局の数をｎとすると、基地
局１0 と各周辺基地局１1 〜１n の送信フレームタイミ
ング差の平均（平均同期誤差）ΔＴ0 は、
局１0 と各周辺基地局１1 〜１n の送信フレームタイミ
ング差の平均（平均同期誤差）ΔＴ0 は、
【０００６】
【数１】
【０００７】となる。このように、基地局１0 では、周
辺基地局信号の受信タイミングと基地局間の伝搬遅延時
間から求まる周辺基地局１i の送信フレームタイミング
（ｔi−ｔ0i)と、基地局１0 の送信フレームタイミング
(ｔ0) との差（同期誤差ΔＴ0i）を検出し、それに応じ
て送信フレームタイミングを補正することによりフレー
ム同期を確立する。さらに、周辺基地局が複数ある場合
には、各周辺基地局１1 〜１nと基地局１0 の送信フレ
ームタイミング差の平均（平均同期誤差ΔＴ0 ）に応じ
て、送信フレームタイミングを補正することによりフレ
ーム同期を確立する。
辺基地局信号の受信タイミングと基地局間の伝搬遅延時
間から求まる周辺基地局１i の送信フレームタイミング
（ｔi−ｔ0i)と、基地局１0 の送信フレームタイミング
(ｔ0) との差（同期誤差ΔＴ0i）を検出し、それに応じ
て送信フレームタイミングを補正することによりフレー
ム同期を確立する。さらに、周辺基地局が複数ある場合
には、各周辺基地局１1 〜１nと基地局１0 の送信フレ
ームタイミング差の平均（平均同期誤差ΔＴ0 ）に応じ
て、送信フレームタイミングを補正することによりフレ
ーム同期を確立する。
【０００８】図５は、従来のフレーム同期制御回路の構
成例を示す。図において、同期語検出回路１１は、受信
ＴＤＭＡ信号の情報種別を認識するとともに同期語を検
出し、同期語検出パルスａを受信制御回路２０に送出す
る。受信制御回路２０は、この同期語検出パルスａから
受信タイミングを検出し、所定の時間差をおいて同期語
送出タイミング信号ｂを同期語位置発生回路１２に送出
し、送信タイミング信号ｃを送信制御回路３０に送出す
る。なお、この時間差は、ＴＤＭＡフレームフォマット
により異なる。同期語位置発生回路１２は、同期語送出
タイミング信号ｂに応じて同期語検出用窓を設定すると
ともに、同期語位置パルスｄを受信制御回路２０に送出
する。送信制御回路３０は、送信タイミング信号ｃに応
じて送信フレームタイミングを設定する。
成例を示す。図において、同期語検出回路１１は、受信
ＴＤＭＡ信号の情報種別を認識するとともに同期語を検
出し、同期語検出パルスａを受信制御回路２０に送出す
る。受信制御回路２０は、この同期語検出パルスａから
受信タイミングを検出し、所定の時間差をおいて同期語
送出タイミング信号ｂを同期語位置発生回路１２に送出
し、送信タイミング信号ｃを送信制御回路３０に送出す
る。なお、この時間差は、ＴＤＭＡフレームフォマット
により異なる。同期語位置発生回路１２は、同期語送出
タイミング信号ｂに応じて同期語検出用窓を設定すると
ともに、同期語位置パルスｄを受信制御回路２０に送出
する。送信制御回路３０は、送信タイミング信号ｃに応
じて送信フレームタイミングを設定する。
【０００９】受信制御回路２０は、同期語検出パルスａ
の入力タイミング（同期語受信タイミング）と、同期語
位置パルスｄの入力タイミングとの時間差を検出する。
ここで、自基地局の送信フレームタイミングは、同期語
位置パルスｄの入力タイミングと一定の時間関係にあ
る。また、周辺基地局の送信フレームタイミングは、同
期語検出パルスａの入力タイミングから自基地局と周辺
基地局間の伝搬遅延時間を補正して求めることができ
る。これにより、自基地局と周辺基地局の送信フレーム
タイミングの差（同期誤差）を検出することができる。
したがって、受信制御回路２０は、この同期誤差に応じ
て、同期語送出タイミング信号ｂおよび送信タイミング
信号ｃを制御することにより、周辺基地局と自基地局の
フレーム同期を確立することができる。
の入力タイミング（同期語受信タイミング）と、同期語
位置パルスｄの入力タイミングとの時間差を検出する。
ここで、自基地局の送信フレームタイミングは、同期語
位置パルスｄの入力タイミングと一定の時間関係にあ
る。また、周辺基地局の送信フレームタイミングは、同
期語検出パルスａの入力タイミングから自基地局と周辺
基地局間の伝搬遅延時間を補正して求めることができ
る。これにより、自基地局と周辺基地局の送信フレーム
タイミングの差（同期誤差）を検出することができる。
したがって、受信制御回路２０は、この同期誤差に応じ
て、同期語送出タイミング信号ｂおよび送信タイミング
信号ｃを制御することにより、周辺基地局と自基地局の
フレーム同期を確立することができる。
【００１０】
【発明が解決しようとする課題】ところで、従来のフレ
ーム同期制御回路の各部は、システムクロック発生回路
１３から出力されるシステムクロックによって動作する
構成になっている。すなわち、システムクロック周期で
同期誤差を検出し、また送信フレームタイミングを制御
する構成になっていた。したがって、システムクロック
が低速の場合には、基地局間の送信フレームタイミング
の誤差が累積され、システム全体のフレーム同期誤差が
大きくなることがあった。
ーム同期制御回路の各部は、システムクロック発生回路
１３から出力されるシステムクロックによって動作する
構成になっている。すなわち、システムクロック周期で
同期誤差を検出し、また送信フレームタイミングを制御
する構成になっていた。したがって、システムクロック
が低速の場合には、基地局間の送信フレームタイミング
の誤差が累積され、システム全体のフレーム同期誤差が
大きくなることがあった。
【００１１】一方、高速なシステムクロックを用いれ
ば、上記の問題を解決して同期精度を高めることができ
るが、バーストの衝突を避けるためにガードタイムのシ
ンボル数（シンボル＝１／システムクロック）を多くと
らなければならない。すなわち、長いガードタイムが必
要となって伝送効率の低下が避けられなかった。また、
基地局全体の動作クロックが高速になるので、消費電力
の増加も避けられなかった。
ば、上記の問題を解決して同期精度を高めることができ
るが、バーストの衝突を避けるためにガードタイムのシ
ンボル数（シンボル＝１／システムクロック）を多くと
らなければならない。すなわち、長いガードタイムが必
要となって伝送効率の低下が避けられなかった。また、
基地局全体の動作クロックが高速になるので、消費電力
の増加も避けられなかった。
【００１２】本発明は、ガードタイムを短くかつ消費電
力の増加を最小限に抑えながら、基地局間のフレーム同
期精度を向上させることができるフレーム同期制御回路
を提供することを目的とする。
力の増加を最小限に抑えながら、基地局間のフレーム同
期精度を向上させることができるフレーム同期制御回路
を提供することを目的とする。
【００１３】
【課題を解決するための手段】請求項１に記載の発明
は、基地局で使用されるシステムクロックより高速なク
ロックを発生する高速クロック発生回路と、周辺基地局
が送信するＴＤＭＡ信号の受信タイミングから検出され
る周辺基地局の送信フレームタイミングと、自基地局の
システムクロックで生成される送信フレームタイミング
との同期誤差を高速クロックの周期精度で検出する同期
誤差検出手段と、この同期誤差に応じて、自基地局の送
信フレームタイミングを高速クロックの周期精度で制御
する送信タイミング制御手段とを備える。
は、基地局で使用されるシステムクロックより高速なク
ロックを発生する高速クロック発生回路と、周辺基地局
が送信するＴＤＭＡ信号の受信タイミングから検出され
る周辺基地局の送信フレームタイミングと、自基地局の
システムクロックで生成される送信フレームタイミング
との同期誤差を高速クロックの周期精度で検出する同期
誤差検出手段と、この同期誤差に応じて、自基地局の送
信フレームタイミングを高速クロックの周期精度で制御
する送信タイミング制御手段とを備える。
【００１４】請求項２に記載の発明は、請求項１に記載
のフレーム同期制御回路において、自基地局の送信フレ
ームタイミングの初期設定時は、検出される各周辺基地
局の送信フレームタイミングの平均値を自基地局の送信
フレームタイミングとする構成である。
のフレーム同期制御回路において、自基地局の送信フレ
ームタイミングの初期設定時は、検出される各周辺基地
局の送信フレームタイミングの平均値を自基地局の送信
フレームタイミングとする構成である。
【００１５】
【作用】本発明は、フレーム同期制御に関わる回路のみ
を高速クロックで動作させ、その他は低速のシステムク
ロックで動作させる。したがって、周辺基地局信号の受
信タイミングの検出、基地局間の送信フレームタイミン
グの同期誤差の検出、および自基地局の送信フレームタ
イミングの制御を高精度で行うことができ、基地局間の
フレーム同期精度を向上させることができる。しかも、
システムクロックで送受信処理が行われるので、ガード
タイムを長くする必要がなく、また消費電力の増加を最
小限に抑えることができる。
を高速クロックで動作させ、その他は低速のシステムク
ロックで動作させる。したがって、周辺基地局信号の受
信タイミングの検出、基地局間の送信フレームタイミン
グの同期誤差の検出、および自基地局の送信フレームタ
イミングの制御を高精度で行うことができ、基地局間の
フレーム同期精度を向上させることができる。しかも、
システムクロックで送受信処理が行われるので、ガード
タイムを長くする必要がなく、また消費電力の増加を最
小限に抑えることができる。
【００１６】また、送信フレームタイミングの初期設定
時においても、高速クロックで検出された各周辺基地局
の送信フレームタイミングの平均値を用いることによ
り、高精度の送信フレームタイミングを初期設定するこ
とができる。
時においても、高速クロックで検出された各周辺基地局
の送信フレームタイミングの平均値を用いることによ
り、高精度の送信フレームタイミングを初期設定するこ
とができる。
【００１７】
【実施例】図１は、本発明のフレーム同期制御回路の第
一実施例の構成を示す。図において、同期語検出回路１
１，同期語位置発生回路１２，システムクロック発生回
路１３，受信制御回路２０および送信制御回路３０の配
置は、従来と同様である。ただし、受信制御回路２０
は、同期誤差検出回路２１，同期誤差平均回路２２およ
び受信タイミング制御回路２３を有する。送信制御回路
３０は、送信タイミング制御回路３１を有する。
一実施例の構成を示す。図において、同期語検出回路１
１，同期語位置発生回路１２，システムクロック発生回
路１３，受信制御回路２０および送信制御回路３０の配
置は、従来と同様である。ただし、受信制御回路２０
は、同期誤差検出回路２１，同期誤差平均回路２２およ
び受信タイミング制御回路２３を有する。送信制御回路
３０は、送信タイミング制御回路３１を有する。
【００１８】本発明の特徴とするところは、システムク
ロックよりも高速なクロックを発生させる高速クロック
発生回路４０を備え、システムクロック発生回路１３，
同期誤差検出回路２１，受信タイミング制御回路２３お
よび送信タイミング制御回路３１に高速クロックを供給
する構成にある。
ロックよりも高速なクロックを発生させる高速クロック
発生回路４０を備え、システムクロック発生回路１３，
同期誤差検出回路２１，受信タイミング制御回路２３お
よび送信タイミング制御回路３１に高速クロックを供給
する構成にある。
【００１９】同期語検出回路１１は、受信ＴＤＭＡ信号
の情報種別を認識するとともに同期語を検出し、同期語
検出パルスａを同期誤差検出回路２１および受信タイミ
ング制御回路２３に送出する。受信タイミング制御回路
２３は、同期語検出パルスａから高速クロックの周期精
度で受信タイミングを検出し、その後所定のタイミング
で同期語送出タイミング信号ｂを同期語位置発生回路１
２に送出し、送信タイミング信号ｃを送信タイミング制
御回路３１に送出する。同期語位置発生回路１２は、同
期語送出タイミング信号ｂに応じて同期語検出用窓を設
定するとともに、同期語位置パルスｄを同期誤差検出回
路２１に送出する。送信タイミング制御回路３１は、送
信タイミング信号ｃに応じて送信フレームタイミングを
設定する。
の情報種別を認識するとともに同期語を検出し、同期語
検出パルスａを同期誤差検出回路２１および受信タイミ
ング制御回路２３に送出する。受信タイミング制御回路
２３は、同期語検出パルスａから高速クロックの周期精
度で受信タイミングを検出し、その後所定のタイミング
で同期語送出タイミング信号ｂを同期語位置発生回路１
２に送出し、送信タイミング信号ｃを送信タイミング制
御回路３１に送出する。同期語位置発生回路１２は、同
期語送出タイミング信号ｂに応じて同期語検出用窓を設
定するとともに、同期語位置パルスｄを同期誤差検出回
路２１に送出する。送信タイミング制御回路３１は、送
信タイミング信号ｃに応じて送信フレームタイミングを
設定する。
【００２０】同期誤差検出回路２１は、高速クロックを
用いて、同期語検出パルスａの入力タイミング（同期語
受信タイミング）と、同期語位置パルスｄの入力タイミ
ングとの時間差を検出する。ここで、自基地局の送信フ
レームタイミングは、同期語位置パルスｄの入力タイミ
ングと一定の時間関係にある。また、周辺基地局の送信
フレームタイミングは、同期語検出パルスａの入力タイ
ミングから自基地局と周辺基地局間の伝搬遅延時間を補
正して求めることができる。これにより、自基地局と周
辺基地局の送信フレームタイミングの差（同期誤差）を
高速クロックの周期精度で検出することができる。同期
誤差平均回路２２は、各周辺基地局との間の同期誤差の
平均をとり、平均同期誤差信号ｅを受信タイミング制御
回路２３およびシステムクロック発生回路１３に送出す
る。
用いて、同期語検出パルスａの入力タイミング（同期語
受信タイミング）と、同期語位置パルスｄの入力タイミ
ングとの時間差を検出する。ここで、自基地局の送信フ
レームタイミングは、同期語位置パルスｄの入力タイミ
ングと一定の時間関係にある。また、周辺基地局の送信
フレームタイミングは、同期語検出パルスａの入力タイ
ミングから自基地局と周辺基地局間の伝搬遅延時間を補
正して求めることができる。これにより、自基地局と周
辺基地局の送信フレームタイミングの差（同期誤差）を
高速クロックの周期精度で検出することができる。同期
誤差平均回路２２は、各周辺基地局との間の同期誤差の
平均をとり、平均同期誤差信号ｅを受信タイミング制御
回路２３およびシステムクロック発生回路１３に送出す
る。
【００２１】システムクロック発生回路１３は、平均同
期誤差信号ｅに応じて、高速クロックの周期精度でシス
テムクロックの位相を制御する。受信タイミング制御回
路２３は、平均同期誤差信号ｅに応じて、同様に同期語
送出タイミング信号ｂおよび送信タイミング信号ｃを制
御する。送信タイミング制御回路３１は、この送信タイ
ミング信号ｃに応じて、自基地局の送信フレームタイミ
ングを高速クロックの周期精度で設定し、周辺基地局と
のフレーム同期を確立する。
期誤差信号ｅに応じて、高速クロックの周期精度でシス
テムクロックの位相を制御する。受信タイミング制御回
路２３は、平均同期誤差信号ｅに応じて、同様に同期語
送出タイミング信号ｂおよび送信タイミング信号ｃを制
御する。送信タイミング制御回路３１は、この送信タイ
ミング信号ｃに応じて、自基地局の送信フレームタイミ
ングを高速クロックの周期精度で設定し、周辺基地局と
のフレーム同期を確立する。
【００２２】ここで、同期語検出パルスａ，同期語位置
パルスｄ，平均同期誤差信号ｅ，送信フレームタイミン
グ，システムクロックおよび高速クロックの位相関係を
図２に示す。なお、破線で示す同期語位置パルスｄおよ
び送信フレームタイミングは、同期制御前の状態を示
す。
パルスｄ，平均同期誤差信号ｅ，送信フレームタイミン
グ，システムクロックおよび高速クロックの位相関係を
図２に示す。なお、破線で示す同期語位置パルスｄおよ
び送信フレームタイミングは、同期制御前の状態を示
す。
【００２３】次に、基地局が送信フレームタイミングを
初期設定する過程について説明する。最初に検出した周
辺基地局の同期語検出パルスａに基づいて同期語位置パ
ルスｄを発生させる。同期誤差検出回路２１は、この同
期語位置パルスｄのタイミングと、順次検出される他の
周辺基地局の同期語検出パルスａのタイミングの位相差
を高速クロックの周期制御で検出する。同期誤差平均回
路２２は各周辺基地局に対応する位相差を平均し、受信
タイミング制御回路２３はこの平均位相差に基づいて、
基地局の初期送信フレームタイミングを設定する送信タ
イミング信号ｃを送信タイミング制御回路３１に送出す
る。送信タイミング制御回路３１は、この送信タイミン
グ信号ｃに応じて自基地局の送信フレームタイミングを
初期設定する。
初期設定する過程について説明する。最初に検出した周
辺基地局の同期語検出パルスａに基づいて同期語位置パ
ルスｄを発生させる。同期誤差検出回路２１は、この同
期語位置パルスｄのタイミングと、順次検出される他の
周辺基地局の同期語検出パルスａのタイミングの位相差
を高速クロックの周期制御で検出する。同期誤差平均回
路２２は各周辺基地局に対応する位相差を平均し、受信
タイミング制御回路２３はこの平均位相差に基づいて、
基地局の初期送信フレームタイミングを設定する送信タ
イミング信号ｃを送信タイミング制御回路３１に送出す
る。送信タイミング制御回路３１は、この送信タイミン
グ信号ｃに応じて自基地局の送信フレームタイミングを
初期設定する。
【００２４】図３は、本発明のフレーム同期制御回路の
第二実施例の構成を示す。本実施例の特徴とするところ
は、同期誤差検出回路２１が、高速クロックを用いて、
同期語検出パルスａと送信タイミング信号ｃから同期誤
差を検出する構成にある。すなわち、自基地局の送信フ
レームタイミングは、送信タイミング信号ｃと一定の時
間関係にある。また、周辺基地局の送信フレームタイミ
ングは、同期語検出パルスａの入力タイミングから自基
地局と周辺基地局間の伝搬遅延時間を補正して求めるこ
とができる。これにより、自基地局と周辺基地局の送信
フレームタイミングの差（同期誤差）を高速クロックの
周期精度で検出することができる。その他の構成は、第
一実施例と同様である。
第二実施例の構成を示す。本実施例の特徴とするところ
は、同期誤差検出回路２１が、高速クロックを用いて、
同期語検出パルスａと送信タイミング信号ｃから同期誤
差を検出する構成にある。すなわち、自基地局の送信フ
レームタイミングは、送信タイミング信号ｃと一定の時
間関係にある。また、周辺基地局の送信フレームタイミ
ングは、同期語検出パルスａの入力タイミングから自基
地局と周辺基地局間の伝搬遅延時間を補正して求めるこ
とができる。これにより、自基地局と周辺基地局の送信
フレームタイミングの差（同期誤差）を高速クロックの
周期精度で検出することができる。その他の構成は、第
一実施例と同様である。
【００２５】
【発明の効果】以上説明したように本発明は、高速クロ
ックと低速のシステムクロックを使い分け、フレーム同
期制御に関わる回路のみを高速クロックで動作させるこ
とにより、基地局間のフレーム同期精度を向上させるこ
とができる。しかも、その他はシステムクロックで動作
させるので、ガードタイムを長くする必要がなく、また
消費電力の増加を最小限に抑えることかできる。
ックと低速のシステムクロックを使い分け、フレーム同
期制御に関わる回路のみを高速クロックで動作させるこ
とにより、基地局間のフレーム同期精度を向上させるこ
とができる。しかも、その他はシステムクロックで動作
させるので、ガードタイムを長くする必要がなく、また
消費電力の増加を最小限に抑えることかできる。
【図１】本発明のフレーム同期制御回路の第一実施例の
構成を示すブロック図。
構成を示すブロック図。
【図２】第一実施例各部の信号の関係を示す図。
【図３】本発明のフレーム同期制御回路の第二実施例の
構成を示すブロック図。
構成を示すブロック図。
【図４】ＴＤＭＡ方式を用いた移動通信システムの構成
例を示す図。
例を示す図。
【図５】従来のフレーム同期制御回路の構成例を示すブ
ロック図。
ロック図。
１ 基地局 ２ 無線ゾーン ３ 移動局（携帯無線器） １１ 同期語検出回路 １２ 同期語位置発生回路 １３ システムクロック発生回路 ２０ 受信制御回路 ２１ 同期誤差検出回路 ２２ 同期誤差平均回路 ２３ 受信タイミング制御回路 ３０ 送信制御回路 ３１ 送信タイミング制御回路 ４０ 高速クロック発生回路
Claims (2)
- 【請求項１】 ＴＤＭＡ方式を用いて各無線ゾーン内の
移動局と通信する各無線ゾーン対応の基地局に備えら
れ、複数の基地局間のＴＤＭＡフレームを同期させるフ
レーム同期制御回路において、 基地局で使用されるシステムクロックより高速なクロッ
クを発生する高速クロック発生回路と、 周辺基地局が送信するＴＤＭＡ信号の受信タイミングか
ら検出される周辺基地局の送信フレームタイミングと、
自基地局のシステムクロックで生成される送信フレーム
タイミングとの同期誤差を前記高速クロックの周期精度
で検出する同期誤差検出手段と、 前記同期誤差に応じて、自基地局の送信フレームタイミ
ングを前記高速クロックの周期精度で制御する送信タイ
ミング制御手段とを備えたことを特徴とするフレーム同
期制御回路。 - 【請求項２】 請求項１に記載のフレーム同期制御回路
において、 自基地局の送信フレームタイミングの初期設定時は、検
出される各周辺基地局の送信フレームタイミングの平均
値を自基地局の送信フレームタイミングとする構成であ
ることを特徴とするフレーム同期制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21264193A JP3237683B2 (ja) | 1993-08-27 | 1993-08-27 | フレーム同期制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21264193A JP3237683B2 (ja) | 1993-08-27 | 1993-08-27 | フレーム同期制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0767171A true JPH0767171A (ja) | 1995-03-10 |
| JP3237683B2 JP3237683B2 (ja) | 2001-12-10 |
Family
ID=16626009
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21264193A Expired - Fee Related JP3237683B2 (ja) | 1993-08-27 | 1993-08-27 | フレーム同期制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3237683B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006310986A (ja) * | 2005-04-26 | 2006-11-09 | Ntt Docomo Inc | 送受信機及び送受信方法 |
| JP2011501526A (ja) * | 2007-10-12 | 2011-01-06 | クゥアルコム・インコーポレイテッド | フェムトセルの同期及びパイロット探索方法 |
-
1993
- 1993-08-27 JP JP21264193A patent/JP3237683B2/ja not_active Expired - Fee Related
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| US7855994B2 (en) | 2005-04-26 | 2010-12-21 | Ntt Docomo, Inc. | Radio transceiver and radio transmitting method |
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| JP2015043598A (ja) * | 2007-10-12 | 2015-03-05 | クゥアルコム・インコーポレイテッドＱｕａｌｃｏｍｍ Ｉｎｃｏｒｐｏｒａｔｅｄ | フェムトセルの同期及びパイロット探索方法 |
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| JP3237683B2 (ja) | 2001-12-10 |
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