JPH07324947A - 分解能増倍回路 - Google Patents

分解能増倍回路

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JPH07324947A
JPH07324947A JP7122533A JP12253395A JPH07324947A JP H07324947 A JPH07324947 A JP H07324947A JP 7122533 A JP7122533 A JP 7122533A JP 12253395 A JP12253395 A JP 12253395A JP H07324947 A JPH07324947 A JP H07324947A
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voltage
peak
valley
voltages
threshold
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JP7122533A
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Inventor
A John Santos
ジョン サントス エイ
Mark E Lacroix
イー ラクロイックス マーク
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Timken US LLC
Original Assignee
Torrington Co
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    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01D—MEASURING NOT SPECIALLY ADAPTED FOR A SPECIFIC VARIABLE; ARRANGEMENTS FOR MEASURING TWO OR MORE VARIABLES NOT COVERED IN A SINGLE OTHER SUBCLASS; TARIFF METERING APPARATUS; MEASURING OR TESTING NOT OTHERWISE PROVIDED FOR
    • G01D5/00—Mechanical means for transferring the output of a sensing member; Means for converting the output of a sensing member to another variable where the form or nature of the sensing member does not constrain the means for converting; Transducers not specially adapted for a specific variable
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    • G01D5/142—Mechanical means for transferring the output of a sensing member; Means for converting the output of a sensing member to another variable where the form or nature of the sensing member does not constrain the means for converting; Transducers not specially adapted for a specific variable using electric or magnetic means influencing the magnitude of a current or voltage using Hall-effect devices
    • G—PHYSICS
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    • G01D5/24404—Interpolation using high frequency signals

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  • General Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Transmission And Conversion Of Sensor Element Output (AREA)
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Abstract

(57)【要約】 （修正有） 【目的】 速度及び変位センサからの出力信号の分解能
を電気的に増倍する回路を提供する。 【構成】 少なくとも二つのアナログセンサ１１、１２
からの信号のピーク及び谷電圧をこの回路によって保持
する。複数のしきい電圧がそれぞれのアナログセンサ１
１、１２の先行ピーク及び谷電圧から発生される。各セ
ンサの信号をそれぞれのしきい電圧と比較して各センサ
ごとに一列の出力遷移を作る。これらの出力遷移は各ア
ナログセンサ１１、１２からの各出力遷移列が他のアナ
ログセンサの出力遷移列の間に起こるように結合され
る。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は一般的にいえば、分解能
増大回路に関し、さらに具体的にいえば、速度センサ及
び変位センサからの出力信号の分解能を増倍する回路に
関する。
【０００２】
【従来の技術】従来、速度センサ又は変位センサに関す
る分解能の増大は機械的増倍によって達成された。例え
ば、磁極とデジタルホール効果センサがデータの各点を
作るのに用いられる場合、追加の磁極又はセンサがデー
タ点間の間隔を密にするために最初の磁極又はセンサの
間に追加されることがある。そのようにして増大した分
解能は、追加の磁極とセンサのための空間必要条件及び
追加の構成要素の関連のコストによって制限される。
【０００３】空間要求条件とコストのほかに、デジタル
センサの転換点の固有ドリフチングが検知装置の不正確
さを招き、特にすべてのセンサが時間、温度及びその他
の条件に関して同じ具合にドリフトしないことがある点
にその原因がある。動作中の空隙、センサ利得、信号振
幅及び磁界のバイアスの変動もまた検知装置の精度を下
げることがある。
【０００４】速度センサ又は変位センサに関する分解能
を大きくするもう一つの公知の方法は、中間データ点を
電子的に作るために二つ以上のセンサからの信号を比較
することである。例えば、位相が９０度異なる信号を作
るために二つのセンサを置くとき、信号を種々のパーセ
ンテージで結合して追加のデータ点を補間法で与えるこ
とができる。しかし、二つのセンサの信号が同じように
してドリフトしない場合、中間点は正確に位置を定めら
れない。
【０００５】
【発明が解決しようとする課題】前述のことは現在の装
置と方法にあると知られている欠点を例示している。従
って、前述の欠点の一つ以上を解消することを目的とし
た代替品を提供することが好都合であることは明かであ
る。それゆえ、後でさらに完全に開示する特徴を備える
適当な代替品が提供される。
【０００６】
【課題を解決するための手段】発明の一つの面におい
て、これはあらかじめ定めた電気分離角を有する複数の
アナログセンサとともに用いる分解増倍回路を提供する
ことによって達成される。ピーク保持手段がそれぞれの
アナログセンサからの信号の先行ピーク電圧を保持し、
谷保持手段がそれぞれのアナログセンサからの信号の先
行谷電圧を保持する。しきい値発生手段がそれぞれのア
ナログセンサの先行ピーク及び谷電圧から複数のしきい
電圧を発生する。電圧比較手段がアナログセンサからの
信号をそれぞれのしきい電圧に比較して出力遷移の列作
る。結合手段が出力遷移を結合して各センサからの各出
力遷移列が他のアナログセンサの出力遷移列シーケンス
の間に起こるようにする。
【０００７】発明のも一つの面において、任意選択のピ
ーク及び谷保持リセット回路が設けられる。
【０００８】
【実施例】前述及びその他の面は、添付図面と共に考慮
するとき発明の以下の詳細な説明から明かになる。
【０００９】次に、図面を参照すると、図１のブロック
線図は、あらかじめ定めた電気分離角で配置された二つ
のアナログセンサ１０及び１２、例えばホール効果セン
サ、を例示している。この線図において、あらかじめ定
めた電気分離角は９０°であり、アナログセンサ１０及
び１２はそれぞれＨａｌｌ Ａ 及びＨａｌｌ Ｂと記
されている。その他の形式のアナログセンサ及び位置決
めを用いても同様の効果を得ることができる。
【００１０】アナログセンサ１０及び１２の信号は、例
えば、図２の最上部に示されているように９０°の位相
角を持った正弦波Ａ及びＢであってもよい。ピーク保持
手段１４及び谷保持手段１６は、信号Ａのそれぞれ先行
ピーク及び谷電圧を検知してそれらの電圧を基準値とし
て保持する。同様に、ピーク保持手段１８及び谷保持手
段２０は、信号Ｂのそれぞれ先行ピーク及び谷電圧を検
知してそれらの電圧を基準値として保持する。
【００１１】任意選択のピークリセット論理回路２２を
用いてピーク及び谷基準電圧をリセットできるように各
周期の端の前に基準電圧を放電させてもよい（図２に示
されているように）。本発明の実施に必要でないが、ピ
ークリセット論理回路２２を追加して信号Ａ及びＢの利
得又は振幅の変化に一定の補償を行い、それによって信
号Ａ又は信号Ｂの電圧が上下にドリフトしたとき検知装
置の精度を大きくすることができる。
【００１２】分圧手段２４、２６及び２８は信号Ａの基
準電圧を分割して信号Ａのピーク及び谷電圧の平均値
と、その平均値とピーク電圧の中間と、その平均値と谷
電圧の中間でしきい電圧を与える。同様に、分圧手段３
０、３２及び３４は信号Ｂの基準電圧を分割して信号Ｂ
のピーク及び谷電圧の平均値と、その平均値とピーク電
圧の中間と、その平均値と谷電圧の中間でしきい電圧を
与える。
【００１３】信号Ａから生成されたしきい電圧は比較器
３６に加えられて図２に示された出力ａ，ｂ及びｃを作
る。同様に、信号Ｂから生成されたしきい電圧は比較器
３８に加えられて出力ｄ，ｅ及びｆを作る。排他的論理
和回路４０は比較器３６と３８の出力を結合して、本発
明の恩恵を受けていないアナログセサ１０の分解能の６
倍を有し、図２の一番下に示された高分解能出力を作
る。
【００１４】任意選択ピークリセット論理回路２２は比
較的３６と３８の出力を結合して、図２に示されたピー
クリセットパルスＰＡ、ＰＢ、ＶＡ及びＶＢを作る。例
えば、ピークリセットパルスＰＡ、ＰＢ、ＶＡおよびＶ
Ｂは、それぞれ反転ｃ ＡＮＤ ｄ、反転ｃ ＡＮＤ
反転ｆ、ａ ＡＮＤ 反転ｆ及びａ ＡＮＤ ｄの論理
積演算に対応しそれらが新しいピーク及び谷電圧の前に
最後に必要になったときにピーク及び谷基準電圧を放電
する。代りに、放電点を次のピーク又は谷により近いも
っと遅い点に設定してもよい。
【００１５】コンデンサ５０にある予想ピーク保持電圧
は、電圧フォロア４８及び抵抗６２を介して増幅器４４
の反転入力に加わる帰還として保持される。アナログセ
ンサ１０からの信号が抵抗４２を通して増幅器４４の非
反転入力に与えられると、増幅器４４の出力はコンデン
サ帯電電圧が決して入力センサ電圧以下にならないよう
にダイオード４６を介してコンデンサ５０を充電する。
ダイオード４６はピークが保持されるようにコンデンサ
５０の充電だけを許す。
【００１６】コンデンサ６０にある予想谷保持電圧は、
電圧フォロア５８及び抵抗６４を介して増幅器５４の反
転入力に加わる帰還として保持される。アナログセンサ
１０からの信号が抵抗５２を通して増幅器５４の非反転
入力に与えられると、増幅器５４の出力はコンデンサ帯
電電圧が決して入力センサ電圧以下にならないようにダ
イオード５６を介してコンデンサ６０を充電する。ダイ
オード５６はピークが保持されるようにコンデンサ６０
の充電だけを許す。
【００１７】分圧手段２４、２６及び２８は、直列に接
続された４個の精密１％１Ｋ抵抗６６、６８、７０及び
７２を備えている。抵抗６８と７０の間の出力がピーク
保持手段１４と谷保持手段１６の基準電圧の平均（中
間）であり、比較器７６に加えられる。抵抗６６と６８
の間の出力はその平均値とピーク保持手段１４の基準電
圧との中間であり、比較器７４に加えられる。抵抗７０
と７２の間の出力はその平均値と谷保持手段１６の基準
電圧との中間であり、比較器７８に加えられる。信号Ａ
は１Ｋ抵抗８０、８２及び８４をそれぞれ介して比較器
７４、７６及び７８の他方の入力に加えられる。１２０
Ｋ、１００Ｋ及び１２０Ｋの値をそれぞれ持ったヒステ
リシス帰還抵抗８６、８８及び９０並びに１０Ｋプルア
ップ抵抗９２、９４及び９６は図１の比較器３６の構成
要素の全部である。比較器７４の出力は図２の出力ｃと
して、比較器７６の出力は図２の出力ｂとして、比較器
７８の出力は図２の出力ａとして示されている。
【００１８】アナログセンサ１２からの信号Ｂは、信号
Ａに関して今説明したものと同様にして独立に処理され
る。コンデンサ１０６にある予想ピーク保持電圧は、電
圧フォロア１０４及び抵抗１１８を介して増幅器１００
の反転入力に加わる帰還として保持される。アナログセ
ンサ１２からの信号が抵抗９８を通して増幅器１００の
非反転入力に与えられると、増幅器１００の出力はコン
デンサ帯電電圧が決して入力センサ電圧以下にならない
ようにダイオード１０２を介してコンデンサ１０６を充
電する。ダイオード１０２はピークが保持されるように
コンデンサ１０６の充電だけを許す。
【００１９】コンデンサ１１６にある予想谷保持電圧
は、電圧フォロア１１４及び抵抗１２０を介して増幅器
１１０の反転入力に加わる帰還として保持される。アナ
ログセンサ１２からの信号が抵抗１０８を通して増幅器
１１０の非反転入力に与えられると、増幅器１１０の出
力はコンデンサ帯電電圧が決して入力センサ電圧以下に
ならないようにダイオード１１２を介してコンデンサ１
１６を充電する。ダイオード１１２はピークが保持され
るようにコンデンサ１１６の充電だけを許す。
【００２０】分圧手段３０、３２及び３４は、直列に接
続された４個の精密１％１Ｋ抵抗１２２、１２４、１２
６及び１２８を備えている。抵抗１２４と１２６の間の
出力がピーク保持手段１８と谷保持手段２０の基準電圧
の平均（中間）であり、比較器１３２に加えられる。抵
抗１２２と１２４の間の出力はその平均値とピーク保持
手段１８の基準電圧との中間であり、比較器１３０に加
えられる。抵抗１２６と１２８の間の出力はその平均値
と谷保持手段２０の基準電圧との中間であり、比較器１
３４に加えられる。
【００２１】信号Ａは１Ｋ抵抗１３６、１３８及び１４
０をそれぞれ介して比較器１３０、１３２及び１３４の
他方の入力に加えられる。１２０Ｋ、１００Ｋ及び１２
０Ｋの値をそれぞれ持ったヒステリシス帰還抵抗１４
２、１４４及び１４６並びに１０Ｋプルアップ抵抗１４
８、１５０及び１５２は図１の比較器３８の構成要素の
全部である。比較器１３０の出力は図２の出力ｆとし
て、比較器１３２の出力は図２の出力ｅとして、比較器
１３４の出力は図２の出力ｄとして示されている。出力
ａ及びｃは排他的論理和回路１５４に加えられ、出力ｄ
及びｆは排他的論理和回路１５６に加えられ、出力ｂ及
びｃは排他的論理和回路１５８に加えられる。排他的論
理和回路１５４及び排他的論理和回路１５６の出力は排
他的論理和回路１６０に加えられ、排他的論理和回路１
５８及び排他的論理和回路１６０の出力は排他的論理和
回路１６２に加えられる。排他的論理和回路１６２の出
力は所望の高分解能出力である。
【００２２】任意選択リセット論理回路２２は出力ａ及
びｄをそれぞれ反転する排他的論理和回路１６４及び排
他的論理和回路１６６並びにＡＮＤゲート１６８、１７
０、１７２及び１７４からなっている。排他的論理和回
路１６４の出力及び出力ｄはＡＮＤゲート１６８によっ
て論理積演算されてリセットパルスＶＡを作る。排他的
論理和回路１６４及び排他的論理和回路１６６の出力は
ＡＮＤゲート１７０によって論理積演算されてリセット
パルスＶＢを作る。排他的論理和回路１６６の出力及び
出力ａはＡＮＤゲート１７２によって論理積演算されて
リセットパルスＰＡを作る。そして、出力ｃ及びｄはＡ
ＮＤゲート１７４によって論理積演算されてリセットパ
ルスＰＡを作る。
【００２３】リセットパルスＶＡ、ＶＢ、ＰＡ及びＰＢ
は、それぞれアナログスイッチ１７６、１７８、１８０
及び１８２に加えられる。図２に示されているように、
リセットパルスはスイッチに適当なコンデンサを充電又
は放電させて信号Ａ又は信号Ｂのどちらかの電圧に等し
い電圧を作る。
【００２４】等しい値の抵抗６６、６８、７０及び７２
は、上述の信号Ａ及びＢの例示された正弦波形に一致す
るように選択されて時間的に等間隔になっているデータ
点を発生する。すなわち、三つのしきい電圧が電気角
０、３０、１５０、１８０、２１０及び３３０度で出力
遷移を発生する。抵抗１２２、１２４、１２６及び１２
８は、６０、９０、１２０、２４０、２７０及び３００
度に出力遷移をもたらす。信号ＡとＢが異なる形をして
いるとき、それらの抵抗の相対値は結果として生ずるデ
ータ点が時間的に等間隔になることを確実にするように
調節できる。
【００２５】重要なことは、信号Ａ及びＢは、信号Ａに
起因する出力遷移のシーケンスが（時間的に）信号Ｂか
らの出力遷移のシーケンスの間に起こるように独立に処
理されることである。結果として、信号Ａ及びＢが利得
のドリフトを生ずるか又は不同又は反対の方法でオフセ
ットするとき、出力信号遷移は等間隔のままである。
図３に示された特定の適用においては、適当なアナログ
センサ１０及び１２は、例えば０．５〜４．０Ｖピーク
ピークの信号を持ったホール効果形のものであってもよ
く、コンデンサ５０、６０、１０６及び１１６は各々
３．３μＦの値を持っていてもよい。増幅器４４、５
４、１００及び１１０並びに電圧フォロア４８、５８、
１０４及び１１４は標準ＬＭ３２４回路によって与えら
れてもよく、スイッチ１７６、１７８、１８０及び１８
２は標準ＣＤ４０１６回路によって与えられてもよく、
比較器７４、７６、７８、１３０、１３２及び１３４は
標準ＬＭ３３９回路によって与えられてもよい。それら
の構成要素はカリフオルニア州サンタクララのナショナ
ル・セミコンダクタ・コーポレーション及びその他の供
給源から容易に入手できる。
【００２６】三つのしきい電圧を発生する代りに、本発
明の分解能増倍回路は先行ピーク及び谷電圧を分割し、
それぞれのアナログセンサの信号と比較するためにそれ
らの値を保持することによって２、４又は別の数のしき
い電圧を発生してもよい。二つのしきい電圧しか用いな
い場合、例えば、二つのアナログセンサは最初の分解能
の４倍を与えるであろう。四つのしきい電圧を用いれ
ば、二つのアナログセンサは最初の分解能の８倍を与え
るであろう。
【００２７】アナログセンサの数は図１〜３に示された
二つのセンサに限られない。例えば、三つのアナログセ
ンサは電気角６０°のあらかじめ定めた電気分離角で用
いることができる。さらに一般的にいえば、電気分離角
はＮをアナログセンサの数とし、ｎを整数又はゼロとす
るとき、１８０／Ｎ＋１８０ｎとして表わされる。従っ
て任意の数のアナログセンサを本発明を実施するために
信号経路に沿って分布できる。信号経路は回転磁気符号
器リングの場合のように、環状であってもよいし、又は
直線状でも良い。
【００２８】電気分離角９０°にある二つのアナログセ
ンサから三つのしきい電圧を発生する図３に示された特
定の実施例によって作られた出力遷移は電気角０、３
０、１５０、１８０、２１０及び３３０°で起こる。二
つのしきい電圧が電気分離角９０°にある二つのアナロ
グセンサから発生されれば、出力遷移は電気角２２．
５、１５７．５、２０２．５及び３３７．５°で起こ
る。他の出力遷移は、追加のアナログセンサしきい電圧
が用いられる場合に作られる。
【００２９】
【発明の効果】上述のことから、本発明は速度及び変位
センサからの出力信号の分解能の増倍を追加の磁極又は
センサを用いないで与えることが明かである。アナログ
センサが用いられるので、デジタルセンサ転換点のドリ
フチングに固有の問題が避けられる。センサからの信号
の利得又は振幅が互いに対してドリフトしても、本発明
は一定の保証を与えて速度又は変位の正確な指示を確実
にする。
【図面の簡単な説明】
【図１】 ファンタム図で表された任意選択ピークリセ
ット論理回路を持った本発明の一つの実施例をブロック
線図である。
【図２】 図１のブロック線図に対応するタイミング波
形のグラフである。
【図３】 図１のブロック線図に対応する適用特種回路
を例示する概要図である。
【符号の説明】
１０、１２ アナログセンサ １４、１８ ピーク保持手段 １６、２０ 谷保持回路 ２４〜３４ 分圧手段 ３６、３８ 比較器 ４０ 排他的論理和回路
───────────────────────────────────────────────────── フロントページの続き (72)発明者 マーク イー ラクロイックス アメリカ合衆国コネチカット州06057 ニ ュー ハートフォード ヘイワード ロー ド 24

Claims (13)

    【特許請求の範囲】
  1. 【請求項１】 ９０°の電気分離角を有する第１及び第
    ２のアナログセンサと共に用いる回路で、前記回路が、 前記第１及び第２のアナログセンサからの信号の先行ピ
    ーク電圧をそれぞれ保持する第１及び第２のピーク保持
    手段と、 前記第１及び第２のアナログセンサからの信号の先行谷
    電圧をそれぞれ保持する第１及び第２の谷保持手段と、 前記第１及び第２のアナログセンサの前記先行ピーク及
    び谷電圧から複数のしきい電圧をそれぞれ独立に発生す
    る第１及び第２のしきい値発生手段と、 前記第１及び第２のアナログセンサからの信号をそれぞ
    れのしきい値発生手段のしきい電圧と独立に比較して数
    列の出力遷移を作る電圧比較手段と、 前記第１のアナログセンサからの各一列の出力遷移が前
    記第２のアナログセンサからの出力遷移列の間に起こる
    ように前記出力遷移を結合する結合手段とを備える分解
    能増倍回路。
  2. 【請求項２】 各しきい値発生手段が三つのしきい電圧
    を、一つは前記それぞれのアナログセンサからの信号の
    先行ピーク及び谷電圧の平均値のところに、一つは前記
    平均値とそれぞれの先行ピーク電圧の間の中間に、そし
    て一つは前記平均値とそれぞれの先行谷電圧の間の中間
    に作る請求項１に記載の分解能増倍回路。
  3. 【請求項３】 各しきい値発生手段が二つのしきい電圧
    を、一方は前記それぞれのアナログセンサからの信号の
    先行ピーク及び谷電圧の平均値に前記平均値とそれぞれ
    の先行ピーク電圧の差の３８％を加えたところに、他方
    は前記平均値より前記平均値とそれぞれの先行谷電圧の
    間の差の３８％少ないところに作る請求項１に記載の分
    解能増倍回路。
  4. 【請求項４】 しきい電圧を発生した後で前記第１及び
    第２のピーク保持手段と前記第１及び第２の谷保持手段
    を放電し、新しいピーク及び谷電圧を設定するリセット
    手段をさらに備える請求項１に記載の分解能増倍回路。
  5. 【請求項５】 あらかじめ定めた電気分離角を有する複
    数のアナログセンサと共に用いる回路で、前記回路が、 おのおのがそれぞれのアナログセンサからの信号の先行
    ピーク電圧を保持する複数のピーク保持手段と、 おのおのがそれぞれのアナログセンサからの信号の先行
    谷電圧を保持する複数の谷保持手段と、 前記それぞれのアナログセンサの前記先行ピーク及び谷
    電圧から複数のしきい電圧をそれぞれ独立に発生するし
    きい値発生手段と、 前記アナログセンサからの信号を前記それぞれのしきい
    電圧と独立に比較して数列の出力遷移を作る電圧比較手
    段と、 各アナログセンサからの各一列の出力遷移が他のアナロ
    グセンサからの出力遷移列の間に起こるように前記出力
    遷移を結合する結合手段とを備える分解能増倍回路。
  6. 【請求項６】 前記各アナログセンサのあらかじめ定め
    た電気分離角がアナログセンサの数の関数であり、前記
    電気分離角はＮをアナログセンサの数とし、ｎを整数又
    はゼロとするとき、 １８０／Ｎ ＋ １８０ｎ によって表される請求項５に記載の分解能増倍回路。
  7. 【請求項７】 アナログセンサの数が３であり、前記ア
    ナログセンサのあらかじめ定めた電気分離角が６０°で
    ある請求項５に記載の分解能増倍回路。
  8. 【請求項８】 アナログセンサの数が２であり、前記ア
    ナログセンサのあらかじめ定めた電気分離角が９０°で
    ある請求項５に記載の分解能増倍回路。
  9. 【請求項９】 しきい電圧を発生した後で前記複数のピ
    ーク保持手段と前記複数の谷保持手段を放電し、新しい
    ピーク及び谷電圧を設定するリセット手段をさらに備え
    る請求項５に記載の分解能増倍回路。
  10. 【請求項１０】 ９０°の電気分離角を有する第１及び
    第２のアナログセンサと共に用いる回路で、前記回路
    が、 前記第１のアナログセンサからの信号の先行ピーク電圧
    を保持する第１のピーク保持手段と、 前記第１のアナログセンサからの信号の先行谷電圧を保
    持する第１の谷保持手段と、 前記第１のアナログセンサからの先行ピーク及び谷電圧
    の平均値のところと、前記平均値と前記先行ピーク電圧
    の間の中間と、前記平均値と前記先行谷電圧の間の中間
    とに二つのしきい電圧を発生する第１のしきい値発生手
    段と、 前記第１のアナログセンサからの信号を前記三つのしき
    い電圧と比較して電気角０、３０、１５０、１８０、２
    １０及び３３０°に出力遷移を作る第１の電圧比較手段
    と、 前記第２のアナログセンサからの信号の先行ピーク電圧
    を保持する第２のピーク保持手段と、 前記第２のアナログセンサからの信号の先行谷電圧を保
    持する第２の谷保持手段と、 前記第２のアナログセンサからの先行ピーク及び谷電圧
    の平均値のところと、前記平均値と前記先行ピーク電圧
    の間の中間と、前記平均値と前記先行谷電圧の間の中間
    とに三つのしきい電圧を発生する第２のしきい値発生手
    段と、 前記第２のアナログセンサからの信号を前記三つのしき
    い電圧と比較して電気角６０、９０、１２０、２４０、
    ２７０及び３００°に出力遷移を作る第２の電圧比較手
    段と、 一つの出力信号が電気角０、３０、６０、９０、１２
    ０、１５０、１８０、２１０、２４０、２７０、３００
    及び３３０°にある出力遷移で作られるように、前記第
    １及び第２の電圧比較手段の前記出力遷移を結合する結
    合手段とを備える分解能増倍回路。
  11. 【請求項１１】 しきい電圧を発生した後で前記第１及
    び第２のピーク保持手段と前記第１及び第２の谷保持手
    段を放電し、新しいピーク及び谷電圧を設定するリセッ
    ト手段をさらに備える請求項１０に記載の分解能増倍回
    路。
  12. 【請求項１２】 ９０°の電気分離角を有する第１及び
    第２のアナログセンサと共に用いる回路で、前記回路
    が、 前記第１のアナログセンサからの信号の先行ピーク電圧
    を保持する第１のピーク保持手段と、 前記第１のアナログセンサからの信号の先行谷電圧を保
    持する第１の谷保持手段と、 前記第１のアナログセンサの先行ピーク及び谷電圧の平
    均値に前記平均値と前記第１のアナログセンサの先行ピ
    ーク電圧の差の３８％を加えたところと、前記平均値よ
    り前記平均値と前記第１のアナログセンサの先行谷電圧
    の間の差の３８％少ないところとに二つのしきい電圧を
    作る第１のしきい値発生手段と、 前記第１のアナログセンサからの信号を前記二つのしき
    い電圧と比較して電気角２２．５、１５７．５、２０
    ２．５、及び３３７．５°に出力遷移を作る第１の電圧
    比較手段と、 前記第２のアナログセンサからの信号の先行ピーク電圧
    を保持する第２のピーク保持手段と、 前記第２のアナログセンサからの信号の先行谷電圧を保
    持する第２の谷保持手段と、 前記第２のアナログセンサの先行ピーク及び谷電圧の平
    均値に前記平均値と前記第２のアナログセンサの先行ピ
    ーク電圧の差の３８％を加えたところと、前記平均値よ
    り前記平均値と前記第２のアナログセンサの先行谷電圧
    の間の差の３８％少ないところとに二つのしきい電圧を
    発生する第２のしきい値発生手段と、 前記第２のアナログセンサからの信号を前記二つのしき
    い電圧と比較して電気％少ないところとに二つのしきい
    電圧を発生する第２のしきい値発生手段と、 前記第２のアナログセンサからの信号を前記二つのしき
    い電圧と比較して電気角６７．５、１１２．５、２４
    ７．５及び２９２．５°に出力遷移を作る第２の電圧比
    較手段と、 一つの出力信号が電気角２２．５、６７．５、１１２．
    ５、１５７．５、２０２．５、２４７．５、２９２．５
    及び３３７．５°にある出力遷移で作られるように、前
    記第１及び第２の電圧比較手段の前記出力遷移を結合す
    る結合手段とを備える分解能増倍回路。
  13. 【請求項１３】 しきい電圧を発生した後で前記第１及
    び第２のピーク保持手段と前記第１及び第２の谷保持手
    段を放電し、新しいピーク及び谷電圧を設定するリセッ
    ト手段をさらに備える請求項１２に記載の分解能増倍回
    路。
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