JPH07297354A - 集積回路及び集積回路のピン割り当て方法及び実装方法 - Google Patents
集積回路及び集積回路のピン割り当て方法及び実装方法Info
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- JPH07297354A JPH07297354A JP7093134A JP9313495A JPH07297354A JP H07297354 A JPH07297354 A JP H07297354A JP 7093134 A JP7093134 A JP 7093134A JP 9313495 A JP9313495 A JP 9313495A JP H07297354 A JPH07297354 A JP H07297354A
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- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
- Y02P70/00—Climate change mitigation technologies in the production process for final industrial or consumer products
- Y02P70/50—Manufacturing or production processes characterised by the final manufactured product
Abstract
(57)【要約】
【目的】大規模集積回路の表面実装等に向く高密度実装
用のピン割り当てと実装方法 【構成】集積回路の中心を通る直線Xに関しての鏡像を
有するピン割り当ての組AとB,C.D等を備えるよう
にする。回路基板の同一面上では互いに180度回転し
た位置をとるように二つの集積回路を配置し、異なる面
に配置する場合は同一ピン割り当てが直接対向するよう
にそれぞれを配置する。
用のピン割り当てと実装方法 【構成】集積回路の中心を通る直線Xに関しての鏡像を
有するピン割り当ての組AとB,C.D等を備えるよう
にする。回路基板の同一面上では互いに180度回転し
た位置をとるように二つの集積回路を配置し、異なる面
に配置する場合は同一ピン割り当てが直接対向するよう
にそれぞれを配置する。
Description
【0001】
【産業上の利用分野】本発明は集積回路構成に関し、更
に詳細には、鏡像ピン割り当てを有する集積回路パッケ
ージ構成を通るリードの経路を決定する方法の改良に関
する。
に詳細には、鏡像ピン割り当てを有する集積回路パッケ
ージ構成を通るリードの経路を決定する方法の改良に関
する。
【0002】
【従来の技術】印刷回路(PC)板上の集積回路(I
C)間のリードの経路決定はPC板構成のコストおよび
性能の双方において重要な役割を演ずる。PC板を製造
するコストはIC間ですべてのリードの経路を効果的に
決めるのに必要な層数に直接関係している。リードの数
を減少させ、そしてリードの長さとリード間の干渉の可
能性を調和できればPC板の性能を高めることができ
る。PC板上のICの密度が増大し、ICあたりのピン
割り当ておよび関連するリードの数が多くなるにつれ
て、リードの経路の決定は益々難しくなる。
C)間のリードの経路決定はPC板構成のコストおよび
性能の双方において重要な役割を演ずる。PC板を製造
するコストはIC間ですべてのリードの経路を効果的に
決めるのに必要な層数に直接関係している。リードの数
を減少させ、そしてリードの長さとリード間の干渉の可
能性を調和できればPC板の性能を高めることができ
る。PC板上のICの密度が増大し、ICあたりのピン
割り当ておよび関連するリードの数が多くなるにつれ
て、リードの経路の決定は益々難しくなる。
【0003】1980年代半ばに、表面実装技術(SM
T)および両面SMTが標準スルーホールPC板技術に
代わって導入された。ICのピンを受け入れるための前
準備としてPC板に穿孔する代わりに、ICをPC板に
糊付けするためにICの特殊なパッケージ方法が開発さ
れた。ピンをPC板の反対側に通し、ICを所定位置に
半田付けする必要が無くなったので、ICをPC板の両
面に実装することも可能になった。
T)および両面SMTが標準スルーホールPC板技術に
代わって導入された。ICのピンを受け入れるための前
準備としてPC板に穿孔する代わりに、ICをPC板に
糊付けするためにICの特殊なパッケージ方法が開発さ
れた。ピンをPC板の反対側に通し、ICを所定位置に
半田付けする必要が無くなったので、ICをPC板の両
面に実装することも可能になった。
【0004】SMTはリードの経路決定の効率を高める
のに役立つとは言え、PC板上のICの全数が両面SM
Tとともに二倍になったので、問題はなお存在してい
る。ICを相互接続するに必要なリードの数はPC板上
のICの全個数とともに増大する他、大規模集積(VL
SI)化(最大1,000,000個程度の構成要素を現在一つ
のICに集積することができる)の進展とともに増大す
る。標準の1メガバイトのメモリーチップには44のピン
割り当てがあり、特注のメモリーコントローラーチップ
には200を超えるピン割り当てがあることがあり、2.5セ
ンチメートル平方に近付いているマルチチップモジュー
ル(MCM)は500を超えるピン割り当てを備えること
ができる。
のに役立つとは言え、PC板上のICの全数が両面SM
Tとともに二倍になったので、問題はなお存在してい
る。ICを相互接続するに必要なリードの数はPC板上
のICの全個数とともに増大する他、大規模集積(VL
SI)化(最大1,000,000個程度の構成要素を現在一つ
のICに集積することができる)の進展とともに増大す
る。標準の1メガバイトのメモリーチップには44のピン
割り当てがあり、特注のメモリーコントローラーチップ
には200を超えるピン割り当てがあることがあり、2.5セ
ンチメートル平方に近付いているマルチチップモジュー
ル(MCM)は500を超えるピン割り当てを備えること
ができる。
【0005】回路板の配置は一般に、回路図からICを
それぞれ分離された領域に組み分けする幾何学的配置へ
と進む。ICを結合するリードを配置してリードの交差
の可能性を排除する。リードの経路決定は3次元の問題
であり、チップ密度および関連リード密度の増加ととも
に非常に複雑になる。リードの交差は回路板に別の層を
追加してリードを貫通孔(ビア)を通して異なるレベル
に配置し直すことができるようにすることにより典型的
に排除することができる。貫通孔とは回路板を部分的に
貫通してリードを一方の板レベルから他方に走行するこ
とができるようにする孔を記述するのに使用される用語
である。その他に、リードの経路決定は最大長さおよび
リードの長さの間の一貫性のような制約に備えなければ
ならないので更に複雑になることさえある。
それぞれ分離された領域に組み分けする幾何学的配置へ
と進む。ICを結合するリードを配置してリードの交差
の可能性を排除する。リードの経路決定は3次元の問題
であり、チップ密度および関連リード密度の増加ととも
に非常に複雑になる。リードの交差は回路板に別の層を
追加してリードを貫通孔(ビア)を通して異なるレベル
に配置し直すことができるようにすることにより典型的
に排除することができる。貫通孔とは回路板を部分的に
貫通してリードを一方の板レベルから他方に走行するこ
とができるようにする孔を記述するのに使用される用語
である。その他に、リードの経路決定は最大長さおよび
リードの長さの間の一貫性のような制約に備えなければ
ならないので更に複雑になることさえある。
【0006】回路の速さが増すにつれて、各リードの長
さに亘る分布キャパシタンスおよびインダクタンスが各
リードを伝送線のように動作させる。全体のリード長を
減らせば回路板からの有害な電波放射が減少する。漏話
(活動線と隣接受動線との間の不必要な結合)が相互イ
ンダクタンスまたはキャパシタンスにより生ずることが
ある。漏話は、活動線で信号強度の損失を、および隣接
線で干渉または不正トリガーを生ずることもある。隣接
リードが同じ平面上に設置されていると横方向の漏話が
生ずることがある。誘電体積層の対向面上に設置された
リード間では垂直漏話を生ずることがある。漏話は隣接
リード間の距離を増すか、または平行リード部分の長さ
を減らすことにより極小にすることができる。垂直漏話
は隣接層上でリードを直交して引き回すことにより究極
的に排除することができる。
さに亘る分布キャパシタンスおよびインダクタンスが各
リードを伝送線のように動作させる。全体のリード長を
減らせば回路板からの有害な電波放射が減少する。漏話
(活動線と隣接受動線との間の不必要な結合)が相互イ
ンダクタンスまたはキャパシタンスにより生ずることが
ある。漏話は、活動線で信号強度の損失を、および隣接
線で干渉または不正トリガーを生ずることもある。隣接
リードが同じ平面上に設置されていると横方向の漏話が
生ずることがある。誘電体積層の対向面上に設置された
リード間では垂直漏話を生ずることがある。漏話は隣接
リード間の距離を増すか、または平行リード部分の長さ
を減らすことにより極小にすることができる。垂直漏話
は隣接層上でリードを直交して引き回すことにより究極
的に排除することができる。
【0007】同じ形式のICを二つ以上組み込んでいる
回路板では、回路板の複雑さ、交差および漏話に関連す
る問題は、二つの同じではあるが逆のピン割り当てを備
えて設計された集積回路の対を使用することにより極小
にすることができる。図1に示すように、Intelにより
販売されている8Mビットフラッシュモリー(F28F008S
A)は標準ピン割り当て(図1A)および逆ピン割り当
て(図1B)の双方の構成で提供されている。メモリー
チップを蛇行レイアウト上に交互に配置する(図2)こ
とにより、相互接続リードの交差および長さが極小にな
るので、逆ピン割り当ては非常に簡単な回路板配置を提
供する。残念ながら、二つの異なるICを製造し、PC
板上に正しく設置しなければならず、結果としてIC挿
入中で識別が必要である。
回路板では、回路板の複雑さ、交差および漏話に関連す
る問題は、二つの同じではあるが逆のピン割り当てを備
えて設計された集積回路の対を使用することにより極小
にすることができる。図1に示すように、Intelにより
販売されている8Mビットフラッシュモリー(F28F008S
A)は標準ピン割り当て(図1A)および逆ピン割り当
て(図1B)の双方の構成で提供されている。メモリー
チップを蛇行レイアウト上に交互に配置する(図2)こ
とにより、相互接続リードの交差および長さが極小にな
るので、逆ピン割り当ては非常に簡単な回路板配置を提
供する。残念ながら、二つの異なるICを製造し、PC
板上に正しく設置しなければならず、結果としてIC挿
入中で識別が必要である。
【0008】従来技術の他の例は、1993年12月14日、Be
chtolsheim、他に与えられた米国特許第5,270,964号に
開示されている。Bechtolsheimは200のピン割り当てを
有する単一インラインメモリーモジュール(SIMM)
を開示している。SIMMをPC板上のメモリーモジュ
ールソケットに接続するのに高密度コネクタを使用して
いる。電力および接地のすべてのリードはコネクタ内で
対称に配列されている。電力および接地のリードは16ピ
ン毎に交替し、SIMMが逆位置でメモリーモジュール
ソケットに不注意に挿入されても、対称配置の電力およ
び接地リードがSIMMを逆電力供給されないように
し、破壊から護る。
chtolsheim、他に与えられた米国特許第5,270,964号に
開示されている。Bechtolsheimは200のピン割り当てを
有する単一インラインメモリーモジュール(SIMM)
を開示している。SIMMをPC板上のメモリーモジュ
ールソケットに接続するのに高密度コネクタを使用して
いる。電力および接地のすべてのリードはコネクタ内で
対称に配列されている。電力および接地のリードは16ピ
ン毎に交替し、SIMMが逆位置でメモリーモジュール
ソケットに不注意に挿入されても、対称配置の電力およ
び接地リードがSIMMを逆電力供給されないように
し、破壊から護る。
【0009】
【発明が解決しようとする課題】したがって本発明の課
題は数百のピン割り当てを有する高密度ICおよびマル
チチップモジュールの要求に適応できるPC板上の層数
の削減とリード経路決定の簡単化を達成することであ
る。
題は数百のピン割り当てを有する高密度ICおよびマル
チチップモジュールの要求に適応できるPC板上の層数
の削減とリード経路決定の簡単化を達成することであ
る。
【0010】
【課題を解決するための手段】本発明は両面PCまたは
SMT板の各面に取り付けられた少なくとも一つのIC
を有する回路板上のIC密度の増大に備えるものであ
る。ICの一つ以上を、ピン割り当てがICパッケージ
を通る中心線に沿ってX軸またはY軸に関し互いに他の
鏡像として設置されるように構成することができる。こ
のようにして、鏡像ICパッケージが与えられる。鏡像
ピン割り当ての同じ組を有する一つ以上のICを回路板
の各面に取り付ける。新しい各ICを既に回路板の反対
面に直接設置されているICに関して180度回転する
と、同じ形式のピン割り当てが確実に互いに直接対向
し、回路板により分離されることになる。
SMT板の各面に取り付けられた少なくとも一つのIC
を有する回路板上のIC密度の増大に備えるものであ
る。ICの一つ以上を、ピン割り当てがICパッケージ
を通る中心線に沿ってX軸またはY軸に関し互いに他の
鏡像として設置されるように構成することができる。こ
のようにして、鏡像ICパッケージが与えられる。鏡像
ピン割り当ての同じ組を有する一つ以上のICを回路板
の各面に取り付ける。新しい各ICを既に回路板の反対
面に直接設置されているICに関して180度回転する
と、同じ形式のピン割り当てが確実に互いに直接対向
し、回路板により分離されることになる。
【0011】(回路板の反対面にある)同じ形式のピン
割り当てから出るリードは今や同じ方向に引き回すこと
ができ、交差に関連する問題は殆ど生じないとおもわれ
るのでリード経路決定は非常に簡単である。二つのIC
の間の同じ形式のリードの長さは必要な長さ公差内に一
層容易に維持することができる。加えて、回路板のいず
れかの面で互いに直接対向している二つのICは(接地
および電力のような)同じピン割り当てを備えており、
2倍の電流を流せるように回路板を通して結合すること
ができる。
割り当てから出るリードは今や同じ方向に引き回すこと
ができ、交差に関連する問題は殆ど生じないとおもわれ
るのでリード経路決定は非常に簡単である。二つのIC
の間の同じ形式のリードの長さは必要な長さ公差内に一
層容易に維持することができる。加えて、回路板のいず
れかの面で互いに直接対向している二つのICは(接地
および電力のような)同じピン割り当てを備えており、
2倍の電流を流せるように回路板を通して結合すること
ができる。
【0012】一般にすべてのピン割り当てが鏡像の相手
を確実に備えていることは可能ではないが、本発明は少
ない複数のピン割り当てだけが鏡像の相手を備えている
ときでさえ、有利であることを立証している。鏡像ピン
割り当てを有するICの数が増加するにつれて、本発明
の効果は大きくなる。好適実施例では、かなりな数のピ
ン割り当てが鏡像の相手を備えている。
を確実に備えていることは可能ではないが、本発明は少
ない複数のピン割り当てだけが鏡像の相手を備えている
ときでさえ、有利であることを立証している。鏡像ピン
割り当てを有するICの数が増加するにつれて、本発明
の効果は大きくなる。好適実施例では、かなりな数のピ
ン割り当てが鏡像の相手を備えている。
【0013】最後に、ICが、それに対向して設置され
ているため、同時に動作しない場合、一組のリードだけ
が情報を伝達していることになり、その結果回路板の反
対面にあるリード間の漏話は極小である。
ているため、同時に動作しない場合、一組のリードだけ
が情報を伝達していることになり、その結果回路板の反
対面にあるリード間の漏話は極小である。
【0014】
【好適実施例の説明】図3Aと図3Bとは本発明に従っ
て構成された集積回路を示す。好適には、スレーブメモ
リーコントローラーICチップ310であってX軸に関し
て鏡像を成すピン割り当てを備えている。図3AはX軸
より上部を図3BはX軸より下部を示している。特に、
接地リード1(dgnd1)はICの左上隅に設けられたピ
ン割り当て1にある。それが左下隅に鏡映されたのがピ
ン割り当て52にある接地リード5(dgnd5)である。チ
ップパッケージの周りの各種接地、電力、データ、スト
ローブ、クロック、およびアドレスのリードは互いに他
の鏡像として設置されているピン割り当てを備えてい
る。可能な場合、これらのピン割り当てをともに組み分
けしてリード交差の可能性を更に減らす。殆どのICは
下記形式の複数のピン割り当てを備えている。即ちアド
レス、データ、列アドレスストローブ、行アドレススト
ローブ、誤り訂正、書込イネーブル、リセット、および
電力の各ピンである。鏡像相手は、ICパッケージの周
りに、各形式のピン割り当てを中心線から等距離に設け
ることにより形成される。
て構成された集積回路を示す。好適には、スレーブメモ
リーコントローラーICチップ310であってX軸に関し
て鏡像を成すピン割り当てを備えている。図3AはX軸
より上部を図3BはX軸より下部を示している。特に、
接地リード1(dgnd1)はICの左上隅に設けられたピ
ン割り当て1にある。それが左下隅に鏡映されたのがピ
ン割り当て52にある接地リード5(dgnd5)である。チ
ップパッケージの周りの各種接地、電力、データ、スト
ローブ、クロック、およびアドレスのリードは互いに他
の鏡像として設置されているピン割り当てを備えてい
る。可能な場合、これらのピン割り当てをともに組み分
けしてリード交差の可能性を更に減らす。殆どのICは
下記形式の複数のピン割り当てを備えている。即ちアド
レス、データ、列アドレスストローブ、行アドレススト
ローブ、誤り訂正、書込イネーブル、リセット、および
電力の各ピンである。鏡像相手は、ICパッケージの周
りに、各形式のピン割り当てを中心線から等距離に設け
ることにより形成される。
【0015】好適実施例では、ICパッケージの左上隅
および左下隅を横断して設置されているリード形式Aは
6個のSA_ピン割り当てのグループおよび一つの接地
ピン割り当てのグループを形成しており、ICパッケー
ジの右上半および下半の半程に設置されているリード形
式Bは4個の列アドレスストローブ(CAS)信号から
成るグループおよび一つの電力ピン割り当て(dvd)
を形成している。リード形式Cも右側に、ただしX軸中
心線に一層近くに設置され、書込(WR)ピン割り当て
を形成しており、リード形式DはICパッケージの上部
および下部の大部分を領して設置され、各側で26個のア
ドレス線BAを形成している。
および左下隅を横断して設置されているリード形式Aは
6個のSA_ピン割り当てのグループおよび一つの接地
ピン割り当てのグループを形成しており、ICパッケー
ジの右上半および下半の半程に設置されているリード形
式Bは4個の列アドレスストローブ(CAS)信号から
成るグループおよび一つの電力ピン割り当て(dvd)
を形成している。リード形式Cも右側に、ただしX軸中
心線に一層近くに設置され、書込(WR)ピン割り当て
を形成しており、リード形式DはICパッケージの上部
および下部の大部分を領して設置され、各側で26個のア
ドレス線BAを形成している。
【0016】図4はSIMMモジュールバンク420とS
IMMモジュールバンク430との間に取り付けられた
(本発明に従って製造された)二つの同一のメモリーコ
ントローラーチップ410および415を備えているSMT板
400の上面図を示す。そのすべてはSIMMモジュール
バンク425とSIMMモジュールバンク435との間に取り
付けられている。円形標識418および円形標識419により
指示したように、メモリーコントローラーチップ415は
メモリーコントローラーチップ410に関して180度回転し
ている。形式Bの組および形式Cの組のピン割り当ては
X軸から等距離に設置されているので、同じ形式のリー
ドは互いに他の方を向いている。複数のリードがメモリ
ーコントローラーチップのピン割り当てをSIMMモジ
ュール425およびSIMMモジュール435に結合してい
る。
IMMモジュールバンク430との間に取り付けられた
(本発明に従って製造された)二つの同一のメモリーコ
ントローラーチップ410および415を備えているSMT板
400の上面図を示す。そのすべてはSIMMモジュール
バンク425とSIMMモジュールバンク435との間に取り
付けられている。円形標識418および円形標識419により
指示したように、メモリーコントローラーチップ415は
メモリーコントローラーチップ410に関して180度回転し
ている。形式Bの組および形式Cの組のピン割り当ては
X軸から等距離に設置されているので、同じ形式のリー
ドは互いに他の方を向いている。複数のリードがメモリ
ーコントローラーチップのピン割り当てをSIMMモジ
ュール425およびSIMMモジュール435に結合してい
る。
【0017】図5は図4に示すSMT板の下面を示す図
である。メモリーコントローラーチップ515は図4のメ
モリーコントローラーチツプ410に直接対向してSMT
板の右側に設置されている。メモリーコントローラーチ
ツプ410は左側に取り付けられている。円形標識518によ
り指示したようにメモリーコントローラーチツプ510は
その上面の相手から180度回転してそれらのピン割り当
ておよび関連するリードの経路が合致するようになって
いる。メモリーコントローラーチップ515は左側にあ
り、円形標識519により指示したようにその上面の相手
から180度回転している。更に、図示してないリードが
メモリーコントローラーチップ510および515のピン割り
当てをPC板の反対側にあるSIMMモジュール420お
よび430に結合している。リードは貫通孔を下方のレベ
ルまで通過してPC板の上面に取り付けられているSI
MMモジュールに接続を行なうことができるようにして
いる。(回路板の反対側にある)同じ形式のピン割り当
てから出るリードは同じ方向に経路を取り、交差に関連
する問題を生ずる可能性は殆ど無いからリードの経路決
定は非常に簡単になっている。二つのICの間のリード
の同じ形式に対するリード長は経路が非常に簡単である
から必要な長さ公差内に容易に維持される。その他に、
回路板のいずれかの側で互いに直接対向して設置されて
いる(接地(grd)および電力(dvd)のような)二つの
ピン割り当てが同一である場合には、2倍の電流を流せ
るように回路板を通してともに結合することができる。
である。メモリーコントローラーチップ515は図4のメ
モリーコントローラーチツプ410に直接対向してSMT
板の右側に設置されている。メモリーコントローラーチ
ツプ410は左側に取り付けられている。円形標識518によ
り指示したようにメモリーコントローラーチツプ510は
その上面の相手から180度回転してそれらのピン割り当
ておよび関連するリードの経路が合致するようになって
いる。メモリーコントローラーチップ515は左側にあ
り、円形標識519により指示したようにその上面の相手
から180度回転している。更に、図示してないリードが
メモリーコントローラーチップ510および515のピン割り
当てをPC板の反対側にあるSIMMモジュール420お
よび430に結合している。リードは貫通孔を下方のレベ
ルまで通過してPC板の上面に取り付けられているSI
MMモジュールに接続を行なうことができるようにして
いる。(回路板の反対側にある)同じ形式のピン割り当
てから出るリードは同じ方向に経路を取り、交差に関連
する問題を生ずる可能性は殆ど無いからリードの経路決
定は非常に簡単になっている。二つのICの間のリード
の同じ形式に対するリード長は経路が非常に簡単である
から必要な長さ公差内に容易に維持される。その他に、
回路板のいずれかの側で互いに直接対向して設置されて
いる(接地(grd)および電力(dvd)のような)二つの
ピン割り当てが同一である場合には、2倍の電流を流せ
るように回路板を通してともに結合することができる。
【0018】図6はメモリーコントローラーチップ610
および615をメモリーコントローラーチップ660および66
5に直接対向して取り付ける仕方を示す。メモリーコン
トローラーのピン割り当ての固有の鏡像は背中合わせの
ピン割り当てが非常に類似していることを保証してい
る。このような類似性は、典型的に同じ方向に進むリー
ドが互いに交差する必要がないからリードの経路決定を
容易にする。加えて、接地および電力のような同一リー
ドを、増加する電流に対して回路板貫通孔670を通して
ともに結合することができる。
および615をメモリーコントローラーチップ660および66
5に直接対向して取り付ける仕方を示す。メモリーコン
トローラーのピン割り当ての固有の鏡像は背中合わせの
ピン割り当てが非常に類似していることを保証してい
る。このような類似性は、典型的に同じ方向に進むリー
ドが互いに交差する必要がないからリードの経路決定を
容易にする。加えて、接地および電力のような同一リー
ドを、増加する電流に対して回路板貫通孔670を通して
ともに結合することができる。
【0019】本発明にはいろいろな変形や追加がなしう
るので、そのような例を含む実施態様を以下に列挙す
る。 (実施態様1)上面および下面を有する回路板に取り付
ける集積回路パッケージ(410、415)であって、前記集
積回路パッケージの周辺に鏡像をなして配置され、前記
集積回路パッケージの中心を通って引かれた任意の軸に
関して互いに他の鏡像として設置されている複数のピン
割り当て(1−208)と前記鏡像なさずに配置されたピ
ン割り当て(1−52)とを有し、から構成されており、
第1、第2の前記集積回路パッケージを前記回路板の上
面に取り付けて互いに他にたいして180度回転させたと
き前記鏡像を有するピン割り当てが互いに直接対向する
集積回路パッケージ。
るので、そのような例を含む実施態様を以下に列挙す
る。 (実施態様1)上面および下面を有する回路板に取り付
ける集積回路パッケージ(410、415)であって、前記集
積回路パッケージの周辺に鏡像をなして配置され、前記
集積回路パッケージの中心を通って引かれた任意の軸に
関して互いに他の鏡像として設置されている複数のピン
割り当て(1−208)と前記鏡像なさずに配置されたピ
ン割り当て(1−52)とを有し、から構成されており、
第1、第2の前記集積回路パッケージを前記回路板の上
面に取り付けて互いに他にたいして180度回転させたと
き前記鏡像を有するピン割り当てが互いに直接対向する
集積回路パッケージ。
【0020】(実施態様2)前記第1の(610)の集積
回路パッケージは上面に取り付けられ、前記第2の(66
0)集積回路パッケージは前記下面に取り付けられたと
き、前記鏡像を有するピン割り当て同士がが前記回路板
を介して互いに直接対向する特徴を有する実施態様1に
記載の集積回路パッケージ。 (実施態様3)前記ピン割り当ては前記鏡像を有するピ
ン割り当ての形式(A、B、C、D)により共に組み分
けされている実施態様1に記載の集積回路パッケージ。
回路パッケージは上面に取り付けられ、前記第2の(66
0)集積回路パッケージは前記下面に取り付けられたと
き、前記鏡像を有するピン割り当て同士がが前記回路板
を介して互いに直接対向する特徴を有する実施態様1に
記載の集積回路パッケージ。 (実施態様3)前記ピン割り当ては前記鏡像を有するピ
ン割り当ての形式(A、B、C、D)により共に組み分
けされている実施態様1に記載の集積回路パッケージ。
【0021】(実施態様4)複数の前記鏡像を有するピ
ン割り当ては同一のピン割り当てである実施態様2に記
載の集積回路パッケージ。 (実施態様5)前記同一のピン割り当ては更に前記回路
板を介して共に結合されている接地ピン割り当てを備え
ている実施態様4に記載の集積回路パッケージ。 (実施態様6)前記同一のピン割り当ては更に電力ピン
(3、51、9、45、25、28)割り当てを備えている実施
態様4に記載の集積回路パッケージ。
ン割り当ては同一のピン割り当てである実施態様2に記
載の集積回路パッケージ。 (実施態様5)前記同一のピン割り当ては更に前記回路
板を介して共に結合されている接地ピン割り当てを備え
ている実施態様4に記載の集積回路パッケージ。 (実施態様6)前記同一のピン割り当ては更に電力ピン
(3、51、9、45、25、28)割り当てを備えている実施
態様4に記載の集積回路パッケージ。
【0022】(実施態様7)上面および下面を有する回
路板上のリード経路決定を容易化する方法であって、中
心を有し該中心を通って引かれた任意の軸に関して互い
に他の鏡像として設置されている鏡像ピン割り当てを備
えている複数の鏡像集積回路を製作する階梯、第1の前
記鏡像集積回路(410)を前記上面に取り付ける階梯、
第2の前記鏡像集積回路(660)を前記下面に取り付け
る階梯であって、前記第1および第2の鏡像集積回路は
互い他に関して180度回転している階梯、異なる形式(4
20、425、430、435)の少なくとも一つの別の集積回路
を前記PC板の上面に取り付ける階梯であって、前記別
の集積回路は前記第1および第2の鏡像集積回路上に共
存する前記鏡像ピン割り当てと同一のピン割り当てを備
えている階梯、第1の組のリード(D)で前記第1の鏡
像集積回路(410)前記鏡像ピン割り当てと前記別の集
積回路上の前記同一のピン割り当てとを結合する階梯、
第2の組のリードで前記第2の鏡像集積回路の鏡像ピン
割り当てと前記別の集積回路上の前記ピン割り当てとを
結合する階梯であって、前記第1および第2の組のリー
ドは前記鏡像ピン割り当ての故に全般的に同じ方向を辿
り、リード交差の可能性を極小にする階梯、を備えた方
法。
路板上のリード経路決定を容易化する方法であって、中
心を有し該中心を通って引かれた任意の軸に関して互い
に他の鏡像として設置されている鏡像ピン割り当てを備
えている複数の鏡像集積回路を製作する階梯、第1の前
記鏡像集積回路(410)を前記上面に取り付ける階梯、
第2の前記鏡像集積回路(660)を前記下面に取り付け
る階梯であって、前記第1および第2の鏡像集積回路は
互い他に関して180度回転している階梯、異なる形式(4
20、425、430、435)の少なくとも一つの別の集積回路
を前記PC板の上面に取り付ける階梯であって、前記別
の集積回路は前記第1および第2の鏡像集積回路上に共
存する前記鏡像ピン割り当てと同一のピン割り当てを備
えている階梯、第1の組のリード(D)で前記第1の鏡
像集積回路(410)前記鏡像ピン割り当てと前記別の集
積回路上の前記同一のピン割り当てとを結合する階梯、
第2の組のリードで前記第2の鏡像集積回路の鏡像ピン
割り当てと前記別の集積回路上の前記ピン割り当てとを
結合する階梯であって、前記第1および第2の組のリー
ドは前記鏡像ピン割り当ての故に全般的に同じ方向を辿
り、リード交差の可能性を極小にする階梯、を備えた方
法。
【0023】(実施態様8)前記鏡像ピン割り当ては形
式(A、B、C、D)毎に組み分けされている実施態様
7に記載の方法。 (実施態様9)前記鏡像ピン割り当ての幾つかは同一
で、第1、第2の前記鏡像集積回路が前記回路板の上面
および下面にそれぞれ取り付けられるように位置決めさ
れたとき、前記同一のピン割り当ては互いに直接対向
し、共に結合することができる実施態様8に記載の方
法。
式(A、B、C、D)毎に組み分けされている実施態様
7に記載の方法。 (実施態様9)前記鏡像ピン割り当ての幾つかは同一
で、第1、第2の前記鏡像集積回路が前記回路板の上面
および下面にそれぞれ取り付けられるように位置決めさ
れたとき、前記同一のピン割り当ては互いに直接対向
し、共に結合することができる実施態様8に記載の方
法。
【0024】
【発明の効果】以上詳述したように回路基板に搭載され
る集積回路がその中心を通る直線に関して互いに他の鏡
像をなすピン割り当てを有するので、同一面上では互い
に180度回転させて鏡像を成すピン割り当て同士を対
向させ配線を容易化することができる。また、回路基板
の上下両面に本発明の集積回路を対向搭載すれば鏡像を
なすピンは直接対向するので、貫通孔により最短距離で
それらをせつぞくできる。また電源ピン等の同一ピン割
り当てにたいしては、それらを接続して電流容量を増加
することも可能である。したがって、本発明を高密度表
面実装基板等に実施すれば効果が特に大きい。
る集積回路がその中心を通る直線に関して互いに他の鏡
像をなすピン割り当てを有するので、同一面上では互い
に180度回転させて鏡像を成すピン割り当て同士を対
向させ配線を容易化することができる。また、回路基板
の上下両面に本発明の集積回路を対向搭載すれば鏡像を
なすピンは直接対向するので、貫通孔により最短距離で
それらをせつぞくできる。また電源ピン等の同一ピン割
り当てにたいしては、それらを接続して電流容量を増加
することも可能である。したがって、本発明を高密度表
面実装基板等に実施すれば効果が特に大きい。
【図1A】標準のピン割り当てを有する従来技術のIC
の平面図である。
の平面図である。
【図1B】逆のピン割り当てを有する従来技術の第2の
ICの平面図である。
ICの平面図である。
【図2】対称的にブロックされた構成を成す図1の従来
技術のICを組込んだ従来技術のPC板配置の平面図で
ある。
技術のICを組込んだ従来技術のPC板配置の平面図で
ある。
【図3A】本発明の好適実施例に従つて設計された鏡像
ICの上半分の平面図である。
ICの上半分の平面図である。
【図3B】本発明の好適実施例に従つて設計された鏡像
ICの下半分のの平面図である。
ICの下半分のの平面図である。
【図4】本発明の好適実施例に従つて構成された回路板
配置の上面の平面図である。
配置の上面の平面図である。
【図5】本発明の好適実施例に従つて構成された回路板
配置の下面の平面図である。
配置の下面の平面図である。
【図6】本発明の好適実施例に従う回路板の断面図であ
る。
る。
310 ICチップ 410, 415 メモリーコントローラーチップ 420, 425, 430, 435 SIMMモジュール 418, 419, 518, 519 円形標識 510, 515、610、660 メモリーコントローラーチップ 670 回路板貫通孔
フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 H01L 27/04 21/822
Claims (9)
- 【請求項1】 上面および下面を有する回路板に取り付
ける集積回路パッケージ(410、415)であって、 前記集積回路パッケージの周辺に鏡像をなして配置さ
れ、前記集積回路パッケージの中心を通って引かれた任
意の軸に関して互いに他の鏡像として設置されている複
数のピン割り当て(1−208)と前記鏡像なさずに配置
されたピン割り当て(1−52)とを有し、から構成され
ており、第1、第2の前記集積回路パッケージを前記回
路板の上面に取り付けて互いに他にたいして180度回転
させたとき前記鏡像を有するピン割り当てが互いに直接
対向する集積回路パッケージ。 - 【請求項2】 前記第1の(610)の集積回路パッケー
ジは上面に取り付けられ、前記第2の(660)集積回路
パッケージは前記下面に取り付けられたとき、前記鏡像
を有するピン割り当て同士がが前記回路板を介して互い
に直接対向する特徴を有する請求項1に記載の集積回路
パッケージ。 - 【請求項3】 前記ピン割り当ては前記鏡像を有するピ
ン割り当ての形式(A、B、C、D)により共に組み分
けされている請求項1に記載の集積回路パッケージ。 - 【請求項4】 複数の前記鏡像を有するピン割り当ては
同一のピン割り当てである請求項2に記載の集積回路パ
ッケージ。 - 【請求項5】 前記同一のピン割り当ては更に前記回路
板を介して共に結合されている接地ピン割り当てを備え
ている請求項4に記載の集積回路パッケージ。 - 【請求項6】 前記同一のピン割り当ては更に電力ピン
(3、51、9、45、25、28)割り当てを備えている請求
項4に記載の集積回路パッケージ。 - 【請求項7】 上面および下面を有する回路板上のリー
ド経路決定を容易化する方法であって、 中心を有し該中心を通って引かれた任意の軸に関して互
いに他の鏡像として設置されている鏡像ピン割り当てを
備えている複数の鏡像集積回路を製作する階梯、 第1の前記鏡像集積回路(410)を前記上面に取り付け
る階梯、 第2の前記鏡像集積回路(660)を前記下面に取り付け
る階梯であって、前記第1および第2の鏡像集積回路は
互い他に関して180度回転している階梯、 異なる形式(420、425、430、435)の少なくとも一つの
別の集積回路を前記PC板の上面に取り付ける階梯であ
って、前記別の集積回路は前記第1および第2の鏡像集
積回路上に共存する前記鏡像ピン割り当てと同一のピン
割り当てを備えている階梯、 第1の組のリード(D)で前記第1の鏡像集積回路(41
0)前記鏡像ピン割り当てと前記別の集積回路上の前記
同一のピン割り当てとを結合する階梯、 第2の組のリードで前記第2の鏡像集積回路の鏡像ピン
割り当てと前記別の集積回路上の前記ピン割り当てとを
結合する階梯であって、前記第1および第2の組のリー
ドは前記鏡像ピン割り当ての故に全般的に同じ方向を辿
り、リード交差の可能性を極小にする階梯、を備えた方
法。 - 【請求項8】 前記鏡像ピン割り当ては形式(A、B、
C、D)毎に組み分けされている請求項7に記載の方
法。 - 【請求項9】 前記鏡像ピン割り当ての幾つかは同一
で、第1、第2の前記鏡像集積回路が前記回路板の上面
および下面にそれぞれ取り付けられるように位置決めさ
れたとき、前記同一のピン割り当ては互いに直接対向
し、共に結合することができる請求項8に記載の方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US08/221,144 US5502621A (en) | 1994-03-31 | 1994-03-31 | Mirrored pin assignment for two sided multi-chip layout |
US221,144 | 1994-03-31 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH07297354A true JPH07297354A (ja) | 1995-11-10 |
Family
ID=22826543
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP7093134A Pending JPH07297354A (ja) | 1994-03-31 | 1995-03-27 | 集積回路及び集積回路のピン割り当て方法及び実装方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US5502621A (ja) |
JP (1) | JPH07297354A (ja) |
DE (1) | DE19511249A1 (ja) |
GB (1) | GB2288066A (ja) |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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JP2007035853A (ja) * | 2005-07-26 | 2007-02-08 | Renesas Technology Corp | 半導体装置の製造方法 |
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