JPH0722980A - 時分割多重デジタル無線通信装置 - Google Patents
時分割多重デジタル無線通信装置Info
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- JPH0722980A JPH0722980A JP16071793A JP16071793A JPH0722980A JP H0722980 A JPH0722980 A JP H0722980A JP 16071793 A JP16071793 A JP 16071793A JP 16071793 A JP16071793 A JP 16071793A JP H0722980 A JPH0722980 A JP H0722980A
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Abstract
(57)【要約】
【目的】 本発明は時分割多重デジタル無線通信装置に
関し、自己の送信部の発生信号に起因する受信時の感度
抑圧現象を回避できるようにした時分割多重デジタル無
線通信装置を得ることを目的とする。 【構成】 本発明の時分割多重デジタル無線通信装置は
局部発振源としてＰＬＬ型シンセサイザー発振器を送信
用と受信用にそれぞ別個に備え、且つ、目的の通信周波
数帯で直接変調を行う送信部を備えている。そして、前
記時分割多重デジタル無線通信装置は送信タイムスロッ
ト（ＴＸ）における前記送信用の局部発振器の発振周波
数ｆ1 を受信タイムスロット（ＲＸ）のタイミングに合
わせて受信帯域外の周波数ｆ3 へシフトするよう制御
し、送信状態に戻る場合には、送信タイムスロット（Ｔ
Ｘ）のタイミングに合わせて前記受信帯域外の周波数ｆ
3 を前記発振周波数ｆ1 に戻すよう制御する。
関し、自己の送信部の発生信号に起因する受信時の感度
抑圧現象を回避できるようにした時分割多重デジタル無
線通信装置を得ることを目的とする。 【構成】 本発明の時分割多重デジタル無線通信装置は
局部発振源としてＰＬＬ型シンセサイザー発振器を送信
用と受信用にそれぞ別個に備え、且つ、目的の通信周波
数帯で直接変調を行う送信部を備えている。そして、前
記時分割多重デジタル無線通信装置は送信タイムスロッ
ト（ＴＸ）における前記送信用の局部発振器の発振周波
数ｆ1 を受信タイムスロット（ＲＸ）のタイミングに合
わせて受信帯域外の周波数ｆ3 へシフトするよう制御
し、送信状態に戻る場合には、送信タイムスロット（Ｔ
Ｘ）のタイミングに合わせて前記受信帯域外の周波数ｆ
3 を前記発振周波数ｆ1 に戻すよう制御する。
Description
【０００１】
【産業上の利用分野】本発明は時分割多重デジタル無線
通信装置に関し、特に、自己の送信部の生成信号に起因
する受信時の感度抑圧現象を回避できるようにした時分
割多重デジタル無線通信装置に係る。
通信装置に関し、特に、自己の送信部の生成信号に起因
する受信時の感度抑圧現象を回避できるようにした時分
割多重デジタル無線通信装置に係る。
【０００２】
【従来の技術】図３は従来の時分割多重デジタル無線通
信装置の一例を示すブロック構成図である。
信装置の一例を示すブロック構成図である。
【０００３】同図において、アンテナ（図示省略）に誘
起した受信信号はアンテナスイッチ１及び低雑音増幅器
２を介して受信ミキサ３に入力し、この受信ミキサ３に
は電圧制御発振器１３とＰＬＬ１４とにより構成された
ＰＬＬ型シンセサイザー発振器からの局部信号ｆ1 が供
給されている。前記受信ミキサ３は２つの入力信号の周
波数の差の周波数の第１中間周波信号を出力し、この中
間周波信号はバンドパスフィルタ４を介して受信ミキサ
５に入力している。なお、このバンドパスフィルタ４に
は１キャリア分の通過帯域幅を持たせてある。
起した受信信号はアンテナスイッチ１及び低雑音増幅器
２を介して受信ミキサ３に入力し、この受信ミキサ３に
は電圧制御発振器１３とＰＬＬ１４とにより構成された
ＰＬＬ型シンセサイザー発振器からの局部信号ｆ1 が供
給されている。前記受信ミキサ３は２つの入力信号の周
波数の差の周波数の第１中間周波信号を出力し、この中
間周波信号はバンドパスフィルタ４を介して受信ミキサ
５に入力している。なお、このバンドパスフィルタ４に
は１キャリア分の通過帯域幅を持たせてある。
【０００４】前記受信ミキサ５には第２局部発振器１２
からの局部信号が入力しており、この受信ミキサ５は第
２中間周波信号を出力する。また、この第２中間周波信
号はバンドパスフィルタ６を介して受信ミキサ７に入力
しており、この受信ミキサ７には水晶発振器１１の発振
出力の周波数（１９．２ＭＨｚ）を分周器９で２分周さ
れた局部信号が入力している。そして、前記受信ミキサ
７は第３中間周波信号を出力し、この第３中間周波信号
はリミッタ８及び図示を省略した中間周波信号増幅器等
を介して不図示のベースバンド信号処理部へ出力される
と共にＲＳＳＩ回路１０を介して不図示の呼び出し制御
回路へ出力されている。
からの局部信号が入力しており、この受信ミキサ５は第
２中間周波信号を出力する。また、この第２中間周波信
号はバンドパスフィルタ６を介して受信ミキサ７に入力
しており、この受信ミキサ７には水晶発振器１１の発振
出力の周波数（１９．２ＭＨｚ）を分周器９で２分周さ
れた局部信号が入力している。そして、前記受信ミキサ
７は第３中間周波信号を出力し、この第３中間周波信号
はリミッタ８及び図示を省略した中間周波信号増幅器等
を介して不図示のベースバンド信号処理部へ出力される
と共にＲＳＳＩ回路１０を介して不図示の呼び出し制御
回路へ出力されている。
【０００５】一方、送信動作について説明すると、不図
示のベースバンド信号処理部からの同相成分ベースバン
ド信号（送信Ｉ）及び直交位相成分ベースバンド信号
（送信Ｑ）は直交変調器１９に入力され、電圧制御発振
器１５とＰＬＬ１６とで構成されたＰＬＬ型シンセサイ
ザー発振器からの局部信号ｆ2 を直交変調する。そし
て、その変調された信号は送信アンプ１８、ハイパワー
アンプ１７によって増幅された後、アンテナスイッチ１
を介してアンテナへ送られる。
示のベースバンド信号処理部からの同相成分ベースバン
ド信号（送信Ｉ）及び直交位相成分ベースバンド信号
（送信Ｑ）は直交変調器１９に入力され、電圧制御発振
器１５とＰＬＬ１６とで構成されたＰＬＬ型シンセサイ
ザー発振器からの局部信号ｆ2 を直交変調する。そし
て、その変調された信号は送信アンプ１８、ハイパワー
アンプ１７によって増幅された後、アンテナスイッチ１
を介してアンテナへ送られる。
【０００６】
【発明が解決しようとする課題】このように、送信回路
は周波数ｆ2 の信号を直接、変調しているので、ブロッ
クＡ内にて受信周波数と同一の周波数を発生している。
ブロックＡに示すＰＬＬ型シンセサイザー発振器はフレ
ーム周期５ｍｓ内にＯＮ／ＯＦＦを行う如き高速な制御
を良好な周波数安定度に維持したまま行うのは困難であ
る。そのため、ブロックＢに示す部分をスタンバイ状態
にしているときであっても、ブロックＡ内のＰＬＬ型シ
ンセサイザー発振器は、その動作を維持させておく必要
がある。従って、時分割多重における受信時にも、ブロ
ックＡ内のＰＬＬ型シンセサイザー発振器が周波数ｆ2
の信号を発生している。それ故、それが受信回路部へ回
り込んで受信感度の抑圧現象等を引き起こすと云った欠
点があった。また、厳重なシールドを施すことができれ
ば、この不都合をかなり回避できるが、携帯機は小型に
形成する必要があり、小型の携帯機にあっては、なかな
か満足な結果が得られるようなアイソレーションを達成
することは困難であった。
は周波数ｆ2 の信号を直接、変調しているので、ブロッ
クＡ内にて受信周波数と同一の周波数を発生している。
ブロックＡに示すＰＬＬ型シンセサイザー発振器はフレ
ーム周期５ｍｓ内にＯＮ／ＯＦＦを行う如き高速な制御
を良好な周波数安定度に維持したまま行うのは困難であ
る。そのため、ブロックＢに示す部分をスタンバイ状態
にしているときであっても、ブロックＡ内のＰＬＬ型シ
ンセサイザー発振器は、その動作を維持させておく必要
がある。従って、時分割多重における受信時にも、ブロ
ックＡ内のＰＬＬ型シンセサイザー発振器が周波数ｆ2
の信号を発生している。それ故、それが受信回路部へ回
り込んで受信感度の抑圧現象等を引き起こすと云った欠
点があった。また、厳重なシールドを施すことができれ
ば、この不都合をかなり回避できるが、携帯機は小型に
形成する必要があり、小型の携帯機にあっては、なかな
か満足な結果が得られるようなアイソレーションを達成
することは困難であった。
【０００７】そこで、本発明は前記問題に鑑みて、自己
の送信部の発生信号に起因する受信時の感度抑圧現象等
を回避できるようにした時分割多重デジタル無線通信装
置を得ることを目的とする。
の送信部の発生信号に起因する受信時の感度抑圧現象等
を回避できるようにした時分割多重デジタル無線通信装
置を得ることを目的とする。
【０００８】
【課題を解決するための手段】本発明の時分割多重デジ
タル無線通信装置は局部発振源としてＰＬＬ型シンセサ
イザー発振器を送信用と受信用にそれぞ別個に備え、且
つ、目的の通信周波数帯で直接変調を行う送信部を備え
ている。
タル無線通信装置は局部発振源としてＰＬＬ型シンセサ
イザー発振器を送信用と受信用にそれぞ別個に備え、且
つ、目的の通信周波数帯で直接変調を行う送信部を備え
ている。
【０００９】そして、前記時分割多重デジタル無線通信
装置は、信号を受信するタイムスロットでは、送信用の
局部発振回路の動作を停止させることなく、通信周波数
帯の周波数信号を発生させないように構成している。よ
り具体的には、前記送信用の局部発振器の発振周波数を
受信タイムスロットのタイミングに合わせて受信帯域外
へシフトするよう制御する構成、或いは前記送信用の局
部発振器とデジタル変調器との間に１／Ｎ分周器（又は
Ｎ逓倍器）を設け、送信周波数を出力する１／Ｎ分周器
（又はＮ逓倍器）の動作を受信タイムスロットのタイミ
ングに合わせて停止せしめるよう制御する構成にしてあ
る。
装置は、信号を受信するタイムスロットでは、送信用の
局部発振回路の動作を停止させることなく、通信周波数
帯の周波数信号を発生させないように構成している。よ
り具体的には、前記送信用の局部発振器の発振周波数を
受信タイムスロットのタイミングに合わせて受信帯域外
へシフトするよう制御する構成、或いは前記送信用の局
部発振器とデジタル変調器との間に１／Ｎ分周器（又は
Ｎ逓倍器）を設け、送信周波数を出力する１／Ｎ分周器
（又はＮ逓倍器）の動作を受信タイムスロットのタイミ
ングに合わせて停止せしめるよう制御する構成にしてあ
る。
【００１０】
【作用】送信時における送信信号源の周波数は受信時に
他の周波数に変更されるので、その信号が受信回路へ回
り込んだ場合であっても、受信時に感度抑圧等が起こる
ことなく、受信信号を良好な状態で受信することができ
る。
他の周波数に変更されるので、その信号が受信回路へ回
り込んだ場合であっても、受信時に感度抑圧等が起こる
ことなく、受信信号を良好な状態で受信することができ
る。
【００１１】
【実施例】以下、図面を参照しながら本発明の実施例に
ついて詳細に説明する。図１は本発明の第１実施例を説
明するタイムチャートである。時分割多重方式におい
て、フレーム周期は、例えば、５ｍｓに設定されてお
り、送信フレーム及び受信フレームは各４タイムスロッ
トで構成されている。
ついて詳細に説明する。図１は本発明の第１実施例を説
明するタイムチャートである。時分割多重方式におい
て、フレーム周期は、例えば、５ｍｓに設定されてお
り、送信フレーム及び受信フレームは各４タイムスロッ
トで構成されている。
【００１２】第１実施例のブロック構成図は示していな
いが、この実施例のものでは、図３におけるブロックＡ
内の電圧制御発振器１５の発振出力の周波数を送信時に
はｆ2 とし、受信時には受信用電圧制御発振器１３が出
力する局部信号ｆ１の周波数との差が前記バンドパスフ
ィルタ４の通過帯域外となる周波数であるｆ3 となるよ
うにしてある。これを実現するには、送受信時のタイミ
ングを検出し、それによって、例えば、前記ＰＬＬ１６
内のプリスケーラ等の可変分周器の分周比を変更するコ
ードをデジタル回路あるいは制御用のＣＰＵからプリス
ケーラ等に付与するよう構成すればよい。
いが、この実施例のものでは、図３におけるブロックＡ
内の電圧制御発振器１５の発振出力の周波数を送信時に
はｆ2 とし、受信時には受信用電圧制御発振器１３が出
力する局部信号ｆ１の周波数との差が前記バンドパスフ
ィルタ４の通過帯域外となる周波数であるｆ3 となるよ
うにしてある。これを実現するには、送受信時のタイミ
ングを検出し、それによって、例えば、前記ＰＬＬ１６
内のプリスケーラ等の可変分周器の分周比を変更するコ
ードをデジタル回路あるいは制御用のＣＰＵからプリス
ケーラ等に付与するよう構成すればよい。
【００１３】そのような構成の下で、スロット２を使用
している場合について考察すると、周波数ｆ2 で通信を
行っているときには、ブロックＡ内の電圧制御発振器１
５の出力の周波数は当然送信タイミング（ＴＸ）の際、
図１に示すように周波数ｆ2となる。受信タイミング
（ＲＸ）のときには、前記電圧制御発振器１５の出力の
周波数が、図１に示すように、周波数ｆ3 に変更され
る。また、受信時には図３におけるブロックＢの部分の
動作は停止させている。
している場合について考察すると、周波数ｆ2 で通信を
行っているときには、ブロックＡ内の電圧制御発振器１
５の出力の周波数は当然送信タイミング（ＴＸ）の際、
図１に示すように周波数ｆ2となる。受信タイミング
（ＲＸ）のときには、前記電圧制御発振器１５の出力の
周波数が、図１に示すように、周波数ｆ3 に変更され
る。また、受信時には図３におけるブロックＢの部分の
動作は停止させている。
【００１４】以上のように構成した結果、前記電圧制御
発振器１５の出力は受信側へ回り込みがあっても、その
信号の周波数は受信用電圧制御発振器１３が出力する局
部信号ｆ１の周波数との差が前記バンドパスフィルタ４
の通過帯域外となる周波数ｆ3 であるので、悪影響を受
けることがなくなり、受信時の感度抑圧現象等を回避で
きるようになる。
発振器１５の出力は受信側へ回り込みがあっても、その
信号の周波数は受信用電圧制御発振器１３が出力する局
部信号ｆ１の周波数との差が前記バンドパスフィルタ４
の通過帯域外となる周波数ｆ3 であるので、悪影響を受
けることがなくなり、受信時の感度抑圧現象等を回避で
きるようになる。
【００１５】図２は本発明の第２実施例を示すブロック
構成図である。同図において、この実施例のものでは、
従来例として示した前記電圧制御発振器１５及びＰＬＬ
１６の構成部分を電圧制御発振器２０、ＰＬＬ２１及び
１／２分周器２２で構成するとともに１／２分周器２２
の動作をＯＮ／ＯＦＦ制御できるように構成してあり、
他の構成は従来例と同じである。前記電圧制御発振器１
５の出力の周波数はｆ2 の二倍にしてあり、送信時に前
記１／２分周器２２で半分の周波数ｆ2 を得て、その周
波数の信号を送信信号源として用いている。受信時には
前記１／２分周器２２に不図示の回路から動作を停止さ
せる制御信号を出力し、前記１／２分周器２２の分周動
作を停止させる。なお、実施例においては分周器は１／
２としてあるが、これは１／Ｎ分周器（Ｎは正の整数）
とすることができ、そのとき、前記電圧制御発振器１５
の出力の周波数はｆ2 のＮ倍に設定すればよい。
構成図である。同図において、この実施例のものでは、
従来例として示した前記電圧制御発振器１５及びＰＬＬ
１６の構成部分を電圧制御発振器２０、ＰＬＬ２１及び
１／２分周器２２で構成するとともに１／２分周器２２
の動作をＯＮ／ＯＦＦ制御できるように構成してあり、
他の構成は従来例と同じである。前記電圧制御発振器１
５の出力の周波数はｆ2 の二倍にしてあり、送信時に前
記１／２分周器２２で半分の周波数ｆ2 を得て、その周
波数の信号を送信信号源として用いている。受信時には
前記１／２分周器２２に不図示の回路から動作を停止さ
せる制御信号を出力し、前記１／２分周器２２の分周動
作を停止させる。なお、実施例においては分周器は１／
２としてあるが、これは１／Ｎ分周器（Ｎは正の整数）
とすることができ、そのとき、前記電圧制御発振器１５
の出力の周波数はｆ2 のＮ倍に設定すればよい。
【００１６】而して、送信時にはキャリア周波数ｆ2 の
送信信号をアンテナより発射でき、受信時には前記１／
２分周器２２がその動作を停止するため、周波数ｆ2 の
信号は装置から生成されなくなる。なお、電圧制御回路
１５は受信時にも発振しているが、その周波数は受信信
号の周波数ｆ２の２倍である。従って、アンテナに誘起
した周波数ｆ2 の受信信号を感度抑圧を生ずることなく
受信することが可能になる。なお、この場合も受信時に
は直交変調器１９、送信アンプ１８、ハイパワーアンプ
１７の動作は停止させるようにしてもよい。
送信信号をアンテナより発射でき、受信時には前記１／
２分周器２２がその動作を停止するため、周波数ｆ2 の
信号は装置から生成されなくなる。なお、電圧制御回路
１５は受信時にも発振しているが、その周波数は受信信
号の周波数ｆ２の２倍である。従って、アンテナに誘起
した周波数ｆ2 の受信信号を感度抑圧を生ずることなく
受信することが可能になる。なお、この場合も受信時に
は直交変調器１９、送信アンプ１８、ハイパワーアンプ
１７の動作は停止させるようにしてもよい。
【００１７】なお、上記第２実施例では電圧制御発振器
１５の出力周波数を分周器２２で分周して送信周波数信
号を得る構成としたが、逆に電圧制御発振器１５の出力
周波数を逓倍器で逓倍して送信周波数信号を得る構成に
してもよい。この場合の逓倍器等の制御は第２実施例と
同一である。
１５の出力周波数を分周器２２で分周して送信周波数信
号を得る構成としたが、逆に電圧制御発振器１５の出力
周波数を逓倍器で逓倍して送信周波数信号を得る構成に
してもよい。この場合の逓倍器等の制御は第２実施例と
同一である。
【００１８】
【発明の効果】以上、詳細に説明したように本発明によ
れば、信号を受信するタイムスロットでは、送信用局部
発振回路の動作を停止させることなく、通信周波数帯の
周波数信号を発生させない構成としたので、受信時の感
度抑圧現象等を回避でき、小型の携帯機も容易に実現で
きるようになる。
れば、信号を受信するタイムスロットでは、送信用局部
発振回路の動作を停止させることなく、通信周波数帯の
周波数信号を発生させない構成としたので、受信時の感
度抑圧現象等を回避でき、小型の携帯機も容易に実現で
きるようになる。
【図１】本発明の第１実施例を説明するタイムチャート
である。
である。
【図２】本発明の第２実施例を示すブロック構成図であ
る。
る。
【図３】従来の時分割多重デジタル無線通信装置の一例
を示すブロック構成図である。
を示すブロック構成図である。
１ アンテナスイッチ ２ 低雑音増幅器 ３ 受信ミキサ ４ バンドパスフィルタ １１ 水晶発振器 １３ 電圧制御発振器 １４ ＰＬＬ １５ 電圧制御発振器 １６ ＰＬＬ １７ ハイパワーアンプ １８ 送信アンプ １９ 直交変調器 ２０ 電圧制御発振器 ２１ ＰＬＬ ２２ １／２分周器
Claims (2)
- 【請求項１】 局部発振源としてＰＬＬ型シンセサイザ
ー発振器を送信用と受信用にそれぞ別個に備え、且つ、
目的の通信周波数帯で直接変調を行う送信部を備える時
分割多重デジタル無線通信装置において、 前記送信用の局部発振器の発振周波数を受信タイムスロ
ットのタイミングに合わせて受信帯域外へシフトするよ
う制御することを特徴とする時分割多重デジタル無線通
信装置。 - 【請求項２】 局部発振源としてＰＬＬ型シンセサイザ
ー発振器を送信用と受信用にそれぞ別個に備え、且つ、
目的の通信周波数帯で直接変調を行う送信部を備える時
分割多重デジタル無線通信装置において、 送信用局部発振器と直接変調の実行を担うデジタル変調
器間に１／Ｎ分周器またはＮ逓倍器（Ｎは正の整数）を
配設して前記１／Ｎ分周器またはＮ逓倍器から送信周波
数を出力する構成にし、且つ、受信タイムスロットのタ
イミングに合わせて前記１／Ｎ分周器またはＮ逓倍器の
動作を停止せしめるよう制御することを特徴とする時分
割多重デジタル無線通信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16071793A JP3284666B2 (ja) | 1993-06-30 | 1993-06-30 | 時分割多重デジタル無線通信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16071793A JP3284666B2 (ja) | 1993-06-30 | 1993-06-30 | 時分割多重デジタル無線通信装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0722980A true JPH0722980A (ja) | 1995-01-24 |
| JP3284666B2 JP3284666B2 (ja) | 2002-05-20 |
Family
ID=15720954
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16071793A Expired - Fee Related JP3284666B2 (ja) | 1993-06-30 | 1993-06-30 | 時分割多重デジタル無線通信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3284666B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN108347235A (zh) * | 2018-01-09 | 2018-07-31 | 晶晨半导体(上海)股份有限公司 | 一种pwm波形生成装置及方法 |
| CN113114237A (zh) * | 2021-03-03 | 2021-07-13 | 浙江大学 | 一种能够实现快速频率锁定的环路系统 |
-
1993
- 1993-06-30 JP JP16071793A patent/JP3284666B2/ja not_active Expired - Fee Related
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN108347235A (zh) * | 2018-01-09 | 2018-07-31 | 晶晨半导体(上海)股份有限公司 | 一种pwm波形生成装置及方法 |
| CN113114237A (zh) * | 2021-03-03 | 2021-07-13 | 浙江大学 | 一种能够实现快速频率锁定的环路系统 |
| CN113114237B (zh) * | 2021-03-03 | 2022-08-23 | 浙江大学 | 一种能够实现快速频率锁定的环路系统 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3284666B2 (ja) | 2002-05-20 |
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Legal Events
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