JPH07210342A - ユニバーサル・インターフェース付プリンタ - Google Patents
ユニバーサル・インターフェース付プリンタInfo
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- JPH07210342A JPH07210342A JP6220283A JP22028394A JPH07210342A JP H07210342 A JPH07210342 A JP H07210342A JP 6220283 A JP6220283 A JP 6220283A JP 22028394 A JP22028394 A JP 22028394A JP H07210342 A JPH07210342 A JP H07210342A
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- processor
- data
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K15/00—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K2215/00—Arrangements for producing a permanent visual presentation of the output data
- G06K2215/0082—Architecture adapted for a particular function
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- General Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Record Information Processing For Printing (AREA)
- Accessory Devices And Overall Control Thereof (AREA)
- Information Transfer Systems (AREA)
- Bus Control (AREA)
Abstract
(57)【要約】
【目的】 外部デバイスからのデータを印字しかつ該外
部デバイスにデータを送出できるようにして、プリンタ
の利用効率を向上させる。 【構成】 入力デバイス２４からの操作者の操作信号に
より、プロセッサ１が信号ライン２、３、バッファ４、
信号ライン６〜９を介して書込／読取信号をインターフ
ェース２０に供給し、インターフェースは外部メモリ２
６、２７、外部デバイス用データ入出力接続部２８に書
込／読取信号を供給する。プロセッサとメモリ等の間の
データの伝送は、バッファ１０、１６、データ・バス１
２、１４、１５、１８、１９、インターフェース２０を
介して行われ、アドレス・バス１１、１３のアドレスに
よりその伝送対象が規定され、アドレス・デコーダ２１
からの信号により書き込み又は読み取りが制御される。
メモリ等からのデータはプロセッサ１を介してプリンタ
機構２５で印字され、逆にメモリ等へデータを記憶する
ことができる。
部デバイスにデータを送出できるようにして、プリンタ
の利用効率を向上させる。 【構成】 入力デバイス２４からの操作者の操作信号に
より、プロセッサ１が信号ライン２、３、バッファ４、
信号ライン６〜９を介して書込／読取信号をインターフ
ェース２０に供給し、インターフェースは外部メモリ２
６、２７、外部デバイス用データ入出力接続部２８に書
込／読取信号を供給する。プロセッサとメモリ等の間の
データの伝送は、バッファ１０、１６、データ・バス１
２、１４、１５、１８、１９、インターフェース２０を
介して行われ、アドレス・バス１１、１３のアドレスに
よりその伝送対象が規定され、アドレス・デコーダ２１
からの信号により書き込み又は読み取りが制御される。
メモリ等からのデータはプロセッサ１を介してプリンタ
機構２５で印字され、逆にメモリ等へデータを記憶する
ことができる。
Description
【０００１】
【産業上の利用分野】本発明は、ユニバーサル・インタ
ーフェース付プリンタ、即ち、外部デバイスのデータ入
力及びデータ出力接続端子のみならず記憶媒体（メモ
リ）にも接続可能なプロセッサを備えたプリンタに関す
るものである。
ーフェース付プリンタ、即ち、外部デバイスのデータ入
力及びデータ出力接続端子のみならず記憶媒体（メモ
リ）にも接続可能なプロセッサを備えたプリンタに関す
るものである。
【０００２】
【従来の技術】英国特許明細書第２，２１１，９７１Ａ
号に上記のタイプの一般的なプリンタが開示されてい
る。プリンタ機構全体を制御するプロセッサが、バスを
介して入出力ポート、読み出し専用メモリ（ＲＯＭ）及
びランダム・アクセス・メモリ（ＲＡＭ）に接続されて
いる。コンピュータ及び別体のフォント用ＲＯＭ等の外
部デバイス用のインターフェースと同様に、プリンタ機
構用のモータ及びプリント・ヘッドが入出力ポートに接
続されている。
号に上記のタイプの一般的なプリンタが開示されてい
る。プリンタ機構全体を制御するプロセッサが、バスを
介して入出力ポート、読み出し専用メモリ（ＲＯＭ）及
びランダム・アクセス・メモリ（ＲＡＭ）に接続されて
いる。コンピュータ及び別体のフォント用ＲＯＭ等の外
部デバイス用のインターフェースと同様に、プリンタ機
構用のモータ及びプリント・ヘッドが入出力ポートに接
続されている。
【０００３】
【発明が解決しようとする課題】上記したような従来例
の構成においては、簡単なプリンタ・インターフェース
であるため、データの入出力が極めて限定されてしまう
ことがあり、不都合が生じることは明らかである。特
に、外部記憶媒体、例えば電子メモリ・ボード等をイン
ターフェースに接続することは不可能である。そしてこ
の種のメモリ・ボードは、異なるフォントでの印刷を１
台のプリンタで可能にするデータを含んでおり、従来技
術のプリンタでは、これらのメモリ・ボードを、特にそ
の目的のために設けられたソケットに差込まなければな
らない。したがって、本発明の目的は、データの入出力
に関するプリンタの能力を、例えばメモリ・ボード等の
外部デバイスからのデータをプリンタ内に読み込み且つ
記憶媒体へ出力できるよう、その能力を向上させること
である。
の構成においては、簡単なプリンタ・インターフェース
であるため、データの入出力が極めて限定されてしまう
ことがあり、不都合が生じることは明らかである。特
に、外部記憶媒体、例えば電子メモリ・ボード等をイン
ターフェースに接続することは不可能である。そしてこ
の種のメモリ・ボードは、異なるフォントでの印刷を１
台のプリンタで可能にするデータを含んでおり、従来技
術のプリンタでは、これらのメモリ・ボードを、特にそ
の目的のために設けられたソケットに差込まなければな
らない。したがって、本発明の目的は、データの入出力
に関するプリンタの能力を、例えばメモリ・ボード等の
外部デバイスからのデータをプリンタ内に読み込み且つ
記憶媒体へ出力できるよう、その能力を向上させること
である。
【０００４】
【課題を解決するための手段】上記問題点は、本発明に
よる、プロセッサにより起動され且つ記憶媒体及び外部
デバイス用のデータ入出力接続部を接続することが可能
な共通のインターフェースを備えたプリンタにより、解
決される。本発明の本質的な概念は、記憶媒体と、外部
デバイス用のデータ入力接続部及びデータ出力接続部を
備えたサーキット・ボードの双方を接続することのでき
るユニバーサル・インターフェースをプリンタに装着す
ることである。例えば、メモリ・ボードを使用すること
で、プリンタの記憶能力を拡張することも可能である
し、また、ＲＯＭ内に永久記憶されたデータから異なる
フォントによってデータを再現することも可能になる。
グラフィック・ボードを使用すれば、ハードコピーとし
て出力される画像を印刷媒体上へ印刷する前にＶＤＵ上
で検査することが可能となり、欠陥が生じている場合は
それを目視により検出して訂正することが可能となる。
さらに、ユニバーサル・インターフェースは、いかなる
入出力ボードでも接続できる手段として機能することが
可能である。更にまた、このような特別なボードは、一
般に標準装備になっており、プロセッサにインターフェ
ースを介してではなく、代わりに他のある記憶場所を介
して接続されるコンピュータ等のデータ・ソースを接続
する手段として使用することできる。
よる、プロセッサにより起動され且つ記憶媒体及び外部
デバイス用のデータ入出力接続部を接続することが可能
な共通のインターフェースを備えたプリンタにより、解
決される。本発明の本質的な概念は、記憶媒体と、外部
デバイス用のデータ入力接続部及びデータ出力接続部を
備えたサーキット・ボードの双方を接続することのでき
るユニバーサル・インターフェースをプリンタに装着す
ることである。例えば、メモリ・ボードを使用すること
で、プリンタの記憶能力を拡張することも可能である
し、また、ＲＯＭ内に永久記憶されたデータから異なる
フォントによってデータを再現することも可能になる。
グラフィック・ボードを使用すれば、ハードコピーとし
て出力される画像を印刷媒体上へ印刷する前にＶＤＵ上
で検査することが可能となり、欠陥が生じている場合は
それを目視により検出して訂正することが可能となる。
さらに、ユニバーサル・インターフェースは、いかなる
入出力ボードでも接続できる手段として機能することが
可能である。更にまた、このような特別なボードは、一
般に標準装備になっており、プロセッサにインターフェ
ースを介してではなく、代わりに他のある記憶場所を介
して接続されるコンピュータ等のデータ・ソースを接続
する手段として使用することできる。
【０００５】本発明はこのような構成を有することによ
り、妥当な価格で既に市販されているプラグイン・ボー
ドの中から任意に所望のものを選択使用できるので、プ
リンタの性能をユニバーサル、すなわち万能的に向上さ
せることにある。一般に、斯かるボードは、外部デバイ
ス用のデータ入力接続部及びデータ出力接続部用の書き
込み信号ライン及び読み出し信号ラインと、記憶媒体用
の書き込み信号ライン及び読み出し信号ラインとを有し
ており、従って、プリンタ・インターフェースにこのよ
うな信号ラインが装備されているのは明らかである。
り、妥当な価格で既に市販されているプラグイン・ボー
ドの中から任意に所望のものを選択使用できるので、プ
リンタの性能をユニバーサル、すなわち万能的に向上さ
せることにある。一般に、斯かるボードは、外部デバイ
ス用のデータ入力接続部及びデータ出力接続部用の書き
込み信号ライン及び読み出し信号ラインと、記憶媒体用
の書き込み信号ライン及び読み出し信号ラインとを有し
ており、従って、プリンタ・インターフェースにこのよ
うな信号ラインが装備されているのは明らかである。
【０００６】プリンタ速度をより向上させるために、超
高速の所謂ＲＩＳＣプリンタ・プロセッサ（例えば、Ａ
ＭＤ２９２００）を、従来のプロセッサ用の命令セット
より短い命令セットと併せて使用する場合を考えると、
これらの超高速のプリンタ・プロセッサは、読み出し信
号ライン及び書き込み信号ラインしか有しておらず、従
って、外部記憶媒体とその他のタイプのデバイスとの識
別を行うための出力接続部を有していないことから、マ
ルチプレクサの使用が必然的に必要になる。本発明にお
いては、マルチプレクサが、プロセッサに関係したアド
レス・バスに論理的に接続されたアドレス・デコーダか
らの出力信号から、動作させるべきデバイスのタイプを
認識して、相応する方法によりインターフェースの４本
の線（外部デバイスに関するデータ入力及びデータ出力
接続部用の書き込み信号ライン及び読み出し信号ライ
ン、並びに、記憶媒体用の書き込み信号ライン及び読み
出し信号ライン）を制御する。アドレス・デコーダ及び
マルチプレクサの働きにより、プロセッサは、そのアド
レス・バスを参照して、異なるタイプの外部デバイスを
切り替えることが可能となる。
高速の所謂ＲＩＳＣプリンタ・プロセッサ（例えば、Ａ
ＭＤ２９２００）を、従来のプロセッサ用の命令セット
より短い命令セットと併せて使用する場合を考えると、
これらの超高速のプリンタ・プロセッサは、読み出し信
号ライン及び書き込み信号ラインしか有しておらず、従
って、外部記憶媒体とその他のタイプのデバイスとの識
別を行うための出力接続部を有していないことから、マ
ルチプレクサの使用が必然的に必要になる。本発明にお
いては、マルチプレクサが、プロセッサに関係したアド
レス・バスに論理的に接続されたアドレス・デコーダか
らの出力信号から、動作させるべきデバイスのタイプを
認識して、相応する方法によりインターフェースの４本
の線（外部デバイスに関するデータ入力及びデータ出力
接続部用の書き込み信号ライン及び読み出し信号ライ
ン、並びに、記憶媒体用の書き込み信号ライン及び読み
出し信号ライン）を制御する。アドレス・デコーダ及び
マルチプレクサの働きにより、プロセッサは、そのアド
レス・バスを参照して、異なるタイプの外部デバイスを
切り替えることが可能となる。
【０００７】本発明においては、異なる幅のデータ・バ
スを有するプラグイン・ボードを使用可能とするため
に、プロセッサがある幅のデータバスから別の幅のデー
タバスへ切り替えることができるような回路構成を採用
している。従って、例えば８ビットまたは１６ビットの
プラグイン・ボードを使用することが可能となる。実際
には、このような切り替えは、プロセッサに関係した双
方向データ・バスに挿入されたバッファの働きによりハ
ードウェア的に実現できる。このバッファは、プロセッ
サからの別の出力により制御され、且つデータ・バス上
での高位ビットの伝送を停止することができる（即ち、
該データバスを高インピーダンス状態に切り替えて、伝
送を停止することが可能である）。最後に、本発明にお
いては、プロセッサを任意の所望のクロック周波数、特
に、自身のクロック・ジェネレータの周波数より高い周
波数で動作可能とするために、インターフェースに別体
のボー・レート・ジェネレータ（ｂａｕｄ ｒａｔｅ
ｇｅｎｅｒａｔｏｒ）を装着することが望ましい。
スを有するプラグイン・ボードを使用可能とするため
に、プロセッサがある幅のデータバスから別の幅のデー
タバスへ切り替えることができるような回路構成を採用
している。従って、例えば８ビットまたは１６ビットの
プラグイン・ボードを使用することが可能となる。実際
には、このような切り替えは、プロセッサに関係した双
方向データ・バスに挿入されたバッファの働きによりハ
ードウェア的に実現できる。このバッファは、プロセッ
サからの別の出力により制御され、且つデータ・バス上
での高位ビットの伝送を停止することができる（即ち、
該データバスを高インピーダンス状態に切り替えて、伝
送を停止することが可能である）。最後に、本発明にお
いては、プロセッサを任意の所望のクロック周波数、特
に、自身のクロック・ジェネレータの周波数より高い周
波数で動作可能とするために、インターフェースに別体
のボー・レート・ジェネレータ（ｂａｕｄ ｒａｔｅ
ｇｅｎｅｒａｔｏｒ）を装着することが望ましい。
【０００８】
【実施例】図１は、本発明の一実施例の、プリンタと関
係したデータ入力／出力回路の略図が示されており、該
図１を参照して本発明の実施例を詳細に説明する。基本
構成において、データ入力／出力回路は、実際のプリン
タ機構２５を制御し、かつ印刷されるデータが供給され
るプロセッサ１を備えている。これらのデータは、アド
レス・バス（Ａ）１１及びデータ・バス（Ｄ）１２を介
してプロセッサ１に入力される。データ入力／出力回路
は、更に、記憶媒体すなわちメモリ２６、２７及び外部
デバイス用のデータ入出力接続部２８等のプラグイン・
ボードが接続されるインターフェース２０を備えてい
る。
係したデータ入力／出力回路の略図が示されており、該
図１を参照して本発明の実施例を詳細に説明する。基本
構成において、データ入力／出力回路は、実際のプリン
タ機構２５を制御し、かつ印刷されるデータが供給され
るプロセッサ１を備えている。これらのデータは、アド
レス・バス（Ａ）１１及びデータ・バス（Ｄ）１２を介
してプロセッサ１に入力される。データ入力／出力回路
は、更に、記憶媒体すなわちメモリ２６、２７及び外部
デバイス用のデータ入出力接続部２８等のプラグイン・
ボードが接続されるインターフェース２０を備えてい
る。
【０００９】プリンタ機構２５は、印刷を行うのに必要
な機械及び電子要素を含んでおり、一般に、少なくとも
１個のプリンタ・ヘッドと、例えば紙またはバッキング
・ストリップに貼付されるラベル等の印字媒体を供給す
るためのモータとを備えている。プリンタ機構２５は、
当業者には十分に公知であることから図面において詳細
に説明をしていない。プリンタ機構が熱式であれば、プ
ロセッサ１は、熱プリント・ヘッドに関係した加熱要素
をも制御する。プロセッサ１の制御タイミングは、クロ
ック・ジェネレータ５により規定される。操作者は、キ
ーボード、オペレータ・コントロール・パネルとして構
成することのできるデータ入力デバイス２４により、プ
ロセッサ１を制御することが可能になり、それによりプ
リンタ機構２５を制御することが可能となる。
な機械及び電子要素を含んでおり、一般に、少なくとも
１個のプリンタ・ヘッドと、例えば紙またはバッキング
・ストリップに貼付されるラベル等の印字媒体を供給す
るためのモータとを備えている。プリンタ機構２５は、
当業者には十分に公知であることから図面において詳細
に説明をしていない。プリンタ機構が熱式であれば、プ
ロセッサ１は、熱プリント・ヘッドに関係した加熱要素
をも制御する。プロセッサ１の制御タイミングは、クロ
ック・ジェネレータ５により規定される。操作者は、キ
ーボード、オペレータ・コントロール・パネルとして構
成することのできるデータ入力デバイス２４により、プ
ロセッサ１を制御することが可能になり、それによりプ
リンタ機構２５を制御することが可能となる。
【００１０】異なるプラグイン・ボードを各々バス２９
〜３１を介して接続することが可能なインターフェース
２０をプリンタ用に使用することが、本発明によってな
された改善事項である。該インターフェース２０を用い
れば、以下に述べるタイプの市販されているボードをプ
ロセッサ１に接続することが可能となる。即ち、外部記
憶媒体であるメモリ２６、２７のボード、外部デバイス
（セントロニクス（Ｃｅｎｔｒｏｎｉｃｓ）インターフ
ェース、ＲＳ２３２及びＲＳ４８５インターフェース、
ネットワークインターフェース（イーサネット（Ｅｔｈ
ｅｒｎｅｔ））及び同軸または対軸のインターフェース
等のＩ／Ｏボード）用のデータ入出力接続部２８のボー
ド、並びにグラフィック・ボードとの接続が可能とな
る。勿論、図面においては３個のボートがインターフェ
ース２０に接続されているが、３個以上のボードを該イ
ンターフェースに接続することも可能である。
〜３１を介して接続することが可能なインターフェース
２０をプリンタ用に使用することが、本発明によってな
された改善事項である。該インターフェース２０を用い
れば、以下に述べるタイプの市販されているボードをプ
ロセッサ１に接続することが可能となる。即ち、外部記
憶媒体であるメモリ２６、２７のボード、外部デバイス
（セントロニクス（Ｃｅｎｔｒｏｎｉｃｓ）インターフ
ェース、ＲＳ２３２及びＲＳ４８５インターフェース、
ネットワークインターフェース（イーサネット（Ｅｔｈ
ｅｒｎｅｔ））及び同軸または対軸のインターフェース
等のＩ／Ｏボード）用のデータ入出力接続部２８のボー
ド、並びにグラフィック・ボードとの接続が可能とな
る。勿論、図面においては３個のボートがインターフェ
ース２０に接続されているが、３個以上のボードを該イ
ンターフェースに接続することも可能である。
【００１１】プロセッサ１に接続されたアドレス・バス
１１が、バッファ１０の一方向作動部を介してインター
フェース２０に接続されたアドレス・バス１３に接続さ
れている。また、プロセッサ１に接続されたデータ・バ
ス１２が、バッファ１０の双方向作動部及び切り替え可
能に制御されるバッファ１６によりインターフェース２
０に接続されている。プロセッサ１により読み出される
メモリのアドレスは、バッファ１０の一方向作動部（ア
ドレスを反対方向に伝送することは不要であるから）を
介してインターフェース２０に伝送される。
１１が、バッファ１０の一方向作動部を介してインター
フェース２０に接続されたアドレス・バス１３に接続さ
れている。また、プロセッサ１に接続されたデータ・バ
ス１２が、バッファ１０の双方向作動部及び切り替え可
能に制御されるバッファ１６によりインターフェース２
０に接続されている。プロセッサ１により読み出される
メモリのアドレスは、バッファ１０の一方向作動部（ア
ドレスを反対方向に伝送することは不要であるから）を
介してインターフェース２０に伝送される。
【００１２】他方、データは、プロセッサ１へ、またプ
ロセッサ１から、双方向に伝送することが可能であり、
例えば、メモリへの書き込み及び該メモリからの読み出
しが可能となる。バッファ１０とプロセッサ１との間に
接続されたデータ・バス１２は二等分（一般に各々が８
ビットづつに分割）され、該二等分されたデータ・バス
は、切り替え可能なバッファ１６によりデータ・ワード
幅を変更するために別々のバス１４、１５に接続され
る。バッファ１６は、制御線１７を介してプロセッサ１
により制御され、次のいずれかの動作を実行する。すな
わち、（ａ）データ・バスの幅（従って、一般的には、
１６ビット）を伝送するために、インターフェース２０
に接続されたデータ・バス１８、１９を、バッファ１０
に接続されたデータ・バス１４、１５に接続するか、ま
たは、（ｂ）下位ビットのデータ・バス１５、１９上の
ビットだけが伝送されるようにして、上位ビットのデー
タ・バス１４、１８の伝送を停止するようスイッチを切
る。即ち、インターフェース２０上で幅の狭いデータ・
バスを有するメモリ２６、２７、データ入出力接続部２
８を使用するために、上位ビットのデータ・バスを互い
に隔離することができるようにしている。制御線１７上
の情報は、従って、上位ビットを伝送するか否かの制御
信号となる。
ロセッサ１から、双方向に伝送することが可能であり、
例えば、メモリへの書き込み及び該メモリからの読み出
しが可能となる。バッファ１０とプロセッサ１との間に
接続されたデータ・バス１２は二等分（一般に各々が８
ビットづつに分割）され、該二等分されたデータ・バス
は、切り替え可能なバッファ１６によりデータ・ワード
幅を変更するために別々のバス１４、１５に接続され
る。バッファ１６は、制御線１７を介してプロセッサ１
により制御され、次のいずれかの動作を実行する。すな
わち、（ａ）データ・バスの幅（従って、一般的には、
１６ビット）を伝送するために、インターフェース２０
に接続されたデータ・バス１８、１９を、バッファ１０
に接続されたデータ・バス１４、１５に接続するか、ま
たは、（ｂ）下位ビットのデータ・バス１５、１９上の
ビットだけが伝送されるようにして、上位ビットのデー
タ・バス１４、１８の伝送を停止するようスイッチを切
る。即ち、インターフェース２０上で幅の狭いデータ・
バスを有するメモリ２６、２７、データ入出力接続部２
８を使用するために、上位ビットのデータ・バスを互い
に隔離することができるようにしている。制御線１７上
の情報は、従って、上位ビットを伝送するか否かの制御
信号となる。
【００１３】比較的高速で且つ信号送出用のライン２、
３を２本しか持たないＲＩＳＣタイプのプロセッサ１を
使用することから、インターフェース２０のアクティブ
／非アクティブを制御するためのマルチプレクサ４の使
用が必然的に必要になる。図１では、プロセッサ１の読
み出し信号ライン２にはＲＤ（「読み出し」）のマーク
が付され、書き込み信号ライン３にはＷＲ（「書き込
み」）のマークが付されている。プロセッサ１がデータ
を読み出している場合には、論理「１」が読み出し信号
ライン２上に存在し、一方、プロセッサ１がインターフ
ェースにデータを伝送すると直ぐに書き込み信号ライン
３上に論理「１」が現れる。インターフェース２０は、
４本の信号ライン６〜９を有しており、そのうち１本は
任意の時に論理「１」に設定することができる。プロセ
ッサ１がインターフェース２０を介して外部デバイスへ
データを伝送している場合には、Ｉ／ＯＷＲと印された
書き込み信号ライン６が論理「１」に設定されなければ
ならず、プロセッサ１が外部デバイスからデータを読み
込んでいる場合には、Ｉ／ＯＲＤと記された読み出し信
号ライン７が論理「１」に設定されなければならない。
同様に、インターフェース２０に接続されたメモリのボ
ード上にデータを書き込みたい場合には、ＭＥＭＷＤと
記された外部記憶媒体（メモリ）用の書き込み信号ライ
ン８が論理「１」に設定される。最後に、ＭＥＭＲＤと
記された、外部メモリのボード用の読み出し信号ライン
９は、プロセッサ１が外部メモリのボードからデータを
読み出そうとすると直ぐに「１」状態になる。
３を２本しか持たないＲＩＳＣタイプのプロセッサ１を
使用することから、インターフェース２０のアクティブ
／非アクティブを制御するためのマルチプレクサ４の使
用が必然的に必要になる。図１では、プロセッサ１の読
み出し信号ライン２にはＲＤ（「読み出し」）のマーク
が付され、書き込み信号ライン３にはＷＲ（「書き込
み」）のマークが付されている。プロセッサ１がデータ
を読み出している場合には、論理「１」が読み出し信号
ライン２上に存在し、一方、プロセッサ１がインターフ
ェースにデータを伝送すると直ぐに書き込み信号ライン
３上に論理「１」が現れる。インターフェース２０は、
４本の信号ライン６〜９を有しており、そのうち１本は
任意の時に論理「１」に設定することができる。プロセ
ッサ１がインターフェース２０を介して外部デバイスへ
データを伝送している場合には、Ｉ／ＯＷＲと印された
書き込み信号ライン６が論理「１」に設定されなければ
ならず、プロセッサ１が外部デバイスからデータを読み
込んでいる場合には、Ｉ／ＯＲＤと記された読み出し信
号ライン７が論理「１」に設定されなければならない。
同様に、インターフェース２０に接続されたメモリのボ
ード上にデータを書き込みたい場合には、ＭＥＭＷＤと
記された外部記憶媒体（メモリ）用の書き込み信号ライ
ン８が論理「１」に設定される。最後に、ＭＥＭＲＤと
記された、外部メモリのボード用の読み出し信号ライン
９は、プロセッサ１が外部メモリのボードからデータを
読み出そうとすると直ぐに「１」状態になる。
【００１４】インターフェース付きの高速プロセッサ１
を作動するためには、プロセッサ１がアドレス・バス１
１を介してアドレス・デコーダ２１を動作させ、該アド
レス・デコーダが、アドレス・バス１１上に現れたアド
レスから、プロセッサ１が周辺デバイスとの入力出力操
作を実行か、または、外部メモリへのデータの書き込み
またはデータの読み出しを実行かを認識する。マルチプ
レクサ４は、アドレス・デコーダ２１の出力ライン２２
上の信号及びプロセッサ１からの読み出し及び書き込み
信号ライン２、３上の信号を参照して、インターフェー
ス２０に接続された４本の信号ライン６〜９を制御す
る。プロセッサ１からの読み出し信号ライン２が論理
「１」の状態にあり、且つ、アドレス・デコーダ２１の
出力ライン２２の信号を参照することにより記憶作業が
実施されつつあることが認識される場合には、マルチプ
レクサ４が外部メモリ用のＭＥＭＲＤ信号ライン９のみ
を論理「１」に設定する。プロセッサ１が外部デバイス
からデータを読み出そうとすると、アドレス・デコーダ
２１の出力が相補論理状態に切り替わって、Ｉ／ＯＲＤ
信号ライン７のみが論理「１」に設定される。
を作動するためには、プロセッサ１がアドレス・バス１
１を介してアドレス・デコーダ２１を動作させ、該アド
レス・デコーダが、アドレス・バス１１上に現れたアド
レスから、プロセッサ１が周辺デバイスとの入力出力操
作を実行か、または、外部メモリへのデータの書き込み
またはデータの読み出しを実行かを認識する。マルチプ
レクサ４は、アドレス・デコーダ２１の出力ライン２２
上の信号及びプロセッサ１からの読み出し及び書き込み
信号ライン２、３上の信号を参照して、インターフェー
ス２０に接続された４本の信号ライン６〜９を制御す
る。プロセッサ１からの読み出し信号ライン２が論理
「１」の状態にあり、且つ、アドレス・デコーダ２１の
出力ライン２２の信号を参照することにより記憶作業が
実施されつつあることが認識される場合には、マルチプ
レクサ４が外部メモリ用のＭＥＭＲＤ信号ライン９のみ
を論理「１」に設定する。プロセッサ１が外部デバイス
からデータを読み出そうとすると、アドレス・デコーダ
２１の出力が相補論理状態に切り替わって、Ｉ／ＯＲＤ
信号ライン７のみが論理「１」に設定される。
【００１５】同様に、アドレス・デコーダ２１の出力ラ
イン２２上の信号に依存するが、プロセッサ１からの書
き込み信号ライン３上の信号が論理「１」の状態にある
場合には、Ｉ／ＯＷＲライン６、もしくは、ＭＥＭＷＲ
信号ライン８が論理「１」に設定される。それぞれの読
み出し信号、または、書き込み信号が、ライン２、３、
６〜９上に現れる代わりに、それらの信号の論理的補数
がそれぞれのライン上に現れることが可能であること
に、留意されたい。更に、インターフェース２０は、ボ
ー・レート・ジェネレータのタイプをとる別個のクロッ
ク・ジェネレータ２３を備えることができる。
イン２２上の信号に依存するが、プロセッサ１からの書
き込み信号ライン３上の信号が論理「１」の状態にある
場合には、Ｉ／ＯＷＲライン６、もしくは、ＭＥＭＷＲ
信号ライン８が論理「１」に設定される。それぞれの読
み出し信号、または、書き込み信号が、ライン２、３、
６〜９上に現れる代わりに、それらの信号の論理的補数
がそれぞれのライン上に現れることが可能であること
に、留意されたい。更に、インターフェース２０は、ボ
ー・レート・ジェネレータのタイプをとる別個のクロッ
ク・ジェネレータ２３を備えることができる。
【００１６】
【発明の効果】以上説明したように、本発明によれば、
広範囲に使用でき、且つ高速プロセッサを使用すること
により得られる高速動作が可能なプリンタを実現するこ
とができる。
広範囲に使用でき、且つ高速プロセッサを使用すること
により得られる高速動作が可能なプリンタを実現するこ
とができる。
【図面の簡単な説明】
【図１】本発明の一実施例を表す、プリンタ用のデータ
入力及びデータ出力回路のブロック図である。
入力及びデータ出力回路のブロック図である。
Claims (10)
- 【請求項１】 記憶媒体（２６、２７）及び外部デバイ
ス用のデータ入出力接続部（２８）に接続可能なプロセ
ッサ（１）を備えたユニバーサル・インターフェース付
プリンタにおいて、 該プロセッサ（１）により動作可能であり、且つ、前記
記憶媒体（２６、２７）及び前記データ入出力接続部
（２８）の双方を接続することが可能な共通のインター
フェース（２０）を備えていることを特徴とするプリン
タ。 - 【請求項２】 請求項１記載のプリンタにおいて、前記
インターフェース（２０）が、前記外部デバイスに対す
るデータ入力及びデータ出力のための書き込み信号ライ
ン（６）及び読み出し信号ライン（７）、及び前記記憶
媒体（２６、２７）に対するデータの書き込み信号ライ
ン（８）及び読み出し信号ライン（９）を有しているこ
とを特徴とするプリンタ。 - 【請求項３】 請求項２記載のプリンタにおいて、読み
出し信号線（２）上の信号、書き込み信号線（３）上の
信号、及び前記プロセッサ（１）に接続されたアドレス
・バス（１１）上の信号を参照することにより、前記イ
ンターフェース（２０）の前記書き込み信号ライン
（６、８）及び読み出し信号ライン（７、９）を制御す
るマルチプレクサ（４）を備えていることを特徴とする
プリンタ。 - 【請求項４】 請求項３記載のプリンタにおいて、前記
プロセッサ（１）に接続されたアドレス・バス（１１）
の信号を参照することによって前記マルチプレクサ
（４）を制御するアドレス・デコーダを備えていること
を特徴とするプリンタ。 - 【請求項５】 請求項１〜４のいずれかに記載のプリン
タにおいて、前記プロセッサ（１）が、前記インターフ
ェース（２０）に接続されたデータバス（１８、１９）
の幅を、ある１つの幅から別の幅へ切り替えることがで
きるよう構成されていることを特徴とするプリンタ。 - 【請求項６】 請求項１〜５いずれかに記載のプリンタ
において、前記インターフェース（２０）に接続され
た、クロック・ジェネレータとして機能するボー・レー
ト・ジェネレータ（２３）を備えており、さらに前記プ
ロセッサ（１）がそれ自身のクロック・ジェネレータ
（５）を備えていることを特徴とするプリンタ。 - 【請求項７】 請求項１〜６のいずれかに記載のプリン
タにおいて、前記プロセッサ（１）が、プリンタ機構
（２５）を制御することを特徴とするプリンタ。 - 【請求項８】 請求項１〜７のいずれかに記載のプリン
タにおいて、ラベル・ストリップ上への印刷を可能にす
る熱式プリンタを備えていることを特徴とするプリン
タ。 - 【請求項９】 請求項１〜９記載のいずれかにプリンタ
において、前記インターフェース（２０）に接続可能な
グラフィック・カードを備えていることを特徴とするプ
リンタ。 - 【請求項１０】 請求項１〜９いずれかに記載のプリン
タにおいて、前記プロセッサ（１）がＲＩＳＣプロセッ
サであることを特徴とするプリンタ。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE4332609A DE4332609A1 (de) | 1993-09-24 | 1993-09-24 | Schaltungsanordnung zur Dateneingabe und Datenausgabe für einen Drucker |
| DE4332609.9 | 1993-09-24 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07210342A true JPH07210342A (ja) | 1995-08-11 |
Family
ID=6498569
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6220283A Pending JPH07210342A (ja) | 1993-09-24 | 1994-09-14 | ユニバーサル・インターフェース付プリンタ |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5684931A (ja) |
| EP (2) | EP0901095A3 (ja) |
| JP (1) | JPH07210342A (ja) |
| AU (1) | AU669816B2 (ja) |
| DE (2) | DE4332609A1 (ja) |
| SG (1) | SG47103A1 (ja) |
Families Citing this family (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6027265A (en) * | 1997-10-14 | 2000-02-22 | Powis Parker, Inc. | Printer having improved print head mechanism and method |
| GB2343658B (en) * | 1998-11-13 | 2002-07-31 | Esselte Nv | A printer with variable friction between printer and a medium |
| US20020138558A1 (en) * | 2001-01-11 | 2002-09-26 | Ferlitsch Andrew R. | Managing and processing print jobs in a networked computer environment |
| US6991130B2 (en) * | 2002-09-13 | 2006-01-31 | Avery Dennison Corporation | Versatile label sheet and dispenser |
| US7128236B2 (en) * | 2002-09-13 | 2006-10-31 | Avery Dennison Corporation | Versatile label sheet and dispenser |
| JP4405223B2 (ja) * | 2003-09-30 | 2010-01-27 | 株式会社キングジム | 文字情報処理システム、文字情報処理装置及び文字情報処理プログラム |
| JP4599827B2 (ja) * | 2003-10-31 | 2010-12-15 | セイコーエプソン株式会社 | テープ印刷装置およびテープ印刷装置のデータ処理方法 |
| JP2008049563A (ja) * | 2006-08-23 | 2008-03-06 | Canon Inc | 画像処理装置、画像記録装置および記録データ生成方法 |
| DE102010009229A1 (de) * | 2010-02-25 | 2011-02-17 | Wavelight Ag | Ärztliche Praxis, insbesondere für augenchirurgische Behandlungen |
| US10350905B2 (en) | 2017-01-26 | 2019-07-16 | Datamax-O'neil Corporation | Detecting printing ribbon orientation |
Family Cites Families (14)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3680569D1 (de) * | 1985-04-26 | 1991-09-05 | Sato Kk | Thermischer etikettendrucker. |
| US4807177A (en) * | 1986-06-06 | 1989-02-21 | Ward Richard J | Multiple format hand held label printer |
| JPH01118454A (ja) * | 1987-10-30 | 1989-05-10 | Brother Ind Ltd | 印字装置 |
| JPH01187627A (ja) * | 1988-01-22 | 1989-07-27 | Toshiba Corp | 情報処理装置 |
| DE58909413D1 (de) * | 1989-05-31 | 1995-10-05 | Siemens Ag | Adaptereinrichtung zum störungsfreien Anschluss von peripheren Rechnereinrichtungen an eine von Rechnersystemen gesteuerte Peripherieschnittstelle. |
| DE69108443T2 (de) * | 1990-05-17 | 1995-09-21 | Seiko Epson Corp | Streifendrucker. |
| US5150456A (en) * | 1990-08-06 | 1992-09-22 | Elite High Technology, Inc. | Graphic image printing system and method |
| US5110226A (en) * | 1990-10-19 | 1992-05-05 | Norand Corporation | Battery operated data entry terminal device and printer attachment |
| JPH05189104A (ja) * | 1990-10-31 | 1993-07-30 | Ricoh Co Ltd | 並列インタフェース |
| US5195176A (en) * | 1991-09-09 | 1993-03-16 | Destiny Technology Corporation | Method and apparatus to enhance laser printer speed and functionality |
| DE4133998A1 (de) * | 1991-10-14 | 1993-04-15 | Schmidt Anita | Druckerumschalter |
| CA2080608A1 (en) * | 1992-01-02 | 1993-07-03 | Nader Amini | Bus control logic for computer system having dual bus architecture |
| GB2267984A (en) * | 1992-06-16 | 1993-12-22 | Thorn Emi Electronics Ltd | Multiplexing bus interface. |
| US5358351A (en) * | 1992-09-30 | 1994-10-25 | Casio Computer Co., Ltd. | Printing apparatus and printing tape cassette used therefor |
-
1993
- 1993-09-24 DE DE4332609A patent/DE4332609A1/de not_active Withdrawn
-
1994
- 1994-07-21 DE DE59408384T patent/DE59408384D1/de not_active Expired - Fee Related
- 1994-07-21 SG SG1996007514A patent/SG47103A1/en unknown
- 1994-07-21 EP EP98121136A patent/EP0901095A3/de not_active Withdrawn
- 1994-07-21 EP EP94111343A patent/EP0645733B1/de not_active Expired - Lifetime
- 1994-08-16 AU AU70289/94A patent/AU669816B2/en not_active Ceased
- 1994-09-14 JP JP6220283A patent/JPH07210342A/ja active Pending
- 1994-09-22 US US08/310,634 patent/US5684931A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| EP0645733A3 (de) | 1995-06-28 |
| DE59408384D1 (de) | 1999-07-15 |
| EP0901095A2 (de) | 1999-03-10 |
| AU7028994A (en) | 1995-04-06 |
| SG47103A1 (en) | 1998-03-20 |
| AU669816B2 (en) | 1996-06-20 |
| EP0645733A2 (de) | 1995-03-29 |
| EP0645733B1 (de) | 1999-06-09 |
| EP0901095A3 (de) | 2002-06-12 |
| US5684931A (en) | 1997-11-04 |
| DE4332609A1 (de) | 1995-03-30 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20040206 |