JPH0719824B2 - 半導体試験装置 - Google Patents

半導体試験装置

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JPH0719824B2
JPH0719824B2 JP1140604A JP14060489A JPH0719824B2 JP H0719824 B2 JPH0719824 B2 JP H0719824B2 JP 1140604 A JP1140604 A JP 1140604A JP 14060489 A JP14060489 A JP 14060489A JP H0719824 B2 JPH0719824 B2 JP H0719824B2
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伸昭 阿部
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山形日本電気株式会社
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Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体の試験装置に関する。
〔従来の技術〕
最近の半導体装置の製造工程における試験の増大に伴
い、その効率の向上が重要となってきた。
第2図は従来の半導体試験装置の一例のブロック図であ
る。
半導体試験装置11aは、プロービング装置2のウェーハ
ステージ4に載置された被試験ウェーハ3のチップにテ
スト信号Sを与え測定データSを入力する測定部7
と、データS及び規格値を比較・演算するCPU6を有す
る試験回路部1と、入出力信号SIOを送受する入出力機
器12とを有していた。
この場合のチップの試験は、予め設定されたテスト条件
や規格のもとに作られたテストプログラムにより自動的
に順次テスト信号Sを供給し、ウェーハ3のチップか
ら得られた測定データSを規格値と照合し、チップの
良否を自動的に判断していた。
また製造ロットの品質管理は、サンプリングした測定デ
ータSの解折によって別に行われていた。
第3図及び第4図は半導体装置の品質管理を説明するた
めの特性分布図及びロット管理図である。
工程能力指数Cは、製造ラインが規格を満足する製品
を出しているかを示す品質管理上の判断基準で第(1)
式で表わされる。
一般に規格幅Tは標準偏差δの8倍以上であれば工程能
力は十分と云われている。
その時の工程能力指数Cは1.33となり、小さいほど好
ましくない。
=T/(6δ) …(1) また、工程能力指数CPKも工程平均及びばらつき6δ
を総合評価するために用いられる判断基準で第(2)
式及び(3)式に表わされる。
PK=〔(1−K)×T〕/6δ …(2) K=(|M−x|)/(T/2) …(3) 第3図に示す特性分布図の場合の工程能力指数Cは1.
86,CPKは0.7で、CPKが悪く、ロットは不良で製造ライ
ンは悪いと判断される。
また第4図に示すように、第9の製造ロットL9は不良ロ
ットであるが、それ以前の第6のロットL6以降からロッ
ト平均値の折線が下方管理限界線LCLに向う傾向にあ
るので、ロットL6,L7で製造ロット異常発生傾向のアラ
ームを出していた。
これらの場合、試験を含めた関連製造ラインは一時停止
され、品質管理上の対策後、製造ラインが再稼働する。
〔発明が解決しようとする課題〕
上述した従来の半導体試験装置は、被試験半導体の測定
値が規格に入っているか否かの試験と、被試験ロットの
品質管理を別途に行っていたため、半導体装置の製造工
程の品質管理上の工程能力が十分に把握されていないの
で、特性値が規格値内に入っている場合は製造ラインの
変動による規格内での特性変動に気付かず、対策が後手
となり、突然の大量不良発生による歩留の低下を生じる
という欠点があった。
本発明の目的は、製造ラインの工程能力を判定できる半
導体試験装置を提供することにある。
〔課題を解決するための手段〕
本発明の半導体試験装置は、連続する製造ロットの被試
験半導体装置を順次接続して電気的特性を測定する試験
回路部を有する半導体試験装置において、前記試験回路
部の出力する前記被試験半導体装置の測定データを入力
して記憶する記憶部と、該記憶部の記憶データを入力し
予め設定した規格値に対応して製造ラインの工程能力指
数を計算する演算部とを含む制御装置を付加して構成さ
れている。
〔実施例〕
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例のブロック図である。
半導体試験装置11は、第2図の入出力機器12の代りに試
験回路部1からの測定データSを受けてプロービング
装置2に制御信号Sを供給する制御装置5を付加した
ことが異る点以外は従来の半導体試験装置11aと同様で
ある。
制御装置5は、測定データSを記憶する記憶部9と、
予め設定した規格値幅Tに対応して製造ライン工程能力
指数C及びCPKを計算する演算部10を有している。
次に、装置11の動作を説明する。
まず、プロービング装置2のウェーハステージ4に自動
的に被試験ウェーハ3が載置される。
次に、プロービング装置2からテスト開始信号が発せら
れるとCPU6から測定部7とバイアスを印加する電源8に
測定条件が転送され、ウェーハ4の最初の被試験チップ
にテスト信号Sが供給されて、その電気的特性が試験
される。
この時、試験された測定データSはCPU6から制御装置
5へ転送される。
CPU6は、試験結果の良否信号をプロービング装置2に送
り、プロービング装置2のプローブは次の被試験チップ
に接続を移す。
制御装置5への測定データSの転送は、サンプリング
上必要な抜取数だけ行われる。
制御装置5では、記憶部9に記憶された測定データS
をもとに項目毎に規格幅に対する製造ラインの工程能力
指数C,CPKを第(1)及び第(2)式により演算部10
で計算する。
その結果が予め設定された管理基準を満足しない場合
は、演算部10からプロービング装置2へ制御信号S
供給されてウェーハ3のチップの試験を自動的に停止す
る。
それと同時に制御装置5はアラームを発し、ロット異常
を知らせる。
従って、前述の第3図に示したように、従来は規格不良
が少いので試験が続行されていたロットでも、CPK不良
の判定で自動的にアラームが発せられ、大量のロット不
良が発生する前に予防的に試験を中止できる効果があ
る。
また、第1図の記憶部9に、過去のロットののデータ
を順次記憶して第4図に示したような判定をすれば、ロ
ットの傾向管理が行える効果がある。
上述の実施例で、被試験半導体装置として被試験ウェー
ハのチップに適用したが、試験対象として特性選別試験
をする半導体装置に適用してもよい。
〔発明の効果〕
以上説明したように本発明は、記憶・演算部を有する制
御装置を付加することにより、被試験半導体装置の測定
データを抜取り、ロットの不良率及び製造ラインの工程
能力指数、さらに記憶装置へ記憶された過去のロットの
測定値による傾向管理を実施できるので、ロットの異常
予測や製造ラインの変動予測を行ない、歩留低下の防止
及び品質予知保全が可能となる効果がある。
【図面の簡単な説明】
第1図は本発明の一実施例のブロック図、第2図は従来
の半導体試験装置の一例のブロック図、第3図及び第4
図は半導体装置の品質管理を説明するための特性分布図
及びロット管理図である。 1……試験回路部、2……プロービング装置、3……被
試験ウェーハ、4……ウェーハステージ、5……制御装
置、6……CPU、7……測定部、9……記憶部、10……
演算部、S……制御信号、S……測定データ、S
……テスト信号。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】連続する製造ロットの被試験半導体装置を
    順次接続して電気的特性を測定する試験回路部を有する
    半導体試験装置において、前記試験回路部の出力する前
    記被試験半導体装置の測定データを入力して記憶する記
    憶部と、該記憶部の記憶データを入力し予め設定した規
    格値に対応して製造ラインの工程能力指数を計算する演
    算部とを含む制御装置を付加したことを特徴とする半導
    体試験装置。
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JP2684011B2 (ja) * 1994-02-04 1997-12-03 本田技研工業株式会社 内燃機関の異常判定装置
JP2019144104A (ja) * 2018-02-21 2019-08-29 セイコーエプソン株式会社 電子部品搬送装置および電子部品検査装置

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* Cited by examiner, † Cited by third party
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JPS62154639A (ja) * 1985-12-26 1987-07-09 Sharp Corp 半導体選別装置

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