JPH07121726A - 画像処理回路 - Google Patents
画像処理回路Info
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- JPH07121726A JPH07121726A JP26274493A JP26274493A JPH07121726A JP H07121726 A JPH07121726 A JP H07121726A JP 26274493 A JP26274493 A JP 26274493A JP 26274493 A JP26274493 A JP 26274493A JP H07121726 A JPH07121726 A JP H07121726A
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Abstract
(57)【要約】
【目的】 圧縮画像データの伸張処理等を高速で行う。
【構成】 外部メモリ１より読み出した圧縮画像データ
をメモリ部２に書き込み、書き込みデータが所要量にな
ったとき、画像処理制御部６を介し圧縮／伸張プロセッ
サ部５に転送開始し、画像処理制御部よりの伸張処理制
御信号により伸張処理を開始する。書き込みデータ量が
転送データ量＋所要値以下になった場合にデータ転送お
よび伸張処理を中断し、書き込みデータ量が所要量に達
したとき伸張処理を再開する。また、非圧縮画像データ
は、データ入力部７よりフレームメモリ８を介し圧縮／
伸張プロセッサ部に入力し、画像処理制御部よりの圧縮
処理信号により圧縮処理され、メモリ部に書き込まれ、
外部メモリに転送し記録される。
をメモリ部２に書き込み、書き込みデータが所要量にな
ったとき、画像処理制御部６を介し圧縮／伸張プロセッ
サ部５に転送開始し、画像処理制御部よりの伸張処理制
御信号により伸張処理を開始する。書き込みデータ量が
転送データ量＋所要値以下になった場合にデータ転送お
よび伸張処理を中断し、書き込みデータ量が所要量に達
したとき伸張処理を再開する。また、非圧縮画像データ
は、データ入力部７よりフレームメモリ８を介し圧縮／
伸張プロセッサ部に入力し、画像処理制御部よりの圧縮
処理信号により圧縮処理され、メモリ部に書き込まれ、
外部メモリに転送し記録される。
Description
【０００１】
【産業上の利用分野】本発明は画像処理回路に係り、画
像データの伸張処理等を高速で行うものに関する。
像データの伸張処理等を高速で行うものに関する。
【０００２】
【従来の技術】光磁気ディスク、ハードディスクあるい
はフロッピィディスク等の記録媒体に圧縮して記録され
ている画像データを読み出し伸張処理する場合、通常、
記録媒体のデータ読み出し速度よりも伸張回路の処理速
度の方が早いため、記録媒体より読み出したデータを所
要量をメモリに溜めて処理回路に転送するという動作を
行っている。
はフロッピィディスク等の記録媒体に圧縮して記録され
ている画像データを読み出し伸張処理する場合、通常、
記録媒体のデータ読み出し速度よりも伸張回路の処理速
度の方が早いため、記録媒体より読み出したデータを所
要量をメモリに溜めて処理回路に転送するという動作を
行っている。
【０００３】
【発明が解決しようとする課題】上述のように、記録媒
体よりの圧縮データの読み出し速度よりもメモリの書き
込み、あるいは伸張処理回路の処理速度の方が早いとい
うことは、メモリの動作中に空き時間があることを意味
する。本発明はこのような点に鑑み、記録媒体よりメモ
リに所要量の圧縮データが取り込まれた時点でデータの
読み出しを開始し、伸張処理回路に転送して伸張処理を
開始するようにして、データの伸張処理を高速化するも
のを提供することにある。
体よりの圧縮データの読み出し速度よりもメモリの書き
込み、あるいは伸張処理回路の処理速度の方が早いとい
うことは、メモリの動作中に空き時間があることを意味
する。本発明はこのような点に鑑み、記録媒体よりメモ
リに所要量の圧縮データが取り込まれた時点でデータの
読み出しを開始し、伸張処理回路に転送して伸張処理を
開始するようにして、データの伸張処理を高速化するも
のを提供することにある。
【０００４】
【課題を解決するための手段】本発明は上述の課題を解
決するため、外部メモリより取り込まれた圧縮画像デー
タを記録するメモリ部と、メモリ部より読み出し転送さ
れた圧縮画像データを伸張処理する伸張プロセッサ部
と、伸張処理の制御信号を出力する画像処理制御部と、
メモリ部に記録されるデータ数を計数し、所要の計数値
にて信号出力する第１カウンタと、前記伸張プロセッサ
部に転送されるデータ数を計数し所要値を加算して出力
する第２カウンタと、前記外部メモリよりのデータ数を
第２カウンタよりの値と比較し、同数に達した場合に信
号出力する比較回路と、前記第１カウンタよりの信号に
てオン、前記比較回路よりの信号にてオフし、オンの期
間、前記画像処理制御部よりの伸張制御信号を前記伸張
プロセッサ部に送出するON／OFF 回路とで構成した画像
処理回路を提供するものである。
決するため、外部メモリより取り込まれた圧縮画像デー
タを記録するメモリ部と、メモリ部より読み出し転送さ
れた圧縮画像データを伸張処理する伸張プロセッサ部
と、伸張処理の制御信号を出力する画像処理制御部と、
メモリ部に記録されるデータ数を計数し、所要の計数値
にて信号出力する第１カウンタと、前記伸張プロセッサ
部に転送されるデータ数を計数し所要値を加算して出力
する第２カウンタと、前記外部メモリよりのデータ数を
第２カウンタよりの値と比較し、同数に達した場合に信
号出力する比較回路と、前記第１カウンタよりの信号に
てオン、前記比較回路よりの信号にてオフし、オンの期
間、前記画像処理制御部よりの伸張制御信号を前記伸張
プロセッサ部に送出するON／OFF 回路とで構成した画像
処理回路を提供するものである。
【０００５】
【作用】以上のように構成したので、本発明による画像
処理回路においては、光磁気ディスク等の外部メモリに
記録されている圧縮画像データを伸張処理する場合、外
部メモリより読み出したデータをメモリに書き込み、書
き込みデータのアドレス数が所要量になったとき読み出
しを開始し、伸張プロセッサ部に転送して伸張処理を開
始する。そして、転送されるデータの数が書き込みデー
タのアドレス数よりも所要の値より少なくなった場合に
伸張処理を中断し、書き込みデータのアドレス数が所要
量になったとき、中断していた伸張処理を続行する。
処理回路においては、光磁気ディスク等の外部メモリに
記録されている圧縮画像データを伸張処理する場合、外
部メモリより読み出したデータをメモリに書き込み、書
き込みデータのアドレス数が所要量になったとき読み出
しを開始し、伸張プロセッサ部に転送して伸張処理を開
始する。そして、転送されるデータの数が書き込みデー
タのアドレス数よりも所要の値より少なくなった場合に
伸張処理を中断し、書き込みデータのアドレス数が所要
量になったとき、中断していた伸張処理を続行する。
【０００６】
【実施例】以下、図面に基づいて本発明による画像処理
回路の実施例を詳細に説明する。図１は本発明による画
像処理回路の一実施例の要部ブロック図である。図にお
いて、１は外部メモリで、画像データの記録／再生が可
能な記録媒体、例えば、光磁気ディスク、ハードディス
クあるいはフロッピィディスク等で構成され、所要の圧
縮処理のなされた画像データ等を記録する。２はメモリ
部で、外部メモリ１より読み出された圧縮画像データ、
あるいは外部メモリ１に記録するための圧縮処理した画
像データ等を記録する。３はＤＭＡ（direct memory ac
cess）制御部、４はＣＰＵで、これらＤＭＡ制御部３若
しくはＣＰＵ４により、前記外部メモリ１およびメモリ
部２の間の書き込み・読み出し制御等を行う。５は圧縮
／伸張プロセッサ部で、圧縮画像データの伸張処理また
は非圧縮画像データの圧縮処理を行う。６は画像処理制
御部で、圧縮／伸張プロセッサ部５の制御を行うと共
に、圧縮／伸張プロセッサ部５で処理されたデータの前
記メモリ部２への書き込みを制御する。７はデータ入力
部で、非圧縮画像データ等を入力する。８はフレームメ
モリで、データ入力部７よりの画像データを記録する。
９はモニタで、フレームメモリ８より読み出された画像
データに基づいて画面に表示する。
回路の実施例を詳細に説明する。図１は本発明による画
像処理回路の一実施例の要部ブロック図である。図にお
いて、１は外部メモリで、画像データの記録／再生が可
能な記録媒体、例えば、光磁気ディスク、ハードディス
クあるいはフロッピィディスク等で構成され、所要の圧
縮処理のなされた画像データ等を記録する。２はメモリ
部で、外部メモリ１より読み出された圧縮画像データ、
あるいは外部メモリ１に記録するための圧縮処理した画
像データ等を記録する。３はＤＭＡ（direct memory ac
cess）制御部、４はＣＰＵで、これらＤＭＡ制御部３若
しくはＣＰＵ４により、前記外部メモリ１およびメモリ
部２の間の書き込み・読み出し制御等を行う。５は圧縮
／伸張プロセッサ部で、圧縮画像データの伸張処理また
は非圧縮画像データの圧縮処理を行う。６は画像処理制
御部で、圧縮／伸張プロセッサ部５の制御を行うと共
に、圧縮／伸張プロセッサ部５で処理されたデータの前
記メモリ部２への書き込みを制御する。７はデータ入力
部で、非圧縮画像データ等を入力する。８はフレームメ
モリで、データ入力部７よりの画像データを記録する。
９はモニタで、フレームメモリ８より読み出された画像
データに基づいて画面に表示する。
【０００７】次に、本発明による画像処理回路の動作
を、図２に示す前記メモリ部２部分の要部詳細ブロック
図により説明する。まず、圧縮画像データを伸張処理す
る場合、ＤＭＡ制御部３若しくはＣＰＵ４の制御によ
り、外部メモリ１より読み出された圧縮データおよびア
ドレス等はデータ端子11より入力し、バッファ12にラッ
チされ、メモリ13にＩ／Ｏ（データ入出力動作）の期間
に順次入力し、１画像分を記録する。メモリ13に記録さ
れた圧縮画像データは読み出され、バッファ14にラッチ
され、データ端子15より圧縮／伸張プロセッサ部５へ送
出される。なお、メモリ13は、所要のメモリ切り換え用
クロック信号に基づいて、メモリ制御回路16を介しスイ
ッチ16の切り換えを行い、データ入出力（Ｉ／Ｏ）動
作、または圧縮／伸張（Ｃ／Ｄ）動作に切り換わる。
を、図２に示す前記メモリ部２部分の要部詳細ブロック
図により説明する。まず、圧縮画像データを伸張処理す
る場合、ＤＭＡ制御部３若しくはＣＰＵ４の制御によ
り、外部メモリ１より読み出された圧縮データおよびア
ドレス等はデータ端子11より入力し、バッファ12にラッ
チされ、メモリ13にＩ／Ｏ（データ入出力動作）の期間
に順次入力し、１画像分を記録する。メモリ13に記録さ
れた圧縮画像データは読み出され、バッファ14にラッチ
され、データ端子15より圧縮／伸張プロセッサ部５へ送
出される。なお、メモリ13は、所要のメモリ切り換え用
クロック信号に基づいて、メモリ制御回路16を介しスイ
ッチ16の切り換えを行い、データ入出力（Ｉ／Ｏ）動
作、または圧縮／伸張（Ｃ／Ｄ）動作に切り換わる。
【０００８】前記外部メモリ１よりの圧縮画像データの
読み出しにて、前記ＤＭＡ制御部３若しくはＣＰＵ４よ
りの１データごとのメモリアドレス信号がアドレス端子
18より入力し、Ｉ／Ｏインターフェース19を介して＋ｍ
回路20に入力し計数を行う。＋ｍ回路20は、入力信号の
数が所要値になったとき信号出力し、この信号によりON
／OFF 回路21はオンに切り換わり、端子22よりＣ／Ｄイ
ンターフェース23を介して入力される画像処理制御部６
よりの伸張制御信号を、端子24を介して圧縮／伸張プロ
セッサ部５に送出する。圧縮／伸張プロセッサ部５は、
この伸張制御信号に基づいてメモリ13より転送された圧
縮画像データの伸張処理を開始する。
読み出しにて、前記ＤＭＡ制御部３若しくはＣＰＵ４よ
りの１データごとのメモリアドレス信号がアドレス端子
18より入力し、Ｉ／Ｏインターフェース19を介して＋ｍ
回路20に入力し計数を行う。＋ｍ回路20は、入力信号の
数が所要値になったとき信号出力し、この信号によりON
／OFF 回路21はオンに切り換わり、端子22よりＣ／Ｄイ
ンターフェース23を介して入力される画像処理制御部６
よりの伸張制御信号を、端子24を介して圧縮／伸張プロ
セッサ部５に送出する。圧縮／伸張プロセッサ部５は、
この伸張制御信号に基づいてメモリ13より転送された圧
縮画像データの伸張処理を開始する。
【０００９】前記メモリ13より圧縮／伸張プロセッサ部
５に転送されるデータの数をカウンタ25で計数し、カウ
ンタ25よりの信号を＋ｎ回路26に印加し、予め設定した
所要の値を加算し、比較回路27に入力する。比較回路27
は、＋ｎ回路26よりの値を前記アドレス端子18よりバッ
ファ28を介し入力されるアドレス信号の数と比較し、＋
ｎ回路26よりの値がアドレス信号の数に等しくなった場
合に信号出力し、ON／OFF 回路21をオフに切り換え、圧
縮／伸張プロセッサ５への伸張制御信号送出を停止し、
伸張処理を中断する。その後、比較回路27により、前記
＋ｎ回路26よりの値と前記アドレス端子18よりのアドレ
ス信号の数との比較を続け、＋ｎ回路26よりの値が小さ
くなったとき信号出力し、前記ON／OFF 回路21をオンに
切り換え、圧縮／伸張プロセッサ部５に伸張制御信号を
出力し、中断されていた画像データの伸張処理を続行す
る。なお、スイッチ30は、伸張処理動作の間はオフにな
っている。
５に転送されるデータの数をカウンタ25で計数し、カウ
ンタ25よりの信号を＋ｎ回路26に印加し、予め設定した
所要の値を加算し、比較回路27に入力する。比較回路27
は、＋ｎ回路26よりの値を前記アドレス端子18よりバッ
ファ28を介し入力されるアドレス信号の数と比較し、＋
ｎ回路26よりの値がアドレス信号の数に等しくなった場
合に信号出力し、ON／OFF 回路21をオフに切り換え、圧
縮／伸張プロセッサ５への伸張制御信号送出を停止し、
伸張処理を中断する。その後、比較回路27により、前記
＋ｎ回路26よりの値と前記アドレス端子18よりのアドレ
ス信号の数との比較を続け、＋ｎ回路26よりの値が小さ
くなったとき信号出力し、前記ON／OFF 回路21をオンに
切り換え、圧縮／伸張プロセッサ部５に伸張制御信号を
出力し、中断されていた画像データの伸張処理を続行す
る。なお、スイッチ30は、伸張処理動作の間はオフにな
っている。
【００１０】そして、外部メモリ１よりメモリ13への圧
縮画像データの転送が終了した場合、ＣＰＵ４よりの転
送終了フラグに基づいて＋ｍ回路20の動作を禁止し、ON
／OFF 回路21をオンにし、メモリ13に残っている圧縮画
像データを全て圧縮／伸張プロセッサ部５に転送し伸張
処理を行う。圧縮／伸張プロセッサ部５は、圧縮画像デ
ータの終了コードに応じて伸張処理動作を停止する。以
上の動作により、外部メモリ１よりのデータの読み出し
速度と、圧縮／伸張プロセッサ部５の伸張処理速度が異
なっていても、圧縮画像データの伸張処理に支障を生じ
ない。
縮画像データの転送が終了した場合、ＣＰＵ４よりの転
送終了フラグに基づいて＋ｍ回路20の動作を禁止し、ON
／OFF 回路21をオンにし、メモリ13に残っている圧縮画
像データを全て圧縮／伸張プロセッサ部５に転送し伸張
処理を行う。圧縮／伸張プロセッサ部５は、圧縮画像デ
ータの終了コードに応じて伸張処理動作を停止する。以
上の動作により、外部メモリ１よりのデータの読み出し
速度と、圧縮／伸張プロセッサ部５の伸張処理速度が異
なっていても、圧縮画像データの伸張処理に支障を生じ
ない。
【００１１】なお、メモリ13のメモリ容量は、例えば、
１／10に圧縮されたハイビジョン信号を２画像分記録で
きるものに設定し、伸張処理された画像を確認するた
め、画像データをフレームメモリ８を介してモニタ９に
入力し、画面表示等している間に次の圧縮画像を取り込
めるようにする、あるいは圧縮率が１／10以下（１／５
以内）の場合に１画像で全容量を使用するようにする、
または、圧縮率が１／10以上の場合には２画像以上の圧
縮データを取り込むようにすることができる。
１／10に圧縮されたハイビジョン信号を２画像分記録で
きるものに設定し、伸張処理された画像を確認するた
め、画像データをフレームメモリ８を介してモニタ９に
入力し、画面表示等している間に次の圧縮画像を取り込
めるようにする、あるいは圧縮率が１／10以下（１／５
以内）の場合に１画像で全容量を使用するようにする、
または、圧縮率が１／10以上の場合には２画像以上の圧
縮データを取り込むようにすることができる。
【００１２】次に、画像データの圧縮処理動作を説明す
る。非圧縮の画像データはデータ入力部７より入力し、
フレームメモリ８を介して圧縮／伸張プロセッサ部５に
入力し、画像処理制御部６よりの信号に応じて圧縮処理
を行う。圧縮された画像データは画像処理制御部６を介
しメモリ部２に入力し記録する。そして、メモリ部２の
データを外部メモリ１に書き込む場合、データのヘッダ
領域に記録するためのデータ量、データの圧縮率等の情
報を付して外部メモリ１に転送する。
る。非圧縮の画像データはデータ入力部７より入力し、
フレームメモリ８を介して圧縮／伸張プロセッサ部５に
入力し、画像処理制御部６よりの信号に応じて圧縮処理
を行う。圧縮された画像データは画像処理制御部６を介
しメモリ部２に入力し記録する。そして、メモリ部２の
データを外部メモリ１に書き込む場合、データのヘッダ
領域に記録するためのデータ量、データの圧縮率等の情
報を付して外部メモリ１に転送する。
【００１３】すなわち、圧縮／伸張プロセッサ部５にて
圧縮処理された画像データはデータ端子15よりバッファ
14に入力し、ラッチされ、Ｃ／Ｄ期間にメモリ13に入力
し、書き込みを行い、入力データのアドレス数をカウン
タ25により計数し、バッファ29にラッチし、スイッチ17
を介しメモリ13のＣ／Ｄ期間にメモリ13に入力し、書き
込みを行う。そして、Ｉ／Ｏインターフェース19よりの
信号にてスイッチ３０をオンにし、カウンタ25に記録さ
た最終アドレスに基づく終了コードを送出し、メモリ13
に記録する。メモリ13への圧縮画像データの書き込み終
了後、Ｉ／Ｏインターフェース19を介しＣＰＵ４または
ＤＭＡ制御部３に制御信号を出力し、外部メモリ１を圧
縮画像データの書き込み動作に制御し、ＣＰＵ４を介し
データ長および圧縮率等の情報をデータヘッダ領域に追
加し、メモリ13の圧縮画像データを読み出し、外部メモ
リ１に転送して記録する。
圧縮処理された画像データはデータ端子15よりバッファ
14に入力し、ラッチされ、Ｃ／Ｄ期間にメモリ13に入力
し、書き込みを行い、入力データのアドレス数をカウン
タ25により計数し、バッファ29にラッチし、スイッチ17
を介しメモリ13のＣ／Ｄ期間にメモリ13に入力し、書き
込みを行う。そして、Ｉ／Ｏインターフェース19よりの
信号にてスイッチ３０をオンにし、カウンタ25に記録さ
た最終アドレスに基づく終了コードを送出し、メモリ13
に記録する。メモリ13への圧縮画像データの書き込み終
了後、Ｉ／Ｏインターフェース19を介しＣＰＵ４または
ＤＭＡ制御部３に制御信号を出力し、外部メモリ１を圧
縮画像データの書き込み動作に制御し、ＣＰＵ４を介し
データ長および圧縮率等の情報をデータヘッダ領域に追
加し、メモリ13の圧縮画像データを読み出し、外部メモ
リ１に転送して記録する。
【００１４】なおメモリ13の記録容量を圧縮画像の２画
像分の容量に設定し、フレームメモリ８のフレーム数を
適宜に設定しておくことにより、多画像を連続的に圧縮
処理する場合、例えば、先に処理された圧縮画像データ
を外部メモリ１に転送（Ｉ／Ｏ期間）しながら、これに
平行して次の画像データを圧縮処理（Ｃ／Ｄ期間）する
ことができるので、２画像目以降の画像圧縮処理速度を
上げることができる。また、圧縮率の異なる画像を２枚
書き込み、比較し選択して外部メモリに書き込むように
もできる。
像分の容量に設定し、フレームメモリ８のフレーム数を
適宜に設定しておくことにより、多画像を連続的に圧縮
処理する場合、例えば、先に処理された圧縮画像データ
を外部メモリ１に転送（Ｉ／Ｏ期間）しながら、これに
平行して次の画像データを圧縮処理（Ｃ／Ｄ期間）する
ことができるので、２画像目以降の画像圧縮処理速度を
上げることができる。また、圧縮率の異なる画像を２枚
書き込み、比較し選択して外部メモリに書き込むように
もできる。
【００１５】
【発明の効果】以上に説明したように、本発明による画
像処理回路によれば、メモリ回路をデータの入出力動作
および画像伸張処理動作にクロックで切り換えて動作さ
せるもので、メモリに圧縮画像データが所要量入力され
た時点で伸張処理動作を開始するようにできるので、複
数の圧縮画像を連続的に伸張処理する場合に２枚目以降
の画像の処理結果を従来より早く得られる。また、メモ
リの記録容量を圧縮画像の約２画像分に設定し、Ｉ／Ｏ
期間とＣ／Ｄ期間とで使い分けることにより、伸張処理
した画像の確認を行いながら、これに平行して次の画像
の伸張処理を行う、あるいは、圧縮処理された画像の転
送と次の画像圧縮処理とを平行して行う等により処理速
度を上げることができる。。
像処理回路によれば、メモリ回路をデータの入出力動作
および画像伸張処理動作にクロックで切り換えて動作さ
せるもので、メモリに圧縮画像データが所要量入力され
た時点で伸張処理動作を開始するようにできるので、複
数の圧縮画像を連続的に伸張処理する場合に２枚目以降
の画像の処理結果を従来より早く得られる。また、メモ
リの記録容量を圧縮画像の約２画像分に設定し、Ｉ／Ｏ
期間とＣ／Ｄ期間とで使い分けることにより、伸張処理
した画像の確認を行いながら、これに平行して次の画像
の伸張処理を行う、あるいは、圧縮処理された画像の転
送と次の画像圧縮処理とを平行して行う等により処理速
度を上げることができる。。
【図１】本発明による画像処理回路の一実施例の要部ブ
ロック図である。
ロック図である。
【図２】本発明による画像処理回路のメモリ回路の要部
ブロック図である。
ブロック図である。
１ 外部メモリ ２ メモリ部 ３ ＤＭＡ制御部 ４ ＣＰＵ ５ 圧縮／伸張プロセッサ部 ６ 画像処理制御部 ７ データ入力部 ８ フレームメモリ 11 データ端子（圧縮画像データ入出力） 13 メモリ 15 データ端子（非圧縮画像データ入力） 16 メモリ制御回路 17 スイッチ 18 アドレス端子 20 ＋ｍ回路 21 ON／OFF 回路 22 端子（伸張制御信号入力） 24 端子（伸張制御信号出力） 25 カウンタ 26 ＋ｎ回路 27 比較回路
Claims (4)
- 【請求項１】 外部メモリより取り込まれた圧縮画像デ
ータを記録するメモリ手段と、メモリ手段よりの圧縮画
像データを伸張処理する伸張プロセッサ手段と、前記メ
モリ手段に記録されるデータの量に応じて前記伸張プロ
セッサ手段を伸張動作／伸張停止に制御する制御手段と
で構成した画像処理回路。 - 【請求項２】 外部メモリより取り込まれた圧縮画像デ
ータを記録するメモリ部と、メモリ部より読み出し転送
された圧縮画像データを伸張処理する伸張プロセッサ部
と、伸張処理の制御信号を出力する画像処理制御部と、
メモリ部に記録されるデータ数を計数し、所要の計数値
にて信号出力する第１カウンタと、前記伸張プロセッサ
部に転送されるデータ数を計数し所要値を加算して出力
する第２カウンタと、前記外部メモリよりのデータ数を
第２カウンタよりの値と比較し、同数に達した場合に信
号出力する比較回路と、前記第１カウンタよりの信号に
てオン、前記比較回路よりの信号にてオフし、オンの期
間、前記画像処理制御部よりの伸張制御信号を前記伸張
プロセッサ部に送出するON／OFF 回路とで構成した画像
処理回路。 - 【請求項３】 非圧縮の画像データを入力するデータ入
力部と、データ入力部よりの画像データを圧縮処理する
圧縮プロセッサ部とを設け、圧縮プロセッサ部よりの圧
縮画像データを前記メモリ部に記録した後、メモリ部の
圧縮画像データを読み出し、前記外部メモリに記録する
ようにした請求項２記載の画像処理回路。 - 【請求項４】 前記メモリ部の記録容量を圧縮画像を２
画像分以上記録可能な容量に設定し、画像伸張処理時、
第１の圧縮画像データの伸張処理された画像をモニタ画
面に表示する等の間に第２の圧縮画像データの書き込み
を行えるようにし、また、画像圧縮処理時、圧縮プロセ
ッサ部にて圧縮処理され書き込まれた第１の圧縮画像デ
ータを外部メモリに転送する間に、圧縮プロセッサ部よ
りの第２の圧縮画像データの書き込みを行えるようにし
た請求項２記載の画像処理回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26274493A JP2862121B2 (ja) | 1993-10-20 | 1993-10-20 | 画像処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26274493A JP2862121B2 (ja) | 1993-10-20 | 1993-10-20 | 画像処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH07121726A true JPH07121726A (ja) | 1995-05-12 |
| JP2862121B2 JP2862121B2 (ja) | 1999-02-24 |
Family
ID=17379986
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26274493A Expired - Lifetime JP2862121B2 (ja) | 1993-10-20 | 1993-10-20 | 画像処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2862121B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008047038A (ja) * | 2006-08-21 | 2008-02-28 | Fujitsu Ltd | 画像処理装置及び画像処理方法 |
| JP2008535547A (ja) * | 2005-03-24 | 2008-09-04 | ギブン・イメージング・リミテツド | 定ビットレート伝送を提供するインビボ撮像装置 |
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1993
- 1993-10-20 JP JP26274493A patent/JP2862121B2/ja not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008535547A (ja) * | 2005-03-24 | 2008-09-04 | ギブン・イメージング・リミテツド | 定ビットレート伝送を提供するインビボ撮像装置 |
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| Publication number | Publication date |
|---|---|
| JP2862121B2 (ja) | 1999-02-24 |
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