JPH0651282A - 表示制御装置 - Google Patents
表示制御装置Info
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- JPH0651282A JPH0651282A JP20554092A JP20554092A JPH0651282A JP H0651282 A JPH0651282 A JP H0651282A JP 20554092 A JP20554092 A JP 20554092A JP 20554092 A JP20554092 A JP 20554092A JP H0651282 A JPH0651282 A JP H0651282A
- Authority
- JP
- Japan
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- signal
- image
- input
- display
- image signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Liquid Crystal Display Device Control (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
Abstract
(57)【要約】
【目的】 表示画像を部分的に書き換えることにより良
好な画像を表示する。 【構成】 メモリ性のあるディスプレイに画像を表示す
るための表示制御装置において、画像信号を入力する手
段（１００）と、該入力手段により入力された画像信号
を格納する格納手段（１７０、１８０）と、該入力手段
から入力される画像信号と該格納手段に格納された単位
時間前の同一位置の画像信号との差分値を求める差分算
出手段（１９０）と、該差分値から表示の部分書換信号
を生成する部分書換制御手段（２２０）を具備すること
を特徴とする。
好な画像を表示する。 【構成】 メモリ性のあるディスプレイに画像を表示す
るための表示制御装置において、画像信号を入力する手
段（１００）と、該入力手段により入力された画像信号
を格納する格納手段（１７０、１８０）と、該入力手段
から入力される画像信号と該格納手段に格納された単位
時間前の同一位置の画像信号との差分値を求める差分算
出手段（１９０）と、該差分値から表示の部分書換信号
を生成する部分書換制御手段（２２０）を具備すること
を特徴とする。
Description
【０００１】
【産業上の利用分野】入力画像信号を該入力画像信号の
フレーム周波数より低い周波数で画像を表示するメモリ
性のあるディスプレイ、特に強誘電性液晶ディスプレイ
（Ｆｅｒｒｏｅｌｅｃｔｒｉｃ Ｌｉｑｕｉｄ Ｃｒｙ
ｓｔａｌ Ｄｉｓｐｌａｙ：以下、ＦＬＣＤと略す）に
よる表示を制御する表示制御装置に関するものである。
フレーム周波数より低い周波数で画像を表示するメモリ
性のあるディスプレイ、特に強誘電性液晶ディスプレイ
（Ｆｅｒｒｏｅｌｅｃｔｒｉｃ Ｌｉｑｕｉｄ Ｃｒｙ
ｓｔａｌ Ｄｉｓｐｌａｙ：以下、ＦＬＣＤと略す）に
よる表示を制御する表示制御装置に関するものである。
【０００２】
【従来の技術】まず、ＦＬＣＤについて簡単に述べる。
ＦＬＣＤは液晶を用いた２値ディスプレイであるが、デ
ィスプレイを構成する画素自体にメモリ性があり、電界
がかからなくなっても画素セルが電界の印加によって変
化した表示状態を保持し続ける特徴がある。大画面の製
造が容易であることから、次世代のディスプレイとして
期待がもたれている。
ＦＬＣＤは液晶を用いた２値ディスプレイであるが、デ
ィスプレイを構成する画素自体にメモリ性があり、電界
がかからなくなっても画素セルが電界の印加によって変
化した表示状態を保持し続ける特徴がある。大画面の製
造が容易であることから、次世代のディスプレイとして
期待がもたれている。
【０００３】また、文字や線図形と自然画像が混在して
いても高画質な２値画像が得られる２値化手法として、
誤差拡散法や平均濃度保存法等の２値化手法が普及し始
めている。
いても高画質な２値画像が得られる２値化手法として、
誤差拡散法や平均濃度保存法等の２値化手法が普及し始
めている。
【０００４】ＦＬＣＤはその特性から、高精細化したデ
ィスプレイ表示スピード、例えば画像サイズ１２８０×
１０２４の６０Ｈｚノンインターレースに、対応できな
い。特に、近年高精細化が進むワークステーション等の
コンピュータ表示出力に対しては、フレーム周波数が１
／４程度であり、インタラクティブ性が問われる、マウ
ス等のカーソル移動等ではこの動きに表示が追従せず、
作業者に不快感を与え、作業効率の低下を招いていた。
ィスプレイ表示スピード、例えば画像サイズ１２８０×
１０２４の６０Ｈｚノンインターレースに、対応できな
い。特に、近年高精細化が進むワークステーション等の
コンピュータ表示出力に対しては、フレーム周波数が１
／４程度であり、インタラクティブ性が問われる、マウ
ス等のカーソル移動等ではこの動きに表示が追従せず、
作業者に不快感を与え、作業効率の低下を招いていた。
【０００５】そのため、ＦＬＣＤのメモリ性を生かし、
フレーム間で変化があった部分のみを表示状態を変更
し、見かけのフレーム周波数を向上させる方式が考えら
れている。
フレーム間で変化があった部分のみを表示状態を変更
し、見かけのフレーム周波数を向上させる方式が考えら
れている。
【０００６】図２はコンピュータとディスプレイとの関
係を示したものである。１０はコンピュータ本体であ
り、ＣＰＵとメモリ、ディスク等の周辺装置で構成され
ている。コンピュータ本体からは、ディスプレイ表示の
ための画像信号１１が出力される。通常、画像信号１１
ディジタル信号や、アナログ信号であれば、ＮＴＳＣコ
ンポジット信号、コンポーネントＲＧＢ信号、ノンイン
ターレース信号等である。３０はＦＬＣＤである。２０
は本発明に関する画像処理部であり、コンピュータ本体
１０からのＲＧＢアナログ信号１１を入力し、ＦＬＣＤ
３０に出力可能なＲＧＢ各１ビットのディジタル信号１
２に変換する。ＦＬＣＤ３０は画像処理部２０からのデ
ィジタルＲＧＢ信号１２を入力し、表示する。
係を示したものである。１０はコンピュータ本体であ
り、ＣＰＵとメモリ、ディスク等の周辺装置で構成され
ている。コンピュータ本体からは、ディスプレイ表示の
ための画像信号１１が出力される。通常、画像信号１１
ディジタル信号や、アナログ信号であれば、ＮＴＳＣコ
ンポジット信号、コンポーネントＲＧＢ信号、ノンイン
ターレース信号等である。３０はＦＬＣＤである。２０
は本発明に関する画像処理部であり、コンピュータ本体
１０からのＲＧＢアナログ信号１１を入力し、ＦＬＣＤ
３０に出力可能なＲＧＢ各１ビットのディジタル信号１
２に変換する。ＦＬＣＤ３０は画像処理部２０からのデ
ィジタルＲＧＢ信号１２を入力し、表示する。
【０００７】
【発明が解決しようとしている課題】しかしながら、図
２にような構成では、コンピュータ１０からの出力は、
例えば画像信号１１が１２８０×１０２４サイズ相当の
６０Ｈｚノンインターレースのアナログ信号であり、図
６に示すようにカーソルが移動しても、カーソルの形状
や、（Ｘ０，Ｙ０）→（Ｘ１，Ｙ１）といった移動の情
報は特に与えられない。即ち、高速表示を実現するため
の表示状態を変更する領域に関する情報がない。
２にような構成では、コンピュータ１０からの出力は、
例えば画像信号１１が１２８０×１０２４サイズ相当の
６０Ｈｚノンインターレースのアナログ信号であり、図
６に示すようにカーソルが移動しても、カーソルの形状
や、（Ｘ０，Ｙ０）→（Ｘ１，Ｙ１）といった移動の情
報は特に与えられない。即ち、高速表示を実現するため
の表示状態を変更する領域に関する情報がない。
【０００８】したがって入力される画像データからこれ
らの情報を抽出しなければならない。
らの情報を抽出しなければならない。
【０００９】特に、画像データを量子化して表示する場
合に、表示状態を変更すべき領域をいかに抽出するかが
問題となる。
合に、表示状態を変更すべき領域をいかに抽出するかが
問題となる。
【００１０】本発明は、かかる事情に鑑みてなされたも
のであり、表示画像を部分的に書き換えることにより、
良好な画像を表示することを目的とする。
のであり、表示画像を部分的に書き換えることにより、
良好な画像を表示することを目的とする。
【００１１】
【課題を解決するための手段及び作用】上記課題を解決
するため、本発明の表示制御装置は、メモリ性のあるデ
ィスプレイに画像を表示するための表示制御装置におい
て、画像信号を入力する手段と、該入力手段により入力
された画像信号を格納する格納手段と、該入力手段から
入力される画像信号と該格納手段に格納された単位時間
前の同一位置の画像信号との差分値を求める差分算出手
段と、該差分値から表示の部分書換信号を生成する部分
書換制御手段を具備することを特徴とする。
するため、本発明の表示制御装置は、メモリ性のあるデ
ィスプレイに画像を表示するための表示制御装置におい
て、画像信号を入力する手段と、該入力手段により入力
された画像信号を格納する格納手段と、該入力手段から
入力される画像信号と該格納手段に格納された単位時間
前の同一位置の画像信号との差分値を求める差分算出手
段と、該差分値から表示の部分書換信号を生成する部分
書換制御手段を具備することを特徴とする。
【００１２】
【実施例】本発明の以下の実施例によれば、メモリ性の
あるディスプレイに表示する際に、単位時間前の画像デ
ータを格納しておく格納手段と、入力された画像信号と
格納された同一位置の画像信号との差分を求める差分算
出手段と、該差分算出手段の結果を閾値で２値化する２
値化手段とを設け、該２値化手段によって得られた画像
から領域を決定することにより、部分書換の領域の精度
を向上させるものである。
あるディスプレイに表示する際に、単位時間前の画像デ
ータを格納しておく格納手段と、入力された画像信号と
格納された同一位置の画像信号との差分を求める差分算
出手段と、該差分算出手段の結果を閾値で２値化する２
値化手段とを設け、該２値化手段によって得られた画像
から領域を決定することにより、部分書換の領域の精度
を向上させるものである。
【００１３】また、入力した画像信号を信号変換する手
段を設け、画像信号を変換することで、主に白黒で表現
されるカーソル等のポインティングマークの検出精度を
向上させている。
段を設け、画像信号を変換することで、主に白黒で表現
されるカーソル等のポインティングマークの検出精度を
向上させている。
【００１４】さらに、入力画像を平滑化する手段を設
け、ノイズによる影響を低減させている。
け、ノイズによる影響を低減させている。
【００１５】以下具体的に説明する。
【００１６】（第１実施例）図１は本発明を適用した画
像表示装置の画像処理部の実施例構成である。
像表示装置の画像処理部の実施例構成である。
【００１７】本実施例ではコンポーネントＲＧＢノンイ
ンターレース６０Ｈｚ信号とする。
ンターレース６０Ｈｚ信号とする。
【００１８】図１は図２の画像処理部２０の詳細であ
る。１００はコンピュータ１０からのＲＧＢアナログ出
力信号１１を入力する端子、１１０は入力されたＲＧＢ
アナログ信号をＡ／Ｄ変換し、多値のディジタルＲＧＢ
信号を生成するＡ／Ｄ変換部である。ＲＧＢアナログ信
号は６０Ｈｚノンインターレースである。１２０は画像
２値化部であり、多値のＲＧＢディジタル信号をＲＧＢ
各１ビットの信号に変換する。ここでは画像の２値化手
法として中間調を表現するのに適した誤差拡散を用い
る。１３０は同期をとるためにＦＩＦＯメモリ等で構成
される遅延バッファである。１４０は制御信号でＯＮ／
ＯＦＦするスイッチである。１５０は各画素のＲＧＢ各
１ビットのデータを格納しておくフレームメモリであ
り、２ボートＲＡＭ等で構成される。１６０は多値ディ
ジタルＲＧＢ信号から輝度信号である多値Ｙ信号生成す
る、ＲＧＢ／Ｙ変換部である。１７０、１８０はＹ信号
を格納するフレームメモリであり、１９０は入力された
Ｙ信号とフレームメモリ１７０または１８０に格納され
た１フレーム前のＹ信号との絶対値差分を求める絶対値
差分部である。２００は多値の絶対差分値を２値化す
る、２値化部である。ここで２値化手法として固定の閾
値と比較して２値化する単純２値化を用いる。２１０は
各走査線ごとにフラグのＯＮ／ＯＦＦができるラインフ
ラグメモリである。２２０はラインフラグメモリ１９０
の内容から、部分書き込みを行うか、どうかを判断し、
部分書き込みの位置等の制御を行う部分書き込み検知部
である。２３０はＦＬＣＤインターフェースであり、ビ
デオフレームメモリ１５０の内容を読みだし、端子２４
０を介して、ＦＬＣＤ３０に出力する。
る。１００はコンピュータ１０からのＲＧＢアナログ出
力信号１１を入力する端子、１１０は入力されたＲＧＢ
アナログ信号をＡ／Ｄ変換し、多値のディジタルＲＧＢ
信号を生成するＡ／Ｄ変換部である。ＲＧＢアナログ信
号は６０Ｈｚノンインターレースである。１２０は画像
２値化部であり、多値のＲＧＢディジタル信号をＲＧＢ
各１ビットの信号に変換する。ここでは画像の２値化手
法として中間調を表現するのに適した誤差拡散を用い
る。１３０は同期をとるためにＦＩＦＯメモリ等で構成
される遅延バッファである。１４０は制御信号でＯＮ／
ＯＦＦするスイッチである。１５０は各画素のＲＧＢ各
１ビットのデータを格納しておくフレームメモリであ
り、２ボートＲＡＭ等で構成される。１６０は多値ディ
ジタルＲＧＢ信号から輝度信号である多値Ｙ信号生成す
る、ＲＧＢ／Ｙ変換部である。１７０、１８０はＹ信号
を格納するフレームメモリであり、１９０は入力された
Ｙ信号とフレームメモリ１７０または１８０に格納され
た１フレーム前のＹ信号との絶対値差分を求める絶対値
差分部である。２００は多値の絶対差分値を２値化す
る、２値化部である。ここで２値化手法として固定の閾
値と比較して２値化する単純２値化を用いる。２１０は
各走査線ごとにフラグのＯＮ／ＯＦＦができるラインフ
ラグメモリである。２２０はラインフラグメモリ１９０
の内容から、部分書き込みを行うか、どうかを判断し、
部分書き込みの位置等の制御を行う部分書き込み検知部
である。２３０はＦＬＣＤインターフェースであり、ビ
デオフレームメモリ１５０の内容を読みだし、端子２４
０を介して、ＦＬＣＤ３０に出力する。
【００１９】コンピュータ１０からの６０Ｈｚノンイン
ターレースのＲＧＢアナログ信号を端子１００より、Ａ
／Ｄ変換部１１０に入力する。入力された多値ＲＧＢア
ナログ信号はＡ／Ｄ変換され、多値のＲＧＢディジタル
信号に変換されて画像２値化部１２０とＲＧＢ／Ｙ変換
部１６０に入力される。画像２値化部１２０は入力され
た多値ＲＧＢ信号を各色ごとに誤差拡散法によって２値
化していく。その結果は遅延バッファ１３０に格納され
る。
ターレースのＲＧＢアナログ信号を端子１００より、Ａ
／Ｄ変換部１１０に入力する。入力された多値ＲＧＢア
ナログ信号はＡ／Ｄ変換され、多値のＲＧＢディジタル
信号に変換されて画像２値化部１２０とＲＧＢ／Ｙ変換
部１６０に入力される。画像２値化部１２０は入力され
た多値ＲＧＢ信号を各色ごとに誤差拡散法によって２値
化していく。その結果は遅延バッファ１３０に格納され
る。
【００２０】一方、ＲＧＢ／Ｙ変換部１６０に入力され
た多値のＲＧＢディジタル信号は画素ごとに順次、Ｙ信
号に変換する。ＲＧＢ信号からＹ信号への変換は Ｙ＝０．２９９×Ｒ＋０．５８７×Ｇ＋０．１１４×Ｂ で行われる。Ｙ信号は絶対値差分部１９０に入力される
と同時に、フレームメモリ１７０または１８０に書き込
まれる。フレームメモリ１７０と１８０は書き込みと読
み出しがフレーム単位で交互に行われ、一方が書き込み
を行っている間、もう一方は読み出しを行っている。
た多値のＲＧＢディジタル信号は画素ごとに順次、Ｙ信
号に変換する。ＲＧＢ信号からＹ信号への変換は Ｙ＝０．２９９×Ｒ＋０．５８７×Ｇ＋０．１１４×Ｂ で行われる。Ｙ信号は絶対値差分部１９０に入力される
と同時に、フレームメモリ１７０または１８０に書き込
まれる。フレームメモリ１７０と１８０は書き込みと読
み出しがフレーム単位で交互に行われ、一方が書き込み
を行っている間、もう一方は読み出しを行っている。
【００２１】絶対値差分部１９０は、ＲＧＢ／Ｙ変換部
１６０から入力されたＹ信号と、フレームメモリ１７０
または１８０に書き込まれている１フレーム前の同一位
置のＹ信号との差分の絶対値を求める。
１６０から入力されたＹ信号と、フレームメモリ１７０
または１８０に書き込まれている１フレーム前の同一位
置のＹ信号との差分の絶対値を求める。
【００２２】２値化部２００に入力されたＹ信号の差分
の絶対値は固定閾値ＴＨと比較され、２値化される。差
分の絶対値が閾値ＴＨよりも大きかった場合は１を出力
し、そうでなければ０を出力する。
の絶対値は固定閾値ＴＨと比較され、２値化される。差
分の絶対値が閾値ＴＨよりも大きかった場合は１を出力
し、そうでなければ０を出力する。
【００２３】閾値ＴＨはアナロクノイズよりも大きな値
であれば良い。閾値ＴＨの決定法はいろいろあるが、例
えば、事前に単一輝度（ここでは１２８とする）のアナ
ログ信号を出力してもらい、端子１００から入力して、
Ａ／Ｄ変換１１０でディジタルデータに変換し、ＲＧＢ
／Ｙ変換部１６０に入力してＹ信号に変換してからフレ
ームメモリ１７０に書き込む。絶対値差分部１９０では
ＲＧＢ／Ｙ変換部１６０からの入力ではなく、固定値
（ここでは１２８）との絶対値差分を求め、その最大値
を閾値ＴＨとすることもできる。
であれば良い。閾値ＴＨの決定法はいろいろあるが、例
えば、事前に単一輝度（ここでは１２８とする）のアナ
ログ信号を出力してもらい、端子１００から入力して、
Ａ／Ｄ変換１１０でディジタルデータに変換し、ＲＧＢ
／Ｙ変換部１６０に入力してＹ信号に変換してからフレ
ームメモリ１７０に書き込む。絶対値差分部１９０では
ＲＧＢ／Ｙ変換部１６０からの入力ではなく、固定値
（ここでは１２８）との絶対値差分を求め、その最大値
を閾値ＴＨとすることもできる。
【００２４】２値化されたＹ信号で１があれば、変化点
として抽出する。走査線の処理を開始する前に、ライン
フラグメモリ２１０の該当するフラグをリセットする。
変化点が抽出されたら、該当する走査線に対応するライ
ンフラグメモリ２１０のフラグをたてる。１走査線内に
変化点がなかった場合、ラインフラグメモリ２１０の該
当するフラグがたっていればこれをリセットする。
として抽出する。走査線の処理を開始する前に、ライン
フラグメモリ２１０の該当するフラグをリセットする。
変化点が抽出されたら、該当する走査線に対応するライ
ンフラグメモリ２１０のフラグをたてる。１走査線内に
変化点がなかった場合、ラインフラグメモリ２１０の該
当するフラグがたっていればこれをリセットする。
【００２５】部分書き込み検知部２２０はラインフラグ
メモリ２１０のフラグの状態を監視し、フラグがたった
場合、該当する走査線の部分書き込みを行う。
メモリ２１０のフラグの状態を監視し、フラグがたった
場合、該当する走査線の部分書き込みを行う。
【００２６】部分書き込みを行う場合はスイッチ１４０
をＯＮにし、部分書き込みを行う走査線の位置情報をビ
デオフレームメモリ１５０とＦＬＣＤインターフェース
部２３０に送る。この結果、変化点が検出された走査線
に対応する走査線の２値化されたＲＧＢ信号を遅延バッ
ファ１３０から読み出し、ビデオフレームメモリ１５０
に書き込みを行う。さらに、ＦＬＣＤインターフェース
２３０はビデオフレームメモリ１５０の該当する走査線
のＲＧＢ２値信号を読み出し、ＦＬＣＤ３０の走査線デ
ータによってＦＬＣＤ３０の該当する走査線の表示状態
を変化させる。
をＯＮにし、部分書き込みを行う走査線の位置情報をビ
デオフレームメモリ１５０とＦＬＣＤインターフェース
部２３０に送る。この結果、変化点が検出された走査線
に対応する走査線の２値化されたＲＧＢ信号を遅延バッ
ファ１３０から読み出し、ビデオフレームメモリ１５０
に書き込みを行う。さらに、ＦＬＣＤインターフェース
２３０はビデオフレームメモリ１５０の該当する走査線
のＲＧＢ２値信号を読み出し、ＦＬＣＤ３０の走査線デ
ータによってＦＬＣＤ３０の該当する走査線の表示状態
を変化させる。
【００２７】ラインフラグメモリ２１０のフラグがたっ
ていない場合、部分書き込み検知部２２０はスイッチ１
４０をＯＦＦにし、該当する走査線のＲＧＢ２値化信号
の書き込みは行わない。このようにして、変化のあった
部分のみの表示状態を変化させる。
ていない場合、部分書き込み検知部２２０はスイッチ１
４０をＯＦＦにし、該当する走査線のＲＧＢ２値化信号
の書き込みは行わない。このようにして、変化のあった
部分のみの表示状態を変化させる。
【００２８】（第２実施例）図３は本発明を適用した画
像表示装置の画像処理部の実施例構成である。図３にあ
って図１と同じ番号のものは第１の実施例と同様な機能
を果たす。３００〜３５０はフレームメモリである。３
６０，３７０，３８０は入力された多値信号とフレーム
メモリに格納された１フレーム前の多値信号を比較して
フレーム間の差分の絶対値を算出する絶対値差分部であ
る。３９０，４００，４１０は画像の２値化部であり、
４２０はＯＲ回路である。
像表示装置の画像処理部の実施例構成である。図３にあ
って図１と同じ番号のものは第１の実施例と同様な機能
を果たす。３００〜３５０はフレームメモリである。３
６０，３７０，３８０は入力された多値信号とフレーム
メモリに格納された１フレーム前の多値信号を比較して
フレーム間の差分の絶対値を算出する絶対値差分部であ
る。３９０，４００，４１０は画像の２値化部であり、
４２０はＯＲ回路である。
【００２９】コンピュータ１０からの６０Ｈｚノンイン
ターレースのＲＧＢアナログ信号を端子１００より、Ａ
／Ｄ変換部１１０に入力する。入力された多値ＲＧＢア
ナログ信号はＡ／Ｄ変換され、多値のＲＧＢディジタル
信号に変換されて画像２値化部１２０に入力され、Ｒの
多値信号はフレームメモリ３２０または３３０に、Ｇの
多値信号はフレームメモリ３００または３１０に、Ｂの
多値信号はフレームメモリ３４０または３５０に入力さ
れる。フレームメモリ３００と３１０、フレームメモリ
３２０と３３０、フレームメモリ３４０と３５０は書き
込みと読み出しがフレーム単位で交互に行われ、一方が
書き込みを行っている間、もう一方は読み出しを行って
いる。
ターレースのＲＧＢアナログ信号を端子１００より、Ａ
／Ｄ変換部１１０に入力する。入力された多値ＲＧＢア
ナログ信号はＡ／Ｄ変換され、多値のＲＧＢディジタル
信号に変換されて画像２値化部１２０に入力され、Ｒの
多値信号はフレームメモリ３２０または３３０に、Ｇの
多値信号はフレームメモリ３００または３１０に、Ｂの
多値信号はフレームメモリ３４０または３５０に入力さ
れる。フレームメモリ３００と３１０、フレームメモリ
３２０と３３０、フレームメモリ３４０と３５０は書き
込みと読み出しがフレーム単位で交互に行われ、一方が
書き込みを行っている間、もう一方は読み出しを行って
いる。
【００３０】画像２値化部１２０は入力された多値ＲＧ
Ｂ信号を各色ごとに誤差拡散法によって２値化してい
く。その結果は遅延バッファ１３０に格納される。
Ｂ信号を各色ごとに誤差拡散法によって２値化してい
く。その結果は遅延バッファ１３０に格納される。
【００３１】絶対値差分部３６０は、Ａ／Ｄ変換部１１
０から入力されたＲ信号と、フレームメモリ１７０また
は１８０に書き込まれている１フレーム前の同一位置の
Ｒ信号との差分の絶対値を求める。
０から入力されたＲ信号と、フレームメモリ１７０また
は１８０に書き込まれている１フレーム前の同一位置の
Ｒ信号との差分の絶対値を求める。
【００３２】２値化部３６０に入力されたＲ信号の差分
の絶対値は固定閾値ＴＨR と比較され、２値化される。
差分の絶対値が閾値ＴＨR よりも大きかった場合は１を
出力し、そうでなければ０を出力する。
の絶対値は固定閾値ＴＨR と比較され、２値化される。
差分の絶対値が閾値ＴＨR よりも大きかった場合は１を
出力し、そうでなければ０を出力する。
【００３３】閾値ＴＨR はアナロクノイズよりも大きな
値であれば良い。
値であれば良い。
【００３４】同様に、Ｂ信号、Ｇ信号に関しても変化点
を検出する。
を検出する。
【００３５】Ｒ信号の２値化部３９０、Ｇ信号の２値化
部４００、Ｂ信号の２値化部４１０の出力はＯＲ回路４
２０に入力される。ＯＲ回路４２０はこれらの入力の論
理和をとってラインフラグメモリ２１０に出力する。
部４００、Ｂ信号の２値化部４１０の出力はＯＲ回路４
２０に入力される。ＯＲ回路４２０はこれらの入力の論
理和をとってラインフラグメモリ２１０に出力する。
【００３６】走査線の処理を開始する前に、ラインフラ
グメモリ２１０の該当するフラグをリセットする。ＯＲ
回路４２０の出力が１の場合、該当する走査線に対応す
るラインフラグメモリ２１０のフラグをたてる。
グメモリ２１０の該当するフラグをリセットする。ＯＲ
回路４２０の出力が１の場合、該当する走査線に対応す
るラインフラグメモリ２１０のフラグをたてる。
【００３７】部分書き込み検知部２２０はラインフラグ
メモリ２１０のフラグの状態を監視し、フラグがたった
場合、該当する走査線の部分書き込みを行う。
メモリ２１０のフラグの状態を監視し、フラグがたった
場合、該当する走査線の部分書き込みを行う。
【００３８】部分書き込みを行う場合はスイッチ１４０
をＯＮにし、部分書き込みを行う走査線の位置情報をビ
デオフレームメモリ１５０とＦＬＣＤインターフェース
部２３０に送る。この結果、変化点が検出された走査線
に対応する走査線の２値化されたＲＧＢ信号を遅延バッ
ファ１３０から読み出し、ビデオフレームメモリ１５０
に書き込みを行う。さらに、ＦＬＣＤインターフェース
２３０はビデオフレームメモリ１５０の該当する走査線
のＲＧＢ２値信号を読み出し、ＦＬＣＤ３０の走査線デ
ータによってＦＬＣＤ３０の該当する走査線の表示状態
を変化させる。
をＯＮにし、部分書き込みを行う走査線の位置情報をビ
デオフレームメモリ１５０とＦＬＣＤインターフェース
部２３０に送る。この結果、変化点が検出された走査線
に対応する走査線の２値化されたＲＧＢ信号を遅延バッ
ファ１３０から読み出し、ビデオフレームメモリ１５０
に書き込みを行う。さらに、ＦＬＣＤインターフェース
２３０はビデオフレームメモリ１５０の該当する走査線
のＲＧＢ２値信号を読み出し、ＦＬＣＤ３０の走査線デ
ータによってＦＬＣＤ３０の該当する走査線の表示状態
を変化させる。
【００３９】ラインフラグメモリ２１０のフラグがたっ
ていない場合、部分書き込み検知部２２０はスイッチ１
４０をＯＦＦにし、該当する走査線のＲＧＢ２値化信号
の書き込みは行わない。このようにして、変化のあった
部分のみの表示状態を変化させる。
ていない場合、部分書き込み検知部２２０はスイッチ１
４０をＯＦＦにし、該当する走査線のＲＧＢ２値化信号
の書き込みは行わない。このようにして、変化のあった
部分のみの表示状態を変化させる。
【００４０】（第３実施例）図４は本発明を適用した画
像表示装置の画像処理部の実施例構成である。図４にあ
って図１と同じ番号のものは第１の実施例と同様な機能
を果たす。６００はアナログＲＧＢ信号から輝度信号で
あるアナログＹ信号生成する、アナログＲＧＢ／Ｙ変換
部である。６１０はアナログＹ信号をＡ／Ｄ変換し、多
値のディジタルＹ信号を生成するＡ／Ｄ変換部である。
６２０はローパスフィルタ部であり、図５に示すローパ
スフィルタ処理を施し、奇数番目の走査線をサブサンプ
リングする。６３０，６４０はディスプレイの画像サイ
ズの縦横１／２のサイズのフレームメモリである。６５
０は入力されたＹ信号とフレームメモリ６３０または６
４０に格納された１フレーム前のＹ信号との絶対値差分
を求める絶対値差分部である。６６０は多値の絶対差分
値を２値化する、２値化部である。ここで２値化手法と
して固定の閾値と比較して２値化する単純２値化を用い
る。
像表示装置の画像処理部の実施例構成である。図４にあ
って図１と同じ番号のものは第１の実施例と同様な機能
を果たす。６００はアナログＲＧＢ信号から輝度信号で
あるアナログＹ信号生成する、アナログＲＧＢ／Ｙ変換
部である。６１０はアナログＹ信号をＡ／Ｄ変換し、多
値のディジタルＹ信号を生成するＡ／Ｄ変換部である。
６２０はローパスフィルタ部であり、図５に示すローパ
スフィルタ処理を施し、奇数番目の走査線をサブサンプ
リングする。６３０，６４０はディスプレイの画像サイ
ズの縦横１／２のサイズのフレームメモリである。６５
０は入力されたＹ信号とフレームメモリ６３０または６
４０に格納された１フレーム前のＹ信号との絶対値差分
を求める絶対値差分部である。６６０は多値の絶対差分
値を２値化する、２値化部である。ここで２値化手法と
して固定の閾値と比較して２値化する単純２値化を用い
る。
【００４１】６７０は各奇数番目の走査線ごとにフラグ
のＯＮ／ＯＦＦができるラインフラグメモリである。６
８０はラインフラグメモリ６７０の内容から、部分書き
込みを行うか、どうかを判断し、部分書き込みの位置等
の制御を行う部分書き込みの位置等の制御を行う部分書
き込み検知部である。６９０は遅延バッファである。
のＯＮ／ＯＦＦができるラインフラグメモリである。６
８０はラインフラグメモリ６７０の内容から、部分書き
込みを行うか、どうかを判断し、部分書き込みの位置等
の制御を行う部分書き込みの位置等の制御を行う部分書
き込み検知部である。６９０は遅延バッファである。
【００４２】コンピュータ１０からの６０Ｈｚノンイン
ターレースのＲＧＢアナログ信号を端子１００より、Ａ
／Ｄ変換部１１０とＲＧＢ／Ｙ変換部６００に入力す
る。入力された多値ＲＧＢアナログ信号はＡ／Ｄ変換部
１１０でＡ／Ｄ変換され、多値のＲＧＢディジタル信号
に変換されて画像２値化部１２０に入力される。画像２
値化部１２０は入力された多値ＲＧＢ信号を各色ごとに
誤差拡散法によって２値化していく。その結果は遅延バ
ッファ６９０に格納される。
ターレースのＲＧＢアナログ信号を端子１００より、Ａ
／Ｄ変換部１１０とＲＧＢ／Ｙ変換部６００に入力す
る。入力された多値ＲＧＢアナログ信号はＡ／Ｄ変換部
１１０でＡ／Ｄ変換され、多値のＲＧＢディジタル信号
に変換されて画像２値化部１２０に入力される。画像２
値化部１２０は入力された多値ＲＧＢ信号を各色ごとに
誤差拡散法によって２値化していく。その結果は遅延バ
ッファ６９０に格納される。
【００４３】一方、ＲＧＢ／Ｙ変換部６００はＲＧＢア
ナログ信号を入力し、アナログＹ信号に変換し、Ａ／Ｄ
変換部６１０に出力する。Ａ／Ｄ変換部６１０はアナロ
グＹ信号をＡ／Ｄ変換し、多値のディジタルＹ信号を生
成し、ローパスフィルタ部６２０に入力する。
ナログ信号を入力し、アナログＹ信号に変換し、Ａ／Ｄ
変換部６１０に出力する。Ａ／Ｄ変換部６１０はアナロ
グＹ信号をＡ／Ｄ変換し、多値のディジタルＹ信号を生
成し、ローパスフィルタ部６２０に入力する。
【００４４】ローパスフィルタ部６２０はローパスフィ
ルタ処理を施し、奇数番目の走査線を１／２の周波数で
サブサンプリングする。ローパスフィルタリングされた
Ｙ信号はフレームメモリ６３０または６４０に書き込ま
れる。フレームメモリ６３０と６４０は書き込みと読み
出しがフレーム単位で交互に行われ、一方が書き込みを
行っている間、もう一方は読み出しを行っている。
ルタ処理を施し、奇数番目の走査線を１／２の周波数で
サブサンプリングする。ローパスフィルタリングされた
Ｙ信号はフレームメモリ６３０または６４０に書き込ま
れる。フレームメモリ６３０と６４０は書き込みと読み
出しがフレーム単位で交互に行われ、一方が書き込みを
行っている間、もう一方は読み出しを行っている。
【００４５】絶対値差分部６５０は、ＲＧＢ／Ｙ変換部
６１０から入力されたＹ信号と、フレームメモリ６３０
または６４０に書き込まれている１フレーム前の同一位
置のＹ信号との差分の絶対値を求める。
６１０から入力されたＹ信号と、フレームメモリ６３０
または６４０に書き込まれている１フレーム前の同一位
置のＹ信号との差分の絶対値を求める。
【００４６】２値化部６６０に入力されたＹ信号の差分
の絶対値は固定閾値ＴＨと比較され、２値化される。差
分の絶対値が閾値ＴＨよりも大きかった場合は１を出力
し、そうでなければ０を出力する。
の絶対値は固定閾値ＴＨと比較され、２値化される。差
分の絶対値が閾値ＴＨよりも大きかった場合は１を出力
し、そうでなければ０を出力する。
【００４７】２値化されたＹ信号で１があれば、変化点
として抽出する。走査線の処理を開始する前に、ライン
フラグメモリ２１０の該当するフラグをリセットする。
変化点が抽出されたら、該当する走査線に対応するライ
ンフラグメモリ２１０のフラグをたてる。１走査線内に
変化点がなかった場合、ラインフラグメモリ２１０の該
当するフラグがたっていればこれをリセットする。
として抽出する。走査線の処理を開始する前に、ライン
フラグメモリ２１０の該当するフラグをリセットする。
変化点が抽出されたら、該当する走査線に対応するライ
ンフラグメモリ２１０のフラグをたてる。１走査線内に
変化点がなかった場合、ラインフラグメモリ２１０の該
当するフラグがたっていればこれをリセットする。
【００４８】部分書き込み検知部２２０はラインフラグ
メモリ２１０のフラグの状態を監視し、フラグがたった
場合、該当する走査線の部分書き込みを行う。
メモリ２１０のフラグの状態を監視し、フラグがたった
場合、該当する走査線の部分書き込みを行う。
【００４９】部分書き込みを行う場合はスイッチ１４０
をＯＮにし、部分書き込みを行う走査線の位置情報をビ
デオフレームメモリ１５０とＦＬＣＤインターフェース
部２３０に送る。ラインフラグメモリ６７０の前の奇数
番目の走査線で部分書き込みを実施していなければ、部
分書き込み検知部６８０は、遅延バッファ６９０から該
当する奇数番目の走査線のデータと、前後の偶数番目の
走査線のデータを読み出す。位置情報としてビデオフレ
ームメモリ１５０に該当する奇数番目の走査線の位置
と、前後の偶数番目の走査線の位置を送り、データを書
き込むと同時に、ＦＬＣＤインターフェース２３０にも
同様に位置情報を送り、ビデオフレームメモリ１５０の
該当する走査線のＲＧＢ２値信号を読み出し、ＦＬＣＤ
３０の走査線データによってＦＬＣＤ３０の該当する走
査線の表示状態を変化させる。
をＯＮにし、部分書き込みを行う走査線の位置情報をビ
デオフレームメモリ１５０とＦＬＣＤインターフェース
部２３０に送る。ラインフラグメモリ６７０の前の奇数
番目の走査線で部分書き込みを実施していなければ、部
分書き込み検知部６８０は、遅延バッファ６９０から該
当する奇数番目の走査線のデータと、前後の偶数番目の
走査線のデータを読み出す。位置情報としてビデオフレ
ームメモリ１５０に該当する奇数番目の走査線の位置
と、前後の偶数番目の走査線の位置を送り、データを書
き込むと同時に、ＦＬＣＤインターフェース２３０にも
同様に位置情報を送り、ビデオフレームメモリ１５０の
該当する走査線のＲＧＢ２値信号を読み出し、ＦＬＣＤ
３０の走査線データによってＦＬＣＤ３０の該当する走
査線の表示状態を変化させる。
【００５０】ラインフラグメモリ６７０のフラグがたっ
ていない場合、部分書き込み検知部６８０はスイッチ１
４０をＯＦＦにし、該当する走査線のＲＧＢ２値化信号
の書き込みは行わない。このようにして、変化のあった
部分のみの表示状態を変化させる。
ていない場合、部分書き込み検知部６８０はスイッチ１
４０をＯＦＦにし、該当する走査線のＲＧＢ２値化信号
の書き込みは行わない。このようにして、変化のあった
部分のみの表示状態を変化させる。
【００５１】（他の実施例）入力信号はこれに限定され
ず、ディジタルの多値信号でもかまわず、さらに別な画
像信号でもかまわない。また、カラーにも限定されな
い。
ず、ディジタルの多値信号でもかまわず、さらに別な画
像信号でもかまわない。また、カラーにも限定されな
い。
【００５２】変化点検出の信号も輝度信号に限定され
ず、色度信号を併用してもかまわないし、輝度色度に限
定されない。
ず、色度信号を併用してもかまわないし、輝度色度に限
定されない。
【００５３】画像の２値化手法もこれに限定されず、平
均濃度保存法等の他の２値化手法を用いてもかまわな
い。
均濃度保存法等の他の２値化手法を用いてもかまわな
い。
【００５４】部分書き込みの単位は走査線単位に限定さ
れず、ブロックや画素単位でもかまわない。
れず、ブロックや画素単位でもかまわない。
【００５５】フレームメモリ等の構成はこれに限定され
ず、複数ラインバッファを用いてもかまわないし、その
他の構成でもかまわない。
ず、複数ラインバッファを用いてもかまわないし、その
他の構成でもかまわない。
【００５６】変化点検出のためのサブサンプリングの手
法はこれに限定されず、Ａ／Ｄ変換前にサブサンプリン
グやフィルタ処理を行っても良い。
法はこれに限定されず、Ａ／Ｄ変換前にサブサンプリン
グやフィルタ処理を行っても良い。
【００５７】ディスプレイの手法もＦＬＣＤに限定され
ず、メモリ性のあるディスプレイであれば良い。
ず、メモリ性のあるディスプレイであれば良い。
【００５８】以上のように表示用の２値化手段と、フレ
ーム間変化検出用の２値化手段を設けることにより、表
示を高精細化すると同時に、フレーム間の変化検出の精
度を向上させることができる。また、入力信号を輝度等
の画像信号に変換することにより、主に白黒であるカー
ソル等の抽出を容易にし、フレーム間の変化を検出する
ためのメモリ容量を減じることができ、装置の低コスト
化がはかれる。また、画像信号をサブサンプリングする
ことにより、装置の低コスト化がはかれ、表示する画像
サイズより少なくサンプリングすることにより、変化点
検出用のメモリ容量を減少させ、さらにローパスフィル
タを用いることでアナログ信号で加わるノイズ等を除去
し、フレーム間の変化の検出精度を向上させられる。
ーム間変化検出用の２値化手段を設けることにより、表
示を高精細化すると同時に、フレーム間の変化検出の精
度を向上させることができる。また、入力信号を輝度等
の画像信号に変換することにより、主に白黒であるカー
ソル等の抽出を容易にし、フレーム間の変化を検出する
ためのメモリ容量を減じることができ、装置の低コスト
化がはかれる。また、画像信号をサブサンプリングする
ことにより、装置の低コスト化がはかれ、表示する画像
サイズより少なくサンプリングすることにより、変化点
検出用のメモリ容量を減少させ、さらにローパスフィル
タを用いることでアナログ信号で加わるノイズ等を除去
し、フレーム間の変化の検出精度を向上させられる。
【００５９】
【発明の効果】以上説明したように、本発明によれば、
表示画像を部分的に書き換えることにより、良好な画像
を表示することができる。
表示画像を部分的に書き換えることにより、良好な画像
を表示することができる。
【図１】第１実施例の画像表示装置の構成を示すブロッ
ク図である。
ク図である。
【図２】本発明の適用にする画像表示システムの全体図
である。
である。
【図３】第２実施例の画像表示装置の構成を示すブロッ
ク図である。
ク図である。
【図４】第３実施例の画像表示装置の構成を示すブロッ
ク図である。
ク図である。
【図５】第３実施例の平滑化に使用するローパスフィル
タを示す図である。
タを示す図である。
【図６】カーソルの移動の様子を表わす図である。
１０ コンピュータ本体 １１，１２ 画像信号 ２０ 画像処理部 ３０ ＦＬＣＤ １００，２４０ 端子 １１０，６１０ Ａ／Ｄ変換部 １２０ 画像２値化部 １３０，６９０ 遅延のバッファ １４０ スイッチ １５０ ビデオフレームメモリ １６０，６００ ＲＧＢ／Ｙ変換部 １７０，１８０，３００，３１０，３２０，３３０，３
４０，３５０，６３０，６４０ フレームメモリ １９０，３９０，４００，６５０ 絶対値差分部 ２００，３９０，４００，４１０，６６０ ２値化部 ２１０，６７０ ラインフラグメモリ ２２０，６８０ 部分書き込み検知部 ２３０ ＦＬＣＤインターフェース ４２０ ＯＲ回路 ６２０ ローパスフィルタ部
４０，３５０，６３０，６４０ フレームメモリ １９０，３９０，４００，６５０ 絶対値差分部 ２００，３９０，４００，４１０，６６０ ２値化部 ２１０，６７０ ラインフラグメモリ ２２０，６８０ 部分書き込み検知部 ２３０ ＦＬＣＤインターフェース ４２０ ＯＲ回路 ６２０ ローパスフィルタ部
Claims (7)
- 【請求項１】 メモリ性のあるディスプレイに画像を表
示するための表示制御装置において、 画像信号を入力する手段と、 該入力手段により入力された画像信号を格納する格納手
段と、 該入力手段から入力される画像信号と該格納手段に格納
された単位時間前の同一位置の画像信号との差分値を求
める差分算出手段と、 該差分値から表示の部分書換信号を生成する部分書換制
御手段を具備することを特徴とする表示制御装置。 - 【請求項２】 前記入力手段により入力される画像信号
は、アナログ信号であり、アナログ／ディジタル変換手
段によりディジタル信号に変換されることを特徴とする
請求項１記載の表示装置。 - 【請求項３】 前記差分算出手段の出力を閾値で２値化
する２値化手段を具備することを特徴とする請求項１記
載の表示制御装置。 - 【請求項４】 前記アナログ信号に加わるノイズを除去
すべく２値化の閾値を設定することを特徴とする請求項
３記載の表示制御装置。 - 【請求項５】 更に前記入力画像信号を量子化する量子
化手段を有することを特徴とする請求項１記載の表示制
御装置。 - 【請求項６】 更に前記入力信号を平滑化する画像平滑
化手段を有することを特徴とする請求項１記載の表示制
御装置。 - 【請求項７】 更に前記画像信号を信号変換する画像信
号変換手段を有することを特徴とする請求項１記載の表
示制御装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20554092A JPH0651282A (ja) | 1992-07-31 | 1992-07-31 | 表示制御装置 |
| EP93306004A EP0581594B1 (en) | 1992-07-31 | 1993-07-29 | Display controlling apparatus |
| DE69321308T DE69321308T2 (de) | 1992-07-31 | 1993-07-29 | Anzeigesteuergerät |
| AT93306004T ATE171808T1 (de) | 1992-07-31 | 1993-07-29 | Anzeigesteuergerät |
| US08/509,177 US6091389A (en) | 1992-07-31 | 1995-07-31 | Display controlling apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20554092A JPH0651282A (ja) | 1992-07-31 | 1992-07-31 | 表示制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0651282A true JPH0651282A (ja) | 1994-02-25 |
Family
ID=16508588
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20554092A Pending JPH0651282A (ja) | 1992-07-31 | 1992-07-31 | 表示制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0651282A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5646693A (en) * | 1994-11-04 | 1997-07-08 | Cismas; Sorin | Memory utilization for video decoding and display with 3:2 pull-down |
| US6198773B1 (en) | 1997-12-18 | 2001-03-06 | Zoran Corporation | Video memory management for MPEG video decode and display system |
| JP2006011027A (ja) * | 2004-06-25 | 2006-01-12 | Victor Co Of Japan Ltd | 画像信号処理装置 |
-
1992
- 1992-07-31 JP JP20554092A patent/JPH0651282A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5646693A (en) * | 1994-11-04 | 1997-07-08 | Cismas; Sorin | Memory utilization for video decoding and display with 3:2 pull-down |
| US6198773B1 (en) | 1997-12-18 | 2001-03-06 | Zoran Corporation | Video memory management for MPEG video decode and display system |
| JP2006011027A (ja) * | 2004-06-25 | 2006-01-12 | Victor Co Of Japan Ltd | 画像信号処理装置 |
| JP4572599B2 (ja) * | 2004-06-25 | 2010-11-04 | 日本ビクター株式会社 | 画像信号処理装置 |
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