JPH07322165A - 多数ビデオウィンドー同時表示方式 - Google Patents

多数ビデオウィンドー同時表示方式

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JPH07322165A
JPH07322165A JP7064390A JP6439095A JPH07322165A JP H07322165 A JPH07322165 A JP H07322165A JP 7064390 A JP7064390 A JP 7064390A JP 6439095 A JP6439095 A JP 6439095A JP H07322165 A JPH07322165 A JP H07322165A
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JP7064390A
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Michael A Kutner
エイ カットナー マイケル
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Sony Electronics Inc
Original Assignee
Sony Electronics Inc
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Abstract

(57)【要約】 【目的】 簡単で経済的な多数ビデオウィンドー同時表
示装置を得る。 【構成】 本装置は、１次ビデオ信号Ｊを受ける１次イ
ンタフェース６１０と、１次ビデオ信号を表すデータを
記憶する１次メモリ６４０とを含む。本装置はまた、複
数の２次ビデオ信号Ｋ〜Ｍを受ける複数の２次インタフ
ェース６１１〜６１３と、複数の２次ビデオ信号を表す
データを記憶する２次メモリ６４１とを有する。１次及
び２次メモリの内容を表示器６７０に選択的に出力さ
せ、１次及び２次ビデオ信号で表されるビデオ画像を表
示器の多数ビデオウィンドーに夫々表示させる。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、ＣＲＴ，ＬＣＤ又はプ
ラズマ型ディスプレイの如き単一の表示器に、実運動(f
ull-motion) の又は生（なま）の複数のビデオ映像を表
示する方式（装置及び方法）に関するものである。
【０００２】
【従来の技術】実運動の（実際の動きをする）、即ち生
のビデオ映像を表示するのにＣＲＴやＬＣＤのような表
示器が広く使用されている。表示器は、一時にただ１つ
のビデオ映像を表示するのに使用されることが多い。し
かし、単一の表示器に１より多い、即ち多数の実運動ビ
デオ映像を同時に表示できる方法もある。かような多数
ビデオ映像は大抵、表示面上で別々の「ウィンドー」に
表示される。図１は、単一のビデオウィンドー９１０が
表示されている表示器９００を示す。図２は、多数のビ
デオウィンドー９２０が表示されている表示器９００を
示す。
【０００３】
【発明が解決しようとする課題】しかし、単一の表示器
に多数のビデオ映像を同時表示する従来公知の技法に
は、幾つかの欠点がある。手短かにいえば、これらの欠
点は、コストが高く複雑な回路を必要とすることであ
る。
【０００４】図３に、上述した従来技法の１つを示す。
この技法では、別々のビデオ映像を表すビデオ信号Ａ，
Ｂ及びＣは、別々のビデオインタフェース回路３１０，
３２０及び３３０を介して個々にバッファメモリ３５
０，３６０及び３７０に入力され、処理される。ビデオ
インタフェース回路３１０〜３３０は夫々各ビデオ信号
Ａ，Ｂ，Ｃをデジタル化し、それら各信号に関するタイ
ミング情報を取出すこれらビデオインタフェース回路は
また、デジタル化されたビデオ映像のサイズを調整する
などの他の処理動作を行うこともある。各ビデオ映像に
関して得られたデジタルデータはそれから、夫々別個の
ビデオバッファメモリ３５０〜３７０に出力され、そこ
で一時的に記憶されたのち主インタフェース回路３８０
に出力される。主インタフェース回路３８０は、バッフ
ァメモリから出力されたデジタルデータをアナログ信号
に変換し、適正なタイミング情報を加える。また、バッ
ファメモリ３５０〜３７０の出力はすべて、主インタフ
ェース回路３８０で組合され、モニタ３９０に出力され
る。バッファメモリ３５０〜３７０に対するアドレス指
定及びその出力は、クロック制御回路３４０によって制
御される。これらバッファメモリの内容は、モニタ３９
０にピクセル情報が表示されるレートにほぼ等しいレー
トで同時に読出される。各バッファメモリ３５０〜３７
０の出力は、バッファメモリ内の各アドレス位置に記憶
された情報が適正時に出力されるように制御され、各バ
ッファメモリに記憶され主インタフェース回路３８０で
組合されたデータに対応する可視像がモニタ３９０に生
成される。この多ビデオ映像表示技法の欠点の１つは、
複雑で高価なメモリ及び制御回路を必要とし、入力され
る生（実況）ビデオ映像信号の数が増すに従って十分な
動作をしなくなることである。
【０００５】図４に、もう１つの従来技法を示す。本例
では、別々の実運動映像を表す多数のビデオ信号Ｄ，
Ｅ，Ｆは夫々、別々のビデオインタフェース回路４１
０，４２０，４３０に入力され、処理される。各ビデオ
インタフェース回路４１０〜４３０から出力されるすべ
ての処理済ビデオデータは、それから結合され、即ち並
直列変換され、単一のバッファメモリ４５０に一時的に
記憶される。クロック制御回路４４０は、各ビデオイン
タフェース回路４１０〜４３０からバッファメモリ４５
０への出力を制御すると共に、これら各インタフェース
回路から出力されバッファメモリ４５０に記憶されるビ
デオデータに関するメモリアドレス情報をも発生する。
このビデオデータは、それからバッファメモリより出力
され主インタフェース回路３８０に読込まれ、その中で
処理されモニタ３９０の駆動に適するＺ信号として出力
される。モニタ３９０は、Ｚ信号で表される形象及び情
報を表示する。
【０００６】この技法は、図３の技法より所要バッファ
メモリが少なくて済むものの、幾つかの欠点がある。第
１は、各ビデオインタフェース回路４１０〜４３０が、
バッファメモリに書込まねばならない連続データストリ
ームを発生していることである。これは極めて広いデー
タ帯域幅を必要とし、高価な高性能バッファメモリを使
用しなければならないことになる。第２は、入力したい
ビデオ信号の数が増すに従い、バッファメモリの速度や
帯域幅などの性能への要求がふえることである。しか
も、重なる生のビデオウィンドーが欲しい場合、アドレ
ス及び制御のため更に複雑な回路を使用しなければなら
ない。その上、コスト制限のため単一の低性能バッファ
メモリを使用する必要がある場合、表示されるビデオ映
像の解像度を下げるか、又は表示しようとするビデオ映
像のサイズを縮小するかして、生のビデオ信号即ちスト
リームのデータ帯域幅を減らさねばならない。
【０００７】図５に、生の多ビデオ映像表示装置の他の
例を示す。本例では、入力ビデオ信号Ｇ，Ｈ，Ｉはすべ
て、ビデオ選択マルチプレクサ５６０を介して並直列変
換され、１つのビデオインタフェース５１０に出力され
る。全入力ビデオ信号Ｇ，Ｈ，Ｉが同期しているとすれ
ば、クロック制御回路５２０は、新しい即ち異なる入力
ビデオ信号Ｇ，Ｈ又はＩを連続するフレーム間のビデオ
ブランキング期間に選択することになる。このようにす
れば、入力ビデオ信号の数に関係なく、最大合計データ
レートを一定に維持できる。しかし、入力ビデオ信号の
数が増すに従い、ビデオ信号の表示更新レート（表示装
置に新しい表示情報が供給されるレート）が減少する。
それは、ビデオインタフェース５１０に入力される追加
入力ビデオ信号をアクセス又は選択するのに追加時間を
要するためである。
【０００８】本発明の課題は、上述した欠点のない、多
数のビデオウィンドーを同時に表示する方式を提供する
ことである。
【０００９】
【課題を解決するための手段及び作用】本発明による装
置は、たった２つのバッファメモリを必要とするだけで
あり、各バッファメモリの記憶容量は、少なくとも、ビ
デオモニタの如き表示器の各ピクセルに対応する情報を
記憶するに足る大きさでよい。これらのバッファメモリ
の一方である１次バッファメモリは、ビデオモニタの１
次（主）ビデオウィンドーに表示すべき１次ビデオ信号
に対応するデータの蓄積に専用する。他方のバッファメ
モリ、即ち２次バッファメモリは、ビデオモニタの、１
次ビデオウィンドーより広さが小さい複数の２次（副）
ビデオウィンドーに表示すべき複数の２次ビデオ信号に
対応するデータの蓄積に専用する。本発明では、追加の
２次ビデオ信号が入力されるとき、これらの追加ビデオ
信号を蓄積するのに追加バッファメモリを必要としな
い。それは、各ビデオ信号が入力制御器により選択され
て、２次バッファメモリに入力されるからである。こう
すると、入力として加えられる各２次ビデオ信号のため
にメモリ又は制御回路を追加することなく、多数のビデ
オウィンドーを提供できる。
【００１０】本装置は、１次ビデオ信号を受ける１次イ
ンタフェースを具える。この１次インタフェースは、入
力１次ビデオ信号を表すデータを記憶する１次記憶メモ
リを含む。本装置はまた、複数の２次ビデオ信号を受け
る２次インタフェースを具える。該２次インタフェース
は、入力される複数の２次ビデオ信号を表すデータを記
憶する２次記憶メモリを含む。更に、１次及び２次記憶
メモリの内容を表示器に選択的に出力する出力制御手段
を含む。
【００１１】表示器に多数のビデオウィンドーを同時に
表示する本発明の方法は、１次アナログ複合ビデオ信号
及び複数の２次アナログ複合ビデオ信号を入力するステ
ップと、該１次アナログ複合ビデオ信号を１次デジタル
ビデオ信号に変換するステップと、複数の２次アナログ
複合ビデオ信号を複数の２次デジタルビデオ信号に変換
するステップと、上記１次デジタルビデオ信号データを
１次記憶メモリ手段に蓄積するステップと、上記複数の
２次デジタルビデオ信号データを２次記憶メモリ手段に
入力するステップと、上記１次及び２次記憶メモリから
夫々上記１次及び２次デジタルビデオデータを選択的に
読出し、該１次及び２次デジタルビデオデータを上記表
示器に出力して、該表示器の１次ウィンドー内に１次実
運動ビデオ映像を表示すると同時に、上記表示器の複数
の２次ウィンドー内に夫々複数の２次実運動ビデオ映像
を表示するステップとを含む。
【００１２】
【実施例】以下、図面を参照して本発明を具体的に説明
する。図６は、本発明の第１実施例を示すブロック図で
ある。簡単にいうと、１次ビデオインタフェース（ビデ
オインタフェース６１０）及び１次バッファメモリ（バ
ッファメモリ６４０）は、１つの表示器、モニタ６７０
に表示される複数のウィンドーのうち一番大きい１次
（主）ウィンドーに表示したい１次ビデオ映像を表す１
次ビデオ信号（ビデオ信号Ｊ）入力の受信と蓄積に専用
するものである。複数の２次ビデオインタフェース（ビ
デオインタフェース６１１，６１２及び６１３）及び２
次バッファメモリ（バッファメモリ６４１）は、同じ表
示器（モニタ６７０）の１次ウィンドーより小さい複数
の２次（副）ウィンドーに表示したい複数の２次ビデオ
映像を表す２次ビデオ信号（ビデオ信号Ｋ，Ｌ，Ｍ）入
力の受信と蓄積に専用するものである。ただし、２次ビ
デオ映像は、ビデオインタフェース６１０が受信し１次
バッファメモリ６４０が記憶したビデオデータにより表
される、より大きな１次ビデオ映像の表示と同時に表示
される。
【００１３】本例では、ビデオ信号Ｊ〜Ｍは、各ビデオ
インタフェース回路６１０〜６１３に加えられる。これ
らのビデオ信号は、複合又はコンポーネントのどちらの
アナログビデオ信号でもよい。また、入力ビデオ信号
は、デジタル信号でもよい。説明の都合上、生のビデオ
信号は複合アナログビデオ信号であると仮定する。各ビ
デオインタフェース回路６１０〜６１３は、複合アナロ
グビデオ信号をデジタルビデオ信号に変換し、該複合ア
ナログビデオ信号から関連するタイミング情報を取出
す。ビデオインタフェース回路６１０〜６１３は、デジ
タルビデオ信号を処理してビデオピクセルを加減し、デ
ジタル化されたビデオ映像のサイズを増したり、減じた
りするのに使用できる。更に、これらのビデオインタフ
ェース回路は、デジタルビデオ信号を処理して、ビデオ
信号により表されるビデオ映像の色調又は色の強さを変
えるのに用いることもできる。
【００１４】ビデオインタフェース６１０の入力端に加
えられるビデオ信号Ｊは、ただ１つの表示モニタ６７０
に表示される多数ウィンドーのうち最も大きいものに見
えるようにしたい映像に対応するものである。このビデ
オ信号を１次ビデオ信号と呼び、ビデオインタフェース
６１０及びバッファメモリ６４０を経由して入力し、処
理し、蓄積する。これらを１次ビデオインタフェース及
び１次バッファメモリと呼ぶことができる。ビデオイン
タフェース６１０の出力は、バッファメモリ６４０の入
力端に加えられる。バッファメモリ６４０は、例えば２
（デュアル）ポート・メモリでよい。入力制御器６３０
は、ビデオインタフェース６１０により入力ビデオ信号
から取出されたタイミング情報を用いてアドレス情報を
発生し、処理済のデジタル化したビデオデータの、ビデ
オインタフェース６１０からバッファメモリ６４０への
書込みを制御する。入力制御器６３０により発生された
アドレス情報は、処理済デジタルビデオデータが記憶さ
れるバッファメモリ６４０における、該デジタルビデオ
データのアドレス位置、即ち書込み位置を制御する。
【００１５】ビデオデータが書込まれるアドレス位置に
応じて、表示モニタの生（なま）ビデオ映像の位置が制
御できる。というのは、各アドレス位置がモニタ６７０
の個々のピクセルに対応するからである。書込み位置の
計算に必要な情報は、主制御プロセッサ６９０により入
力制御器６３０に供給される。この情報は、可変であっ
て、表示モニタ及び（又は）表示モードにおける生ビデ
オ映像の位置に関する情報のようなものを含むことがで
きる。表示モードには、例えばフィールドモード、凍結
フレームモード又は凍結フィールドモードなどがある。
【００１６】ビデオインタフェース６１０及びバッファ
メモリ６４０間のデジタルビデオ信号又はストリームの
帯域幅は、ビデオインタフェース６１０によって行われ
る処理のタイプによって決まることに注意すべきであ
る。例えばビデオインタフェースがピクセル情報を減ら
して表示されるビデオ映像のサイズを縮小する処理を行
うと、デジタルビデオストリームの帯域幅は減じるであ
ろう。同様に、ビデオインタフェースがピクセル情報を
加えて表示ビデオ映像のサイズを拡大する処理をする
と、デジタルビデオストリームの帯域幅は増すであろ
う。バッファメモリ６４０の入力帯域幅は、表示モニタ
にどんなサイズの生ビデオウィンドーを表示しても、そ
れに必要なデータレートを提供できるよう十分に大きい
のがよい。
【００１７】ビデオインタフェース回路６１１，６１２
及び６１３の出力は、入力制御器６３１の制御の下にＦ
ＩＦＯメモリ６２１，６２２及び６２３の入力端に夫々
加えられる。ビデオデータは、バッファメモリ６４１に
出力されるまで、一時ここに蓄積される。バッファメモ
リ６４１は、例えば２ポート・メモリでよい。入力制御
器６３１により、ビデオインタフェース６１１からの処
理済デジタルビデオデータストリーム及びタイミング情
報は、ＦＩＦＯメモリ６２１に書込まれる。同様に、ビ
デオインタフェース６１２からの処理済デジタルビデオ
データストリーム及びタイミング情報は、ＦＩＦＯメモ
リ６２２に書込まれ、ビデオインタフェース６１３から
の処理済デジタルビデオデータストリーム及びタイミン
グ情報は、ＦＩＦＯメモリ６２３に書込まれる。このタ
イミング情報は、ライン及びフレームを示す情報を含
む。
【００１８】入力制御器６３１はまた、アドレス、即ち
書込み位置情報の発生を含め、ＦＩＦＯメモリ６２１〜
６２３からバッファメモリ６４１へのデータ読込みを制
御する。入力制御器６３１により発生されるアドレス情
報は、バッファメモリ６４１における書込み位置、即ち
メモリ位置を決定する。この位置に、ビデオインタフェ
ース回路６１１〜６１３から出力された処理済ビデオデ
ータが書込まれる。処理済ビデオデータが書込まれるメ
モリ位置を制御することにより、バッファメモリ６４１
に記憶されたビデオデータによって表される、ビデオモ
ニタ６７０上のビデオ映像の表示位置を制御できる。ビ
デオデータのバッファメモリ６４１への書込みアドレス
（位置）の計算に必要な計算情報は、主制御プロセッサ
６９０によって入力制御器６３１内に設定される。この
可変計算情報は、表示モニタ又は表示モード（即ち、フ
ィールドモード、凍結フレームモード又は凍結フィール
ドモード）における各生ビデオ映像の位置を決める情報
を含むことがある。１組の計算情報が、各入力ビデオ及
びタイミングデータのために使用される。
【００１９】ビデオ又はタイミングデータをＦＩＦＯメ
モリ６２１の出力から得る場合、入力制御器６３１は、
このデータストリームに対する位置及びモード設定に加
え、取出したタイミングデータを用いてビデオデータを
書込むバッファメモリ６４１のアドレスを計算する。入
力制御器６３１はそれから、ＦＩＦＯメモリ６２１から
のビデオデータをバッファメモリ６４１の計算されたア
ドレスに書込む。入力制御器６３１は、ＦＩＦＯメモリ
６２１内の全データをバッファメモリ６４１に書込み終
えるか、或いは所定数のビデオデータ・サンプルをメモ
リに書込み終えるまで、この処理を続ける。入力制御器
６３１は次いで、ＦＩＦＯメモリ６２２，６２３よりの
データ及びタイミング情報を用いて同じ動作を行う。Ｆ
ＩＦＯメモリ６２１〜６２３からのこの読出し処理は、
所望の全ビデオ情報を表示するのに必要な間繰返され
る。
【００２０】入力制御器６３１の機能は、４つの別個の
動作に分けることができる。即ち、（１）データ及びタ
イミング情報をＦＩＦＯメモリ６２１〜６２３に書込む
こと、（２）ＦＩＦＯメモリ６２１〜６２３から読出し
たデータ及びタイミング情報に基いて書込みアドレス情
報を計算すること、（３）ＦＩＦＯメモリ６２１〜６２
３から出力される３つのデータストリームをバッファメ
モリ６４１への入力として次々に選択すること及び
（４）ビデオデータのバッファメモリ６４１への書込み
を制御することである。これら４つの機能をすべて単一
の制御器によって行う必要はない点に注意されたい。各
ビデオ及びタイミングデータストリームに対応する別々
の専用制御器を、データ及びタイミング情報のＦＩＦＯ
メモリへの書込みのために設けてもよい。また、ＦＩＦ
Ｏメモリから読出したデータ及びタイミング情報に基い
てバッファメモリ６４１における書込みアドレスを計算
するのに、別個の専用制御器を使用してもよい。
【００２１】前述したとおり、ビデオインタフェース６
１１〜６１３によって行われる処理のタイプが、ＦＩＦ
Ｏメモリ６２１〜６２３及びバッファメモリ６４１間の
デジタルビデオストリームの帯域幅を決める。ビデオイ
ンタフェース処理で多くのピクセルを落として表示され
るビデオ映像のサイズを縮小すると、デジタルビデオス
トリームの帯域幅は大きく減少する。好適な具体構成で
は、バッファメモリ６４１の入力帯域幅は、充分に大き
くて、どんなサイズの生ビデオウィンドーのデータレー
ト条件でも受入れることができる。
【００２２】しかし、例えば、３つのビデオウィンドー
をバッファメモリ６４１に蓄積する場合、ビデオインタ
フェース６１１〜６１３は、ビデオウィンドーとして表
示しようとするビデオ映像のサイズを縮小して、全帯域
幅がバッファメモリ６４１の帯域幅容量を越えないよう
にしなければならない。出力タイミング回路６５０は、
バッファメモリ６４０及び６４１からビデオデータを読
出すのに用いるアドレスを発生する。バッファメモリ６
４０及び６４１は、記憶容量が十分に大きくて、表示モ
ニタ６７０の各ピクセルに対応するビデオデータを夫々
記憶することができる。例えば、表示モニタ６７０が１
２８０×１０２４の解像度を有する場合、両バッファメ
モリ６４０，６４１は、表示モニタ６７０上の各ピクセ
ルに対するビデオ情報を記憶するのに充分な大きさとす
る。
【００２３】バッファメモリ６４０は、表示モニタ６７
０の１次ウィンドー内で表示しようとする１次ビデオ映
像に関する情報のみを記憶する専用メモリである。これ
に対し、バッファメモリ６４１は、１次ビデオ映像が表
示される１次ウィンドーとサイズが等しいか又はこれよ
り小さい、表示モニタ６７０上の複数の２次ウィンドー
の１つに各々を表示しようとする複数のビデオ映像に関
する情報を記憶する専用メモリである。ビデオデータ
は、バッファメモリ６４０，６４１からモニタ６７０に
表示するのに適したスピードで読出される。
【００２４】出力タイミング回路６５０により発生され
る出力タイミングは、異なるタイミング特性をもつ表示
モニタを受入れられるように可変とすることができる。
バッファメモリ６４０，６４１の出力は、出力選択器６
５２によって一緒に並直列変換される。この出力選択器
は、出力制御メモリ６５１から出力される信号に従い、
バッファメモリ６４０に記憶された情報により表される
１つの生ビデオウィンドーと、バッファメモリ６４１に
記憶された情報により表される複数の生ビデオウィンド
ーとの間で選択を行う。主制御プロセッサ６９０は、出
力制御メモリ６５１に、表示モニタ６７０上の各ピクセ
ルに対し、バッファメモリ６４０又はバッファメモリ６
４１のどちらの内容を出力すべきかを決めるデータを記
憶させる。例えば、特定のピクセルに関して、出力制御
メモリ６５１からの出力信号「００」をバッファメモリ
６４０の内容を出力すべきであることを示し、出力信号
「０１」をバッファメモリ６４１の内容を出力すべきで
あることを示すのに用いてもよい。こうして、各ピクセ
ルに対するバッファメモリ６４０，６４１の出力を切替
える(toggle)ことにより、多数の生ビデオウィンドーを
希望に応じ互いの上に「重なって」見えるように表示す
ることができる。
【００２５】出力制御メモリ６５１の内容は、出力タイ
ミング回路６５０の制御の下に読出される。出力制御メ
モリ６５１は、出力選択器６５２を制御する。出力イン
タフェース回路６６０は、出力選択器６５２からのビデ
オデータ出力をアナログビデオ信号に逆変換し、出力タ
イミング回路６５０に従って適切なビデオタイミング信
号を加え、ビデオ信号がモニタ６７０に適正に表示され
るようにする。こうして得られたビデオ信号又は複数の
ビデオウィンドーは、それからモニタ６７０に表示され
る。
【００２６】上述した本発明の実施例の変形では、生ビ
デオウィンドーを単一の表示器に図形映像と一緒に表示
することができる。本発明のこの具体構成では、図９に
示すように、図形データ９４０をビデオ映像データ９５
０と共に「重なった」形で表示できる。この具体構成
は、図６について説明したものと非常に似ている。図７
を参照して、両者の差をこれより説明する。
【００２７】図形制御器７８０は、図形映像を図形メモ
リ７８１に書込む。図形制御器７８０は、主制御プロセ
ッサ６９０、又は希望により他の別の制御源によって制
御されるように構成できる。出力タイミング回路６５０
は、ビデオデータを読出すバッファメモリ６４０，６４
１及び図形メモリ７８１内のメモリ位置をアドレスする
のに用いるアドレス情報を発生する。ビデオデータは、
バッファメモリ６４０，６４１からモニタ６７０に表示
するのに適したスピードで読出される。出力タイミング
回路６５０により発生され出力されるタイミング情報
は、異なるタイミング特性をもつ表示モニタでも受入れ
られるように、調整可能である。
【００２８】バッファメモリ６４０，６４１及び図形メ
モリ７８１の出力は、出力選択器６５２により並直列変
換、即ち結合される。この出力選択器６５２は、バッフ
ァメモリ６４０に記憶された情報により表される単一の
生ビデオウィンドーと、バッファメモリ６４１に記憶さ
れた情報により表される複数の生ビデオウィンドーと、
図形メモリ７８１に記憶された図形映像データとの間で
選択を行う。主制御プロセッサ６９０は、表示モニタ６
７０の各ピクセルに関係するデータであって、バッファ
メモリ６４０，６４１又は図形メモリ７８１の内容をモ
ニタ６７０の特定ピクセルに表示するため出力するかど
うかを決める又は示すデータを、出力制御メモリ６５１
に蓄積する。
【００２９】例えば、出力制御メモリ６５１からの出力
信号「００」をバッファメモリ６４０の内容を出力すべ
きであることを示すのに用い、出力制御メモリ６５１か
らの出力信号「０１」をバッファメモリ６４１の内容を
出力すべきであることを示すのに用い、出力制御メモリ
６５１からの出力信号「１０」を図形メモリ７８１の内
容を出力すべきであることを示すのに用いてもよい。こ
のようにして、生ビデオウィンドーを互いの上に「重な
った」又は図形映像と任意に組合せた形で、表示するこ
とができる。出力制御メモリ６５１の内容は、出力タイ
ミング回路６５０の制御の下に読出される。また、出力
制御メモリ６５１の出力は、出力選択器６５２を制御す
る。
【００３０】図８は、本発明の他の実施例を示す。この
具体構成は、前述したものに比べ、出力タイミング回路
６５０が、この回路に入力されるアナログコンピュータ
・ビデオディスプレー信号から導出されるタイミング情
報を取出す点に特徴がある。したがって、バッファメモ
リ６４０，６４１の出力は、入来コンピュータ・ビデオ
ディスプレー信号と同期している。図７に示した実施例
と同様に、主制御プロセッサ６９０は出力制御メモリ６
５１にデータを蓄積する。
【００３１】オーバーレイ回路８８５は、コンピュータ
・グラフィックス・データ及びバッファメモリ６４０，
６４１からの出力の間で切替えを行うのに用いる。オー
バーレイ回路８８５は、例えばアナログ・スイッチ又は
アナログ合算回路でよい。オーバーレイ回路８８５がア
ナログ・スイッチより成る場合、出力制御メモリ６５１
の内容は、出力選択器６５２とオーバーレイ回路８８５
の両方を制御するのに用いることができる。例えば、出
力制御メモリ６５１からの出力信号「００」を、バッフ
ァメモリ６４０の内容を主インタフェース回路６６０に
出力させるよう出力選択器６５２に命じるのに用いるこ
とができる。信号「０１」を、バッファメモリ６４１の
内容を出力させるよう出力選択器６５２に命じるのに用
い、信号「１０」を、入来コンピュータビデオ信号をモ
ニタ６７０に出力させるようオーバーレイ回路８８５に
命じるのに用いることができる。出力制御メモリ６５１
から「００」か又は「０１」が出力される場合、オーバ
ーレイ回路８８５は、主インタフェース回路６６０を介
して出力選択器６５２の出力を選択し、これをモニタ６
７０に出力させる動作をする。出力制御メモリ６５１か
ら「１０」が出力される場合、オーバーレイ回路８８５
は、入来コンピュータビデオ信号を選択してモニタ６７
０に供給する。
【００３２】オーバーレイ回路８８５がアナログ合算回
路である場合、出力制御メモリ６５１の内容は、出力選
択器６５２及び主インタフェース回路６６０のブランキ
ング回路の両方を制御する。例えば、出力制御メモリ６
５１から出力される信号「００」が、バッファメモリ６
４０の内容を出力することを意味し、信号「０１」が、
バッファメモリ６４１の内容を出力することを意味し、
信号「１０」が、入来コンピュータビデオ信号を出力す
ることを意味するものとすることができる。出力制御メ
モリ６５１が「００」又は「０１」の信号を出力する場
合、オーバーレイ回路８８５は、出力選択器６５２の出
力を入力コンピュータ・グラフィックス映像に加える。
ただし、これは、生ビデオ映像を表示しようとする場
合、コンピュータ・グラフィックス映像は黒か又は存在
しない、と仮定している。出力制御メモリ６５１が「１
０」の信号を出力する場合、主インタフェース回路６６
０のブランキング回路が作動して黒信号を入来コンピュ
ータビデオ信号に加える。これは、実効的に入来コンピ
ュータビデオ信号を選択して表示モニタ６７０に出力す
ることである。
【００３３】図６〜図８に示した上述の各実施例では、
１次バッファメモリは、１次ビデオ信号に対応するデー
タを記憶する専用メモリである。このデータは、ビデオ
モニタの１次ビデオウィンドー内に表示される。２次バ
ッファメモリは、ビデオモニタの２次ウィンドー内に表
示される複数の２次ビデオ信号に対応するビデオデータ
を記憶するのに使用される。各２次ウィンドーは、１次
ウィンドーよりも面積が小さい。本発明では、追加の２
次ビデオ信号が入力されるに従い、それらは２次バッフ
ァメモリに記憶される。ビデオ入力信号がいくら供給さ
れるかに関係なく、メモリを追加する必要はない。した
がって、本発明は、１対の比較的低速のビデオメモリを
用いるだけの、多数ビデオウィンドーを表示する簡単な
メカニズムを提供する。
【００３４】本発明は、特許請求の範囲内で多くの変形
が可能である。例えば、２次インタフェースは、どんな
数の２次入力信号をも受けることができる。バッファメ
モリは２ポートメモリが好ましいが、他のタイプのメモ
リでもよい。ＦＩＦＯメモリは、シフトレジスタ又は他
の適当な記憶素子を用いて実現できる。入力信号は、複
合又はコンポーネント・アナログビデオ、或いはどんな
適当なデジタルビデオフォーマットのものでもよい。
【００３５】
【発明の効果】以上説明したとおり、本発明によれば、
１対の比較的低速のビデオメモリを用いて、構成が簡単
でコストが少なく、入力ビデオ信号の数が増しても良好
な動作をし、さほど広いデータ帯域幅を必要としない多
数ビデオウィンドー同時表示方式を得ることができる。
【図面の簡単な説明】
【図１】単数ビデオウィンドーを表示するモニタの例を
示す正面図である。
【図２】多数ビデオウィンドーを表示するモニタの例を
示す正面図である。
【図３】多数生ビデオ映像を表示する従来技法の例１を
示すブロック図である。
【図４】多数生ビデオ映像を表示する従来技法の例２を
示すブロック図である。
【図５】多数生ビデオ映像を表示する従来技法の例３を
示すブロック図である。
【図６】本発明の第１実施例を示すブロック図である。
【図７】本発明の第２実施例を示すブロック図である。
【図８】本発明の第３実施例を示すブロック図である。
【図９】単一の表示モニタに多数ビデオウィンドーを図
形データと一緒に表示した例を示す正面図である。
【符号の説明】
Ｊ １次ビデオ信号 Ｋ，Ｌ，Ｍ ２次ビデオ信号 ６１０ １次ビデオインタフェース（１次インタフェー
ス手段） ６１１，６１２，６１３ ２次ビデオインタフェース
（２次インタフェース手段） ６４０ １次バッファ（記憶）メモリ ６４１ ２次バッファ（記憶）メモリ ６２１，６２２，６２３ 一時記憶ＦＩＦＯメモリ ６３０ １次入力制御器 ６３１ ２次入力制御器 ６５１ 出力制御メモリ ６５２ 出力選択器（手段） ６６０ 出力インタフェース（出力手段） ６７０ 表示モニタ（表示器） ６９０ 主制御プロセッサ

Claims (14)

    【特許請求の範囲】
  1. 【請求項１】 １次ウィンドー内に表示するための１次
    ビデオ信号を受け、上記１次ビデオウィンドーを表すデ
    ータを出力する１次インタフェース手段と、 上記１次ビデオウィンドーを表す上記データを受け、こ
    れを記憶する１次記憶メモリと、 複数の２次ビデオウィンドー内に表示するための複数の
    ２次ビデオ信号を受け、上記２次ビデオウィンドーを表
    すデータを出力する２次インタフェース手段と、 上記２次ビデオウィンドーを表す上記データを受け、こ
    れを記憶する２次記憶メモリと、 上記１次記憶メモリ及び上記２次記憶メモリを選択的に
    読むことにより、上記１次及び２次ビデオウィンドーを
    編成する出力選択手段とを具えた多数ビデオウィンドー
    同時表示装置。
  2. 【請求項２】 上記出力選択手段により編成された上記
    ウィンドーを受け、これを表示するビデオ表示器を更に
    有する請求項１の装置。
  3. 【請求項３】 １次ビデオ信号を受ける入力端と、該入
    力１次ビデオ信号を表すデータを記憶する１次記憶メモ
    リとを含む１次入力手段と、 複数の２次ビデオ信号を受ける複数の入力端と、該入力
    複数２次ビデオ信号を表すデータを記憶する２次記憶メ
    モリとを含む２次入力手段と、 上記１次記憶メモリ及び上記２次記憶メモリの内容を選
    択的に出力する出力手段とを具え、 上記入力１次ビデオ信号は、表示器の１次ウィンドー内
    に表示しようとするビデオ信号を表し、 上記入力複数２次ビデオ信号は、表示器の夫々の２次ウ
    ィンドー内に表示しようとするビデオ信号を表し、 上記２次ウィンドーは、上記１次ウィンドーより面積が
    小さいものである多数ビデオウィンドー同時表示装置。
  4. 【請求項４】 上記１次及び２次ビデオ信号は、アナロ
    グ複合ビデオ信号である請求項３の装置。
  5. 【請求項５】 上記１次入力手段は、上記１次アナログ
    複合ビデオ信号を、すぐあとで上記１次記憶メモリに蓄
    積する対応１次デジタルビデオデータに変換する手段を
    更に含む請求項４の装置。
  6. 【請求項６】 上記出力手段は、上記１次デジタルビデ
    オデータを上記表示器に表示するアナログビデオ信号に
    変換する手段を更に含む請求項５の装置。
  7. 【請求項７】 上記２次入力手段は、上記２次アナログ
    複合ビデオ信号を、すぐあとで上記２次記憶メモリに蓄
    積する２次デジタルビデオデータに変換する手段を更に
    含む請求項４の装置。
  8. 【請求項８】 上記出力手段は、上記２次デジタルビデ
    オデータを上記表示器に表示するのに適したアナログビ
    デオ信号に変換する手段を更に含む請求項７の装置。
  9. 【請求項９】 図形信号を発生する図形処理器と、 上記図形信号を表すデータを記憶する図形記憶メモリと
    を更に有し、 上記出力手段は、上記図形記憶メモリの内容を上記表示
    器に選択的に出力する手段を更に含む請求項３の装置。
  10. 【請求項１０】 上記図形信号は、動きの少ない絵画的
    形象を表すものである請求項９の装置。
  11. 【請求項１１】 上記図形信号は、原文情報を表す請求
    項９の装置。
  12. 【請求項１２】 １次アナログ複合ビデオ信号を入力す
    るステップと、 複数の２次アナログ複合ビデオ信号を入力するステップ
    と、 上記１次アナログ複合ビデオ信号を１次デジタルビデオ
    信号に変換するステップと、 上記複数の２次アナログ複合ビデオ信号を複数の２次デ
    ジタルビデオ信号に変換するステップと、 上記１次デジタルビデオ信号データを１次記憶メモリ手
    段に蓄積するステップと、 上記複数の２次デジタルビデオ信号データを２次記憶メ
    モリ手段に入力するステップと、 表示器の１次ウィンドー内に１次実運動ビデオ映像を表
    示するとと同時に、該表示器の複数の２次ウィンドー内
    に夫々複数の２次実運動ビデオ映像を表示するために、
    上記１次記憶メモリ及び上記２次記憶メモリから上記１
    次デジタルビデオデータ及び上記２次デジタルビデオデ
    ータを選択的に読出し、該１次デジタルビデオデータ及
    び該２次デジタルビデオデータを上記表示器に出力する
    ステップとを含む多数ビデオウィンドー同時表示方法。
  13. 【請求項１３】 入力１次ビデオ信号を受け、１次ビデ
    オデータを出力する１次ビデオインタフェースと、 複数の入力２次ビデオ信号の１つを受け、２次ビデオデ
    ータを出力する複数の２次ビデオインタフェースと、 上記１次ビデオインタフェースから出力される１次ビデ
    オデータを記憶するために、上記１次ビデオインタフェ
    ースの出力に接続された１次バッファメモリと、 上記複数の２次ビデオインタフェースの各々から出力さ
    れる２次ビデオデータを記憶するために、上記２次ビデ
    オインタフェースの出力に接続された２次バッファメモ
    リと、 上記複数の２次ビデオインタフェースから上記２次バッ
    ファメモリへの上記２次ビデオデータの入力を選択的に
    制御する入力制御器と、 表示モニタに表示するために、上記１次バッファメモリ
    及び上記２次バッファメモリから上記１次ビデオデータ
    及び上記２次ビデオデータを選択的に出力する出力選択
    器とを具えた多数ビデオウィンドー同時表示装置。
  14. 【請求項１４】 入力端及び出力端を有し、１次ビデオ
    信号の入力を受ける１次ビデオインタフェースと、 各々が入力端及び出力端を有し、複数の２次ビデオ信号
    の入力を受ける複数の２次ビデオインタフェースと、 上記入力１次ビデオ信号に対応する１次ビデオデータを
    記憶するために、上記１次ビデオインタフェースの出力
    端に接続された１次バッファメモリと、 上記入力２次ビデオ信号に対応する２次ビデオデータを
    受けるために上記２次ビデオインタフェースの各出力端
    に接続され、入力端及び出力端を有する複数の一時記憶
    ＦＩＦＯメモリと、 上記複数の一時記憶ＦＩＦＯメモリから出力される上記
    ２次ビデオデータを記憶するために、上記複数の一時記
    憶ＦＩＦＯメモリの全出力端に接続された２次バッファ
    メモリと、 上記１次ビデオインタフェースから上記１次バッファメ
    モリへの上記１次ビデオデータの出力を制御する１次入
    力制御器と、 上記複数の一時記憶ＦＩＦＯメモリから上記２次バッフ
    ァメモリへの上記２次ビデオデータの出力を制御する２
    次入力制御器と、 出力制御メモリに記憶された情報に従って、上記１次バ
    ッファメモリ及び上記２次バッファメモリから出力イン
    タフェースに夫々上記１次及び２次ビデオデータを選択
    的に出力するために、上記１次バッファメモリ及び上記
    ２次バッファメモリの出力端に接続された出力選択手段
    とを具え、 上記出力インタフェースは、上記出力選択手段から出力
    されるデータを処理し、上記１次及び２次バッファメモ
    リに記憶された上記１次及び２次ビデオデータに対応す
    る、表示モニタに適正な表示をするに適したビデオ信号
    を出力し、 上記１次入力制御器、上記２次入力制御器及び上記出力
    選択手段は、主制御プロセッサからの制御信号に従って
    作動するものである多数ビデオウィンドー同時表示装
    置。
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