JPH06311386A - 垂直同期分離回路 - Google Patents
垂直同期分離回路Info
- Publication number
- JPH06311386A JPH06311386A JP9271993A JP9271993A JPH06311386A JP H06311386 A JPH06311386 A JP H06311386A JP 9271993 A JP9271993 A JP 9271993A JP 9271993 A JP9271993 A JP 9271993A JP H06311386 A JPH06311386 A JP H06311386A
- Authority
- JP
- Japan
- Prior art keywords
- output
- monostable multivibrator
- vertical
- sync signal
- signal
- Prior art date
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- Pending
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- Synchronizing For Television (AREA)
Abstract
(57)【要約】
【構成】本発明は、積分回路４，電圧比較回路５からな
る垂直同期分離回路および２つの単安定マルチバイブレ
ータ７，９で構成される。 【効果】本発明によれば、電圧比較回路５の基準電圧
ｄ’の変動あるいは外来ノイズ等により、電圧比較回路
５の出力ｅ’にチャタリングが出力されたとしても、第
１の単安定マルチバイブレータ７より出力される垂直同
期信号出力ｆは単一パルスとなる。従って、本発明によ
る垂直同期分離回路をディスプレイ，テレビジョン受信
機等の映像信号処理装置に使用すれば、上記チャタリン
グによるインタレース不良，ジッタを防止することがで
きる。
る垂直同期分離回路および２つの単安定マルチバイブレ
ータ７，９で構成される。 【効果】本発明によれば、電圧比較回路５の基準電圧
ｄ’の変動あるいは外来ノイズ等により、電圧比較回路
５の出力ｅ’にチャタリングが出力されたとしても、第
１の単安定マルチバイブレータ７より出力される垂直同
期信号出力ｆは単一パルスとなる。従って、本発明によ
る垂直同期分離回路をディスプレイ，テレビジョン受信
機等の映像信号処理装置に使用すれば、上記チャタリン
グによるインタレース不良，ジッタを防止することがで
きる。
Description
【０００１】
【産業上の利用分野】本発明は、ディスプレイ，テレビ
ジョン受信機等の映像信号処理装置の垂直同期分離回路
に関するものである。
ジョン受信機等の映像信号処理装置の垂直同期分離回路
に関するものである。
【０００２】
【従来の技術】複合同期信号から垂直同期信号を分離す
る垂直同期分離回路として一般的なものは、特開平２−
２８３１７１号公報の従来例として記載されているよう
に、図３の構成となっている。
る垂直同期分離回路として一般的なものは、特開平２−
２８３１７１号公報の従来例として記載されているよう
に、図３の構成となっている。
【０００３】上記垂直同期分離回路では、図４の動作波
形図に示すように、複合同期信号ｂ（ＰHは水平同期信
号、ＰVは垂直同期信号、ＰEは等化パルス、１Ｈは１水
平期間を示す）を積分回路４で積分した出力信号ｃを、
電圧比較回路５により所定の電圧ｄと比較し、垂直同期
信号出力ｅが得られる。
形図に示すように、複合同期信号ｂ（ＰHは水平同期信
号、ＰVは垂直同期信号、ＰEは等化パルス、１Ｈは１水
平期間を示す）を積分回路４で積分した出力信号ｃを、
電圧比較回路５により所定の電圧ｄと比較し、垂直同期
信号出力ｅが得られる。
【０００４】
【発明が解決しようとする課題】上記従来の垂直同期分
離回路においては、図４に示すように、例えば、回路の
温度ドリフト等により基準電圧ｄのレベルがｄ’に変化
してしまった時、複合同期信号に含まれている等化パル
ス，切り込みパルスにより、電圧比較回路５から出力さ
れるパルスが単一パルスとならず、分離された垂直同期
信号出力にはｅ’に示すようなチャタリングを生じるこ
とがある。また、外来ノイズ等が加わった時にも同様に
チャタリングを生じることがある。このチャタリングが
垂直同期分離回路の後段の回路の誤動作の原因となり、
ジッタを生じたり、インタレースが不安定になったりし
てしまう。
離回路においては、図４に示すように、例えば、回路の
温度ドリフト等により基準電圧ｄのレベルがｄ’に変化
してしまった時、複合同期信号に含まれている等化パル
ス，切り込みパルスにより、電圧比較回路５から出力さ
れるパルスが単一パルスとならず、分離された垂直同期
信号出力にはｅ’に示すようなチャタリングを生じるこ
とがある。また、外来ノイズ等が加わった時にも同様に
チャタリングを生じることがある。このチャタリングが
垂直同期分離回路の後段の回路の誤動作の原因となり、
ジッタを生じたり、インタレースが不安定になったりし
てしまう。
【０００５】本発明は以上のような問題点を解決するた
めに成されたものである。
めに成されたものである。
【０００６】
【課題を解決するための手段】上記問題を解決するため
に従来の垂直同期分離回路の後段に出力パルス幅を上記
電圧比較回路の出力パルス幅より長く、垂直同期信号周
期より短い幅に設定した第１の単安定マルチバイブレー
タを設け、電圧比較回路の出力パルスを第１の単安定マ
ルチバイブレータのトリガに入力し、第１の単安定マル
チバイブレータの出力パルスを垂直同期信号出力とする
構成にしたものである。
に従来の垂直同期分離回路の後段に出力パルス幅を上記
電圧比較回路の出力パルス幅より長く、垂直同期信号周
期より短い幅に設定した第１の単安定マルチバイブレー
タを設け、電圧比較回路の出力パルスを第１の単安定マ
ルチバイブレータのトリガに入力し、第１の単安定マル
チバイブレータの出力パルスを垂直同期信号出力とする
構成にしたものである。
【０００７】さらに、上記第１の単安定マルチバイブレ
ータの後段に、出力パルス幅を所定の幅に設定した第２
の単安定マルチバイブレータを設け、第１の単安定マル
チバイブレータの出力パルスを第２の単安定マルチバイ
ブレータのトリガに入力し、第２の単安定マルチバイブ
レータの出力パルスを垂直同期信号出力とする構成にし
たものである。
ータの後段に、出力パルス幅を所定の幅に設定した第２
の単安定マルチバイブレータを設け、第１の単安定マル
チバイブレータの出力パルスを第２の単安定マルチバイ
ブレータのトリガに入力し、第２の単安定マルチバイブ
レータの出力パルスを垂直同期信号出力とする構成にし
たものである。
【０００８】
【作用】単安定マルチバイブレータの出力パルスは、一
度立ち上った後、その設定パルス幅の期間内には立ち下
がることはないので、その期間内に電圧比較回路の出
力、すなわち、第１の単安定マルチバイブレータのトリ
ガ入力にチャタリングが現れた場合でも、第１の単安定
マルチバイブレータの出力パルスは単一パルスとなる。
よって、第１の単安定マルチバイブレータの出力パルス
を電圧比較回路の出力パルス幅より長く、かつ、垂直同
期信号周期より短くなるように設定することにより、チ
ャタリングを除去した単一パルスの垂直同期信号出力が
得られる。
度立ち上った後、その設定パルス幅の期間内には立ち下
がることはないので、その期間内に電圧比較回路の出
力、すなわち、第１の単安定マルチバイブレータのトリ
ガ入力にチャタリングが現れた場合でも、第１の単安定
マルチバイブレータの出力パルスは単一パルスとなる。
よって、第１の単安定マルチバイブレータの出力パルス
を電圧比較回路の出力パルス幅より長く、かつ、垂直同
期信号周期より短くなるように設定することにより、チ
ャタリングを除去した単一パルスの垂直同期信号出力が
得られる。
【０００９】さらに、第１の単安定マルチバイブレータ
の出力を第２の単安定マルチバイブレータのトリガに入
力し、その出力パルス幅を、例えば、垂直同期信号パル
スの幅に設定することにより、所定のパルス幅に整形さ
れた垂直同期信号出力を得ることができる。
の出力を第２の単安定マルチバイブレータのトリガに入
力し、その出力パルス幅を、例えば、垂直同期信号パル
スの幅に設定することにより、所定のパルス幅に整形さ
れた垂直同期信号出力を得ることができる。
【００１０】
【実施例】以下、本発明の実施例を図面を用いて説明す
る。図１は本発明によるテレビジョン受信機における垂
直同期分離回路のブロック図である。図２は、図１の各
部の動作波形図である。図１において、１は複合映像信
号入力端子、２は複合同期信号分離回路、３は複合同期
信号入力端子、４は積分回路、５は電圧比較回路、８，
１０は垂直同期信号出力端子、７は第１の単安定マルチ
バイブレータ、９は第２の単安定マルチバイブレータで
ある。図１及び図２において、ａは複合映像信号、ｂは
複合同期信号、ｃは積分回路４の出力、ｄ’は電圧比較
回路５の基準電圧、ｅ’は電圧比較回路５の出力、ｆは
第１の単安定マルチバイブレータ７の出力、ｇは第２の
単安定マルチバイブレータ９の出力である。
る。図１は本発明によるテレビジョン受信機における垂
直同期分離回路のブロック図である。図２は、図１の各
部の動作波形図である。図１において、１は複合映像信
号入力端子、２は複合同期信号分離回路、３は複合同期
信号入力端子、４は積分回路、５は電圧比較回路、８，
１０は垂直同期信号出力端子、７は第１の単安定マルチ
バイブレータ、９は第２の単安定マルチバイブレータで
ある。図１及び図２において、ａは複合映像信号、ｂは
複合同期信号、ｃは積分回路４の出力、ｄ’は電圧比較
回路５の基準電圧、ｅ’は電圧比較回路５の出力、ｆは
第１の単安定マルチバイブレータ７の出力、ｇは第２の
単安定マルチバイブレータ９の出力である。
【００１１】まず、複合同期信号入力端子３より入力
し、垂直同期信号出力端子８より出力する場合の説明を
行なう。複合同期信号入力端子３に入力された水平同期
信号と垂直同期信号を含んだ複合同期信号ｂは、積分回
路４で積分され水平同期信号成分を除去した出力ｃとな
り、電圧比較回路５にて波形整形され出力波形ｅ’にな
る。次に、第１の単安定マルチバイブレータ７のトリガ
に入力し、電圧比較回路５のパルス幅Ｔ０より長く、垂
直同期信号周期Ｔ２より短い幅Ｔ１に設定したパルス幅
に整形したパルスｆを出力する。
し、垂直同期信号出力端子８より出力する場合の説明を
行なう。複合同期信号入力端子３に入力された水平同期
信号と垂直同期信号を含んだ複合同期信号ｂは、積分回
路４で積分され水平同期信号成分を除去した出力ｃとな
り、電圧比較回路５にて波形整形され出力波形ｅ’にな
る。次に、第１の単安定マルチバイブレータ７のトリガ
に入力し、電圧比較回路５のパルス幅Ｔ０より長く、垂
直同期信号周期Ｔ２より短い幅Ｔ１に設定したパルス幅
に整形したパルスｆを出力する。
【００１２】単安定マルチバイブレータの出力パルス
は、一度立ち上った後、その設定パルス幅の期間内には
立ち下がることはないので、もし、回路の温度ドリフト
等により電圧比較回路５の基準電圧ｄ’が変化してしま
い、出力波形ｅ’、すなわち、第１の単安定マルチバイ
ブレータのトリガ入力にチャタリングが出力された場合
でも、第１の単安定マルチバイブレータの出力パルスは
単一パルスとなる。
は、一度立ち上った後、その設定パルス幅の期間内には
立ち下がることはないので、もし、回路の温度ドリフト
等により電圧比較回路５の基準電圧ｄ’が変化してしま
い、出力波形ｅ’、すなわち、第１の単安定マルチバイ
ブレータのトリガ入力にチャタリングが出力された場合
でも、第１の単安定マルチバイブレータの出力パルスは
単一パルスとなる。
【００１３】以上述べたようにして、チャタリングのな
い垂直同期信号出力ｆを得られる。
い垂直同期信号出力ｆを得られる。
【００１４】さらに、その出力パルスｆを第２の単安定
マルチバイブレータ９のトリガに入力し、パルス幅を所
定のパルス幅、例えば、垂直同期信号の幅Ｔｗにした垂
直同期信号ｇを出力することができる。
マルチバイブレータ９のトリガに入力し、パルス幅を所
定のパルス幅、例えば、垂直同期信号の幅Ｔｗにした垂
直同期信号ｇを出力することができる。
【００１５】また、垂直同期分離回路の前段に、映像信
号，水平同期信号、および、垂直同期信号を含んだ複合
映像信号ａより複合同期信号を得る複合同期信号分離回
路２を設けた場合でも、同様に垂直同期信号出力ｆ，ｇ
を得られる。
号，水平同期信号、および、垂直同期信号を含んだ複合
映像信号ａより複合同期信号を得る複合同期信号分離回
路２を設けた場合でも、同様に垂直同期信号出力ｆ，ｇ
を得られる。
【００１６】
【発明の効果】本発明によれば、積分回路，電圧比較回
路よりなる垂直同期分離回路において、その電圧比較回
路の後段に単安定マルチバイブレータを１段設けるだけ
で、垂直同期分離回路の後段に誤動作をおよぼす複数の
パルスを除去することができる。これを用いて、インタ
レース不良，ジッタが防止できる。
路よりなる垂直同期分離回路において、その電圧比較回
路の後段に単安定マルチバイブレータを１段設けるだけ
で、垂直同期分離回路の後段に誤動作をおよぼす複数の
パルスを除去することができる。これを用いて、インタ
レース不良，ジッタが防止できる。
【００１７】さらに、単安定マルチバイブレータを１段
追加することで所定のパルス幅に整形した垂直同期信号
も出力できる。
追加することで所定のパルス幅に整形した垂直同期信号
も出力できる。
【図１】本発明の一実施例によるテレビジョン受信機に
おける垂直同期分離回路のブロック図である。
おける垂直同期分離回路のブロック図である。
【図２】本発明の一実施例によるテレビジョン受信機に
おける垂直同期分離回路のブロック図の動作波形を示し
た図である。
おける垂直同期分離回路のブロック図の動作波形を示し
た図である。
【図３】従来の垂直同期分離回路の一例のブロック図で
ある。
ある。
【図４】従来の垂直同期分離回路の一例のブロック図の
動作波形を示した図である。
動作波形を示した図である。
１…複合映像信号入力端子、２…複合同期信号分離回
路、３…複合同期信号入力端子、４…積分回路、５…電
圧比較回路、６，８，１０…垂直同期信号出力端子、７
…第１の単安定マルチバイブレータ、９…第２の単安定
マルチバイブレータ、ａ…複合映像信号、ｂ…複合同期
信号、ｃ…積分回路４の出力、ｄ，ｄ’…電圧比較回路
５の基準電圧、ｅ，ｅ’…電圧比較回路５の出力、ｆ…
第１の単安定マルチバイブレータ７の出力、ｇ…第２の
単安定マルチバイブレータ９の出力。
路、３…複合同期信号入力端子、４…積分回路、５…電
圧比較回路、６，８，１０…垂直同期信号出力端子、７
…第１の単安定マルチバイブレータ、９…第２の単安定
マルチバイブレータ、ａ…複合映像信号、ｂ…複合同期
信号、ｃ…積分回路４の出力、ｄ，ｄ’…電圧比較回路
５の基準電圧、ｅ，ｅ’…電圧比較回路５の出力、ｆ…
第１の単安定マルチバイブレータ７の出力、ｇ…第２の
単安定マルチバイブレータ９の出力。
Claims (4)
- 【請求項１】水平同期信号と垂直同期信号を含んだ複合
同期信号を、積分回路に入力して水平同期信号成分を除
去し、電圧比較回路で波形整形して垂直同期信号を分離
する垂直同期分離回路と、出力パルス幅を上記電圧比較
回路の出力パルスより長く、垂直同期信号周期より短く
設定した第１の単安定マルチバイブレータとを設け、上
記電圧比較回路の出力パルスを第１の単安定マルチバイ
ブレータのトリガに入力し、第１の単安定マルチバイブ
レータの出力パルスを垂直同期信号出力とすることを特
徴とする垂直同期分離回路。 - 【請求項２】請求項１記載の垂直同期分離回路と、出力
パルス幅を所定の幅に設定した第２の単安定マルチバイ
ブレータとを設け、上記第１の単安定マルチバイブレー
タの出力パルスを、第２の単安定マルチバイブレータの
トリガに入力し、その第２の単安定マルチバイブレータ
の出力パルスを垂直同期信号出力とすることを特徴とす
る垂直同期分離回路。 - 【請求項３】映像信号と水平同期信号と垂直同期信号を
含んだ複合映像信号より、水平同期信号と垂直同期信号
を含んだ複合同期信号を分離する複合同期信号分離回路
と、請求項１記載の垂直同期分離回路とを設け、上記垂
直同期分離回路の出力パルスを垂直同期信号出力とする
ことを特徴とする垂直同期分離回路。 - 【請求項４】請求項２記載の垂直同期分離回路の出力パ
ルス幅を複合同期信号内の垂直同期信号パルス幅に設定
することを特徴とする垂直同期分離回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9271993A JPH06311386A (ja) | 1993-04-20 | 1993-04-20 | 垂直同期分離回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9271993A JPH06311386A (ja) | 1993-04-20 | 1993-04-20 | 垂直同期分離回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06311386A true JPH06311386A (ja) | 1994-11-04 |
Family
ID=14062267
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9271993A Pending JPH06311386A (ja) | 1993-04-20 | 1993-04-20 | 垂直同期分離回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06311386A (ja) |
-
1993
- 1993-04-20 JP JP9271993A patent/JPH06311386A/ja active Pending
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