JPH06253251A - デジタル電子カメラ装置 - Google Patents
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- JPH06253251A JPH06253251A JP5036782A JP3678293A JPH06253251A JP H06253251 A JPH06253251 A JP H06253251A JP 5036782 A JP5036782 A JP 5036782A JP 3678293 A JP3678293 A JP 3678293A JP H06253251 A JPH06253251 A JP H06253251A
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- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/92—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback
- H04N5/926—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback by pulse code modulation
- H04N5/9261—Transformation of the television signal for recording, e.g. modulation, frequency changing; Inverse transformation for playback by pulse code modulation involving data reduction
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- Multimedia (AREA)
- Signal Processing (AREA)
- Television Signal Processing For Recording (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】
【目的】 静止画像の撮影も動画像の撮影も可能なデジ
タル電子カメラ装置を提供する。 【構成】 ＣＣＤ２からの電気信号をＡ／Ｄ変換器４で
デジタル化したラスタ信号に変換する。ここで静止画像
撮影の場合は、フレームメモリ13でラスタ信号をブロッ
ク信号に変換し、このブロック信号をデジタル信号処理
回路６で輝度信号，色差信号に変換してフレームメモリ
13に再度記憶し、ブロックバッファ19に蓄積する。動画
像撮影の場合は、ラスタ信号を輝度信号，色差信号に変
換してからラインメモリ14でブロック信号に変換し、ブ
ロックバッファ19に蓄積する。そして、ブロックバッフ
ァ19のデータを圧縮回路７で画像圧縮してメモリカード
11に記録する。
タル電子カメラ装置を提供する。 【構成】 ＣＣＤ２からの電気信号をＡ／Ｄ変換器４で
デジタル化したラスタ信号に変換する。ここで静止画像
撮影の場合は、フレームメモリ13でラスタ信号をブロッ
ク信号に変換し、このブロック信号をデジタル信号処理
回路６で輝度信号，色差信号に変換してフレームメモリ
13に再度記憶し、ブロックバッファ19に蓄積する。動画
像撮影の場合は、ラスタ信号を輝度信号，色差信号に変
換してからラインメモリ14でブロック信号に変換し、ブ
ロックバッファ19に蓄積する。そして、ブロックバッフ
ァ19のデータを圧縮回路７で画像圧縮してメモリカード
11に記録する。
Description
【０００１】
【産業上の利用分野】本発明は、被写体を撮影して得た
デジタル画像データを圧縮して、記録媒体に記録するデ
ジタル電子カメラ装置に関する。
デジタル画像データを圧縮して、記録媒体に記録するデ
ジタル電子カメラ装置に関する。
【０００２】
【従来の技術】従来、この種の装置の１つに特開平３−
42973号公報記載のものがある。この技術は、連続撮影
の場合にデータ圧縮を行わないか、または圧縮率を変え
て記録媒体に記録することにより、撮影速度の向上を図
ったものである。
42973号公報記載のものがある。この技術は、連続撮影
の場合にデータ圧縮を行わないか、または圧縮率を変え
て記録媒体に記録することにより、撮影速度の向上を図
ったものである。
【０００３】
【発明が解決しようとする課題】デジタル電子カメラ装
置においては、静止画像撮影(１コマ撮影)の場合と動画
像撮影(連続撮影)の場合とでは、その映像信号の処理方
法が若干違ってくる。すなわち、静止画像撮影の場合
は、映像信号の処理時間を考慮する必要はないが、動画
像撮影の場合は、映像信号の処理時間がそのまま撮影速
度に関わってくる。
置においては、静止画像撮影(１コマ撮影)の場合と動画
像撮影(連続撮影)の場合とでは、その映像信号の処理方
法が若干違ってくる。すなわち、静止画像撮影の場合
は、映像信号の処理時間を考慮する必要はないが、動画
像撮影の場合は、映像信号の処理時間がそのまま撮影速
度に関わってくる。
【０００４】上述した特開平３−42973号公報記載の技
術では、その点を鑑み、撮影速度を向上させ、静止画像
も動画像も撮影できるようにした。
術では、その点を鑑み、撮影速度を向上させ、静止画像
も動画像も撮影できるようにした。
【０００５】しかしながら、動画像撮影の撮影速度向上
のために、データ圧縮を行わないかまたは圧縮率を低く
抑えることは、それだけ１コマの画像あたりに使用する
メモリが縮小されないので、記録媒体に入力できる画像
の枚数も少なくなる。
のために、データ圧縮を行わないかまたは圧縮率を低く
抑えることは、それだけ１コマの画像あたりに使用する
メモリが縮小されないので、記録媒体に入力できる画像
の枚数も少なくなる。
【０００６】本発明は、このような問題点を解決し、静
止画像の撮影も動画像の撮影も可能なデジタル電子カメ
ラ装置を提供することを目的とする。
止画像の撮影も動画像の撮影も可能なデジタル電子カメ
ラ装置を提供することを目的とする。
【０００７】
【課題を解決するための手段】上記目的を達成するため
に、本発明は、光学的に結像した画像を受けて電気信号
に変換して画像信号を出力する撮像素子と、この撮像素
子からの電気信号をデジタル信号に変換するアナログ／
デジタル変換器と、このアナログ／デジタル変換器から
のデジタル信号を記録媒体に記憶する記憶手段とを備え
たデジタル電子カメラ装置において、前記デジタル信号
を輝度信号と色差信号に変換するデジタル信号処理回路
と、前記輝度信号と色差信号または前記撮像素子の出力
である１フレーム分の前記アナログ／デジタル変換器か
らのデジタル信号を記憶するフレームメモリと、ｎライ
ン分の輝度信号と色差信号を記憶するラインメモリと、
前記フレームメモリのアドレスを制御するフレームメモ
リ制御回路と、前記ラインメモリのアドレスを制御する
ラインメモリ制御回路と、前記フレームメモリ制御回路
と前記ラインメモリ制御回路とを切り換えるアドレス切
換回路と、このアドレス切換回路の切り換えにより送出
されるアドレス制御された前記ラインメモリの輝度信号
と色差信号または前記フレームメモリのデジタル信号を
デジタル信号処理回路に入力して変換した輝度信号と色
差信号をｎ×ｎのブロックとして一時記憶するブロック
バッファと、このブロックバッファの画像データを圧縮
し、前記記憶媒体に記録するための圧縮データに変換す
る圧縮回路とを備えたことを特徴とする。
に、本発明は、光学的に結像した画像を受けて電気信号
に変換して画像信号を出力する撮像素子と、この撮像素
子からの電気信号をデジタル信号に変換するアナログ／
デジタル変換器と、このアナログ／デジタル変換器から
のデジタル信号を記録媒体に記憶する記憶手段とを備え
たデジタル電子カメラ装置において、前記デジタル信号
を輝度信号と色差信号に変換するデジタル信号処理回路
と、前記輝度信号と色差信号または前記撮像素子の出力
である１フレーム分の前記アナログ／デジタル変換器か
らのデジタル信号を記憶するフレームメモリと、ｎライ
ン分の輝度信号と色差信号を記憶するラインメモリと、
前記フレームメモリのアドレスを制御するフレームメモ
リ制御回路と、前記ラインメモリのアドレスを制御する
ラインメモリ制御回路と、前記フレームメモリ制御回路
と前記ラインメモリ制御回路とを切り換えるアドレス切
換回路と、このアドレス切換回路の切り換えにより送出
されるアドレス制御された前記ラインメモリの輝度信号
と色差信号または前記フレームメモリのデジタル信号を
デジタル信号処理回路に入力して変換した輝度信号と色
差信号をｎ×ｎのブロックとして一時記憶するブロック
バッファと、このブロックバッファの画像データを圧縮
し、前記記憶媒体に記録するための圧縮データに変換す
る圧縮回路とを備えたことを特徴とする。
【０００８】また本発明は、フレームメモリの一部を、
ｎライン分のラインメモリとして使用することを特徴と
する。
ｎライン分のラインメモリとして使用することを特徴と
する。
【０００９】また本発明は、フレームメモリを１フレー
ム遅延用として用い、フレーム間の画像データの差分を
とるための加減算回路を設け、出力されるフレーム間の
差分信号を圧縮回路で圧縮することを特徴とする。
ム遅延用として用い、フレーム間の画像データの差分を
とるための加減算回路を設け、出力されるフレーム間の
差分信号を圧縮回路で圧縮することを特徴とする。
【００１０】
【作用】本発明は、上記構成を採用することにより、デ
ジタル信号処理回路より出力された輝度信号と色差信号
がラインメモリによりブロック化され、さらにこのブロ
ック化された輝度信号と色差信号がブロックバッファに
蓄積される。このブロックバッファに蓄積された信号が
圧縮回路によって圧縮され、記録媒体に記憶されるた
め、動画像撮影においては、高速化，低容量化が可能と
なる。また、静止画像撮影においては、アナログ／デジ
タル変換器からのデジタル信号がフレームメモリにより
ブロック化され、このブロック化されたデジタル信号が
輝度信号と色差信号に変換される。そしてさらに、この
輝度信号と色差信号はフレームメモリに書き込まれ、こ
のフレームメモリのブロック単位の画像データがブロッ
クバッファに送られる。以下、上記動画像撮影と同様
に、信号の蓄積，データ圧縮の後に記録媒体に記憶され
るため、静止画像の画像記録も動画像の画像記録も両方
とも実現できる。
ジタル信号処理回路より出力された輝度信号と色差信号
がラインメモリによりブロック化され、さらにこのブロ
ック化された輝度信号と色差信号がブロックバッファに
蓄積される。このブロックバッファに蓄積された信号が
圧縮回路によって圧縮され、記録媒体に記憶されるた
め、動画像撮影においては、高速化，低容量化が可能と
なる。また、静止画像撮影においては、アナログ／デジ
タル変換器からのデジタル信号がフレームメモリにより
ブロック化され、このブロック化されたデジタル信号が
輝度信号と色差信号に変換される。そしてさらに、この
輝度信号と色差信号はフレームメモリに書き込まれ、こ
のフレームメモリのブロック単位の画像データがブロッ
クバッファに送られる。以下、上記動画像撮影と同様
に、信号の蓄積，データ圧縮の後に記録媒体に記憶され
るため、静止画像の画像記録も動画像の画像記録も両方
とも実現できる。
【００１１】また、動画像圧縮のためのラインメモリを
フレームメモリで代用するため、必要なメモリがフレー
ムメモリ１つだけでよくなる。
フレームメモリで代用するため、必要なメモリがフレー
ムメモリ１つだけでよくなる。
【００１２】また、動画像撮影において、フレームメモ
リに１フレーム前の画像データを記憶しておき、加減算
回路によりフレーム間の差分信号を出力させる。この差
分信号をラインメモリでブロック単位の信号とし画像圧
縮するため、圧縮効率が良くなる。
リに１フレーム前の画像データを記憶しておき、加減算
回路によりフレーム間の差分信号を出力させる。この差
分信号をラインメモリでブロック単位の信号とし画像圧
縮するため、圧縮効率が良くなる。
【００１３】
【実施例】以下、本発明の実施例について図面を参照し
ながら詳細に説明する。
ながら詳細に説明する。
【００１４】図１は、本発明のデジタル電子カメラの基
本構成を示すブロック図であり、１は撮影レンズ、２は
撮像素子であるＣＣＤ、３はＣＤＳ(相関二重サンプリ
ング)回路、４はアナログ／デジタル変換器(以下、Ａ／
Ｄ変換器と称する)、５はメモリ、６はデジタル信号処
理回路、７は圧縮回路、８は同期信号発生回路、９はア
ドレスコントローラ、10はＣＰＵ(中央演算処理部)、11
は記録媒体であるメモリカード、12はデジタル電子カメ
ラを示す。
本構成を示すブロック図であり、１は撮影レンズ、２は
撮像素子であるＣＣＤ、３はＣＤＳ(相関二重サンプリ
ング)回路、４はアナログ／デジタル変換器(以下、Ａ／
Ｄ変換器と称する)、５はメモリ、６はデジタル信号処
理回路、７は圧縮回路、８は同期信号発生回路、９はア
ドレスコントローラ、10はＣＰＵ(中央演算処理部)、11
は記録媒体であるメモリカード、12はデジタル電子カメ
ラを示す。
【００１５】撮影レンズ１を通して入ってきた撮影情報
である入射光は、その光量に応じ、ＣＣＤ２によって光
電変換され、電荷がＣＣＤ２の受光素子に蓄積される。
そして、蓄積された電荷は各ラインごとのラスタ・スキ
ャンにより撮影情報の電気信号であるＣＣＤ信号として
出力される。ＣＣＤ信号は、ＣＤＳ回路３でリセットノ
イズ等が除去された後、Ａ／Ｄ変換器４でデジタル信号
に変換される。さらに、このデジタル信号は同期信号発
生回路８のタイミングで制御されたアドレスコントロー
ラ９により、ｎライン分のメモリ５に読み書きを行うこ
とで、ｎ×ｎのブロック(ｎは整数)単位の信号に変換さ
れる。
である入射光は、その光量に応じ、ＣＣＤ２によって光
電変換され、電荷がＣＣＤ２の受光素子に蓄積される。
そして、蓄積された電荷は各ラインごとのラスタ・スキ
ャンにより撮影情報の電気信号であるＣＣＤ信号として
出力される。ＣＣＤ信号は、ＣＤＳ回路３でリセットノ
イズ等が除去された後、Ａ／Ｄ変換器４でデジタル信号
に変換される。さらに、このデジタル信号は同期信号発
生回路８のタイミングで制御されたアドレスコントロー
ラ９により、ｎライン分のメモリ５に読み書きを行うこ
とで、ｎ×ｎのブロック(ｎは整数)単位の信号に変換さ
れる。
【００１６】ブロック単位のデジタル信号は、デジタル
信号処理回路６によりブロック単位の輝度信号Ｙ，色差
信号Ｒ−Ｙ，Ｂ−Ｙに変換される。さらにブロック単位
の輝度信号Ｙ，色差信号Ｒ−Ｙ，Ｂ−Ｙは圧縮回路７で
画像圧縮され、メモリカード11に記録される。これらの
一連のシーケンスはＣＰＵ10により制御される。
信号処理回路６によりブロック単位の輝度信号Ｙ，色差
信号Ｒ−Ｙ，Ｂ−Ｙに変換される。さらにブロック単位
の輝度信号Ｙ，色差信号Ｒ−Ｙ，Ｂ−Ｙは圧縮回路７で
画像圧縮され、メモリカード11に記録される。これらの
一連のシーケンスはＣＰＵ10により制御される。
【００１７】図２は、本発明の第１実施例を示すブロッ
ク図であり、13は１フレーム分のデジタル信号または輝
度信号Ｙと色差信号Ｒ−Ｙ，Ｂ−Ｙ(以下、輝度信号Ｙ
と色差信号Ｒ−Ｙ，Ｂ−Ｙを総称して画像データと称す
る)を記憶するフレームメモリを示す。このフレームメ
モリ13としては、512(column)×1024(row)×８(bit)の
４MbitのＤＲＡＭを、輝度信号用と色差信号用に２個使
うことで１つのフレームの画像を記録することが可能で
ある。
ク図であり、13は１フレーム分のデジタル信号または輝
度信号Ｙと色差信号Ｒ−Ｙ，Ｂ−Ｙ(以下、輝度信号Ｙ
と色差信号Ｒ−Ｙ，Ｂ−Ｙを総称して画像データと称す
る)を記憶するフレームメモリを示す。このフレームメ
モリ13としては、512(column)×1024(row)×８(bit)の
４MbitのＤＲＡＭを、輝度信号用と色差信号用に２個使
うことで１つのフレームの画像を記録することが可能で
ある。
【００１８】14は、ｎライン分の画像データを記憶する
ラインメモリを示す。このフレームメモリ13とラインメ
モリ14が、図１に示すメモリ５に相当する。
ラインメモリを示す。このフレームメモリ13とラインメ
モリ14が、図１に示すメモリ５に相当する。
【００１９】15はフレームメモリ13のアドレスを発生さ
せるフレームメモリ制御回路、16はラインメモリ14のア
ドレスを発生させるラインメモリ制御回路を示す。この
フレームメモリ制御回路15とラインメモリ制御回路16
が、図１に示すアドレスコントローラ９に相当する。
せるフレームメモリ制御回路、16はラインメモリ14のア
ドレスを発生させるラインメモリ制御回路を示す。この
フレームメモリ制御回路15とラインメモリ制御回路16
が、図１に示すアドレスコントローラ９に相当する。
【００２０】17は、Ａ／Ｄ変換器４の出力端子とメモリ
５に対する入出力端子とデジタル信号処理回路６の入力
端子とを相互に切り換えるデータ切換回路、18は上記２
つの制御回路15，16を切り換えるアドレス切換回路を示
す。
５に対する入出力端子とデジタル信号処理回路６の入力
端子とを相互に切り換えるデータ切換回路、18は上記２
つの制御回路15，16を切り換えるアドレス切換回路を示
す。
【００２１】次に、動作について説明する。まず、静止
画像記録の場合について説明する。
画像記録の場合について説明する。
【００２２】撮影レンズ１を通して入ってきた入射光
は、前述したプロセスを経てデジタル信号に変換され
る。このデジタル信号は、データ切換回路17によりメモ
リ５側に送られる。このとき、アドレス切換回路18が切
り換えられ、フレームメモリ制御回路15の制御のもと
に、フレームメモリ13にデジタル信号が記録される。１
フレーム分のデジタル信号が記録された後、フレームメ
モリ13に記録されたそのデジタル信号が読みだされ、デ
ジタル信号処理回路６により、画像データに変換され
る。さらに、フレームメモリ13に書き込まれているデジ
タル信号を、上記画像データに書き換える(以下、この
書換動作をリードモディファイライトモードと称す
る)。そして、このフレームメモリ13の画像データを基
に、データ圧縮が行われ、圧縮データとしてメモリカー
ド11に記憶される。
は、前述したプロセスを経てデジタル信号に変換され
る。このデジタル信号は、データ切換回路17によりメモ
リ５側に送られる。このとき、アドレス切換回路18が切
り換えられ、フレームメモリ制御回路15の制御のもと
に、フレームメモリ13にデジタル信号が記録される。１
フレーム分のデジタル信号が記録された後、フレームメ
モリ13に記録されたそのデジタル信号が読みだされ、デ
ジタル信号処理回路６により、画像データに変換され
る。さらに、フレームメモリ13に書き込まれているデジ
タル信号を、上記画像データに書き換える(以下、この
書換動作をリードモディファイライトモードと称す
る)。そして、このフレームメモリ13の画像データを基
に、データ圧縮が行われ、圧縮データとしてメモリカー
ド11に記憶される。
【００２３】再生時には、メモリカード11の圧縮データ
が記録再生回路20によって取り出され、圧縮回路７によ
ってブロック単位の画像データに逆変換される。この画
像データがブロックバッファ19に蓄積され、さらに蓄積
されたブロック単位の画像データがフレームメモリ制御
回路15の制御によりフレームメモリ13に書き込まれてい
く。１フレーム分の画像データがフレームメモリ13に書
き込まれた後、フレーム制御回路15によってフレームメ
モリ13の画像データがラスタ・アドレスで読み出され、
ラスタ信号に変換される。ラスタ信号に変換された画像
データは、エンコーダ21によってコンポジットビデオ信
号に変換され、さらにＤ／Ａ変換器22によりアナログビ
デオ信号に変換される。このアナログビデオ信号により
モニタＴＶ23で画像再生がなされる。
が記録再生回路20によって取り出され、圧縮回路７によ
ってブロック単位の画像データに逆変換される。この画
像データがブロックバッファ19に蓄積され、さらに蓄積
されたブロック単位の画像データがフレームメモリ制御
回路15の制御によりフレームメモリ13に書き込まれてい
く。１フレーム分の画像データがフレームメモリ13に書
き込まれた後、フレーム制御回路15によってフレームメ
モリ13の画像データがラスタ・アドレスで読み出され、
ラスタ信号に変換される。ラスタ信号に変換された画像
データは、エンコーダ21によってコンポジットビデオ信
号に変換され、さらにＤ／Ａ変換器22によりアナログビ
デオ信号に変換される。このアナログビデオ信号により
モニタＴＶ23で画像再生がなされる。
【００２４】次に、動画像記録の場合を説明する。撮影
レンズ１を通して入ってきた入射光は、静止画像記録と
同様にデジタル信号に変換される。このデジタル信号は
デジタル信号処理回路６により画像データに変換され
る。そして、アドレス切換回路18が切り換えられ、ライ
ンメモリ制御回路16の制御のもとに、上記画像データは
ラインメモリ13に記憶され、同時にｎ×ｎのブロック信
号に変換される。ブロック信号に変換された画像データ
はブロックバッファ19に蓄積され、さらに圧縮回路７に
より圧縮データに変換され、メモリカード22に記録再生
回路20によって記録される。
レンズ１を通して入ってきた入射光は、静止画像記録と
同様にデジタル信号に変換される。このデジタル信号は
デジタル信号処理回路６により画像データに変換され
る。そして、アドレス切換回路18が切り換えられ、ライ
ンメモリ制御回路16の制御のもとに、上記画像データは
ラインメモリ13に記憶され、同時にｎ×ｎのブロック信
号に変換される。ブロック信号に変換された画像データ
はブロックバッファ19に蓄積され、さらに圧縮回路７に
より圧縮データに変換され、メモリカード22に記録再生
回路20によって記録される。
【００２５】再生時には、メモリカード11の圧縮データ
が記録再生回路20によって読み出され、圧縮回路７によ
ってブロック単位の画像データに逆変換される。この画
像データがブロックバッファ19に蓄積され、さらに蓄積
されたブロック単位の画像データがラインメモリ14に書
き込まれ、ラインメモリ制御回路16の制御によりラスタ
信号の画像データに変換される。ラスタ信号に変換され
た画像データは、エンコーダ21によってコンポジットビ
デオ信号に変換され、さらにＤ／Ａ変換器22によりアナ
ログビデオ信号に変換される。このアナログビデオ信号
によりモニタＴＶ23で画像再生がなされる。
が記録再生回路20によって読み出され、圧縮回路７によ
ってブロック単位の画像データに逆変換される。この画
像データがブロックバッファ19に蓄積され、さらに蓄積
されたブロック単位の画像データがラインメモリ14に書
き込まれ、ラインメモリ制御回路16の制御によりラスタ
信号の画像データに変換される。ラスタ信号に変換され
た画像データは、エンコーダ21によってコンポジットビ
デオ信号に変換され、さらにＤ／Ａ変換器22によりアナ
ログビデオ信号に変換される。このアナログビデオ信号
によりモニタＴＶ23で画像再生がなされる。
【００２６】図３は、上記実施例の制御動作を示すタイ
ムチャートであり、図３(a)はＣＣＤクロックの動作、
図３(b)は図１に示すメモリ５へのＲＥＡＤ／ＷＲＩＴ
Ｅ動作、図３(c)はメモリ５におけるブロック単位のア
ドレス、図３(d)はデータバスを通るデータ、図３(e)は
高速ページモードを利用した場合のアドレスを示す。
ムチャートであり、図３(a)はＣＣＤクロックの動作、
図３(b)は図１に示すメモリ５へのＲＥＡＤ／ＷＲＩＴ
Ｅ動作、図３(c)はメモリ５におけるブロック単位のア
ドレス、図３(d)はデータバスを通るデータ、図３(e)は
高速ページモードを利用した場合のアドレスを示す。
【００２７】図３に示すように、ＣＣＤクロックの動作
(図３(a))に応じてラインメモリ14に信号のＲＥＡＤ／
ＷＲＩＴＥ(Ｒe／Ｗ)が行われる(図３(b))。その際、ラ
インメモリ14に対してアドレスコントローラ６によりブ
ロック単位のアドレスにブロックデータＢの読み出し
と、ラスタデータＲaの書き込みが行われる(図３(c))。
つまり、データバス上にはブロックデータＢとラスタデ
ータＲaとが交互に入れ替わる。また、フレームメモリ1
3に対して高速ページモードを使用する場合、そのアド
レスに対し行アドレスであるrowアドレスＲoを設定し、
列アドレスであるcolumnアドレスＣをブロックの水平個
数であるｎ回、例えば８回設定することにより、ＣＣＤ
信号のラスタデータＲaからブロックデータＢに変換さ
れる。また、再生の場合もブロックデータＢからラスタ
データＲaに変換できる。
(図３(a))に応じてラインメモリ14に信号のＲＥＡＤ／
ＷＲＩＴＥ(Ｒe／Ｗ)が行われる(図３(b))。その際、ラ
インメモリ14に対してアドレスコントローラ６によりブ
ロック単位のアドレスにブロックデータＢの読み出し
と、ラスタデータＲaの書き込みが行われる(図３(c))。
つまり、データバス上にはブロックデータＢとラスタデ
ータＲaとが交互に入れ替わる。また、フレームメモリ1
3に対して高速ページモードを使用する場合、そのアド
レスに対し行アドレスであるrowアドレスＲoを設定し、
列アドレスであるcolumnアドレスＣをブロックの水平個
数であるｎ回、例えば８回設定することにより、ＣＣＤ
信号のラスタデータＲaからブロックデータＢに変換さ
れる。また、再生の場合もブロックデータＢからラスタ
データＲaに変換できる。
【００２８】さらに、８ラインのラインメモリ14の場
合、フレームメモリ13として512(column)×1024(row)×
８(bit)の４MbitのＤＲＡＭを、輝度信号用と色差信号
用に２個使うとすると、フレームメモリ13中の768×８
×16bit(約100ｋビット)の部分を使ってラインメモリ14
として使うことができる。
合、フレームメモリ13として512(column)×1024(row)×
８(bit)の４MbitのＤＲＡＭを、輝度信号用と色差信号
用に２個使うとすると、フレームメモリ13中の768×８
×16bit(約100ｋビット)の部分を使ってラインメモリ14
として使うことができる。
【００２９】図４は、本発明の第２実施例を示すブロッ
ク図であり、24は加減算器を示し、この加減算器24はフ
レームメモリ13の画像データとデータバスからの画像デ
ータとの差分データ、または差分データとフレームメモ
リ13の画像データとの加算データを出力するものであ
る。25は加減算器24のフレームメモリ13からの画像デー
タの入力をＯＮ−ＯＦＦするスイッチを示す。
ク図であり、24は加減算器を示し、この加減算器24はフ
レームメモリ13の画像データとデータバスからの画像デ
ータとの差分データ、または差分データとフレームメモ
リ13の画像データとの加算データを出力するものであ
る。25は加減算器24のフレームメモリ13からの画像デー
タの入力をＯＮ−ＯＦＦするスイッチを示す。
【００３０】動画像の圧縮においては、画像データの圧
縮率を上げるために、画像の空間的な相関だけではな
く、時間軸方向の相関を利用する方式もある。しかし、
時間軸での相関を利用するためには、画像の１フレーム
前の画像を用意する必要がある。ここで第２実施例で
は、１フレーム前の画像を得るために静止画像の圧縮用
に使用したフレームメモリ13を活用するというものであ
る。
縮率を上げるために、画像の空間的な相関だけではな
く、時間軸方向の相関を利用する方式もある。しかし、
時間軸での相関を利用するためには、画像の１フレーム
前の画像を用意する必要がある。ここで第２実施例で
は、１フレーム前の画像を得るために静止画像の圧縮用
に使用したフレームメモリ13を活用するというものであ
る。
【００３１】図４において、まずデータ切換回路17によ
り、デジタル信号処理回路６の出力である画像データ
が、ラインメモリ14のデータラインからフレームメモリ
13のデータライン方向に切り換えられる。ここで、フレ
ームメモリ制御回路15の制御により、フレームメモリ13
がリードモディファイライトのモードで使用され、１フ
レーム遅延データとして使用される。このフレームメモ
リ13からの出力である１フレーム遅延した画像データ
と、現フレームの画像データとの差分データが加減算器
24により求められる。そして、ラスタ信号であるこの差
分データが、ラインメモリ制御回路16の制御により、ラ
インメモリ14に書き込まれることで、ブロック信号に変
換される。このブロック信号がＡＤＣＴ変換回路である
圧縮回路７により圧縮されてメモリカード11に記憶され
る。
り、デジタル信号処理回路６の出力である画像データ
が、ラインメモリ14のデータラインからフレームメモリ
13のデータライン方向に切り換えられる。ここで、フレ
ームメモリ制御回路15の制御により、フレームメモリ13
がリードモディファイライトのモードで使用され、１フ
レーム遅延データとして使用される。このフレームメモ
リ13からの出力である１フレーム遅延した画像データ
と、現フレームの画像データとの差分データが加減算器
24により求められる。そして、ラスタ信号であるこの差
分データが、ラインメモリ制御回路16の制御により、ラ
インメモリ14に書き込まれることで、ブロック信号に変
換される。このブロック信号がＡＤＣＴ変換回路である
圧縮回路７により圧縮されてメモリカード11に記憶され
る。
【００３２】圧縮された画像データは、数フレームに１
つの割合でフレーム間の差分でない生のフレーム画像の
圧縮データを送ることで、差分データの誤差累積を防ぐ
必要がある。そのため、スイッチ25を数フレームに１回
の割合で開くように制御することにより、数フレームに
１回きり元々の画像データがラインメモリ14にそのまま
送られる。
つの割合でフレーム間の差分でない生のフレーム画像の
圧縮データを送ることで、差分データの誤差累積を防ぐ
必要がある。そのため、スイッチ25を数フレームに１回
の割合で開くように制御することにより、数フレームに
１回きり元々の画像データがラインメモリ14にそのまま
送られる。
【００３３】再生時は、フレーム間の圧縮された差分デ
ータが圧縮回路７によりブロック単位の差分データに逆
変換され、さらにこの差分データがラインメモリ14に書
き込まれ、ラインメモリ制御回路16によりラスタ信号に
変換される。さらに、このラスタ信号にフレームメモリ
13から読み出された画像データが加減算器24により加算
が行われ、再生画像データとして出力される。この再生
画像データを基にモニタＴＶ23等で画像が再現される。
また、この再生画像は、フレームメモリ13に再度書き込
まれ、次のフレームの差分データを再現する画像として
フレームメモリ13に記憶される。
ータが圧縮回路７によりブロック単位の差分データに逆
変換され、さらにこの差分データがラインメモリ14に書
き込まれ、ラインメモリ制御回路16によりラスタ信号に
変換される。さらに、このラスタ信号にフレームメモリ
13から読み出された画像データが加減算器24により加算
が行われ、再生画像データとして出力される。この再生
画像データを基にモニタＴＶ23等で画像が再現される。
また、この再生画像は、フレームメモリ13に再度書き込
まれ、次のフレームの差分データを再現する画像として
フレームメモリ13に記憶される。
【００３４】図５は上記代２実施例の動作を示すタイム
チャートであり、図５(a)はＣＣＤクロック、図５(b)は
データバスに現れるデータ、図５(c)はフレームメモリ1
3の読出データ、図５(d)はフレームメモリ13よりデータ
を読み出すタイミング、図５(e)はラインメモリ14の読
出しデータ、図５(f)はラインメモリ14よりデータを読
み出すタイミング、図５(g)はフレームメモリ13への書
込みデータ、図５(h)はフレームメモリ13のデータを書
き込むタイミング、図５(i)はラインメモリ14の書き込
みデータ、図５(j)はラインメモリ14にデータを書き込
むタイミングを示す。
チャートであり、図５(a)はＣＣＤクロック、図５(b)は
データバスに現れるデータ、図５(c)はフレームメモリ1
3の読出データ、図５(d)はフレームメモリ13よりデータ
を読み出すタイミング、図５(e)はラインメモリ14の読
出しデータ、図５(f)はラインメモリ14よりデータを読
み出すタイミング、図５(g)はフレームメモリ13への書
込みデータ、図５(h)はフレームメモリ13のデータを書
き込むタイミング、図５(i)はラインメモリ14の書き込
みデータ、図５(j)はラインメモリ14にデータを書き込
むタイミングを示す。
【００３５】図５に示すように、フレームメモリ13より
データが読み出されてからラインメモリ14よりデータが
読み出される。さらにフレームメモリ13における先のデ
ータが読み出されたアドレスに、新たに画像データが書
き込まれ、ラインメモリ14にも新たに画像データが書き
込まれる。
データが読み出されてからラインメモリ14よりデータが
読み出される。さらにフレームメモリ13における先のデ
ータが読み出されたアドレスに、新たに画像データが書
き込まれ、ラインメモリ14にも新たに画像データが書き
込まれる。
【００３６】すなわち、データバスには図５(b)に示す
ようにフレームメモリ13およびラインメモリ14より読み
出されたデータと、フレームメモリ13およびラインメモ
リ14に書き込むデータとが交互に存在する。
ようにフレームメモリ13およびラインメモリ14より読み
出されたデータと、フレームメモリ13およびラインメモ
リ14に書き込むデータとが交互に存在する。
【００３７】次に、上記実施例の構成を採ることによる
作用効果を説明する。
作用効果を説明する。
【００３８】上述した第１，第２実施例においては、フ
レームメモリ13とラインメモリ14を両方持っているの
で、静止画像の画像記録も動画像の画像記録も両方とも
可能である。また、動画像の画像記録においても、静止
画像の画像記録と同じ画像圧縮の圧縮回路７を使用する
ため、メモリーカード１枚に記録できる画像の数が多く
なる。
レームメモリ13とラインメモリ14を両方持っているの
で、静止画像の画像記録も動画像の画像記録も両方とも
可能である。また、動画像の画像記録においても、静止
画像の画像記録と同じ画像圧縮の圧縮回路７を使用する
ため、メモリーカード１枚に記録できる画像の数が多く
なる。
【００３９】特に、第１実施例においては、まず、静止
画像撮影において、ＣＣＤ２からの映像信号をデジタル
化したデジタル信号がフレームメモリ13に記憶され、こ
のフレームメモリ13からデータを読み出して、デジタル
信号処理回路６により、画像データに変換させるため、
デジタル信号処理回路６においては、比較的ゆっくり演
算処理ができる。したがって演算処理のクロックに低周
波数のものが使用できるので、消費電流が少なくてす
む。また、ＣＣＤ２が画素混合型の場合、ＣＣＤ２から
画素混合しないモードで映像信号を読み出してフレーム
メモリ13に記録し、デジタル信号処理回路６で処理する
ことにより、動画像撮影による画質よりも高画質の画質
を得ることができる。
画像撮影において、ＣＣＤ２からの映像信号をデジタル
化したデジタル信号がフレームメモリ13に記憶され、こ
のフレームメモリ13からデータを読み出して、デジタル
信号処理回路６により、画像データに変換させるため、
デジタル信号処理回路６においては、比較的ゆっくり演
算処理ができる。したがって演算処理のクロックに低周
波数のものが使用できるので、消費電流が少なくてす
む。また、ＣＣＤ２が画素混合型の場合、ＣＣＤ２から
画素混合しないモードで映像信号を読み出してフレーム
メモリ13に記録し、デジタル信号処理回路６で処理する
ことにより、動画像撮影による画質よりも高画質の画質
を得ることができる。
【００４０】また、フレームメモリ13とラインメモリ14
とをそれぞれ設けてもよいが、第１実施例で述べたよう
に、フレームメモリ13の一部のメモリをラインメモリ14
として使用してもよいので、その分カメラ本体の小型化
が図れる。
とをそれぞれ設けてもよいが、第１実施例で述べたよう
に、フレームメモリ13の一部のメモリをラインメモリ14
として使用してもよいので、その分カメラ本体の小型化
が図れる。
【００４１】第２実施例においては、静止画像記録のた
めのフレームメモリ13を、動画像のフレーム間における
差分データをとるための１フレーム遅延線として使用す
ることにより、動画像の画像圧縮率を上げることができ
る。したがって、メモリカード11であっても、より多い
枚数の動画像を記録することができる。
めのフレームメモリ13を、動画像のフレーム間における
差分データをとるための１フレーム遅延線として使用す
ることにより、動画像の画像圧縮率を上げることができ
る。したがって、メモリカード11であっても、より多い
枚数の動画像を記録することができる。
【００４２】
【発明の効果】本発明は、上記した通り構成するので、
次に記載する効果を奏する。
次に記載する効果を奏する。
【００４３】請求項１のデジタル電子カメラ装置におい
ては、静止画像撮影による画像信号も動画像撮影による
画像信号も共にブロック型の信号に変換し、同じ圧縮回
路でデータ圧縮するため、静止画像撮影も動画像撮影も
両方可能で、かつ記録媒体に、より多くの画像を記憶さ
せることが可能となる。
ては、静止画像撮影による画像信号も動画像撮影による
画像信号も共にブロック型の信号に変換し、同じ圧縮回
路でデータ圧縮するため、静止画像撮影も動画像撮影も
両方可能で、かつ記録媒体に、より多くの画像を記憶さ
せることが可能となる。
【００４４】請求項２のデジタル電子カメラ装置におい
ては、動画像圧縮のためのラインメモリをフレームメモ
リの一部のメモリで代用するため、画像圧縮に必要なメ
モリが１つだけでよい。したがって、装置の小型化が図
れる。
ては、動画像圧縮のためのラインメモリをフレームメモ
リの一部のメモリで代用するため、画像圧縮に必要なメ
モリが１つだけでよい。したがって、装置の小型化が図
れる。
【００４５】請求項３のデジタル電子カメラ装置におい
ては、静止画像記録のためのフレームメモリを、動画像
のフレーム間の差分信号をとるための１フレーム遅延線
として使うことにより、動画像の画像圧縮率を上げるこ
とができるため、同じ記録媒体であってもより長い時間
の動画像を記録することができる。
ては、静止画像記録のためのフレームメモリを、動画像
のフレーム間の差分信号をとるための１フレーム遅延線
として使うことにより、動画像の画像圧縮率を上げるこ
とができるため、同じ記録媒体であってもより長い時間
の動画像を記録することができる。
【図１】本発明のデジタル電子カメラ装置の基本構成を
示すブロック図である。
示すブロック図である。
【図２】本発明の第１実施例の構成を示すブロック図で
ある。
ある。
【図３】図２の構成におけるデータ制御を示すタイムチ
ャートである。
ャートである。
【図４】本発明の第２実施例の要部構成を示すブロック
図である。
図である。
【図５】図４の構成におけるデータ制御を示すタイムチ
ャートである。
ャートである。
２…ＣＣＤ、 ５…メモリ、 ６…デジタル信号処理回
路、 ７…圧縮回路、８…同期信号発生回路、 ９…ア
ドレスコントローラ、 11…メモリカード、12…デジタ
ル電子カメラ、 13…フレームメモリ、 14…ラインメ
モリ、 15…フレームメモリ制御回路、 16…ラインメ
モリ制御回路、 17…データ切換回路、 18…アドレス
切換回路、 19…ブロックバッファ、 24…加減算器、
25…スイッチ。
路、 ７…圧縮回路、８…同期信号発生回路、 ９…ア
ドレスコントローラ、 11…メモリカード、12…デジタ
ル電子カメラ、 13…フレームメモリ、 14…ラインメ
モリ、 15…フレームメモリ制御回路、 16…ラインメ
モリ制御回路、 17…データ切換回路、 18…アドレス
切換回路、 19…ブロックバッファ、 24…加減算器、
25…スイッチ。
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 9/79 Ｇ 7916−5Ｃ
Claims (3)
- 【請求項１】 光学的に結像した画像を受けて電気信号
に変換して画像信号を出力する撮像素子と、この撮像素
子からの電気信号をデジタル信号に変換するアナログ／
デジタル変換器と、このアナログ／デジタル変換器から
のデジタル信号を記録媒体に記憶する記憶手段とを備え
たデジタル電子カメラ装置において、 前記デジタル信号を輝度信号と色差信号に変換するデジ
タル信号処理回路と、 前記輝度信号と色差信号または前記撮像素子の出力であ
る１フレーム分の前記アナログ／デジタル変換器からの
デジタル信号を記憶するフレームメモリと、 ｎライン分の輝度信号と色差信号を記憶するラインメモ
リと、 前記フレームメモリのアドレスを制御するフレームメモ
リ制御回路と、 前記ラインメモリのアドレスを制御するラインメモリ制
御回路と、 前記フレームメモリ制御回路と前記ラインメモリ制御回
路とを切り換えるアドレス切換回路と、 このアドレス切換回路の切り換えにより送出されるアド
レス制御された前記ラインメモリの輝度信号と色差信号
または前記フレームメモリのデジタル信号をデジタル信
号処理回路に入力して変換した輝度信号と色差信号をｎ
×ｎのブロックとして一時記憶するブロックバッファ
と、 このブロックバッファの画像データを圧縮し、前記記憶
媒体に記録するための圧縮データに変換する圧縮回路と
を備えたことを特徴とするデジタル電子カメラ装置。 - 【請求項２】 フレームメモリの一部を、ｎライン分の
ラインメモリとして使用することを特徴とする請求項１
記載のデジタル電子カメラ装置。 - 【請求項３】 フレームメモリを１フレーム遅延用とし
て用い、フレーム間の画像データの差分をとるための加
減算器を設け、出力されるフレーム間の差分信号を圧縮
回路で圧縮することを特徴とするデジタル電子カメラ装
置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03678293A JP3438205B2 (ja) | 1993-02-25 | 1993-02-25 | デジタル電子カメラ装置 |
| US08/202,235 US5444483A (en) | 1993-02-25 | 1994-02-25 | Digital electronic camera apparatus for recording still video images and motion video images |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03678293A JP3438205B2 (ja) | 1993-02-25 | 1993-02-25 | デジタル電子カメラ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06253251A true JPH06253251A (ja) | 1994-09-09 |
| JP3438205B2 JP3438205B2 (ja) | 2003-08-18 |
Family
ID=12479351
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03678293A Expired - Fee Related JP3438205B2 (ja) | 1993-02-25 | 1993-02-25 | デジタル電子カメラ装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5444483A (ja) |
| JP (1) | JP3438205B2 (ja) |
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| US7995897B2 (en) | 1999-05-07 | 2011-08-09 | Hitachi, Ltd. | Video recording and reproducing method, and video reproducing apparatus and method |
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1993
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- 1994-02-25 US US08/202,235 patent/US5444483A/en not_active Expired - Lifetime
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| US5444483A (en) | 1995-08-22 |
| JP3438205B2 (ja) | 2003-08-18 |
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