JPH06236325A - データ記憶装置 - Google Patents

データ記憶装置

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JPH06236325A
JPH06236325A JP2015593A JP2015593A JPH06236325A JP H06236325 A JPH06236325 A JP H06236325A JP 2015593 A JP2015593 A JP 2015593A JP 2015593 A JP2015593 A JP 2015593A JP H06236325 A JPH06236325 A JP H06236325A
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JP
Japan
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JP2015593A
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Jiyunya Amashiro
順也 天白
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SANSEI DENSHI JAPAN KK
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    • G11C16/06—Auxiliary circuits, e.g. for writing into memory
    • G11C16/22—Safety or protection circuits preventing unauthorised or accidental access to memory cells

Abstract

(57)【要約】 【目的】 記憶された情報を確実に保護することのでき
るデータ記憶装置を提供することを目的とする。 【構成】 外部の装置２００からのアクセスに応じて記
憶したデータを読み出すデータ記憶装置において、パス
ワード情報を書き込むためのパスワード記憶領域１０
と、前記外部の装置から送られてきたパスワードと前記
パスワード記憶領域から読み出したパスワードとを比較
する比較回路１２とを有し、比較が一致したときに、指
定されたデータを前記外部の装置が読み取ることを許可
する。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は、データ記憶装置に関
し、特に、データ記憶装置に記憶されたデータの機密保
護の改良に関する。
【０００２】
【従来の技術】記憶媒体に記憶された情報データには色
々な保護が行なわれている。代表的な保護の手法は、ハ
ード的な又はソフト的なライトプロテクション(Write P
rotection)である。ハード的なライトプロテクションは
書き込み保護の爪であり、ソフト的なライトプロテクシ
ョンとは、記録媒体のファイル毎に、アクセスを許すか
否か（更に、データの変更を許すか否か）の情報をデイ
レクトリに加えると言うものである。
【０００３】
【発明が解決しようとする課題】しかし上述のライトプ
ロテクションは、あくまでも注意若しくは警告程度の機
能しか有さず、任意の（第三者による）データの読み出
しに対してライトプロテクション機能は働かない。プロ
グラミング言語では、データファイルにオーナ指定がで
き、パスワードを知らない本人以外は読み出せなくする
モードがあるが、この機能もスーパーユーザ等の特権パ
スワードを有するものに読み出されてしまうという問題
がある。
【０００４】本発明は、前記従来の欠点を除去するため
に提案されたもので、記憶された情報を確実に保護する
ことのできるデータ記憶装置を提供することを目的とす
る。
【０００５】
【課題を解決するための手段】この課題を解決するた
め、本発明のデータ記憶装置は、外部の装置からのアク
セスに応じて記憶したデータを読み出すデータ記憶装置
において、記憶媒体上に設けられ、パスワード情報を書
き込むためのパスワード記憶領域と、前記外部の装置か
ら送られてきたパスワードと前記パスワード記憶領域か
ら読み出したパスワードとを比較する比較手段とを有
し、前記比較手段による比較が一致したときに、アクセ
ス対象の記憶されたデータを前記外部の装置がアクセス
することを許可する手段とを備えることを特徴とする。
【０００６】
【実施例】以下、添付図面を参照しながら本発明の好適
な実施例を説明する。この実施例では、記憶媒体とし
て、通常のファイルデータと更にまたパスワードデータ
をも記憶するフラッシュＥＥＰＲＯＭを使用する。そこ
で、この実施例では、とくに断らないかぎりは、フラッ
シュＥＥＰＲＯＭを簡単に「メモリ」と称する。
【０００７】図１は、本実施例のデータ記憶装置１００
の構成図である。記憶装置１００はデータ及びパスワー
ドを記憶するためのメモリ１０を有する。２００は、記
憶装置１００と交信することにより、記憶装置１００の
メモリ１０上のデータ及びパスワードをアクセスする例
えばパソコン等のホストコンピュータである。データ記
憶装置１００は、メモリ１０と、このメモリ１０へのデ
ータの読み出し／書き込みを制御する制御回路１１と、
アドレスを発生するアドレス発生器１３とを有する。メ
モリ１０は、図示するように、パスワードの記憶番地を
記憶する領域（パスワードテーブル１５）と、通常のデ
ータ（ファイルデータ）を記憶する領域１６とを有す
る。アドレス発生器１３は、パスワードテーブル１５か
ら読み取ったアドレスからメモリ１０上の実際のパスワ
ード格納アドレスを発生する。発生器１３が発生したア
ドレスに従って、制御回路１１はメモリ１０の領域１６
からパスワードデータを読み出す。また更に、記憶装置
１００は、制御回路１１が読み出したパスワードとホス
ト２００から送られてきたパスワードとを比較し、比較
で一致が取れれば、ホスト２００に対してアクセスが許
される意味の信号ＯＫを送る。
【０００８】図２は、ホスト２００と記憶装置１００と
の間での、データの読み出し書き込みに関するインタフ
ェース信号を示す。ホスト２００からは、読み出しを要
求する信号ＲＤ／（／は反転信号を表す）又は書き込み
を要求する信号ＷＴ／が送られてくる。これらの要求診
号は、前述の信号ＯＫが真の時にのみ、読み出し若しく
は書き込みを許可する信号ＲＤＸ，ＷＤＸとなる。一
方、信号ＯＫはホスト２００にも送られる。即ち、ホス
ト２００はアクセスが許可されたか否かを、信号ＯＫを
モニタすることにより分かる。また、ディスク装置１０
０側では、信号信号ＲＤＸ，ＷＴＸが真にならないかぎ
り、実際の読み出し、書き込みは禁止される。
【０００９】図３は、パスワードテーブル１５に記憶さ
れたパスワードアドレスと、メモリ１０上のアドレスと
の関係を示す。周知のように、フラッシュメモリ１０
は、複数のブロック単位でアクセスが可能である。そこ
で、この実施例では、ブロック毎にパスワードを１つず
つ記憶する。本実施例では、５個（拡張は可能である）
までのパスワードの記憶を許す。従って、パスワードテ
ーブル１５は５つのエントリを有する。図３の例では、
＃１〜＃５までのエントリが設定されている。各エント
リの番地は固定である。各エントリの最初のフィールド
は、そのパスワードが使用されているか否かを示すビッ
トである。そのビットが１であれば、そのパスワードは
使われており、０であれば使用されていないことを示
す。使用／不使用を示すビットの次のフィールドは、そ
のパスワードが記憶されているメモリ１０上のアドレス
である。使用／不使用フィールドが１であるエントリか
ら読みだされたアドレスデータはアドレス発生器１３に
渡されて、この発生器がパスワードを実際に記憶してい
る絶対番地を発生して、制御回路１１がそのパスワード
データを読みだす。
【００１０】ところで、フラッシュＥＥＰＲＯＭは耐久
性の点で問題がある。そこで、記憶装置１００の不図示
のエラーチェック回路がメモリ１０からの読み出しパス
ワードアドレスデータにエラーを検出したときには、対
応するパスワードテーブル１５のエントリ上に例えば
“ＦＦＦＦ”を書き込んでおく。もし、メモリ１０から
読みだされたデータが“ＦＦＦＦ”ならば、そのパスワ
ードは信頼が置けないことを意味する。また、当該エラ
ーの発生したメモリ１０上のアドレスにも“ＦＦＦＦ”
を書き込んでおく。
【００１１】図３に示すように、本実施例では、パスワ
ードは５つまで設定できる。５つとしたのは、読み出さ
れた５つのパスワードに不一致が合った場合に、多数決
方式によって決定するためである。図４は比較回路１２
と制御回路１４との関係を示す。比較回路は、デジタル
コンパレータ４１と、インバータ４２と、アップダウン
カウンタ４３とを有する。カウンタ４３は、ホスト２０
０から送られてきたパスワードとメモリ１０から読み出
したパスワード（ＲＤデータ）との比較結果において、
一致の回数と不一致の回数を相補的にカウントするもの
である。
【００１２】計数に先立ち、ホスト２００から新たなパ
スワードが送られてきたならば、制御回路１４はカウン
タ４３に対してクリア信号ＣＬＲを送ってカウンタ４３
をクリアする。コンパレータ４１は、ホスト２００から
送られてきたパスワードとメモリ１０から読み出したパ
スワード（ＲＤデータ）とを比較する。一致信号は、カ
ウンタ４３のアップカウント端子（ＵＰ）に入力され
る。一致信号はインバータ４２により反転されて、不一
致信号としてダウンカウント端子（ＤＮ）に入力され
る。
【００１３】記憶された全てのパスワードについて検索
されたかいなかは、制御回路１４が使用／不使用フィー
ルドが１であるか０であるかを見て判断する。全てのパ
スワードについて検索されたならば、制御回路１４はカ
ウンタ４３の端子（ＯＥ）に対して、その出力を付勢す
る信号であるところの「終了」信号を送る。この信号が
真になると、カウンタ４３の出力端子（ＯＵＴ）から信
号ＯＫが有効となる。
【００１４】図３の例で、５つのパスワードが全て使用
されていた場合において、ホストから送られてきたパス
ワードと、記憶されていたパスワードデータとが、３つ
について一致し、２つについては不一致であったときに
は、カウンタ４３は信号ＯＫを出力する。本発明はその
趣旨を逸脱しない範囲で種々変形が可能である。
【００１５】例えば、前記実施例では、メモリ媒体にフ
ラッシュメモリとしたが、本発明はそれ記憶媒体（例え
ば、ディスク装置等）にデータを記憶する装置にも適用
可能である。また、上記実施例では、パスワードを記憶
する記憶媒体（領域１６）とパスワードアドレスを記憶
する領域（パスワードテーブル１５）とを同じものとし
ていた。しかし、本発明は、それらの記憶媒体が異なっ
ている装置に対しても適用可能である。
【００１６】また、前記実施例では、パスワードデータ
をフラッシュメモリのブロック毎に設定していたが、全
てのパスワードデータ領域を１つのブロックに設定して
もよい。また、上記実施例では、パスワードテーブルの
開始番地は固定であるとした。これは、パスワードテー
ブルの開始番地をホスト側からアクセス不能にするため
である。しかし本発明は、このパスワードテーブルの開
始番地をホスト側のディレクトリ上にもたせてもよい。
【００１７】
【発明の効果】以上説明したように本発明は、パスワー
ド情報を書き込むためのパスワード記憶領域を備え、前
記外部の装置から送られてきたパスワードと前記パスワ
ード記憶領域から読み出したパスワードとを比較し、比
較が一致したときに、アクセス対象の記憶されたデータ
を外部の装置がアクセスすることを許可するようにした
ことにより、記憶された情報を確実に保護することので
きるデータ記憶装置を提供することができる。
【図面の簡単な説明】
【図１】本実施例のデータ記憶装置１００の基本的回路
構成を示す図である。
【図２】データ記憶装置１００とホスト２００との間の
インタフェースを説明する図である。
【図３】記憶装置１００におけるパスワードの記憶体系
を説明する図。
【図４】比較回路の構成を示す図。
【符号の説明】
１０…メモリ（フラッシュＥＥＰＲＯＭ）、１１…Ｒ／
Ｗ制御回路、１２…比較回路、１３…アドレス発生器、
１４…Ｒ／Ｗ制御回路、１５…パスワードテーブル、１
６…ファイルデータ領域、４０，４１…コンパレータ、
４３…ＵＰダウンカウンタ、１００…データ記憶装置、
２００…ホストコンピュータ

Claims (3)

    【特許請求の範囲】
  1. 【請求項１】 外部の装置からのアクセスに応じて記憶
    したデータを読み出すデータ記憶装置において、 記憶媒体上に設けられ、パスワード情報を書き込むため
    のパスワード記憶領域と、 前記外部の装置から送られてきたパスワードと前記パス
    ワード記憶領域から読み出したパスワードとを比較する
    比較手段とを有し、 前記比較手段による比較が一致したときに、アクセス対
    象の記憶されたデータを前記外部の装置がアクセスする
    ことを許可する手段とを備えることを特徴とするデータ
    記憶装置。
  2. 【請求項２】 請求項１のデータ記憶装置において、前
    記パスワード記憶領域は前記記憶媒体上の異なる部分に
    夫々設けられ、前記比較手段は、前記複数の記憶領域か
    ら読み出した複数のパスワードのなかでもっとも多く一
    致するデータ内容と前記外部の装置から送られてきたパ
    スワードとを比較することを特徴とするデータ記憶装
    置。
  3. 【請求項３】 請求項２のデータ記憶装置において、前
    記記憶媒体は、 フラッシュＥＥＰＲＯＭで構成されるとともに、 個々のパスワードを記憶するこの記憶媒体上の番地を表
    すポインタデータを記憶するポインタ記憶領域と、前記
    ポインタデータとリンクされ、実際のパスワードデータ
    を記憶する領域とを有することを特徴とするデータ記憶
    装置。
JP2015593A 1993-02-08 1993-02-08 データ記憶装置 Pending JPH06236325A (ja)

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