JPH0621175A - 半導体装置用テストチップ - Google Patents

半導体装置用テストチップ

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JPH0621175A
JPH0621175A JP17804792A JP17804792A JPH0621175A JP H0621175 A JPH0621175 A JP H0621175A JP 17804792 A JP17804792 A JP 17804792A JP 17804792 A JP17804792 A JP 17804792A JP H0621175 A JPH0621175 A JP H0621175A
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JP
Japan
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bonding pad
bonding
voltage
conductive wiring
wire
Prior art date
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Pending
Application number
JP17804792A
Other languages
English (en)
Inventor
Eigo Shirakashi
衛吾 白樫
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Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Filing date
Publication date
Application filed by Matsushita Electronics Corp filed Critical Matsushita Electronics Corp
Priority to JP17804792A priority Critical patent/JPH0621175A/ja
Publication of JPH0621175A publication Critical patent/JPH0621175A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484Connecting portions
    • H01L2224/48463Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
    • H01L2224/48465Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch

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  • Testing Of Individual Semiconductor Devices (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)

Abstract

(57)【要約】 【目的】 ワイヤーボンディング後のボンディングパッ
ドからのネールヘッドのずれの有無、ウエハーのスクラ
イブ時、半導体チップのダイパットへの接着時等の衝撃
による半導体チップの周囲のクラックを電気的に検査で
きるようにする。 【構成】 ボンディングパッド16は、ワイヤーボンド
ずれがあるかどうかを電気的に検査する際に電圧を印加
する部分である。電圧は、組立、リード加工後のDC検
査時に印加される。導電性配線15は、一般に実施され
ている技術を用いて、ボンディングパッド12の各々の
少なくとも一つ以上の周囲を囲むように形成されてい
る。ボンディングパッド16のうち電圧を印加するそれ
は、他のボンディングパッド16周囲を囲む配線と導通
させてある。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体装置の組立製造
に於ける品質管理に用いられる半導体装置用テストチッ
プに関するものである。
【0002】
【従来の技術】従来、半導体装置は、図3に示すよう
に、ボンディングパッド2とリードフレームのインナー
リード3とがボンディングワイヤー5で接続されてい
る。半導体装置内では、半導体チップ1上に設けられた
ボンディングパッド2に、直径30μm前後の金あるい
はアルミニウムのワイヤーの一端を熱圧着あるいは超音
波熱圧着する。この後、ワイヤーにループを描かせてイ
ンナーリード3に他端を熱圧着あるいは超音波熱圧着し
て接続されている。
【0003】
【発明が解決しようとする課題】このような構造におい
ては、ワイヤーボンディングの際、ワイヤーボンディン
グ装置の認識不良、ボンディング精度不良等によって、
ボンディングパッド2からワイヤーのネールヘッド6が
ずれ、ボンディング位置が大きくずれると、ネールヘッ
ド6とボンディングパッド2の接合面が小さくなり、接
合が不安定となる。このため樹脂封止の際、外的衝撃に
よりワイヤーの接合がはずれる危険性がある。さらに、
ネールヘッド6がずれ、やはりボンディング位置がずれ
て保護膜7に衝撃を与えた場合、保護膜7にクラック8
が発生し、半導体チップ1の耐湿性の劣化を起こすおそ
れがある。また、ウエハーから半導体チップに分割する
際のスクライブ時やブレイク時、あるいはその他の組立
工程で生じる衝撃によって半導体チップ1周囲にクラッ
ク8が発生すると、半導体チップ1周縁部の配線が断線
したり、クラック8による耐湿性不良を保護膜7で生じ
るおそれがある。このため、工程毎に顕微鏡による検査
をし、外観検査装置による検査を実施して、不良となる
半導体チップを抜き取っていた。
【0004】
【課題を解決するための手段】上記の問題を解決するた
めに、本発明の半導体装置用テストチップは、半導体ウ
エハー上に形成された半導体素子と、前記半導体素子の
周辺に形成された複数のボンディングパッドと、前記ボ
ンディングパッドの各々の周囲を囲むように形成した導
電性配線を備え、前記導電性配線を少なくとも一つの前
記ボンディングパッドに導通させている。
【0005】また、半導体ウエハー上に形成された半導
体素子と、前記半導体素子の周辺に形成された複数のボ
ンディングパッドと、前記半導体素子の周囲の少なくと
も一辺に形成された導電性配線と、前記導電性配線の一
端を前記ボンディングパッドのうち少なくとも一つ以上
に導通させ、他端を前記一端と接続させたボンディング
パッド以外の少なくとも一つ以上のボンディングパッド
に導通させている。
【0006】
【作用】上記本発明の構成により、導電性配線を形成す
ることにより、ワイヤーボンディング時のネールヘッド
がボンディングパッドからずれた場合には、導電性配線
とネールヘッドが短絡する。これを組立、リード加工終
了後のDC検査で検出することによって接合面が不安定
な不良品が生じても容易に抜き取ることができる。
【0007】また、導電性配線を形成することにより、
ウエハースクライブ、チップマウントへの半導体チップ
の接着時に、半導体チップにクラックが発生した場合に
は、導電性配線が断線する。これを組立、リード加工終
了後のDC検査で検出することによって容易に不良品を
抜き取ることができる。
【0008】
【実施例】図1に本発明の第1の実施例の半導体装置の
斜視図を示す。11は半導体チップ、12はボンディン
グパッド、13はインナーリード、14はダイパット、
15は導電性の配線、16は電圧を印加するためのボン
ディングパッド、17はボンディングワイヤー、18は
ネールヘッドである。
【0009】ボンディングパッド16は、ワイヤーボン
ドずれがあるかどうかを電気的に検査する際に電圧を印
加する部分である。電圧は、組立、リード加工後のDC
検査時に印加される。導電性配線15はリソグラフィー
技術及び、ドライエッチングやウエットエッチング技術
を用いて、ボンディングパッド12の各々の少なくとも
一つ以上の周囲を囲むように形成されている。ボンディ
ングパッド16の内電圧を印加するそれは、他のボンデ
ィングパッド16周囲を囲む配線と導通させてある。導
電性配線15の材料として本実施例ではアルミニウムと
シリコンと銅の合金を使用している。また、導電性配線
15を形成する位置はボンディングパッド12から30
μm離れた位置に形成してある。導電性配線15の材料
としてポリシリコン、金等の導電性金属、もしくはそれ
らを二種類以上を組み合わせたものを用いる。また、ボ
ンディングパッド16からの導電性配線15の距離は、
ネールヘッド18の大きさ、ボンディングパッド16の
大きさ等に応じて決定する。
【0010】半導体装置にワイヤーボンド、樹脂封止を
行ない、リード加工を施したものについてDC検査を行
なう。この時、電圧を印加するボンディングパッド16
とボンディングワイヤーで結ばれたリードに5Vの電圧
を、その他のリードに0Vの電圧を印加する。
【0011】このような状態で、ワイヤーボンド工程で
ボンディングワイヤー17のネールヘッド18の接合部
がボンディングパッド12からずれ、ボンディングパッ
ド16周囲の導電性配線15に接触したものがある場
合、電圧を印加するボンディングパッド16には電流が
流れる。このため、その電流の有無を測定することで、
ボンドずれの有無が容易に判断できる。
【0012】また、図2に本発明の第2の実施例の半導
体装置の斜視図を示す。11は半導体チップ、12はボ
ンディングパッド、13はインナーリード、14はダイ
パット、15は導電性の配線、17はボンディングワイ
ヤー、18はネールヘッド、19は電圧を印加するボン
ディングパッドA、20は電圧を印加する別のボンディ
ングパッドBである。電圧を印加するボンディングパッ
ドA19とボンディングパッドB20とには、組立、リ
ード加工後のDC検査時に、半導体チップのクラックが
発生しているかどうかを電気的に検査するために用いら
れる。導電性配線15はリソグラフィー技術及び、ドラ
イエッチングやウエットエッチング技術を用いて、半導
体チップ1の周縁部の少なくとも一辺に、もしくは周縁
部を一周するように形成してある。この導電性配線15
の一端は電圧を印加するためのボンディングパッドA1
9に、他端にはボンディングパッドB20に導通されて
いる。導電性配線15の材料として本実施例では、アル
ミニウムとシリコンの合金を使用したが、ポリシリコ
ン、金等の導電性金属、もしくはそれらの二種類以上を
組み合わせたものでもよい。
【0013】半導体チップ1にワイヤーボンド、樹脂封
止を行ない、リード加工を施したものについてDC検査
を行なう際には、ボンディングパッドA19とボンディ
ングワイヤーで結ばれたリードに5Vの電圧、ボンディ
ングパッドB20とボンディングワイヤーで結ばれたリ
ードに0Vの電圧を印加する。ウエハースクライブ、チ
ップ分割、ダイパットへの半導体チップの接着時、ある
いはその他の衝撃によって、半導体チップの周囲にクラ
ックが発生すると、導電性配線5が断線する。このた
め、ボンディングパッドA19とボンディングパッドB
20間には、電流が流れず、チップクラックが発生して
いると判断できる。
【0014】
【発明の効果】上記のように本発明によれば、ボンディ
ングパッド周囲に設けられた導電性配線により、ボンデ
ィングワイヤーのボンディングパッドからのズレがDC
検査で抜き取れるため、検査工程が軽減され不安定な不
良品が良品に混入する事なく、高信頼度の半導体装置の
製造が可能になる。
【0015】また、本発明によれば半導体チップの周囲
の少なくとも一辺に設けられた導電性配線により、半導
体チップ分割時、チップマウントへの半導体チップの接
着時等の半導体チップのクラックをDC検査で抜き取れ
るため、検査工程が軽減され不安定な不良品が良品に混
入する事なく、高信頼度の半導体装置の製造が可能にな
る。
【図面の簡単な説明】
【図1】本発明の一実施例に係る半導体装置の要部図
【図2】本発明の一実施例に係る半導体装置の要部図
【図3】従来の半導体装置の要部図
【符号の説明】
11 半導体チップ 12 ボンディングパッド 13 インナーリード 14 ダイパット 15 導電性配線 16 電圧印加用ボンディングパッド 17 ボンディングワイヤー 18 ネールヘッド

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】半導体ウエハー上に形成された半導体素子
    と、前記半導体素子の周辺に形成された複数のボンディ
    ングパッドと、前記ボンディングパッドの各々の周囲を
    囲むように形成した導電性配線を備え、前記導電性配線
    を少なくとも一つの前記ボンディングパッドに導通させ
    た半導体装置用テストチップ。
  2. 【請求項2】半導体ウエハー上に形成された半導体素子
    と、前記半導体素子の周辺に形成された複数のボンディ
    ングパッドと、前記半導体素子の周囲の少なくとも一辺
    に形成された導電性配線と、前記導電性配線の一端を前
    記ボンディングパッドのうち少なくとも一つ以上に導通
    させ、他端を前記一端と接続させたボンディングパッド
    以外の少なくとも一つ以上のボンディングパッドに導通
    させた半導体装置用テストチップ。
JP17804792A 1992-07-06 1992-07-06 半導体装置用テストチップ Pending JPH0621175A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP17804792A JPH0621175A (ja) 1992-07-06 1992-07-06 半導体装置用テストチップ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP17804792A JPH0621175A (ja) 1992-07-06 1992-07-06 半導体装置用テストチップ

Publications (1)

Publication Number Publication Date
JPH0621175A true JPH0621175A (ja) 1994-01-28

Family

ID=16041671

Family Applications (1)

Application Number Title Priority Date Filing Date
JP17804792A Pending JPH0621175A (ja) 1992-07-06 1992-07-06 半導体装置用テストチップ

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JP (1) JPH0621175A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5736792A (en) * 1995-08-30 1998-04-07 Texas Instruments Incorporated Method of protecting bond wires during molding and handling
KR100326063B1 (ko) * 1998-06-04 2002-03-07 칼 하인쯔 호르닝어 본딩 패드용 테스트 장치

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5736792A (en) * 1995-08-30 1998-04-07 Texas Instruments Incorporated Method of protecting bond wires during molding and handling
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