JPH06202908A - マイクロコンピュータ監視装置 - Google Patents
マイクロコンピュータ監視装置Info
- Publication number
- JPH06202908A JPH06202908A JP4347711A JP34771192A JPH06202908A JP H06202908 A JPH06202908 A JP H06202908A JP 4347711 A JP4347711 A JP 4347711A JP 34771192 A JP34771192 A JP 34771192A JP H06202908 A JPH06202908 A JP H06202908A
- Authority
- JP
- Japan
- Prior art keywords
- microcomputer
- data
- memory
- abnormality determination
- abnormality
- Prior art date
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- Pending
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Abstract
(57)【要約】
【目的】 異常検出用ポートを不要とし、マイクロコン
ピュータの拡張性を低減させることなく、マイクロコン
ピュータ相互の監視を行う。 【構成】 デュアルポートＲＡＭ１０５の一部に異常判
定用メモリ１０５−１を設ける。送り手側のマイクロコ
ンピュータは、異常判定用メモリ１０５−１の記憶デー
タ（異常判定データ）をインクリメントして、通信デー
タをデュアルポートＲＡＭ１０５に書き込む。受け手側
のマイクロコンピュータは、異常判定用メモリ１０５−
１の異常判定データを監視し、所定時間が経過しても異
常判定データが更新されない場合、これを送り手側のマ
イクロコンピュータに異常が生じたものと判断する。
ピュータの拡張性を低減させることなく、マイクロコン
ピュータ相互の監視を行う。 【構成】 デュアルポートＲＡＭ１０５の一部に異常判
定用メモリ１０５−１を設ける。送り手側のマイクロコ
ンピュータは、異常判定用メモリ１０５−１の記憶デー
タ（異常判定データ）をインクリメントして、通信デー
タをデュアルポートＲＡＭ１０５に書き込む。受け手側
のマイクロコンピュータは、異常判定用メモリ１０５−
１の異常判定データを監視し、所定時間が経過しても異
常判定データが更新されない場合、これを送り手側のマ
イクロコンピュータに異常が生じたものと判断する。
Description
【０００１】
【産業上の利用分野】この発明は、デュアルポートＲＡ
Ｍを介して相互にデータ通信を行うマイクロコンピュー
タの異常の有・無を監視するマイクロコンピュータ監視
装置に関するものである。
Ｍを介して相互にデータ通信を行うマイクロコンピュー
タの異常の有・無を監視するマイクロコンピュータ監視
装置に関するものである。
【０００２】
【従来の技術】図４に従来のマイクロコンピュータ監視
装置のシステム構成図を示す。同図において、４０１お
よび４０２はデータ通信を制御する第１および第２のマ
イクロコンピュータ、４０３および４０４は通信データ
を伝送する第１および第２のＡ／Ｄバス、４０５は通信
データを中継するデュアルポートＲＡＭ、４０１−１お
よび４０１−２はマイクロコンピュータ４０１の信号送
出ポートおよび信号受信ポート、４０２−１および４０
２−２はマイクロコンピュータ４０２の信号送出ポート
および信号受信ポートである。
装置のシステム構成図を示す。同図において、４０１お
よび４０２はデータ通信を制御する第１および第２のマ
イクロコンピュータ、４０３および４０４は通信データ
を伝送する第１および第２のＡ／Ｄバス、４０５は通信
データを中継するデュアルポートＲＡＭ、４０１−１お
よび４０１−２はマイクロコンピュータ４０１の信号送
出ポートおよび信号受信ポート、４０２−１および４０
２−２はマイクロコンピュータ４０２の信号送出ポート
および信号受信ポートである。
【０００３】次に動作について説明する。図５（ａ）に
信号送出ポート４０１−１，４０２−１からの送出信号
波形を示し、図５（ｂ）にマイクロコンピュータ４０
１，４０２が内部に保有するタイマのタイマ波形を示
す。
信号送出ポート４０１−１，４０２−１からの送出信号
波形を示し、図５（ｂ）にマイクロコンピュータ４０
１，４０２が内部に保有するタイマのタイマ波形を示
す。
【０００４】信号送出ポート４０１−１，４０２−１よ
り一定周期Ｔのクロック信号を送出することによって、
受け手のマイクロコンピュータ４０２，４０１でのタイ
マ動作をクリアする。信号送出ポート４０１−１，４０
２−１からのクロック信号が停止すると、受け手のマイ
クロコンピュータ４０２，４０１でのタイマ動作はクリ
アされず、そのタイマ波形の値が一定値ＴＭ以上とな
る。これにより、受け手のマイクロコンピュータ４０
２，４０１は、送り手のマイクロコンピュータ４０１，
４０２の異常を判断する。
り一定周期Ｔのクロック信号を送出することによって、
受け手のマイクロコンピュータ４０２，４０１でのタイ
マ動作をクリアする。信号送出ポート４０１−１，４０
２−１からのクロック信号が停止すると、受け手のマイ
クロコンピュータ４０２，４０１でのタイマ動作はクリ
アされず、そのタイマ波形の値が一定値ＴＭ以上とな
る。これにより、受け手のマイクロコンピュータ４０
２，４０１は、送り手のマイクロコンピュータ４０１，
４０２の異常を判断する。
【０００５】
【発明が解決しようとする課題】しかしながら、このよ
うな従来のマイクロコンピュータ監視装置によると、ク
ロック信号を送受信するためのポート（異常検出用ポー
ト）が必要で、マイクロコンピュータの拡張性が低減す
るという問題があった。また、最悪の場合、ポートが不
足し、１ランク上のマイクロコンピュータを使用しなけ
ればならず、コストが上昇するという問題もあった。
うな従来のマイクロコンピュータ監視装置によると、ク
ロック信号を送受信するためのポート（異常検出用ポー
ト）が必要で、マイクロコンピュータの拡張性が低減す
るという問題があった。また、最悪の場合、ポートが不
足し、１ランク上のマイクロコンピュータを使用しなけ
ればならず、コストが上昇するという問題もあった。
【０００６】本発明はこのような課題を解決するために
なされたもので、その目的とするところは、異常検出用
ポートを不要とし、マイクロコンピュータの拡張性を低
減させることなく、マイクロコンピュータ相互の監視を
行うことができるマイクロコンピュータ監視装置を提供
することにある。
なされたもので、その目的とするところは、異常検出用
ポートを不要とし、マイクロコンピュータの拡張性を低
減させることなく、マイクロコンピュータ相互の監視を
行うことができるマイクロコンピュータ監視装置を提供
することにある。
【０００７】
【課題を解決するための手段】このような目的を達成す
るために、本発明は、送り手側のマイクロコンピュータ
からの通信データの書き込みに際し、デュアルポートＲ
ＡＭに設けた異常判定用メモリの記憶データを更新する
ものとし、受け手側のマイクロコンピュータにおいて、
上記異常判定用メモリの記憶データを監視することによ
り、送り手側のマイクロコンピュータの異常の有・無を
判断するようにしたものである。
るために、本発明は、送り手側のマイクロコンピュータ
からの通信データの書き込みに際し、デュアルポートＲ
ＡＭに設けた異常判定用メモリの記憶データを更新する
ものとし、受け手側のマイクロコンピュータにおいて、
上記異常判定用メモリの記憶データを監視することによ
り、送り手側のマイクロコンピュータの異常の有・無を
判断するようにしたものである。
【０００８】
【作用】したがってこの発明によれば、デュアルポート
ＲＡＭに対して、送り手側のマイクロコンピュータから
通信データの書き込みに際し、これと並行して異常判定
用メモリの記憶データが更新される。受け手側のマイク
ロコンピュータは、この異常判定用メモリの記憶データ
を監視することにより、例えばこの記憶データが所定時
間経過しても更新されない場合を、送り手側のマイクロ
コンピュータの異常として判断する。
ＲＡＭに対して、送り手側のマイクロコンピュータから
通信データの書き込みに際し、これと並行して異常判定
用メモリの記憶データが更新される。受け手側のマイク
ロコンピュータは、この異常判定用メモリの記憶データ
を監視することにより、例えばこの記憶データが所定時
間経過しても更新されない場合を、送り手側のマイクロ
コンピュータの異常として判断する。
【０００９】
【実施例】以下、本発明を実施例に基づき詳細に説明す
る。
る。
【００１０】図１はこの発明の一実施例を示すマイクロ
コンピュータ監視装置のシステム構成図である。同図に
おいて、１０１および１０２はデータ通信を制御する第
１および第２のマイクロコンピュータ、１０３および１
０４は通信データを伝送する第１および第２のＡ／Ｄバ
ス、１０５は通信データを中継するデュアルポートＲＡ
Ｍである。デュアルポートＲＡＭ１０５にはその一部に
異常判定用メモリ１０５−１が設けられている。
コンピュータ監視装置のシステム構成図である。同図に
おいて、１０１および１０２はデータ通信を制御する第
１および第２のマイクロコンピュータ、１０３および１
０４は通信データを伝送する第１および第２のＡ／Ｄバ
ス、１０５は通信データを中継するデュアルポートＲＡ
Ｍである。デュアルポートＲＡＭ１０５にはその一部に
異常判定用メモリ１０５−１が設けられている。
【００１１】次に、このマイクロコンピュータ監視装置
の動作について、マイクロコンピュータ１０１，１０２
およびデュアルポートＲＡＭ１０５の機能を交えながら
説明する。
の動作について、マイクロコンピュータ１０１，１０２
およびデュアルポートＲＡＭ１０５の機能を交えながら
説明する。
【００１２】今、送り手側のマイクロコンピュータを１
０１、受け手側のマイクロコンピュータを１０２とする
と、送り手側のマイクロコンピュータ１０１は、図２に
その処理フローチャートを示すように、異常判定用メモ
リ１０５−１の記憶データ（異常判定データ）をインク
リメントして（ステップ２０１）、通信データをデュア
ルポートＲＡＭ１０５に書き込む（ステップ２０２）。
０１、受け手側のマイクロコンピュータを１０２とする
と、送り手側のマイクロコンピュータ１０１は、図２に
その処理フローチャートを示すように、異常判定用メモ
リ１０５−１の記憶データ（異常判定データ）をインク
リメントして（ステップ２０１）、通信データをデュア
ルポートＲＡＭ１０５に書き込む（ステップ２０２）。
【００１３】すなわち、デュアルポートＲＡＭ１０５で
は、送り手側のマイクロコンピュータ１０１からの通信
データの書き込みに際し、これと並行して異常判定用メ
モリ１０５−１の記憶する異常判定データが更新され
る。
は、送り手側のマイクロコンピュータ１０１からの通信
データの書き込みに際し、これと並行して異常判定用メ
モリ１０５−１の記憶する異常判定データが更新され
る。
【００１４】一方、受け手側のマイクロコンピュータ１
０２は、図３にその処理フローチャートを示すように、
異常判定用メモリ１０５−１の記憶している異常判定デ
ータを読み込み（ステップ３０１）、この読み込んだ異
常判定データと前回保存した異常判定データと比較する
（ステップ３０２）。今回読み込んだ異常判定データと
前回保存した異常判定データとが異なっていれば、すな
わち異常判定データが更新されていれば、異常判定デー
タが正常値であるとして、後述するカウンタのカウント
値をクリアしたうえ（ステップ３０３）、デュアルポー
トＲＡＭ１０５からの通信データを読み込む（ステップ
３０４）。そして、今回読み込んだ異常判定データを異
常判定用メモリ１０５−１に更新記憶し（ステップ３０
５）、以下同様にして、所定周期でステップ３０１以降
の処理動作を繰り返す。
０２は、図３にその処理フローチャートを示すように、
異常判定用メモリ１０５−１の記憶している異常判定デ
ータを読み込み（ステップ３０１）、この読み込んだ異
常判定データと前回保存した異常判定データと比較する
（ステップ３０２）。今回読み込んだ異常判定データと
前回保存した異常判定データとが異なっていれば、すな
わち異常判定データが更新されていれば、異常判定デー
タが正常値であるとして、後述するカウンタのカウント
値をクリアしたうえ（ステップ３０３）、デュアルポー
トＲＡＭ１０５からの通信データを読み込む（ステップ
３０４）。そして、今回読み込んだ異常判定データを異
常判定用メモリ１０５−１に更新記憶し（ステップ３０
５）、以下同様にして、所定周期でステップ３０１以降
の処理動作を繰り返す。
【００１５】受け手側のマイクロコンピュータ１０２
は、ステップ３０２において、今回読み込んだ異常判定
データが更新されていないことを確認すると、前述のカ
ウンタのカウント値をアップし（ステップ３０６）、そ
のカウント値Ｎが所定値ｎ以上であるか否かを確認する
（ステップ３０７）。カウント値Ｎがｎ以下であれば、
マイクロコンピュータ１０１からの書き込み処理が終了
していないと判断して、今回読み込んだ異常判定データ
を異常判定用メモリ１０５−１に更新記憶する（ステッ
プ３０５）。
は、ステップ３０２において、今回読み込んだ異常判定
データが更新されていないことを確認すると、前述のカ
ウンタのカウント値をアップし（ステップ３０６）、そ
のカウント値Ｎが所定値ｎ以上であるか否かを確認する
（ステップ３０７）。カウント値Ｎがｎ以下であれば、
マイクロコンピュータ１０１からの書き込み処理が終了
していないと判断して、今回読み込んだ異常判定データ
を異常判定用メモリ１０５−１に更新記憶する（ステッ
プ３０５）。
【００１６】カウント値Ｎがｎ以上であれば、すなわち
カウント値ｎに応じた所定時間が経過しても異常判定デ
ータが更新されない場合には、これを送り手側のマイク
ロコンピュータ１０１に異常が生じたものと判断し、フ
ェール処理を行う（ステップ３０８）。
カウント値ｎに応じた所定時間が経過しても異常判定デ
ータが更新されない場合には、これを送り手側のマイク
ロコンピュータ１０１に異常が生じたものと判断し、フ
ェール処理を行う（ステップ３０８）。
【００１７】なお、上述においては、送り手側のマイク
ロコンピュータを１０１、受け手側のマイクロコンピュ
ータを１０２としたが、送り手側のマイクロコンピュー
タを１０２、受け手側のマイクロコンピュータを１０１
とした場合にも、同様動作が行われる。
ロコンピュータを１０１、受け手側のマイクロコンピュ
ータを１０２としたが、送り手側のマイクロコンピュー
タを１０２、受け手側のマイクロコンピュータを１０１
とした場合にも、同様動作が行われる。
【００１８】
【発明の効果】以上説明したことから明らかなように本
発明によれば、デュアルポートＲＡＭに設けられた異常
判定用メモリの記憶データを監視することにより、送り
手側のマイクロコンピュータの異常の有・無を判断する
ようにしたので、異常検出用ポートを不要とし、マイク
ロコンピュータの拡張性を低減させることなく、マイク
ロコンピュータ相互の監視を行うことができるようにな
る。
発明によれば、デュアルポートＲＡＭに設けられた異常
判定用メモリの記憶データを監視することにより、送り
手側のマイクロコンピュータの異常の有・無を判断する
ようにしたので、異常検出用ポートを不要とし、マイク
ロコンピュータの拡張性を低減させることなく、マイク
ロコンピュータ相互の監視を行うことができるようにな
る。
【図１】本発明の一実施例を示すマイクロコンピュータ
監視装置のシステム構成図である。
監視装置のシステム構成図である。
【図２】送り手側のマイクロコンピュータの処理フロー
チャートである。
チャートである。
【図３】受け手側のマイクロコンピュータの処理フロー
チャートである。
チャートである。
【図４】従来のマイクロコンピュータ監視装置のシステ
ム構成図である。
ム構成図である。
【図５】従来のマイクロコンピュータ監視装置の動作を
説明するためのタイムチャートである。
説明するためのタイムチャートである。
１０１ 第１のマイクロコンピュータ １０２ 第２のマイクロコンピュータ １０３ 第１のＡ／Ｄバス １０４ 第２のＡ／Ｄバス １０５ デュアルポートＲＡＭ １０５−１ 異常判定用メモリ
Claims (1)
- 【請求項１】 デュアルポートＲＡＭを介して相互にデ
ータ通信を行うマイクロコンピュータの異常の有・無を
監視するマイクロコンピュータ監視装置において、 前記デュアルポートＲＡＭに設けられ、送り手側のマイ
クロコンピュータからの通信データの書き込みに際し、
その記憶データが更新される異常判定用メモリと、 受け手側のマイクロコンピュータにおいて、前記異常判
定用メモリの記憶データを監視することにより、送り手
側のマイクロコンピュータの異常の有・無を判断する手
段とを備えたことを特徴とするマイクロコンピュータ監
視装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4347711A JPH06202908A (ja) | 1992-12-28 | 1992-12-28 | マイクロコンピュータ監視装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4347711A JPH06202908A (ja) | 1992-12-28 | 1992-12-28 | マイクロコンピュータ監視装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06202908A true JPH06202908A (ja) | 1994-07-22 |
Family
ID=18392071
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4347711A Pending JPH06202908A (ja) | 1992-12-28 | 1992-12-28 | マイクロコンピュータ監視装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06202908A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08305675A (ja) * | 1995-04-28 | 1996-11-22 | Nippon Denki Ido Tsushin Kk | マルチプロセッサシステムおよびその運転管理方 法 |
| JP2010257121A (ja) * | 2009-04-23 | 2010-11-11 | Toshiba Mach Co Ltd | ステータス表示切替 |
-
1992
- 1992-12-28 JP JP4347711A patent/JPH06202908A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08305675A (ja) * | 1995-04-28 | 1996-11-22 | Nippon Denki Ido Tsushin Kk | マルチプロセッサシステムおよびその運転管理方 法 |
| JP2010257121A (ja) * | 2009-04-23 | 2010-11-11 | Toshiba Mach Co Ltd | ステータス表示切替 |
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