JPH06180580A - 画像処理装置 - Google Patents

画像処理装置

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Publication number
JPH06180580A
JPH06180580A JP4284980A JP28498092A JPH06180580A JP H06180580 A JPH06180580 A JP H06180580A JP 4284980 A JP4284980 A JP 4284980A JP 28498092 A JP28498092 A JP 28498092A JP H06180580 A JPH06180580 A JP H06180580A
Authority
JP
Japan
Prior art keywords
affine transformation
data
registers
rotation
screen
Prior art date
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Pending
Application number
JP4284980A
Other languages
English (en)
Inventor
Mitsuhiro Takahashi
充宏 高橋
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Hudson Soft Co Ltd
Original Assignee
Seiko Epson Corp
Hudson Soft Co Ltd
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Publication date
Application filed by Seiko Epson Corp, Hudson Soft Co Ltd filed Critical Seiko Epson Corp
Priority to JP4284980A priority Critical patent/JPH06180580A/ja
Priority to TW085214171U priority patent/TW317954U/zh
Priority to EP93307738A priority patent/EP0590968B1/en
Priority to DE69328149T priority patent/DE69328149T2/de
Priority to CA002107436A priority patent/CA2107436C/en
Priority to US08/130,575 priority patent/US5987190A/en
Publication of JPH06180580A publication Critical patent/JPH06180580A/ja
Pending legal-status Critical Current

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  • Controls And Circuits For Display Device (AREA)
  • Image Processing (AREA)

Abstract

(57)【要約】 【目的】 複数のバックグラウンド画面とスプライト画
面を組み合わせて画像を表示するコンピュータ画像処理
装置において、水平同期期間内で回転、拡大、縮小など
の処理を行うことを可能とする装置を得ること。 【構成】 少なくとも1面のバックグラウンド画面にた
いしてラスタ単位で処理可能なアフィン変換手段を備え
る。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はコンピュータを用いる画
像処理装置に関する。
【0002】
【従来の技術】従来、多くのアニメなどを画像処理をす
るゲームなどに用いられるコンピュータ画像処理装置に
おいてはビデオ画面に表示する方法としてバックグラウ
ンド(BG)とスプライトと呼ばれる2種類の画面を重
ね合わせる方式をとっている。
【0003】このようなシステムでは、バックグラウン
ド画面は「キャラクタ」、スプライト画面は「スプライ
ト」と呼ばれるパターンを単位として画面が構成されて
いる。通常、画像表示においてはメモリ上の仮想画面は
CRT画面(実画面)より大きく取ってある。この仮想
画面のデータを垂直あるいは水平にずらせていくことに
よって、実画面上でスクロールが実現できる。
【0004】バックグラウンドはCRT画面のラスタと
キャラクターピッチを単位とするバックグラウンドキャ
ラクタ毎に、表示位置、色、パターンの情報で定義され
る。キャラクタの表示位置は画面上の座標を示してい
る。
【0005】図1に示すようにバックグラウンド画面は
コンピュータ内のメモリにおいてバックグラウンドアト
リビュートテーブル(BAT)とキャラクタジェネレー
タ(CG)というデータ形式で管理される。
【0006】このような装置において、たとえばBG画
像などを回転させようとするときは、あらかじめアニメ
ーションのように別の絵を用意しておいて切り替えて表
示して回転しているように見せるか、あるいは図2に示
すようなマトリックス座標計算を行って回転後の画像を
計算によって作って次々に表示していた。
【0007】
【発明が解決しようとする課題】コンピュータ装置で扱
う画像データは一般に量が大きく、短時間で処理するこ
とが困難である。とくにコンピュータゲーム装置のよう
に1秒間に数十枚の画面を表示しながら、走査線が戻る
までの水平同期期間:1HSYNCの間に対処しなけれ
ばならない処理が多く、回転、拡大、縮小といったグラ
フィック処理をこの期間内に処理することは困難であっ
た。
【0008】
【課題を解決するための手段】本発明は上記課題を解決
するために、ラスタ単位で処理できるアフィン変換処理
手段を画像処理装置にそなえる。
【0009】アフィン変換(逆変換)は(X0,Y0)
を中心に拡大、縮小、回転を行う処理である。変換式は
図3のとおりである。ここで、 A=αcosθ B=−βsinθ C=αsinθ D=βcosθ α=X方向の縮小率 β=Y方向の縮小率 θ=回転角 (X0,Y0):回転の中心座標 (X1,Y1):逆変換後の座標 (X2,Y2):逆変換前の座標
【0010】逆変換であるために図2とはマイナス符号
の位置が違っている。X方向の縮小率αをnとすると、
X方向の長さはn分の1となる。一方回転は、中心点を
どの位置に取るかによって、図形の移動位置が変わって
くる。
【0011】たとえば図3に示すように、正三角形の中
心点(重心)に回転の中心座標(X0,Y0)を取り1
80度回転させると正三角形は同じ位置で回転し、逆向
きとなる。ところが回転の中心座標を正三角形の外側に
取ると、正三角形は回転の中心点のまわりを回り、点対
象の位置で逆向きとなる。
【0012】
【実施例】本発明のコンピュータ装置の実施例に基づい
て説明する。図5は本発明の一実施例の画像処理装置の
ブロック図である。CPU専用のM−RAMのほかにビ
デオディスプレイプロセッサ(VDP)用のV−RA
M、コントローラユニット用のK−RAM、圧縮された
画像信号を復号する画像伸長用のR−RAMなどの多様
なRAMを備えている。
【0013】図6は図5におけるSCSIコントロー
ラ、グラフィックコントローラ、サウンドコントローラ
などが含まれているコントローラユニット内部のより詳
細な図である。
【0014】この装置では、コントローラユニットはC
D−ROMなどの外部記憶装置からデータを読み取りK
−RAMに蓄える。K−RAMには画像データ等の各種
データが一時的に保存され、その中には8ビットで1レ
コードをなすものや16ビットで1レコードをなすよう
なさまざまな種類のデータが含まれている。このコント
ローラユニットではバックグラウンドの画像について
は、4面のBG画面が同時に扱える。
【0015】上記のコントロールユニットにはアフィン
変換のアルゴリズムをハードウェアとして組み込まれて
いる。コントロールユニットではBG0、BG1、BG
2、BG3の4BG画面が同時に扱えるが、アフィン変
換の対象はBG0画面のみである。
【0016】アフィン変換用の係数A、B、C、DはB
Gアフィン変換係数レジスタで設定し、回転の中心座標
はBGアフィン変換中心座標XおよびYレジスタで設定
する。そのレジスタの形式は図7のようになっている。
係数A、B、C、Dおよび中心座標はX0、Y0は図3
に示された式の変数に対応する。係数は、レジスタの上
位8ビットに小数点以上の値を設定し、下位8ビットに
小数点以下を指定する。中心座標は原画座標系で指定す
る。
【0017】いずれのレジスタの値も1度設定したあと
は、次に新たに設定されるまで保持される。またレジス
タが有効になるのは、次のHSYNCからである。
【0018】縮小の例について説明図する。図8は原画
を縮小して画像表示する場合のデータの流れを示したも
のである。K−RAMはコントロールユニットのDRA
Mで、画像データが蓄えられている。
【0019】図では画面上に真っ直の道が描かれてい
る。それをコントロールユニットで縮小し、ビデオ画面
に表示する。ビデオ画面表示時は、道の上部を4分の1
の幅にし、一番下は原画サイズそのままにする。
【0020】これを実現するには、X方向の縮小率αを α=3x(R−r)/R+1 のように各ラスタごとに計算する。
【0021】ここでRは(ラスタ数−1)、rはRから
始まり、ラスタごとに1ずつ減じていき、最後のラスタ
を表示する前には0となる値である。すなわち、αは画
面最上部を表示するときには4、最下部を表示するとき
には1となる。回転は行わないか回転角θは0、回転の
中心座標X0、Y0も0とする。
【0022】したがってアフィン変換係数はA、B、
C、Dは A= αcos(θ)=α B=−βsin(θ)=0 C= αcos(θ)=α D= βsin(θ)=0 と求まる。
【0023】この処理のフローを図9に示す。ループ中
のr、AおよびCの計算は、HSYNC期間中に行う。
実際には水平同期期間割り込みが起きるので、この割り
込みでの処理となる。
【0024】以上の処理は縮小率を変えての表示である
が、一律に画面全体を縮小する場合には、図9の初期処
理で縮小率αを求め、BGアフィン変換レジスタにその
値を設定しておくだけでよい。これは回転の場合も同様
である。
【0025】本発明での処理は、表示データに対しての
加工であるから、原画像そのものはそのまま残ってい
る。したがって、原画像を何度でも再利用することがで
きる。
【0026】
【発明の効果】本発明の装置はラスタごとにアフィン変
換処理が可能であるので回転、拡大、縮小がレジスタの
設定だけで可能となった。
【図面の簡単な説明】
【図1】バックグラウンド画面のメモリ上の管理の説明
図である。
【図2】2次元座標における座標回転の説明図である。
【図3】アフィン変換式(逆変換)を示す図である。
【図4】回転の中心座標と回転後の図形位置の説明図で
ある。
【図5】本発明の一実施例の画像処理装置のブロック図
である。
【図6】本発明の実施例の画像処理装置のコントロール
ユニット部の詳細図である。
【図7】本発明の実施例におけるアフィン変換係数レジ
スタとアフィン変換中心座標レジスタの説明図である。
【図8】本発明の実施例における縮小時のデータの流れ
図である。
【図9】本発明の実施例におけるラスタごとに縮小率を
変えた処理の流れ図である。
【手続補正書】
【提出日】平成4年11月20日
【手続補正1】
【補正対象書類名】明細書
【補正対象項目名】0009
【補正方法】変更
【補正内容】
【0009】アフィン変換(逆変換)は(X0,Y0)
を中心に拡大、縮小、回転を行う処理である。変換式は
図4のとおりである。ここで、 A=αcosθ B=−βsinθ C=αsinθ D=βcosθ α=X方向の縮小率 β=Y方向の縮小率 θ=回転角 (X0,Y0):回転の中心座標 (X1,Y1):逆変換後の座標 (X2,Y2):逆変換前の座標
【手続補正2】
【補正対象書類名】明細書
【補正対象項目名】0021
【補正方法】変更
【補正内容】
【0021】ここでRは(ラスタ数−1)、rはRから
始まり、ラスタごとに1ずつ減じていき、最後のラスタ
を表示する前には0となる値である。すなわち、αは画
面最上部を表示するときには4、最下部を表示するとき
には1となる。回転は行わないか回転角θは0、回転
の中心座標X0、Y0も0とする。

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 複数のバックグラウンド画面とスプライ
    ト画面を組み合わせて画像を表示する画像処理装置にお
    いて、少なくとも1面のバックグラウンド画面にたいし
    てラスタ単位で処理可能なアフィン変換手段を備えたこ
    とを特徴とする画像処理装置。
JP4284980A 1992-10-01 1992-10-01 画像処理装置 Pending JPH06180580A (ja)

Priority Applications (6)

Application Number Priority Date Filing Date Title
JP4284980A JPH06180580A (ja) 1992-10-01 1992-10-01 画像処理装置
TW085214171U TW317954U (en) 1992-10-01 1993-09-08 Image processing system including a processor side memory and a display side memory
EP93307738A EP0590968B1 (en) 1992-10-01 1993-09-29 Image processing system
DE69328149T DE69328149T2 (de) 1992-10-01 1993-09-29 Bildverarbeitungssystem
CA002107436A CA2107436C (en) 1992-10-01 1993-09-30 Image processing system including a processor side memory and a display side memory
US08/130,575 US5987190A (en) 1992-10-01 1993-10-01 Image processing system including a processor side memory and a display side memory

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP4284980A JPH06180580A (ja) 1992-10-01 1992-10-01 画像処理装置

Publications (1)

Publication Number Publication Date
JPH06180580A true JPH06180580A (ja) 1994-06-28

Family

ID=17685577

Family Applications (1)

Application Number Title Priority Date Filing Date
JP4284980A Pending JPH06180580A (ja) 1992-10-01 1992-10-01 画像処理装置

Country Status (1)

Country Link
JP (1) JPH06180580A (ja)

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61215587A (ja) * 1985-03-20 1986-09-25 ソニー株式会社 画像表示装置
JPS62128374A (ja) * 1985-11-29 1987-06-10 Canon Inc 画像処理方法
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