JPH053839B2 - - Google Patents
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- JPH053839B2 JPH053839B2 JP60199561A JP19956185A JPH053839B2 JP H053839 B2 JPH053839 B2 JP H053839B2 JP 60199561 A JP60199561 A JP 60199561A JP 19956185 A JP19956185 A JP 19956185A JP H053839 B2 JPH053839 B2 JP H053839B2
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- 238000000034 method Methods 0.000 claims description 16
- 238000006243 chemical reaction Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 13
- 239000011159 matrix material Substances 0.000 description 7
- 101150065817 ROM2 gene Proteins 0.000 description 3
- 230000006870 function Effects 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明はドツトの集合で文字、記号等を印字す
るドツトプリンタのドツトパターン格納方法に関
するものである。
るドツトプリンタのドツトパターン格納方法に関
するものである。
（従来の技術）
ドツトプリンタは、文字、記号等の文字種を印
字するために、該文字種のドツトパターンをメモ
リに格納している。これらの文字種の中で、一般
に所定の行又は列を境界として規則性を有する文
字を罫線文字という。第７図はドツトマトリクス
を縦12×横６ドツトで構成したときの罫線文字の
ドツトパターンの一例を示す図である。従来、同
図に示す罫線文字のドツトパターンを例えば９ピ
ン印字ヘツドのドツトプリンタを用いて印字する
場合、縦12ドツトを９ピンの印字ヘツドで一度に
印字することができないため、縦12ドツトを２分
割し２回の印字動作を行つていた。すなわち縦12
ドツトを６ドツトずつに２分割し、分割された
各々をそれぞれ２回の印字動作の印字データに対
応させていた。
字するために、該文字種のドツトパターンをメモ
リに格納している。これらの文字種の中で、一般
に所定の行又は列を境界として規則性を有する文
字を罫線文字という。第７図はドツトマトリクス
を縦12×横６ドツトで構成したときの罫線文字の
ドツトパターンの一例を示す図である。従来、同
図に示す罫線文字のドツトパターンを例えば９ピ
ン印字ヘツドのドツトプリンタを用いて印字する
場合、縦12ドツトを９ピンの印字ヘツドで一度に
印字することができないため、縦12ドツトを２分
割し２回の印字動作を行つていた。すなわち縦12
ドツトを６ドツトずつに２分割し、分割された
各々をそれぞれ２回の印字動作の印字データに対
応させていた。
このような印字データをメモリに格納する従来
の方式について以下説明する。第８図は、第７図
の罫線文字のドツトマトリクスパターンをメモリ
に格納した状態を示す図である。図中、丸印は印
字されるドツト（論理“１”とする）を示し、空
欄はドツトを印字しない（論理“０”とする）こ
とを示している。アドレスは説明を簡単にするた
めに１〜１２を割付けてある。第７図のドツトパ
ターンの縦12ドツトを２分割し、Ｒ１〜Ｒ６の６
ドツトを１バイト（８ビツト）としてＣ１〜Ｃ６
を第８図のアドレス１〜６へバイト毎に格納し、
同様にＲ７〜Ｒ１２の６ドツトを１バイト（８ビ
ツト）としてＣ１〜Ｃ６を第８図のアドレス７〜
12バイト毎に格納して行う。
の方式について以下説明する。第８図は、第７図
の罫線文字のドツトマトリクスパターンをメモリ
に格納した状態を示す図である。図中、丸印は印
字されるドツト（論理“１”とする）を示し、空
欄はドツトを印字しない（論理“０”とする）こ
とを示している。アドレスは説明を簡単にするた
めに１〜１２を割付けてある。第７図のドツトパ
ターンの縦12ドツトを２分割し、Ｒ１〜Ｒ６の６
ドツトを１バイト（８ビツト）としてＣ１〜Ｃ６
を第８図のアドレス１〜６へバイト毎に格納し、
同様にＲ７〜Ｒ１２の６ドツトを１バイト（８ビ
ツト）としてＣ１〜Ｃ６を第８図のアドレス７〜
12バイト毎に格納して行う。
（発明が解決しようとする問題点）
しかしながら、従来のドツトパターン格納方法
は次のような問題点があつた。
は次のような問題点があつた。
前述したように、第７図に示す縦12×横６ドツ
トで構成されるドツトパターンを例えば９ピン印
字ヘツドを用いて印字する場合、縦が12ドツトの
ため２回の印字動作をしなければならない。この
ためドツトパターンを２分割してそれぞれメモリ
に格納し、分割された各ドツトパターンを各々の
印字動作に対応する印字データとする必要がある
ので、メモリ容量が増大するという問題点があつ
た。更に、縦12×横６ドツトのドツトパターンを
メモリから読みだして展開する場合、分割されて
メモリに格納された各々のドツトパターンの先頭
アドレスを示すテーブルを持たせる必要があるの
で、その先頭アドレスのテーブルの格納のため余
分のメモリ容量が必要となる欠点があつた。
トで構成されるドツトパターンを例えば９ピン印
字ヘツドを用いて印字する場合、縦が12ドツトの
ため２回の印字動作をしなければならない。この
ためドツトパターンを２分割してそれぞれメモリ
に格納し、分割された各ドツトパターンを各々の
印字動作に対応する印字データとする必要がある
ので、メモリ容量が増大するという問題点があつ
た。更に、縦12×横６ドツトのドツトパターンを
メモリから読みだして展開する場合、分割されて
メモリに格納された各々のドツトパターンの先頭
アドレスを示すテーブルを持たせる必要があるの
で、その先頭アドレスのテーブルの格納のため余
分のメモリ容量が必要となる欠点があつた。
本発明は、このような従来技術の問題点を解決
するためになされたものであつて、印字すべき文
字等のドツトパターンを格納するメモリの容量を
大幅に削減させるこのとできるドツトパターン格
納方法を提供することを目的とする。
するためになされたものであつて、印字すべき文
字等のドツトパターンを格納するメモリの容量を
大幅に削減させるこのとできるドツトパターン格
納方法を提供することを目的とする。
（問題点を解決するための手段）
本発明は前記問題点を解決するために規則性を
有する印字パターンを所定の行又は列を境界とし
て２分割し、分割された一方の印字パターンは印
字情報としてそのままメモリに格納し、他方の印
字パターンは前記規則性を示すコードを割当て、
この割当てたコードを前記メモリの空ビツトに格
納するようにしたものである。
有する印字パターンを所定の行又は列を境界とし
て２分割し、分割された一方の印字パターンは印
字情報としてそのままメモリに格納し、他方の印
字パターンは前記規則性を示すコードを割当て、
この割当てたコードを前記メモリの空ビツトに格
納するようにしたものである。
（作用）
本発明によれば、以上のようにドツトプリンタ
のドツトパターン格納方法を構成したので作用は
次のようになる。
のドツトパターン格納方法を構成したので作用は
次のようになる。
規則性を有する印字パターンにおいて、前記境
界で分割された一方の印字パターンはそのままメ
モリに格納され、他方の印字パターンはメモリに
格納されないで、規則性を示すコードを割当てら
れる。この割り当てられたコードを前記メモリの
空きビツトに格納し、該規則性を示すコードに基
づいて他方の印字パターンは作成することができ
る。従つて分割された一方の印字パターンと前記
規則性を示すコードをメモリに格納すれば、全体
の印字パターンをメモリに格納していることにな
りメモリ容量を削減でき、更に各々の印字パター
ンの先頭アドレスを示すテーブルは一つで済み、
前記問題点を解決できるのである。
界で分割された一方の印字パターンはそのままメ
モリに格納され、他方の印字パターンはメモリに
格納されないで、規則性を示すコードを割当てら
れる。この割り当てられたコードを前記メモリの
空きビツトに格納し、該規則性を示すコードに基
づいて他方の印字パターンは作成することができ
る。従つて分割された一方の印字パターンと前記
規則性を示すコードをメモリに格納すれば、全体
の印字パターンをメモリに格納していることにな
りメモリ容量を削減でき、更に各々の印字パター
ンの先頭アドレスを示すテーブルは一つで済み、
前記問題点を解決できるのである。
（実施例）
第４図は前記ドツトプリンタのドツトパターン
格納方法を実施するための回路構成例を示すブロ
ツク図である。同図において、１はマイクロプロ
セツサ（CPU）、２はリードオンリーメモリ
（ROM）、３はランダムアクセスメモリ
（RAM）、４はＩ／Ｏドライバ、５はバスライン
である。ROM２はプログラム及び文字、記号等
のパターンデータを格納し、RAM３は外部から
の受信データを一時記憶する。ROM２及び
RAM３はバスライン５に接続される。CPU１
は、バスライン５を介してＩ／Ｏドライバ４を駆
動し、このＩ／Ｏドライバ４に接続される外部装
置（図示なし）とのインターフエース回路、印字
ヘツド、改行用モータ、印字ヘツドを印字方向に
移動させるスペーシング用モータの制御を行う。
格納方法を実施するための回路構成例を示すブロ
ツク図である。同図において、１はマイクロプロ
セツサ（CPU）、２はリードオンリーメモリ
（ROM）、３はランダムアクセスメモリ
（RAM）、４はＩ／Ｏドライバ、５はバスライン
である。ROM２はプログラム及び文字、記号等
のパターンデータを格納し、RAM３は外部から
の受信データを一時記憶する。ROM２及び
RAM３はバスライン５に接続される。CPU１
は、バスライン５を介してＩ／Ｏドライバ４を駆
動し、このＩ／Ｏドライバ４に接続される外部装
置（図示なし）とのインターフエース回路、印字
ヘツド、改行用モータ、印字ヘツドを印字方向に
移動させるスペーシング用モータの制御を行う。
以下、本発明の一実施例のドツトパターン格納
方法について説明する。本実施例では一例として
縦12×横６ドツトで構成したときの罫線文字を扱
うものとする。本実施例の格納方法では、縦12×
横６ドツトの罫線文字のドツトパターンを列方向
にそれぞれ縦６×横６ドツトの印字パターンとに
２分割し、一方の印字パターンは印字情報として
そのままメモリに格納し、他方の印字パターンに
は規則性を示すコードを割当て、そのコードをメ
モリの空ビツトに格納する。第１図は本発明の一
実施例によるドツトパターン格納方法を説明する
図である。同図ａは縦12×横６ドツトで構成され
る罫線文字のドツトパターンを示す図であり、前
述した第７図に示すドツトパターンと同じであ
る。同図ｂは同図ａのドツトパターンを本実施例
の格納方法によりメモリに格納した状態を示す図
である。罫線文字のドツトパターンは前述したよ
うにドツトマトリクスの所定の行又は列を境とし
て規則性を有している。第１図ａに示すドツトマ
トリクスパターンはＣ１〜Ｃ６のＲ１〜Ｒ６の印
字パターンとＣ１のＲ７〜Ｒ１２の印字パターン
とにおいてＲ６を境界として規則性を有してい
る。この規則性は、Ｒ６を境界としてＲ６を印字
するならばその縦列のＲ７〜Ｒ１２をすべて印字
し、Ｒを印字しなければその縦列のＲ７〜Ｒ１２
をすべて印字しないというものである。例えばこ
のドツトマトリクスパターンのＣ３の縦列に着目
すると、Ｃ３のＲ６は印字でありＣ３のＲ７〜Ｒ
１２はすべて印字され、Ｃ４の縦列に着目する
と、Ｒ６を印字しないためＣ４のＣ７〜Ｃ１２は
すべて印字されない。このような規則性を持つフ
オントは第１図ｂに示すような格納が行われる。
同図中、丸印は、印字ドツト有りを示す論理
“１”に対応し、空欄は印字ドツト無しを示す論
理“０”に対応している。第１図ａのＣ１のＲ１
〜Ｒ６の６ドツトを１バイト（８ビツト）として
第１図ｂのアドレス１のb0〜b5へ格納し、同様に
Ｃ２〜Ｃ６のＲ１〜Ｒ６をアドレス２〜６へ格納
する。ここで第１図ｂに示すb6，b7は空き領域と
なるので、この空きエリアに該規則性を示すコー
ドとしてb6＝０，b7＝１を格納する。
方法について説明する。本実施例では一例として
縦12×横６ドツトで構成したときの罫線文字を扱
うものとする。本実施例の格納方法では、縦12×
横６ドツトの罫線文字のドツトパターンを列方向
にそれぞれ縦６×横６ドツトの印字パターンとに
２分割し、一方の印字パターンは印字情報として
そのままメモリに格納し、他方の印字パターンに
は規則性を示すコードを割当て、そのコードをメ
モリの空ビツトに格納する。第１図は本発明の一
実施例によるドツトパターン格納方法を説明する
図である。同図ａは縦12×横６ドツトで構成され
る罫線文字のドツトパターンを示す図であり、前
述した第７図に示すドツトパターンと同じであ
る。同図ｂは同図ａのドツトパターンを本実施例
の格納方法によりメモリに格納した状態を示す図
である。罫線文字のドツトパターンは前述したよ
うにドツトマトリクスの所定の行又は列を境とし
て規則性を有している。第１図ａに示すドツトマ
トリクスパターンはＣ１〜Ｃ６のＲ１〜Ｒ６の印
字パターンとＣ１のＲ７〜Ｒ１２の印字パターン
とにおいてＲ６を境界として規則性を有してい
る。この規則性は、Ｒ６を境界としてＲ６を印字
するならばその縦列のＲ７〜Ｒ１２をすべて印字
し、Ｒを印字しなければその縦列のＲ７〜Ｒ１２
をすべて印字しないというものである。例えばこ
のドツトマトリクスパターンのＣ３の縦列に着目
すると、Ｃ３のＲ６は印字でありＣ３のＲ７〜Ｒ
１２はすべて印字され、Ｃ４の縦列に着目する
と、Ｒ６を印字しないためＣ４のＣ７〜Ｃ１２は
すべて印字されない。このような規則性を持つフ
オントは第１図ｂに示すような格納が行われる。
同図中、丸印は、印字ドツト有りを示す論理
“１”に対応し、空欄は印字ドツト無しを示す論
理“０”に対応している。第１図ａのＣ１のＲ１
〜Ｒ６の６ドツトを１バイト（８ビツト）として
第１図ｂのアドレス１のb0〜b5へ格納し、同様に
Ｃ２〜Ｃ６のＲ１〜Ｒ６をアドレス２〜６へ格納
する。ここで第１図ｂに示すb6，b7は空き領域と
なるので、この空きエリアに該規則性を示すコー
ドとしてb6＝０，b7＝１を格納する。
次に第２図及び第３図は、前記以外の規則性を
有する罫線文字を対象にした場合の本実施例の格
納方法を説明する図である。
有する罫線文字を対象にした場合の本実施例の格
納方法を説明する図である。
第２図ａに示すドツトパターンは、Ｒ６を境界
としてＲ６を印字するならばその縦列のＲ７〜Ｒ
１２をすべて印字せず、Ｒ６を印字しなければそ
の縦列のＲ７〜Ｒ１２をすべて印字するという規
則性を有する罫線文字の一例を示す図である。例
えばこのドツトパターンのＣ１に着目すると、Ｃ
１のＲ６は印字であり、Ｃ１のＲ７〜Ｒ１２はす
べて印字されない。このような規則性を持つフオ
ントは第２図ｂに示すような格納が行われる。前
述と同様に丸印は論理１、空欄は論理０であり、
第２図ａのＣ１〜Ｃ６の各々のＲ１〜Ｒ６が第２
図ｂに示すアドレス１〜６に順次格納される。こ
の規則性を示すコードとしてb6及びb7の空きエリ
アにb6＝１，b7＝０を格納する。
としてＲ６を印字するならばその縦列のＲ７〜Ｒ
１２をすべて印字せず、Ｒ６を印字しなければそ
の縦列のＲ７〜Ｒ１２をすべて印字するという規
則性を有する罫線文字の一例を示す図である。例
えばこのドツトパターンのＣ１に着目すると、Ｃ
１のＲ６は印字であり、Ｃ１のＲ７〜Ｒ１２はす
べて印字されない。このような規則性を持つフオ
ントは第２図ｂに示すような格納が行われる。前
述と同様に丸印は論理１、空欄は論理０であり、
第２図ａのＣ１〜Ｃ６の各々のＲ１〜Ｒ６が第２
図ｂに示すアドレス１〜６に順次格納される。こ
の規則性を示すコードとしてb6及びb7の空きエリ
アにb6＝１，b7＝０を格納する。
第３図ａに示すドツトパターンは、Ｒ６を境界
としてＣ１〜Ｃ６のＲ１〜Ｒ６とＲ７〜Ｒ１２が
同じマトリクスであるという規則性を有する罫線
文字の一例を示す図である。例えばＣ１の縦列を
着目すると、Ｒ１〜Ｒ６とＲ７〜Ｒ１２は同じマ
トリクスであり同様なことがＣ２〜Ｃ６について
も言える。このような規則性を持つフオントは第
３図ｂに示すような格納が行われる。同図中、丸
印は論理１、空欄は論理０とし、第３図ａのＣ１
のＲ１〜Ｒ６を１バイトとして第１図ａのアドレ
ス１のb0〜b7へ格納し、同様にＣ２〜Ｃ６のＲ１
〜Ｒ６をアドレス２〜６へ格納する。ここで、第
３図ｂにおけるb6，b7は空き領域となるので、こ
の空きエリアに該規則性を示すコードとしてb6＝
０，b7＝０を格納する。
としてＣ１〜Ｃ６のＲ１〜Ｒ６とＲ７〜Ｒ１２が
同じマトリクスであるという規則性を有する罫線
文字の一例を示す図である。例えばＣ１の縦列を
着目すると、Ｒ１〜Ｒ６とＲ７〜Ｒ１２は同じマ
トリクスであり同様なことがＣ２〜Ｃ６について
も言える。このような規則性を持つフオントは第
３図ｂに示すような格納が行われる。同図中、丸
印は論理１、空欄は論理０とし、第３図ａのＣ１
のＲ１〜Ｒ６を１バイトとして第１図ａのアドレ
ス１のb0〜b7へ格納し、同様にＣ２〜Ｃ６のＲ１
〜Ｒ６をアドレス２〜６へ格納する。ここで、第
３図ｂにおけるb6，b7は空き領域となるので、こ
の空きエリアに該規則性を示すコードとしてb6＝
０，b7＝０を格納する。
以上詳細に説明したように、本実施例で対象に
した罫線文字のドツトパターンはＲ６を境界とし
て３種類の規則性に分類され、この３種類の規則
性のコードを格納したb6，b7とＲ６に対応する印
字データb5の関係を第５図に示す。
した罫線文字のドツトパターンはＲ６を境界とし
て３種類の規則性に分類され、この３種類の規則
性のコードを格納したb6，b7とＲ６に対応する印
字データb5の関係を第５図に示す。
第６図は本実施例により格納された罫線文字の
ドツトパターンの展開を示すフローチヤートであ
る。同図中、ADDCT１はアドレスカウンタ１、
CLMCTはコラムカウンタ、ACCはアキユムレ
ータ、FLAGAはＲ１〜Ｒ６の印字パターンかＲ
７〜Ｒ１２の印字パターンかを判別するフラグ
Ａ，３Ｆ，FC及び00は16進数である。ここで
ROM２に格納された第１図ｂに示す印字パター
ンを展開する動作を簡単に説明する。先ず、印字
パターンを格納したROM２のアドレス１をリー
ドし、リードしたデータをACC（アキユムレー
タ）に格納する。ACCに格納されたデータはb0
〜b7であり、そのうちb6，b7は規則性を示すため
のコードが格納されているため、３Ｆでb6，b7を
マスクする。この処理によつて得られたデータは
Ｃ１のＲ１〜Ｒ６の印字データとなる。以上の動
作をアドレス２〜６まで順次行ない、その結果第
１図ａに示すようなＣ１〜Ｃ６のＲ１〜Ｒ６に相
当するドツトパターンが得られる。前記動作が終
了したら、引き続き前述と同様にROM２に格納
された第１図ｂに示す印字パターンをリードす
る。ROM２のアドレス１のデータをACC（アキ
ユムレータ）に格納する。今度はFLAGAによつ
てＲ７〜Ｒ１２の印字パターンへ判別される。
ACC・７，ACC・６、ACC・５はそれぞれ
ROM２からリードしたb7，b6，b5に対応する。
b7，b6に格納された規則性を示すコードにより３
通りに分類され、それぞれＲ７〜Ｒ１２に相当す
る印字データを作成する。印字データ00あるいは
FCセツトとは、Ｒ７〜Ｒ１２をすべて印字する
か否かを示す。この動作をアドレス２〜６まで順
次行い、その結果第１図ａに示すようなＣ１〜Ｃ
６のＲ７〜Ｒ１２に相当するドツトパターンを作
成する。
ドツトパターンの展開を示すフローチヤートであ
る。同図中、ADDCT１はアドレスカウンタ１、
CLMCTはコラムカウンタ、ACCはアキユムレ
ータ、FLAGAはＲ１〜Ｒ６の印字パターンかＲ
７〜Ｒ１２の印字パターンかを判別するフラグ
Ａ，３Ｆ，FC及び00は16進数である。ここで
ROM２に格納された第１図ｂに示す印字パター
ンを展開する動作を簡単に説明する。先ず、印字
パターンを格納したROM２のアドレス１をリー
ドし、リードしたデータをACC（アキユムレー
タ）に格納する。ACCに格納されたデータはb0
〜b7であり、そのうちb6，b7は規則性を示すため
のコードが格納されているため、３Ｆでb6，b7を
マスクする。この処理によつて得られたデータは
Ｃ１のＲ１〜Ｒ６の印字データとなる。以上の動
作をアドレス２〜６まで順次行ない、その結果第
１図ａに示すようなＣ１〜Ｃ６のＲ１〜Ｒ６に相
当するドツトパターンが得られる。前記動作が終
了したら、引き続き前述と同様にROM２に格納
された第１図ｂに示す印字パターンをリードす
る。ROM２のアドレス１のデータをACC（アキ
ユムレータ）に格納する。今度はFLAGAによつ
てＲ７〜Ｒ１２の印字パターンへ判別される。
ACC・７，ACC・６、ACC・５はそれぞれ
ROM２からリードしたb7，b6，b5に対応する。
b7，b6に格納された規則性を示すコードにより３
通りに分類され、それぞれＲ７〜Ｒ１２に相当す
る印字データを作成する。印字データ00あるいは
FCセツトとは、Ｒ７〜Ｒ１２をすべて印字する
か否かを示す。この動作をアドレス２〜６まで順
次行い、その結果第１図ａに示すようなＣ１〜Ｃ
６のＲ７〜Ｒ１２に相当するドツトパターンを作
成する。
以上詳細に説明したように本実施例による罫線
文字のドツトパターン格納方法は、Ｃ１〜Ｃ６の
Ｒ１〜Ｒ６の印字パターンだけをそのままメモリ
に格納し、Ｃ１〜Ｃ６のＲ７〜Ｒ１２の印字パタ
ーンは規則性を示すコードとして前記メモリの空
き領域（b6，b7）に格納すればよい。Ｃ１〜Ｃ６
のＲ７〜Ｒ１２の印字パターンは、メモリの空き
領域（b6，b7）に格納された規則性を示すコード
に基づいて作成することができる。又、このよう
な規則性を有する罫線文字のフオント数は一般に
48種類あり、その代表的なものを第９図に示す。
従つて、従来これらの罫線文字をメモリに格納す
るには48種類×12バイト＝578バイトのメモリ容
量を要したが、本実施例により48×６＝288バイ
トのメモリ容量に削減できた。
文字のドツトパターン格納方法は、Ｃ１〜Ｃ６の
Ｒ１〜Ｒ６の印字パターンだけをそのままメモリ
に格納し、Ｃ１〜Ｃ６のＲ７〜Ｒ１２の印字パタ
ーンは規則性を示すコードとして前記メモリの空
き領域（b6，b7）に格納すればよい。Ｃ１〜Ｃ６
のＲ７〜Ｒ１２の印字パターンは、メモリの空き
領域（b6，b7）に格納された規則性を示すコード
に基づいて作成することができる。又、このよう
な規則性を有する罫線文字のフオント数は一般に
48種類あり、その代表的なものを第９図に示す。
従つて、従来これらの罫線文字をメモリに格納す
るには48種類×12バイト＝578バイトのメモリ容
量を要したが、本実施例により48×６＝288バイ
トのメモリ容量に削減できた。
尚、本実施例において縦12×横６ドツトで構成
される罫線文字のドツトパターンを用いたが、こ
れに限らず同様の規則性を有する文字であれば実
施することができる。
される罫線文字のドツトパターンを用いたが、こ
れに限らず同様の規則性を有する文字であれば実
施することができる。
（発明の効果）
本発明では、罫線文字のドツトパターンを同一
パターンの繰り返しからなる規則性を有する下部
領域と残りの上部領域とに所定の行を境界として
上下に分割する。この上部領域のドツトパターン
を印字情報としてそのままメモリに格納し、一
方、下部領域のドツトパターンを上述の規則性を
示すコードに各横ビツト列毎に変換し、このよう
に変換して得たコードを格納した印字情報と対応
させてメモリに格納している。このように、ドツ
トパターンの一部が繰り返しパターンの規則性に
応じたコードに横ビツト列毎に変換されて格納さ
れる。
パターンの繰り返しからなる規則性を有する下部
領域と残りの上部領域とに所定の行を境界として
上下に分割する。この上部領域のドツトパターン
を印字情報としてそのままメモリに格納し、一
方、下部領域のドツトパターンを上述の規則性を
示すコードに各横ビツト列毎に変換し、このよう
に変換して得たコードを格納した印字情報と対応
させてメモリに格納している。このように、ドツ
トパターンの一部が繰り返しパターンの規則性に
応じたコードに横ビツト列毎に変換されて格納さ
れる。
罫線文字は、一般に、上部分が複雑なパターン
で規則性に乏しく、下部分が規則性を有するとい
う特徴を有している。これは、第９図からも明ら
かのように、通常の文字フオントが縦長の長方形
で構成されているので本文字フオントも当然に縦
形であり、罫線文字を構成している横棒パターン
が上部分に設けられているためである。従つて、
本発明によれば、罫線文字を簡単な法則で圧縮す
ることができる。このようにメモリ容量を大幅に
削減でき、又格納されたドツトパターンの先頭ア
ドレス用のテーブルも半減でき、メモリ容量の削
減となる。更にメモリ容量の削減に伴いドツトプ
リンタの低価格化の効果が期待できる。
で規則性に乏しく、下部分が規則性を有するとい
う特徴を有している。これは、第９図からも明ら
かのように、通常の文字フオントが縦長の長方形
で構成されているので本文字フオントも当然に縦
形であり、罫線文字を構成している横棒パターン
が上部分に設けられているためである。従つて、
本発明によれば、罫線文字を簡単な法則で圧縮す
ることができる。このようにメモリ容量を大幅に
削減でき、又格納されたドツトパターンの先頭ア
ドレス用のテーブルも半減でき、メモリ容量の削
減となる。更にメモリ容量の削減に伴いドツトプ
リンタの低価格化の効果が期待できる。
第１図、第２図、第３図は本発明の一実施例の
ドツトパターン格納方法を説明する図、第４図は
本発明のドツトパターン格納方法を実施するため
の回路構成例を示すブロツク図、第５図は格納さ
れた３種類のフオントのビツトの関係を説明する
図、第６図はドツトパターンの展開を示すフロー
チヤート、第７図は罫線文字のドツトパターンを
示す図、第８図は従来のドツトパターン格納方法
により第６図をメモリに格納した状態を示す図、
第９図は罫線文字の代表的ドツトパターンを示す
図である。 １…CPU、２…ROM、３…RAM、４…Ｉ／
Ｏドライバ、５…バスライン。
ドツトパターン格納方法を説明する図、第４図は
本発明のドツトパターン格納方法を実施するため
の回路構成例を示すブロツク図、第５図は格納さ
れた３種類のフオントのビツトの関係を説明する
図、第６図はドツトパターンの展開を示すフロー
チヤート、第７図は罫線文字のドツトパターンを
示す図、第８図は従来のドツトパターン格納方法
により第６図をメモリに格納した状態を示す図、
第９図は罫線文字の代表的ドツトパターンを示す
図である。 １…CPU、２…ROM、３…RAM、４…Ｉ／
Ｏドライバ、５…バスライン。
Claims (1)
- １ 罫線文字のドツトパターンを同一パターンの
繰り返しからなる規則性を有する下部領域と残り
の上部領域とに所定の行を境界として上下に分割
し、該上部領域のドツトパターンを印字情報とし
てそのままメモリに格納し、一方、前記下部領域
のドツトパターンを前記規則性を示すコードに各
横ビツト列毎に変換し、該変換して得たコードを
前記格納した印字情報と対応させて前記メモリに
格納することを特徴とするドツトプリンタのドツ
トパターン格納方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60199561A JPS6260656A (ja) | 1985-09-11 | 1985-09-11 | ドットプリンタのドットパターン格納方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60199561A JPS6260656A (ja) | 1985-09-11 | 1985-09-11 | ドットプリンタのドットパターン格納方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6260656A JPS6260656A (ja) | 1987-03-17 |
| JPH053839B2 true JPH053839B2 (ja) | 1993-01-18 |
Family
ID=16409872
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60199561A Granted JPS6260656A (ja) | 1985-09-11 | 1985-09-11 | ドットプリンタのドットパターン格納方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6260656A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58107370A (ja) * | 1981-12-21 | 1983-06-27 | インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション | 圧縮文字再構成方法 |
-
1985
- 1985-09-11 JP JP60199561A patent/JPS6260656A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58107370A (ja) * | 1981-12-21 | 1983-06-27 | インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション | 圧縮文字再構成方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6260656A (ja) | 1987-03-17 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |