JPH05324342A - プログラムロード方法 - Google Patents
プログラムロード方法Info
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- JPH05324342A JPH05324342A JP4123699A JP12369992A JPH05324342A JP H05324342 A JPH05324342 A JP H05324342A JP 4123699 A JP4123699 A JP 4123699A JP 12369992 A JP12369992 A JP 12369992A JP H05324342 A JPH05324342 A JP H05324342A
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- system control
- control unit
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Abstract
に対して行う初期プログラムのロード時間を短縮し、シ
ステム効率を向上する。 【構成】システム制御部１はワークステーション３1 か
らＤＬＬ要求があると、初期プログラムを５つのブロッ
クに分割するとともにその各ブロックにロードアドレス
を付してプログラムブロックとしてワークステーション
に順次繰り返し送信する。各ワークステーション３1 〜
３3 はシステム制御部にＤＬＬ要求を送信した後のブロ
ックを受信する。そして５つのブロックが揃うとシステ
ム制御部にＤＬＬ完了を送信する。システム制御部は全
てのワークステーションからＤＬＬ完了を受信すると初
期プログラムのロード制御を終了する。
Description
数台のワークステーションに対してワークステーション
立ち上げのための初期プログラムの初期ロードを行う場
合のプログラムロード方法に関する。
ワークステーションが接続されたシステムにおいて、シ
ステム制御部から各ワークステーションに対してワーク
ステーション立ち上げのための初期プログラムの初期ロ
ードを行う場合は、ある１台のワークステーションの電
源が立ち上げられると、そのワークステーションのＲＯ
Ｍ等の不揮発性メモリに格納されている初期プログラム
によりシステム制御部にダウン・ライン・ロード（以
下、ＤＬＬと称する。）要求を送信する。これによりシ
ステム制御部は図８に示すように、初期プログラムを複
数のブロックに分割してプログラムブロックとして対応
するワークステーションに順次送信する。そしてワーク
ステーションでは初期プログラムを構成するすべてのプ
ログラムブロックを受信するとシステム制御部に対して
ＤＬＬ完了を送信する。以降ワークステーションでは受
信した初期プログラムによって動作を開始するようにな
っている。
ムロードを行っている最中に他のワークステーションの
電源が立ち上げられてシステム制御部にＤＬＬ要求があ
ると、システム制御部はプログラムロードを行っている
最中のワークステーションに対するプログラムロードが
完了した後に他のワークステーションに対するプログラ
ムロードを開始し、前記同様、すなわち図８に示すプロ
グラムロード処理を行うようになっている。
部は各ワークステーションに対して電源が立ち上げられ
た順番にワークステーション毎にプログラムロードを行
う方法であった。
グラムロード方法では、１台のワークステーションに対
してプログラムロード時間がＴ時間かかるとｍ台のワー
クステーションではＴ×ｍ時間かかることになり、シス
テム制御部がプログラムロードのために使用する時間が
長くなる問題があった。このことはシステム制御部によ
って動作する業務がある場合には、その業務の遅延を招
き機能が低下することになる。
ンが使用する初期プログラムが格納されているメモリ領
域についてもワークステーションに対するプログラムロ
ードを行っている期間は使用できなくなるため、システ
ム制御部で動作している他の業務の遅延を防止するには
別のメモリ領域を使用して動作しなければならなくな
り、その結果メモリ容量不足による機能低下も招く虞が
あった。
のワークステーションに対して行う初期プログラムのロ
ード時間を短縮でき、これによりシステム制御部により
動作される業務の遅延を極力防止してシステム効率を向
上できるプログラムロード方法を提供しようとするもの
である。
ム制御部から複数台のワークステーションに対してワー
クステーション立ち上げのための初期プログラムの初期
ロードを行う場合に、システム制御部は、各ワークステ
ーションの少なくとも１つからプログラムロード要求が
あると、初期プログラムを複数のブロックに分割すると
ともにその各ブロックに識別情報を付してプログラムブ
ロックとして各ワークステーションに順次繰り返し送信
し、すべてのワークステーションからプログラムロード
完了を受信するとプログラムブロックの送信を終了し、
各ワークステーションは、システム制御部にプログラム
ロード要求を送信した後、そのシステム制御部からのプ
ログラムブロックを順次受信してメモリに展開し、受信
すべき初期プログラムの全てのブロックが揃ったときシ
ステム制御部にプログラムロード完了を送信することに
ある。
テーションに対してプログラムロードを行っている最中
に他のワークステーションからプログラムロード要求が
あるとシステム制御部はあるワークステーションととも
に他のワークステーションに対してもプログラムブロッ
クの送信を行い、各ワークステーションはそのプログラ
ムブロックを受信するとそのブロックに付された識別情
報によりどのブロックか判断する。こうして各ワークス
テーションではどのプログラムブロックを受信してもブ
ロックの区別ができるのですべてのプログラムブロック
が揃ったときシステム制御部にプログラムロード完了を
送信する。
する。
システム制御部１に制御線２を介して複数台のワークス
テーション３1 ，３2 ，３3 ，…が接続されている。前
記システム制御部１にはハードディスク装置やフロッピ
ディスク装置等の補助記憶装置４が接続されている。こ
の補助記憶装置４には前記システム制御部１が各ワーク
ステーション３1 ，…にロードすべき初期プログラム等
が格納されている。
に、制御部本体を構成するＣＰＵ（中央処理装置）１
１、このＣＰＵ１１が各種制御を行うためのプログラム
データが格納されたＲＯＭ（リード・オンリー・メモ
リ）１２、データ処理のための各種メモリや前記各ワー
クステーション３1 ，…を管理するための情報を格納す
るメモリ等が設けられたＲＡＭ（ランダム・アクセス・
メモリ）１３及び前記各ワークステーション３1 ，…と
データの送受信制御を行うインターフェース１４等で構
成されている。ワークステーションの管理情報としては
例えばワークステーションの台数やワークステーション
の状態等がある。
に示すように、制御部本体を構成するＣＰＵ（中央処理
装置）３１、このＣＰＵ３１がプログラ初期制御を行う
ための初期プログラムや各種制御を行うためのプログラ
ムデータが格納されたＲＯＭ（リード・オンリー・メモ
リ）３２、データ処理のための各種メモリが設けられた
ＲＡＭ（ランダム・アクセス・メモリ）３３、キーボー
ド３４を制御するキーボードコントローラ３５、ＣＲＴ
ディスプレイ３６を制御するＣＲＴコントローラ３７及
び前記システム制御部１とデータの送受信制御を行うイ
ンターフェース３８等で構成されている。
４に示す初期プログラムロード制御を行うようにプログ
ラム設定されている。先ずＤＬＬ要求の受信待ちとな
り、ＲＡＭ１３内に設けられたファイルポインタを
「０」にする。そして前記補助記憶装置４から初期ロー
ドすべき初期プログラムの一定の長さ分、すなわち１ブ
ロック分を読み出し、そのブロックがロードされるべき
アドレスを付加する。
レベル・データ・リンク・コントロール）手順情報を付
加する。こうして図６に示すような情報フレームが作成
される。この情報フレームは、フラグＦ、すべてのワー
クステーションを対象にしたアドレスＡ、制御フィール
ドＣ、初期プログラムの１ブロックの長さＬを示す情報
（２バイト）、識別情報である４バイト構成の１ブロッ
ク分の初期プログラムのロードアドレスＡＤＤＲ、１ブ
ロック分の初期プログラムＩ、フィールドチェックシー
ケンスＦＣＳ、フラグＦによって構成されている。
クステ−ション３1 ，…からのＤＬＬ要求の受信、ＤＬ
Ｌ完了の受信をチェックし、ＤＬＬ要求の受信があれ
ば、またＤＬＬ完了の受信が無ければ、再度前記補助記
憶装置４から初期ロードすべき初期プログラムの一定の
長さ分を読み出し、そのブロックがロードされるべきア
ドレスを付加して次のブロックの送信のための処理を行
う。またＤＬＬ完了の受信があってもそれが最後のワー
クステーションからのＤＬＬ完了の受信で無ければ再度
前記補助記憶装置４から初期ロードすべき初期プログラ
ムの一定の長さ分を読み出し、そのブロックがロードさ
れるべきアドレスを付加して次のブロックの送信のため
の処理を行う。
ークステーションからのＤＬＬ完了の受信であればこの
制御を終了する。
Ｕ３１は図５に示す初期プログラムロード時の受信制御
を行うようにプログラム設定されている。先ず前記シス
テム制御部１に対してＤＬＬ要求を送信する。そして前
記システム制御部１からのブロックを受信し、ＲＡＭ３
３に展開する。そして全てのブロックについて受信が完
了したか否かをチェックし、受信が完了していなければ
次のブロックの受信を行い、また全てのブロックについ
て受信が完了していれば前記システム制御部１に対して
ＤＬＬ完了を送信してこの制御を終了する。
て述べる。
ステーション３1 ，３2 ，３3 に初期プログラムを５ブ
ロックに分割して送信する場合について述べる。今ワー
クステーション３1 からＤＬＬ要求があると、システム
制御部１は図７に示すように１番目のブロックをＨＤＬ
Ｃ手順の情報フレームとして送信する。この１番目のブ
ロックはワークステーション３1 により受信されＲＡＭ
１３に展開される。このとき付加されているロードアド
レスＡＤＤＲに基づいてメモリ領域の所定の位置に展開
される。
クを送信する。この２番目のブロックはワークステーシ
ョン３1 により受信されＲＡＭ１３に展開される。この
ときも付加されているロードアドレスＡＤＤＲに基づい
てメモリ領域の所定の位置に展開される。
ＬＬ要求が送信される。システム制御部１は次のブロッ
クである３番目のブロックを送信する。この３番目のブ
ロックはワークステーション３1 及び３2 により受信さ
れＲＡＭ１３に展開される。このときも付加されている
ロードアドレスＡＤＤＲに基づいてメモリ領域の所定の
位置に展開される。
クを送信する。この４番目のブロックはワークステーシ
ョン３1 及び３2 により受信されＲＡＭ１３に展開され
る。このときも付加されているロードアドレスＡＤＤＲ
に基づいてメモリ領域の所定の位置に展開される。
ＬＬ要求が送信される。システム制御部１は次のブロッ
クである５番目のブロックを送信する。この５番目のブ
ロックはワークステーション３1 ，３2 及び３3 により
受信されＲＡＭ１３に展開される。このときも付加され
ているロードアドレスＡＤＤＲに基づいてメモリ領域の
所定の位置に展開される。
ークステーション３1 は全てのブロックを受信したこと
になるのでワークステーション３1 からシステム制御部
１にＤＬＬ完了が送信される。
いて再度１番目のブロックを送信する。この１番目のブ
ロックはワークステーション３2 及び３3 により受信さ
れＲＡＭ１３に展開される。このときも付加されている
ロードアドレスＡＤＤＲに基づいてメモリ領域の所定の
位置に展開される。
クを送信する。この２番目のブロックはワークステーシ
ョン３2 及び３3 により受信されＲＡＭ１３に展開され
る。このときも付加されているロードアドレスＡＤＤＲ
に基づいてメモリ領域の所定の位置に展開される。
ークステーション３2 は全てのブロックを受信したこと
になるのでワークステーション３2 からシステム制御部
１にＤＬＬ完了が送信される。
クを送信する。この３番目のブロックはワークステーシ
ョン３3 により受信されＲＡＭ１３に展開される。この
ときも付加されているロードアドレスＡＤＤＲに基づい
てメモリ領域の所定の位置に展開される。
クを送信する。この４番目のブロックはワークステーシ
ョン３3 により受信されＲＡＭ１３に展開される。この
ときも付加されているロードアドレスＡＤＤＲに基づい
てメモリ領域の所定の位置に展開される。
ークステーション３3 は全てのブロックを受信したこと
になるのでワークステーション３3 からシステム制御部
１にＤＬＬ完了が送信される。
，３3 の全てからＤＬＬ完了を受信することによりシ
ステム制御部１は各ワークステーションへの初期プログ
ラムの送信制御を終了する。
うことによりシステム制御部１は合計９ブロックの送信
で制御を終了することができ、時間の短縮化を図ること
ができる。この点従来の送信制御では１５ブロック送信
しなければならなくなり時間がかかる。
務があっても初期プログラムの送信制御による遅延時間
が減少するので、機能低下を極力防止することができ、
システム効率を向上できる。
ステム制御部が複数台のワークステーションに対して行
う初期プログラムのロード時間を短縮でき、これにより
システム制御部により動作される業務の遅延を極力防止
してシステム効率を向上できるプログラムロード方法を
提供できるものである。
ク図。
ロック図。
ログラムのロード制御を示す流れ図。
期プログラムの受信制御を示す流れ図。
る情報フレームの構成を示す図。
ケンスを示す図。
す図。
ン。
Claims (1)
- 【請求項１】 システム制御部から複数台のワークステ
ーションに対してワークステーション立ち上げのための
初期プログラムの初期ロードを行う場合に、 前記システム制御部は、前記各ワークステーションの少
なくとも１つからプログラムロード要求があると、初期
プログラムを複数のブロックに分割するとともにその各
ブロックに識別情報を付してプログラムブロックとして
前記各ワークステーションに順次繰り返し送信し、すべ
てのワークステーションからプログラムロード完了を受
信するとプログラムブロックの送信を終了し、 前記各ワークステーションは、前記システム制御部にプ
ログラムロード要求を送信した後、そのシステム制御部
からのプログラムブロックを順次受信してメモリに展開
し、受信すべき初期プログラムの全てのブロックが揃っ
たとき前記システム制御部にプログラムロード完了を送
信することを特徴とするプログラムロード方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4123699A JPH05324342A (ja) | 1992-05-15 | 1992-05-15 | プログラムロード方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4123699A JPH05324342A (ja) | 1992-05-15 | 1992-05-15 | プログラムロード方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05324342A true JPH05324342A (ja) | 1993-12-07 |
Family
ID=14867155
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4123699A Pending JPH05324342A (ja) | 1992-05-15 | 1992-05-15 | プログラムロード方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05324342A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002116932A (ja) * | 2000-10-05 | 2002-04-19 | Sanyo Electric Co Ltd | データ配信方法 |
| JP2019008449A (ja) * | 2017-06-22 | 2019-01-17 | コニカミノルタ株式会社 | 画像形成装置の管理装置、画像形成装置の管理方法、画像形成装置管理用プログラム、および、画像形成システム |
-
1992
- 1992-05-15 JP JP4123699A patent/JPH05324342A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002116932A (ja) * | 2000-10-05 | 2002-04-19 | Sanyo Electric Co Ltd | データ配信方法 |
| JP4623810B2 (ja) * | 2000-10-05 | 2011-02-02 | 三洋電機株式会社 | データ配信方法 |
| JP2019008449A (ja) * | 2017-06-22 | 2019-01-17 | コニカミノルタ株式会社 | 画像形成装置の管理装置、画像形成装置の管理方法、画像形成装置管理用プログラム、および、画像形成システム |
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Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20071030 |
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Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20071227 |
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Effective date: 20080617 Free format text: JAPANESE INTERMEDIATE CODE: A02 |
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