JPH05185631A - 感熱プリンタヘッドに制御データを伝達するための方法 - Google Patents

感熱プリンタヘッドに制御データを伝達するための方法

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JPH05185631A
JPH05185631A JP20590192A JP20590192A JPH05185631A JP H05185631 A JPH05185631 A JP H05185631A JP 20590192 A JP20590192 A JP 20590192A JP 20590192 A JP20590192 A JP 20590192A JP H05185631 A JPH05185631 A JP H05185631A
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JP20590192A
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Andrzei Treibisz
アンジェイ・トライビス
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Vodafone GmbH
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Mannesmann AG
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    • B—PERFORMING OPERATIONS; TRANSPORTING
    • B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
    • B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
    • B41J5/00—Devices or arrangements for controlling character selection
    • B41J5/30—Character or syllable selection controlled by recorded information
    • B—PERFORMING OPERATIONS; TRANSPORTING
    • B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
    • B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
    • B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
    • B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
    • B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
    • B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
    • B41J2/355—Control circuits for heating-element selection

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  • Electronic Switches (AREA)

Abstract

(57)【要約】 【目的】 感熱プリンタヘッドの加熱素子における熱蓄
積による悪影響を防止するために、当該ドットが前のサ
イクルで加熱されたか、あるいは隣接するドットが加熱
されるかを考慮して制御信号を送る。このとき、この判
断をさせる回路をフレックスにし、かつ安価で応答速度
が速いものをつくる。 【構成】 感熱プリンタヘッドＴＤは加熱素子Ｒ1 …Ｒ
n を有する複数のセグメントＳｅｇ１…Ｓｅｇ４から成
る。各セグメントに１つのメモリＳＰ１…ＳＰ４が割当
てられる。中央制御装置ＺＳで形成される部分データＺ
０，Ｚ１，Ｚ２は１つのセグメントの制御中にメモリＳ
Ｐ１…ＳＰ４に書込まれる。印字のために使用可能にさ
れるセグメントＳｅｇ４のための全てのデータＺ０，Ｚ
１，Ｚ２がメモリから読出され制御回路に入力される。
環境観察が高度な場合でも部分パルスの全持続時間は中
央制御装置ＺＳからのデータ伝送に必要な時間より短
い。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は感熱プリンタヘッドに制
御データを伝達するための方法に関する。
【０００２】
【従来の技術】米国特許第４５７４２９３号明細書から
公知の方法においては、所与の印字データに従って画像
を感熱複写紙に印字するか（感熱複写）又は感熱リボン
を間に挟んで記録担体に印字する（熱転写記録）ため
に、感熱プリンタヘッドに制御データが伝達される。こ
の公知の方法では、多数の加熱素子を有するプリンタヘ
ッドが用いられる。なお加熱素子は複数のセグメントに
統合されることもある。
【０００３】セグメントは個別にサイクル的に順次に制
御される。なおこの明細書中で「セグメントが制御され
る」とは、セグメントの加熱素子が印刷動作をするよう
に制御されることを意味する。１つのセグメントのすべ
ての加熱素子は、その都度に個々の加熱素子に固有のそ
れぞれ１つの制御パルスにより制御される。それぞれの
加熱素子のための１つの制御パルスは、時間的に順次に
配列されている複数のパルス列から成る。同一の配置の
部分パルスは、１つのセグメントにおける対応する加熱
素子に同時に入力される。
【０００４】部分パルスを定めるために部分データは次
のようにして生成される。すなわち当該の加熱素子の印
字データから出発して、現行の印字サイクルのための隣
接の加熱素子の印字データ（隣接加熱素子の観察）と、
先行の印字サイクルにおける当該の加熱素子の印字デー
タ（当該加熱素子の前歴）とを、異なる重み付けをした
後に、パルス列の数及び時間的順序を定めるために用い
る。
【０００５】このようにして求められた部分データはシ
フトレジスタに入力される。それぞれの加熱素子のため
のそれぞれ第１の時間的順番の部分パルスに対応する部
分データがすべてシフトレジスタに入力された後に、こ
れらの部分データはバッファメモリに書込まれる。
【０００６】対応する加熱素子に割当られているそれぞ
れの部分データはＡＮＤゲートを介して使用可能回路の
使用可能パルスと論理結合され、これにより対応する加
熱素子に、使用可能パルス持続時間に対応する時間に第
１の部分パルスが入力される。
【０００７】それぞれ第１の時間的順番の部分パルスに
対応する部分データがすべてバッファメモリに書込まれ
ると、第２の時間的順番の部分データが前と同様にシフ
トレジスタに入力される。
【０００８】公知の方法においては、隣接加熱素子の観
察および当該加熱素子の前歴を考慮することが比較的コ
スト高の回路により行われ、熱蓄積の補償のために、こ
の回路を用いて対応するメモリ素子の中に記憶されてい
る補正データを呼び出す。
【０００９】従って公知の方法は比較的融通がきかな
い。何故ならば当該加熱素子の前歴観察および隣接加熱
素子の観察への重み付けを変えると、対応する変化がこ
の回路に対して行われなければならないからである。比
較的コスト高のこの回路により、公知の方法で動作する
プリンタは対応してコスト高になる。
【００１０】
【発明が解決しようとする課題】本発明の課題は、実施
するための回路技術的コストが非常に小さく、動作が迅
速であり、大きい融通性を有する、感熱プリンタヘッド
に制御データを伝達するための方法に関する。
【００１１】
【課題を解決するための手段】上記課題は、それぞれ複
数の加熱素子により形成されるセグメントがサイクル的
に順次に制御されることと、各サイクルにおいて個々の
加熱素子固有の制御パルスが、ある特定の時間的順番で
配列されているある特定の数の部分パルスにより形成さ
れることと、それぞれの加熱素子のための所与の印字デ
ータから出発して現行のサイクルにおいて、部分パルス
を定める部分データが中央制御装置により発生され、少
なくとも現行のサイクルのための隣接加熱素子の印字デ
ータと先行のサイクルにおけるそれぞれの加熱素子の印
字データは必ず考慮されることと、１つの制御パルス当
り最大の数の部分パルスより多い数の記憶域を有するそ
れぞれ１つのメモリがそれぞれのセグメントに割当られ
ることと、サイクル的にアドレス指定信号によりそれぞ
れのメモリのそれぞれ１つの記憶域が書込み可能な記憶
域としてアドレス指定され、１つの制御パルス当り部分
パルスの最大数に対応する数を有するそれぞれ残りの記
憶域が読出し可能な記憶域としてアドレス指定されるこ
とと、１つのセグメントの加熱素子を同時に制御するた
めに用いられる部分データが、１つのセグメントが制御
される間にほぼ書込まれることと、アドレス指定信号に
より少なくとも１つのセグメントを制御するためのすべ
ての部分データが、対応するメモリにおける読出し可能
な記憶域に現行のサイクルにおいて完全に記憶されるよ
うに、アドレス指定信号が制御されかつ部分データの発
生及び書込みが制御されることと、このメモリのそれぞ
れの部分データがデータ取出し信号により読出され、こ
のセグメントのための制御回路に入力されることとを特
徴とする感熱プリンタヘッドに制御データを伝達するた
めの方法により解決される。
【００１２】本発明の方法は、それぞれの加熱素子の高
度の環境観察を可能にする。
【００１３】本発明の方法では１つのセグメントの加熱
素子のための制御パルスの全持続時間が、中央制御装置
でデータが発生されてそれぞれのメモリに伝達されるた
めに必要な時間より短くすることができる。これによ
り、まだ伝達されていない制御データに起因する、印字
サイクル内の待機時間が回避される。
【００１４】部分データを読出すために同じ部分パルス
が、１つのセグメント加熱素子に必要な時間のために、
このセグメントのための後続の部分データが読出され制
御回路に送られる前に設けられていることが保証される
だけでよい。
【００１５】すなわち第１の時間的順番の部分データの
伝送の終了後に、直ちにこれらの部分データの伝送が開
始されることが可能であり、従ってこの場合にも部分パ
ルスの持続時間の独立性が与えられている。
【００１６】セグメントへの伝送のために設けられてい
る時間は、１つのセグメント当り６４０の加熱素子で伝
送速度が４ＭＨｚの場合に１６０μｓである。
【００１７】隣接加熱素子の観察及び当該加熱素子の前
歴の種類及び重み付けは、中央制御装置における対応す
るプログラミングにより簡単にかつ回路変更なしに変化
されることが可能である。
【００１８】本発明の方法の１つの有利な実施例に従っ
てそれぞれの制御パルスが前パルス，主パルス，後パル
スにより形成されれば、実際の上では十分であることが
分かった。当該加熱素子前歴及び隣接加熱素子観察に依
存する部分データに依存して制御パルスは、例えばまっ
たく部分パルスを有しないか又はただ１つの主パルスの
みを有することもある。
【００１９】本発明の印字速度及び回路技術的コストの
面で有利な１つの実施例では、４つのセグメントが形成
され、４つの記憶域を有するそれぞれ１つのメモリがそ
れぞれのセグメントのために設けられ、アドレス指定信
号により後続のサイクルのためのすべての部分データを
記憶することになるメモリのために、現行のサイクルの
ための部分データが読出されるまで、それのアドレス指
定が遅延される。これにより１つのサイクル当り３つの
アドレス指定信号を発生するだけでよく、その他の３つ
のメモリへのデータ伝送は第４のメモリの読出し前にす
でに行われていることが可能であり、これにより速度が
更に速まる。
【００２０】本発明の発生する制御信号のためのコスト
の面で有利な１つの別の実施例では、セグメントが、サ
イクル的に発生される使用可能信号により順次に制御さ
れ、使用可能信号が、アドレス指定信号を発生するため
に用いられる。
【００２１】部分データを発生するために必要な演算量
が減少されることと、これにより印字速度が上昇される
こととは、現行及び先行のサイクルのための隣接加熱素
子の印字データと、少なくとも２つの先行のサイクルに
おけるそれぞれの加熱素子とが、データが発生される際
に同一の重み付けで考慮されることにより実現されると
有利である。
【００２２】
【実施例】図１は、４つのセグメントＳｅｇ１，Ｓｅｇ
２，Ｓｅｇ３，Ｓｅｇ４に分割されている櫛状加熱素子
配列ＴＫを有するサーマルヘッドすなわち感熱プリンタ
ヘッドＴＤを示す。各セグメントは多数の加熱素子
Ｒ1 ．．．Ｒn を有する。加熱素子Ｒ1 ．．．Ｒn は１
本の直線に沿って配列されている。
【００２３】加熱素子Ｒ1 ．．．Ｒn は使用可能信号線
を介して中央制御装置ＺＳからの使用可能信号ＳＴＲ
１．．．ＳＴＲ４を入力されることが可能である。
【００２４】後述（図８）のように中央制御装置ＺＳ
は、当該の加熱素子Ｒ1 ．．．Ｒn の隣接加熱素子の観
察及び当該加熱素子の前歴により、前もって与えられて
いる印字データから部分データＤＡＴＡ１，２，３，４
を形成する。
【００２５】部分データＤＡＴＡ１，２，３，４は、セ
グメントＳｅｇ１．．．Ｓｅｇ４に割当られているメモ
リＳＰ１．．．ＳＰ４の記憶域にデータ線ＢＵＳ１を介
して書込まれる。
【００２６】メモリＳＰ１．．．ＳＰ４の個々の記憶域
はアドレス指定信号ＬＩにより書込み可能又は読出し可
能な記憶域としてアドレス指定される。
【００２７】中央制御装置ＺＳは制御信号Ｎ１及びＮ２
も出力する。一方では制御信号Ｎ１及びＮ２は使用可能
信号ＳＴＲ１．．．ＳＴＲ４の長さを制限する。
【００２８】他方では制御信号Ｎ１及びＮ２は論理結合
回路Ｖに入力され論理結合され、これによりデータ呼出
し信号ＬＡ１．．．ＬＡ４が出力され、それぞれのデー
タ呼出し信号ＬＡ１．．．ＬＡ４はそれぞれのメモリＳ
Ｐ１．．．ＳＰ４に入力され、これによりそれぞれのデ
ータ列ＤＡＴ１．．．ＤＡＴ４がそれぞれのメモリＳＰ
１．．．ＳＰ４から読出される。
【００２９】有利にはメモリＳＰ１．．．ＳＰ４は、ユ
ーザーによりプログラミングされることが可能なモジュ
ールＡＳ（いわゆるＡＳＩＣ）を有する。
【００３０】図２は、加熱素子Ｒ1 ．．．Ｒn と、それ
に対応する数の前置接続されているＡＮＤ素子
Ｇ1 ．．．Ｇn とを有する、感熱プリンタヘッドＴＤ
（図１）のセグメントＳｅｇ４を詳細に示す。
【００３１】それぞれのＡＮＤ素子Ｇ1 ．．．Ｇn の一
方の入力側には使用可能信号ＳＴＲ４が入力される。そ
れぞれのＡＮＤ素子Ｇ1 ．．．Ｇn の他方の入力側に
は、バッファメモリＺＳＰ出力側に接続されている。バ
ッファメモリＺＳＰの入力側は、直列入力並列出力変換
器としてのシフトレジスタＳＲの出力側に接続されてい
る。
【００３２】メモリーＳＰ４の記憶域（図３）の中に保
持されている、例えば図８の後パルスのための、ある配
置の部分データは、完全にシフトレジスタＳＲの中に読
込まれる。ここにおいてこの配置のデータは、同時にセ
グメントＳｅｇ４の加熱素子Ｒ1 ．．．Ｒn について出
力される部分パルスを表現するものである。
【００３３】転送命令信号が現れると、シフトレジスタ
ＳＲの中に保持されている部分データは並列出力として
バッファメモリＺＳＰに転送される。
【００３４】各加熱素子に対応して配置され、そしてバ
ッファメモリＺＳＰの中に読込まれた部分データに従
い、各加熱素子Ｒ1 ．．．Ｒn は、使用可能信号ＳＴＲ
４が現れると、ＡＮＤゲートにより部分パルスを得る。
【００３５】転送命令信号ＴＢにより、直ちにさらに、
セグメントＳｅｇ４に関係する高位の配置（例えば主イ
ンパルスのための配置）の部分データがシフトレジスタ
ＳＲに読込まれる。
【００３６】図３は、メモリＳＰ１．．．ＳＰ４（図
１）の構造をメモリＳＰ４を例にとって示す。
【００３７】最下位の記憶域である第１の記憶域ＳＰ４
−１は、１セグメント当りの加熱素子Ｒ1 ．．．Ｒn の
数ｎに対応する数ｎの記憶場所を有する。各記憶場所に
は、１つの加熱素子のための部分パルスに対応する部分
データが記憶される。
【００３８】記憶域ＳＰ４−１は、セグメントＳｅｇ４
のために同時に出力される部分パルスを表す部分データ
（すなわち順番が同一の部分データ）を書込むために使
われる。
【００３９】その他の３つの記憶域ＳＰ４−２．．．Ｓ
Ｐ４−４は、この時点で読出し可能な記憶域として使わ
れる。
【００４０】記憶域ＳＰ４−１．．．ＳＰ４−４は物理
的には同一なメモリＳＰ４の記憶領域である。すなわち
境界はポインターＰＴにより定められ、ポインターＰＴ
により書込み可能又は読出し可能が示される。
【００４１】アドレス信号が現れると、すでに読込まれ
ている部分データＺ２が記憶域ＳＰ４−１から記憶域Ｓ
Ｐ４−２に移され、同時に中央制御装置により使用可能
とされているデータＤＡＴＡ１，２，３，４の中に含ま
れている部分データＺ１が、セグメントＳｅｇ４のため
に記憶域ＳＰ４−１の中に読込まれる。
【００４２】実際上は、メモリＳＰ４の記憶域は同等な
ものであり、データの移送と（新しい）読込み記憶域Ｓ
Ｐ−１の設定はポインターＰＴを移動することによって
行われる。
【００４３】図４（Ａ）は、各セグメントＳｅｇ
１．．．Ｓｅｇ４の制御パルスを形成するために中央制
御装置ＺＳからその都度の環境観察に基づいて出力され
て待機状態にあるデータであるＤＡＴＡ１，２，３，４
の発生のタイムチャートを示す。
【００４４】ブロックとして表されているそれぞれのデ
ータＤＡＴＡ１，２，３，４の上部に各データブロック
に含まれている各セグメントＳｅｇ１．．．Ｓｅｇ４の
ための部分データが示されている。ここにおいて、Ｚ１
は前パルス用として使われる部分データ、Ｚ０は主パル
ス用として使われる部分データ、Ｚ２は後パルス用とし
て使われる部分データを示す。
【００４５】図４（Ｂ）〜図４（Ｅ）は使用可能信号Ｓ
ＴＲ１．．．ＳＴＲ４の時間変化の線図である。
【００４６】使用可能信号が送られている時間に当該セ
グメントに送られた制御信号に基づいて印刷が行われ
る。
【００４７】図４（Ｆ）は，図５に関連して詳述したア
ドレス指定信号ＬＩの出現のタイムチャートを示す。
【００４８】図４（Ｇ）及び図４（Ｈ）は、制御パルス
Ｎ１及びＮ２の時間変化を示す。制御信号Ｎ１及びＮ２
は一方では使用可能信号ＳＴＲ１．．．ＳＴＲ４の長さ
を制限し、他方ではデータ取出し信号ＬＡ１．．．ＬＡ
４（図１及び図５）を形成する。
【００４９】図５は、アドレス指定信号ＬＩが入力され
る都度に変化する、メモリＳＰ１．．．ＳＰ４の記憶域
ＳＰ１−１．．．ＳＰ１−４等の記憶内容を示す。
【００５０】印刷行の印字動作は、その都度のセグメン
トＳｅｇ４の制御により開始される。
【００５１】最初の印字行サイクルｍにおいて現れるア
ドレス指定信号はＬＩ１（ｍ）により示されている。た
だし印字行サイクルｍにおいては印字行ｍが印字され
る。
【００５２】第２のアドレス指定信号はＬＩ２（ｍ）に
より示される。
【００５３】第３のアドレス指定信号はＬＩ３（ｍ）に
より示される。
【００５４】ＬＩ（ｍ＋１）は次の印字行サイクルｍ＋
１に、ＬＩ（ｍ＋２）はその次の印字行サイクルｍ＋２
に、入力されるアドレス指定信号ＬＩ１又はＬＩ２又は
ＬＩ３を示す。
【００５５】図５において、部分データを示す記号にお
けるそれぞれの括弧（例えば（Ｚ１））は、次に続く印
字行ｍ＋１のための部分データを意味する。
【００５６】二重括弧（（Ｚ１））によりその次の印字
行ｍ＋２のための部分データが示される。
【００５７】図５は、印字動作がセグメントＳｅｇ４か
ら開始する様子を示す。
【００５８】セグメントＳｅｇ４の読出し可能な記憶域
ＳＰ４−２．．．ＳＰ４−４には印刷行ｍのためのそれ
ぞれ部分データＺ０、部分データＺ１、部分データＺ２
が記憶されている。
【００５９】これらの部分データは、順次にセグメント
Ｓｅｇ４における記憶域間で伝達され、図２との関連で
説明されたように必要に応じて部分パルスを発生する。
【００６０】後続のそれぞれのアドレス指定信号ＬＩ１
がそれぞれのメモリＳＰ１−ＳＰ４に入力されると、書
込み可能としてアドレス指定された記憶域に、部分パル
スの同時出力のために準備されている部分データが次の
ように書込まれる。
【００６１】すなわち、アドレス指定信号ＬＩに従って
（例えばメモリＳＰ３のＬＩ１に従って）、少なくとも
１つのメモリは少なくとも１つのセグメント（Ｓｅｇ
３）の制御のための全ての部分データを、その印字サイ
クルにおいて完全に含んでいるように書込まれる。
【００６２】図５において、この条件を満足するメモリ
が、部分データの横に垂直の短い線が付加されることに
より示されている。
【００６３】印字動作中に、メモリＳＰ３は後続の印字
行ｍ＋１のための後パルス用部分データＺ２を既に受取
っている。これは括弧（Ｚ２）により示されている。
【００６４】この時点で、メモリＳＰ４は、読出し可能
な記憶平面ＳＰ４−２にすでに記憶されている部分デー
タ（Ｚ２）の外に、後続の印字行ｍ＋１のための別の部
分データ（Ｚ１）をすでに受取っている。
【００６５】アドレス指定信号ＬＩ２が入力されると、
メモリＳＰ２はセグメントＳｅｇ２に出力される制御パ
ルスを形成するために必要なすべての部分データを記憶
する。
【００６６】次の印字行ｍ＋１のための部分データ（Ｚ
２）はメモリＳＰ２に書込まれ、同時に次の印字行ｍ＋
１のための部分データ（Ｚ１）及び（Ｚ０）はメモリＳ
Ｐ３及びＳＰ４に書込まれ、現行の印字行のための部分
データＺ０はメモリＳＰ１に書込まれる。
【００６７】後続のアドレス指定信号ＬＩ３が入力され
ると、メモリＳＰ１のみが、現行の印字行において最後
の制御するセグメントＳｅｇ１のためのすべての部分デ
ータを記憶する。
【００６８】これと同時にメモリＳＰ４は、後続の印字
行ｍ＋１のためのすべての部分データ（Ｚ０）から（Ｚ
２）までをすでに記憶している。
【００６９】後続のアドレス指定信号ＬＩ１（ｍ＋
１）、ＬＩ２（ｍ＋１）、ＬＩ３（ｍ＋１）が入力され
ると、後続の印字行ｍ＋１のための前述の動作が繰返さ
れる。
【００７０】図６は、データ取出し信号ＬＡ１．．．Ｌ
Ａ４に依存してメモリＳＰ１．．．ＳＰ４から出力され
るデータＤＡＴ１．．．ＤＡＴ４を示す。
【００７１】図５に関連して説明したように、アドレス
指定信号ＬＩ１（ｍ）が入力される前にメモリＳＰ４
は、セグメントＳｅｇ４を制御するために必要なすべて
の部分データＺ０からＺ２を記憶している（図５の第１
の行を参照）。
【００７２】印字サイクルｍにおける新しい印字行ｍが
開始される時に、先行の印字行ｍ−１の終了時点でデー
タ取出し信号ＬＡ４−Ｚ１によりメモリＳＰ４からシフ
トレジスタＳＲにすでに転送され、その後でバッファメ
モリＺＳＰに書込まれる。
【００７３】この書込みが終了するとすぐに別のデータ
取出し信号ＬＡ４−Ｚ０が入力されて、部分データが、
対応する記憶平面ＳＰ４−２（図５）から読出される。
【００７４】続いて、時間を節約するために、前パルス
と主パルスを規定する部分データＺ１およびＺ０を用い
てセグメントＳｅｇ４を制御している間に、後パルスを
規定する部分データＺ２がデータ取出し信号ＬＡ２−Ｚ
２を用いて読出される。
【００７５】セグメントＳｅｇ４のための順次に続くデ
ータ取出し信号ＬＡ４−Ｚ０．．．ＬＡ４−Ｚ２の間の
時間間隔は、シフトレジスタＳＲの入出力速度のみを考
慮するだけでよく、例えば１６０μｍでよい。
【００７６】従って前パルス、主パルス、後パルスの持
続時間は、中央制御装置ＺＳからユーザ素子ＡＳへのデ
ータ処理及び伝達に必要な時間より短く選択されること
が可能である。
【００７７】何故ならばこのようなデータ処理及び伝達
は、その都度に部分パルスが入力されている間に大部分
行われ、更に部分データ（例えばセグメントＳｅｇ４に
おいてＺ２）の一部は、セグメントＳｅｇ４の制御の間
に伝達されることが可能であるからである。
【００７８】セグメントＳｅｇ４に関連して説明した方
法と同様の方法で、それぞれのメモリＳＰ１．．．ＳＰ
３からそれぞれのセグメントＳｅｇ１．．．Ｓｅｇ３へ
のデータ伝達が行われる。
【００７９】図４の破線の矢印は、使用可能信号ＳＴＲ
４が出力されると、アドレス指定信号ＬＩ１（ｍ）又は
ＬＩ１（ｍ＋１）が出力されることが可能であることを
示す。
【００８０】この場合にはアドレス指定信号ＬＩ（ｍ）
又はＬＩ（ｍ＋１）の作用は、現行の印字サイクルｍの
ための最後の部分データ（例えばＺ２）が読出されるま
で、メモリＳＰ４のために単に遅延させることである。
【００８１】遅延アドレス指定信号の代りに、すべての
３つのアドレス指定信号ＬＩ１〜ＬＩ３が入力され、前
述の遅延アドレス指定信号の時に、メモリＳＰ４にのみ
に作用する付加的なアドレス指定信号が出力されること
も可能である。
【００８２】この場合には図１のメモリＳＰ４の代り
に、図７のメモリＳＰ４′が使用される。図７には、付
加的なアドレス指定信号により行われる、それぞれの部
分データのシフトを対応して補償する付加的な記憶域が
示されている。
【００８３】図８（Ａ）〜図８（Ｅ）は、それぞれの使
用可能信号ＳＴＲ１．．．ＳＴＲ４（図１）の構成と、
当該加熱素子の隣接加熱素子の観察及び当該加熱素子の
前歴から得られる、加熱素子固有の部分パルスの数及び
順序を示す。
【００８４】図４（Ｂ）〜図４（Ｅ）では簡単化のため
に図示されていないが、図８（Ａ）〜図８（Ｅ）のそれ
ぞれの使用可能信号ＳＴＲ１．．．ＳＴＲ４はそれぞれ
の３つの部分パルスすなわち前パルスＡ及び主パルスＢ
及び後パルスＣから成る。
【００８５】これらはそれぞれ部分データＺ１，Ｚ０，
Ｚ２に依存して作用するか又は抑圧される。
【００８６】図８（Ａ）〜図８（Ｅ）の環境観察におい
ては、当該の加熱素子Ｒi のための前もって与えられて
いる印字データから出発して、現行の印字行ｍ及び先行
の印字行ｍ−１における隣接加熱素子Ｒi+1 及びＲi-1
のためのデータと、２つの先行の印字行ｍ−１及びｍ−
２における隣接加熱素子Ｒi の印字データとが考慮され
る。
【００８７】先行の印字行ｍ−１及びｍ−２における印
字データの代りに、制御パルス長を定めるデータが用い
られることも可能である。
【００８８】図８（Ａ）は、現行の印字サイクルｍにて
当該の加熱素子Ｒi がドットを印字しないという簡単な
場合を示す。従って部分インパルスＡ，Ｂ，Ｃを規定す
る全ての部分データＺ１，Ｚ０，Ｚ２は、図２の論理結
合により制御インパルスが全く発生しないように設定さ
れる。
【００８９】図８（Ｂ）は、加熱素子Ｒi の回りの環境
により、先行のサイクルにおいても現行のサイクルにお
いてもドットを作らない場合を示す。部分データＺ１，
Ｚ０，Ｚ２が、部分パルスＡ，Ｂ，Ｃが付活されるよう
に設定される。
【００９０】図８（Ｃ）は当該の加熱素子Ｒi の環境の
種々の配置を示す。この配置は中央制御装置ＺＳで、部
分データＺ１とＺ０を作ることを導く。この配置はパル
スＡとＢを付活し、そしてこれにより、対応する前パル
スと主パルスを作る。
【００９１】図８（Ｄ）に示されている種々の配置は、
対応する態様で付活されている主パルス及び後パルスに
作用し、部分データＺ０とＺ２を作る。
【００９２】図８（Ｅ）は、主パルスのみが付活される
配置を示す。
【００９３】図８から、隣接加熱素子Ｒi+1 及びＲi-1
の観察と、当該の加熱素子Ｒi の前歴とが、本発明の方
法では中央制御装置ＺＳでの計算規模を減少するために
ほぼ等しく重み付けされることが分かる。
【図面の簡単な説明】
【図１】本発明の方法を実施するための回路装置であ
る。
【図２】図１の詳細図である。
【図３】図１の詳細図である。
【図４】本発明の方法との関連で発生され入力される信
号の線図である。
【図５】図１に示されているメモリのデータ内容であ
る。
【図６】本発明の方法との関連で発生され入力される信
号の線図である。
【図７】本発明の１つの変形に対応して図１の詳細が変
形されて示されている詳細図である。
【図８】図４（Ｂ）〜図４（Ｅ）に示されている信号の
配置を示す詳細図である。
【符号の説明】
ＢＵＳ１ データ線 Ｇ1 ．．．Ｇn ＡＮＤ素子 ＬＩ１，ＬＩ２，ＬＩ３ アドレス指定信号 ｍ サイクル Ｎ１，Ｎ２ 制御信号 ＰＴ ポインター Ｒ1 ．．．Ｒn 加熱素子 Ｓｅｇ１．．．Ｓｅｇ４ セグメント ＳＰ１．．．ＳＰ４ メモリ ＳＰ１−１．．．ＳＰ４−４ メモリＳＰ４の記憶域 ＳＲ シフトレジスタ ＳＴＲ１．．．ＳＴＲ４ 使用可能信号 ＴＢ 転送命令信号 ＴＤ 感熱プリンタヘッド ＴＫ 櫛状加熱素子配列 Ｖ 論理結合回路 ＺＳ 中央制御装置 ＺＳＰ バッファメモリ

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】 それぞれ複数の加熱素子（Ｒ1 ．．．Ｒ
    n ）により形成されるセグメント（Ｓｅｇ１．．．Ｓｅ
    ｇ４）がサイクル的に順次に制御されることと、各サイ
    クルにおいて個々の加熱素子固有のそれぞれ１つの制御
    パルスが、ある特定の時間的順番で配列されているある
    特定の数の部分パルス（Ａ，Ｂ，Ｃ）により形成される
    ことと、それぞれの加熱素子（Ｒi ）のための所与の印
    字データから出発して現行のサイクル（ｍ）において、
    部分パルス（Ａ，Ｂ，Ｃ）を定める部分データ（Ｚ１，
    Ｚ０，Ｚ２）が中央制御装置により発生され、少なくと
    も現行のサイクル（ｍ）のための隣接加熱素子
    （Ｒi+1 ；Ｒi-1 ）の印字データと先行のサイクル（ｍ
    −１）におけるそれぞれの加熱素子（Ｒi ）の印字デー
    タは必ず考慮されることと、１つの制御パルス当り最大
    の数の部分パルス（Ａ，Ｂ，Ｃ）より多い数の記憶域
    （ＳＰ１．．．ＳＰ４−４）を有するそれぞれ１つのメ
    モリ（ＳＰ１．．．ＳＰ４）がそれぞれのセグメント
    （Ｓｅｇ１．．．Ｓｅｇ４）に割当られることと、サイ
    クル的にアドレス指定信号（ＬＩ１（ｍ），ＬＩ２
    （ｍ），ＬＩ３（ｍ））によりそれぞれのメモリ（ＳＰ
    １．．．ＳＰ４）のそれぞれ１つの記憶域（ＳＰ
    １．．．ＳＰ４−４）が書込み可能な記憶域としてアド
    レス指定され、１つの制御パルス当りの部分パルスの最
    大数に対応する数を有するそれぞれ残りの記憶域（ＳＰ
    １−２．．．ＳＰ４−４）が読出し可能な記憶域として
    アドレス指定されることと、１つのセグメント（Ｓｅｇ
    １．．．Ｓｅｇ４）の加熱素子（Ｒ1 ．．．Ｒn ）を同
    時に制御するために用いられる部分データ（Ｚ１，Ｚ
    ０，Ｚ２）が、１つのセグメント（Ｓｅｇ４）が制御さ
    れる間にほぼ書込まれることと、アドレス指定信号（Ｌ
    Ｉ１（ｍ），ＬＩ２（ｍ），ＬＩ３（ｍ））により少な
    くとも１つのセグメント（Ｓｅｇ４）を制御するための
    すべての部分データ（Ｚ１，Ｚ０，Ｚ２）が、対応する
    メモリ（ＳＰ４）における読出し可能な記憶域（ＳＰ４
    −２．．．ＳＰ４−４）に現行のサイクル（ｍ）におい
    て完全に記憶されているように、アドレス指定信号（Ｌ
    Ｉ１（ｍ），ＬＩ２（ｍ），ＬＩ３（ｍ））が制御され
    かつ部分データ（Ｚ１，Ｚ０，Ｚ２）の発生及び書込み
    が制御されることと、このメモリ（ＳＰ４）のそれぞれ
    の記憶域（ＳＰ１．．．ＳＰ４−４）に記憶されている
    それぞれの部分データ（Ｚ１，Ｚ０，Ｚ２）がデータ取
    出し信号（ＬＡ４−Ｚ１，ＬＡ４−Ｚ０，ＬＡ４−Ｚ
    ２）により読出され、このセグメント（Ｓｅｇ４）のた
    めの制御回路に入力されることとを特徴とする感熱プリ
    ンタヘッドに制御データを伝達するための方法。
  2. 【請求項２】 それぞれの制御パルスが前パルス及び主
    パルス及び後パルス（Ａ，Ｂ，Ｃ）により形成されるこ
    とを特徴とする請求項１に記載の感熱プリンタヘッドに
    制御データを伝達するための方法。
  3. 【請求項３】 ４つのセグメント（Ｓｅｇ１．．．Ｓｅ
    ｇ４）が形成されることと、４つの記憶域を有するそれ
    ぞれ１つのメモリがそれぞれのセグメント（Ｓｅｇ
    １．．．Ｓｅｇ４）のために設けられることと、アドレ
    ス指定信号（ＬＩ３（ｍ））により後続のサイクル（ｍ
    ＋１）のためのすべての部分データ（Ｚ１，Ｚ０，Ｚ
    ２）をすべて記憶することになるメモリ（ＳＰ４）から
    現行のサイクル（ｍ）のためのこのメモリ（ＳＰ４）の
    部分データが読出されるまで、その都度のアドレス指定
    信号（ＬＩ３（ｍ））が遅延されることを特徴とする感
    熱プリンタヘッドに制御データを伝達するための方法。
  4. 【請求項４】 セグメント（Ｓｅｇ１．．．Ｓｅｇ４）
    が、サイクル的に発生される使用可能信号（ＳＴＲ
    １．．．ＳＴＲ４）により順次に制御されることと、使
    用可能信号（ＳＴＲ１．．．ＳＴＲ４）が、アドレス指
    定信号（ＬＩ１（ｍ），ＬＩ２（ｍ），ＬＩ２（ｍ））
    を発生するために用いられることとを特徴とする請求項
    １から請求項３のうちのいずれか１つの請求項に記載の
    感熱プリンタヘッドに制御データを伝達するための方
    法。
  5. 【請求項５】 現行のサイクル（ｍ）及び先行のサイク
    ル（ｍ−１）のための隣接加熱素子（Ｒi+1 ；Ｒi-1 ）
    の印字データと、その都度の加熱素子（ｍ−１）の印字
    データとが、少なくとも２つの先行のサイクル（ｍ−
    １；ｍ−２）においては部分データ（Ｚ１，Ｚ０，Ｚ
    ２）の発生において同一の重み付けされることを特徴と
    する請求項１から請求項４のうちのいずれか１つの請求
    項に記載の感熱プリンタヘッドに制御データを伝達する
    ための方法。
JP20590192A 1991-07-11 1992-07-09 感熱プリンタヘッドに制御データを伝達するための方法 Pending JPH05185631A (ja)

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DE4123221A1 (de) 1993-01-21

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