JPH0514914B2 - - Google Patents

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JPH0514914B2
JPH0514914B2 JP58107166A JP10716683A JPH0514914B2 JP H0514914 B2 JPH0514914 B2 JP H0514914B2 JP 58107166 A JP58107166 A JP 58107166A JP 10716683 A JP10716683 A JP 10716683A JP H0514914 B2 JPH0514914 B2 JP H0514914B2
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JP
Japan
Prior art keywords
display
bus line
pixel
display device
display medium
Prior art date
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Expired - Lifetime
Application number
JP58107166A
Other languages
English (en)
Other versions
JPS59232386A (ja
Inventor
Yasushi Ookawa
Kenichi Oki
Hiroyuki Gondo
Kazuhiro Takahara
Terunobu Miura
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP10716683A priority Critical patent/JPS59232386A/ja
Publication of JPS59232386A publication Critical patent/JPS59232386A/ja
Publication of JPH0514914B2 publication Critical patent/JPH0514914B2/ja
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  • Devices For Indicating Variable Information By Combining Individual Elements (AREA)

Description

【発明の詳細な説明】 (a) 発明の技術分野 本発明は表示装置、特に効果的に冗長性が与え
られて信頼度及び歩留の向上が達成されるアクテ
イブマトリクス形表示装置に関する。
(b) 従来技術と問題点 図形、文字等を一時的に可視像で表示する表示
装置において、マトリクス状に配設された表示媒
体を選択して発光などの表示状態とする方式が多
く行なわれている。この表示媒体の選択は例えば
エレクトロルミネセンス、プラズマデイスプレ
イ、液晶或いは発光ダイオードなどの素子を用い
る平板形表示装置においては、選択される表示媒
体を含む行及び列のバスラインを選択することに
よつて行なわれる。
前記の表示装置において、各画素の表示媒体を
駆動するために必要な電子回路等を行又は列を単
位として設けることは回路の合理化などのために
有利であり広く行なわれている。
しかしながら表示媒体と、スイツチ、メモリー
等の機能をもつその駆動回路とを一体化して各画
素領域に配設するアクテイブマトリクス形表示装
置は表示規模の拡大、信頼度向上などに有利であ
る。
従来のアクテイブマトリクス形表示装置は一般
に、第1図に示す如く各表示媒体Em,nを枡目
状に配置し、データラインDmとスキヤンライン
Snとの組合せによつて表示媒体が選択される。
この構造においては、ある表示媒体の駆動回路に
障害が発生すればその表示媒体は発光等が行なわ
れず、またバスラインの障害によつてその行又は
列の画素の表示が不可能となる。
この様な障害発生による表示信頼度の低下は、
例えば画素を更に微細化して同一の図形をより多
くの画素によつて表示するならば、障害画素の影
響を軽減することが可能である。しかしながらこ
の方法によつて図形表示本来の必要限度以上に画
素を微細化することは、システム全体にその取扱
う情報量の冗長な拡大を強いることとなる。
表示装置に発生する前記の如き障害に対処する
信頼度向上の手段としては、敢てシステム全体に
負担を強いることなく、表示装置のみで実施可能
な方法が望ましい。
(c) 発明の目的 本発明はアクテイブマトリクス表示装置に関し
て、該表示装置の表示媒体及びバスライン等に発
生する障害の表示画質に対する影響を効果的に軽
減して実用上支障を認めない表示装置を提供する
ことを目的とする。
(d) 発明の構成 本発明の前記目的は、マトクリス状に配設され
表示図形の画素を形成する表示媒体が、各表示媒
体の近傍に配設されてなる駆動回路を介して、デ
ータバスラインおよびスキヤンバスラインに接続
され、該データバスラインと該スキヤンバスライ
ンの組合せによつて、該表示媒体が選択されるア
クテイブマトリクス形表示装置において、一画素
を形成する表示媒体が互いにかみ合わせた複数個
の画素単位からなり、同一表示媒体を構成する画
素単位がそれぞれ駆動回路を介して、別系統のデ
ータバスラインおよびスキヤンバスラインに接続
され、該画素単位毎に選択可能なよう構成されて
なる表示装置により達成される。
(e) 発明の実施例 以下本発明を実施例により図面を参照して具体
的に説明する。
マトリクス状に表示媒体を配設した表示装置に
おいて、各表示媒体を例えば2個の同時に選択さ
れる画素単位に分割して、一方の画素単位又は一
方のラインのデータアドレス回路に障害が発生し
た場合にも、残る一方の画素単位によつて表示機
能を実用上支障なく逐行することによつて、該表
示装置の信頼度を向上することができる。
第2図はこの様に2個の画素単位の組合わせを
1つの表示媒体とするアクテイブマトリクス形表
示装置の画素単位の配置の例を示す平面図であ
る。図において、E1(m,n),E2(m,n),E1
(m+1,n),E2(m+1,n),E1(m+2,n),E2
(m+2,n)はそれぞれ画素単位であり、隣接す
る2画素単位例えばE1(m,n)とE2(m,n)
との組合わせを1つの表示媒体Em,nとして取
扱う。また例えば画素単位(m,n)はデータラ
インD1,mとスキヤンラインS1,nによつてア
ドレスされ、画素単位E2(m,n)はデータライ
ンD2,mとスキヤンラインS2,nによつてアド
レスされるなど、1つの表示媒体Em,nを構成
する2個の画素単位は相互に異なるバスラインに
より同時に選択される。この様に構成された各画
素単位に表示領域1がそれぞれ設けられている。
上記の如き構造によつて信頼度が向上される
が、第2図の例において例えば画素単位E1(m,
n),E2(m+1,n)及びE1(m+2,n)に障害が
発生して発光せず、画素単位E2(m,n),E1
(m+1,n)及びE2(m+2,n)が正常に動作する
場合には、直線であるべき表示に歪みを生ずる。
すなわち1つの表示媒体を2個の画素単位の組合
わせとして表示装置の信頼性を向上する目的に対
して第2図の如き構造では効果が未だ不十分であ
る。
第3図は上記の不備を改善した本発明の実施例
を示す平面図である。
図において、E1(m,n),E2(m,n),E1
(m+1,n)及びE2(m+1,n)はそれぞれ画素単
位であり、E1(m,n)とE2(m,n),E1(m+1
n)とE2(m+1,n)はそれぞれ1つの画素を形
成する組合わせである。また1組の画素単位は前
記例と同様に相互に異なるバスラインにより同時
に選択される。
本実施例においては、前記例とは異なり、表示
領域11は同一表示媒体を構成する組合わせにつ
いて相互にかみ合つた形状とされており、更にこ
の表示領域11の相互間の間隔或いは多くの部分
の幅等が200乃至100〔μm〕程度とされている。
表示装置11が上記の如く設けられることによ
つて、本来の動作である同一画素を構成する画素
単位がすべて表示状態となる場合に画素単位が分
離して見えることなく、また画素単位に前記例の
如き障害が発生した場合に直線が歪んで見える等
のこともない。
更に先に述べた如く、例えば画素単位E1(m,
n)はデータラインD1,mとスキヤンラインS1
n、画素単位E2(m,n)はデータラインD2,m
とスキヤンラインS2,nによつて同時にアドレス
されるために、何れかのバスラインに障害が発生
した場合にも他の系統が正常に動作すれば視覚上
正常な表示が行なわれる。
以上説明した本発明による表示領域の構造は、
本来アクテイブマトリクス形表示装置に限らずマ
トリクス形表示装置全般について効果を有する
が、本発明の効果を十分に得るためにはアクテイ
ブマトリクス形とすることが望ましい。
(f) 発明の効果 以上説明した如く本発明によれば、マトリクス
形表示装置特にアクテイブマトリクス形表示装置
に対して冗長性が極めて効果的に与えられて、信
頼度及び歩留りの向上を達成することができる。
【図面の簡単な説明】
第1図はマトリクス形表示装置の例を示す要部
平面図、第2図は各表示媒体を画素単位の組合せ
により構成するアクテイブマトリクス表示装置の
要部平面図、第3図は本発明の実施例の要部平面
図である。 図において、E1(m,n),E2(m,n)等は画
素単位、D1,m,D2,m等はデータライン、S1
n,S2,n等はスキヤンライン、1及び11は表
示領域を示す。

Claims (1)

  1. 【特許請求の範囲】 1 マトリクス状に配設され表示図形の画素を形
    成する表示媒体が、各表示媒体の近傍に配設され
    てなる駆動回路を介して、データバスラインおよ
    びスキヤンバスラインに接続され、該データバス
    ラインと該スキヤンバスラインの組合せによつ
    て、該表示媒体が選択されるアクテイブマトリク
    ス形表示装置において、 一画素を形成する表示媒体が互いにかみ合わせ
    た複数個の画素単位からなり、同一表示媒体を構
    成する画素単位がそれぞれ駆動回路を介して、別
    系統のデータバスラインおよびスキヤンバスライ
    ンに接続され、該画素単位毎に選択可能なよう構
    成されてなることを特徴とする表示装置。
JP10716683A 1983-06-15 1983-06-15 表示装置 Granted JPS59232386A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP10716683A JPS59232386A (ja) 1983-06-15 1983-06-15 表示装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP10716683A JPS59232386A (ja) 1983-06-15 1983-06-15 表示装置

Publications (2)

Publication Number Publication Date
JPS59232386A JPS59232386A (ja) 1984-12-27
JPH0514914B2 true JPH0514914B2 (ja) 1993-02-26

Family

ID=14452154

Family Applications (1)

Application Number Title Priority Date Filing Date
JP10716683A Granted JPS59232386A (ja) 1983-06-15 1983-06-15 表示装置

Country Status (1)

Country Link
JP (1) JPS59232386A (ja)

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5677887A (en) * 1979-11-30 1981-06-26 Citizen Watch Co Ltd Liquid crystal display unit

Family Cites Families (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6030775Y2 (ja) * 1979-03-30 1985-09-14 シャープ株式会社 マトリックス型液晶表示装置の電極構造

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5677887A (en) * 1979-11-30 1981-06-26 Citizen Watch Co Ltd Liquid crystal display unit

Also Published As

Publication number Publication date
JPS59232386A (ja) 1984-12-27

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