JPH05113838A - 接続装置 - Google Patents
接続装置Info
- Publication number
- JPH05113838A JPH05113838A JP30276691A JP30276691A JPH05113838A JP H05113838 A JPH05113838 A JP H05113838A JP 30276691 A JP30276691 A JP 30276691A JP 30276691 A JP30276691 A JP 30276691A JP H05113838 A JPH05113838 A JP H05113838A
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- Japan
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- data
- parallel
- serial data
- signal
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- Pending
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Abstract
(57)【要約】
【目的】 各パラレルインタフェースの接続動作状態を
高速に制御できる。 【構成】 接続手段（接続装置本体１）が複数のパラレ
ル入力と複数のパラレル出力の１つとを接続してデータ
バス上のパラレルデータの送受信待機中に、シリアルデ
ータ受信回路６０がデータバスの任意のデータラインを
介して送受信されるシリアルデータを検出して接続装置
本体１の接続動作状態を制御する構成を特徴とする。
高速に制御できる。 【構成】 接続手段（接続装置本体１）が複数のパラレ
ル入力と複数のパラレル出力の１つとを接続してデータ
バス上のパラレルデータの送受信待機中に、シリアルデ
ータ受信回路６０がデータバスの任意のデータラインを
介して送受信されるシリアルデータを検出して接続装置
本体１の接続動作状態を制御する構成を特徴とする。
Description
【０００１】
【産業上の利用分野】本発明は、セントロニクインタフ
ェース等のパラレルインタフェースの接続装置に関する
ものである。
ェース等のパラレルインタフェースの接続装置に関する
ものである。
【０００２】
【従来の技術】従来、この種の装置においては、自動も
しくは手動により入力から出力へデータの転送経路が確
立され、データ転送が行われる。データ転送が終了した
とき転送経路を切断しなければならないが、接続装置は
通常コマンドを解析する手段を持たないので、手動で切
断するか、データが一定時間途切れたら転送の終了と見
なして切断していた。
しくは手動により入力から出力へデータの転送経路が確
立され、データ転送が行われる。データ転送が終了した
とき転送経路を切断しなければならないが、接続装置は
通常コマンドを解析する手段を持たないので、手動で切
断するか、データが一定時間途切れたら転送の終了と見
なして切断していた。
【０００３】
【発明が解決しようとする課題】しかしながら、手動切
換えでは接続装置のところまで行かねばならないし、一
定の時間途切れたら切断する方式では、実際のデータ転
送の終了から必ず一定の時間待たされることになる。ま
た、処理の関係によりデータが途切れた場合、切断が起
きて他の入力に接続が移ってしまう問題点があった。
換えでは接続装置のところまで行かねばならないし、一
定の時間途切れたら切断する方式では、実際のデータ転
送の終了から必ず一定の時間待たされることになる。ま
た、処理の関係によりデータが途切れた場合、切断が起
きて他の入力に接続が移ってしまう問題点があった。
【０００４】本発明は、上記の問題点を解決するために
なされたもので、複数のパラレルインタフェースを接続
可能な接続装置において、１つのパラレルインタフェー
スが接続された状態で、パラレルデータの送受信待機中
にライン上でシリアルデータを送受信可能とすることに
より、接続された各パラレルインタフェースのデータ転
送終了状態を検出して接続動作状態を高速に制御できる
接続装置を得ることを目的とする。
なされたもので、複数のパラレルインタフェースを接続
可能な接続装置において、１つのパラレルインタフェー
スが接続された状態で、パラレルデータの送受信待機中
にライン上でシリアルデータを送受信可能とすることに
より、接続された各パラレルインタフェースのデータ転
送終了状態を検出して接続動作状態を高速に制御できる
接続装置を得ることを目的とする。
【０００５】
【課題を解決するための手段】本発明に係る接続装置
は、複数のパラレル入力と複数のパラレル出力の１つと
を接続する接続手段と、データバス上のパラレルデータ
の送受信待機中に、データバスの任意のデータラインを
介して送受信されるシリアルデータを検出する信号検出
手段とを有するものである。
は、複数のパラレル入力と複数のパラレル出力の１つと
を接続する接続手段と、データバス上のパラレルデータ
の送受信待機中に、データバスの任意のデータラインを
介して送受信されるシリアルデータを検出する信号検出
手段とを有するものである。
【０００６】また、接続手段は、信号検出手段が検出す
るシリアルデータに基づいて接続中のパラレル入力部お
よびパラレル出力部との接続状態を切断するように構成
したものである。
るシリアルデータに基づいて接続中のパラレル入力部お
よびパラレル出力部との接続状態を切断するように構成
したものである。
【０００７】
【作用】本発明においては、接続手段が複数のパラレル
入力と複数のパラレル出力の１つとを接続してデータバ
ス上のパラレルデータの送受信待機中に、信号検出手段
がデータバスの任意のデータラインを介して送受信され
るシリアルデータを検出して接続手段の動作を制御する
ことを可能とする。
入力と複数のパラレル出力の１つとを接続してデータバ
ス上のパラレルデータの送受信待機中に、信号検出手段
がデータバスの任意のデータラインを介して送受信され
るシリアルデータを検出して接続手段の動作を制御する
ことを可能とする。
【０００８】また、接続手段は、信号検出手段が検出す
るシリアルデータに基づいて接続中のパラレル入力部お
よびパラレルス出力部との接続状態を切断し、切断処理
時間を短縮することを可能とする。
るシリアルデータに基づいて接続中のパラレル入力部お
よびパラレルス出力部との接続状態を切断し、切断処理
時間を短縮することを可能とする。
【０００９】
【実施例】図１は本発明の一実施例を示す接続装置の構
成を説明するブロック図である。
成を説明するブロック図である。
【００１０】図において、１はパラレルインタフェー
ス、例えばセントロニクインタフェースの接続装置本体
で、ホスト０〜３からの入力ＩＮ０〜ＩＮ３を１つの出
力ＯＵＴに送出する。接続装置本体１は待機状態（何処
にも接続されていない状態）においてデータが先に来た
入力（入力ＩＮ０〜ＩＮ３の何れか１つ）と出力ＯＵＴ
とを接続する。
ス、例えばセントロニクインタフェースの接続装置本体
で、ホスト０〜３からの入力ＩＮ０〜ＩＮ３を１つの出
力ＯＵＴに送出する。接続装置本体１は待機状態（何処
にも接続されていない状態）においてデータが先に来た
入力（入力ＩＮ０〜ＩＮ３の何れか１つ）と出力ＯＵＴ
とを接続する。
【００１１】セントロニクインタフェースのデータ転送
タイミングは、図２に示すようにストローブ信号により
データをラッチすることでなされる。通常ストローブは
１マイクロセカンド程度であり、その前後数マイクロセ
カンド程度データバスが有効データを保持していれば正
しく転送が行われる。ストローブが出ていない時間は、
データバスはどんなデータを出していても転送に支障は
ない。従って、ストローブの出ていないデータバスの空
き時間にシリアルデータを送出し、機器を制御すること
ができる。
タイミングは、図２に示すようにストローブ信号により
データをラッチすることでなされる。通常ストローブは
１マイクロセカンド程度であり、その前後数マイクロセ
カンド程度データバスが有効データを保持していれば正
しく転送が行われる。ストローブが出ていない時間は、
データバスはどんなデータを出していても転送に支障は
ない。従って、ストローブの出ていないデータバスの空
き時間にシリアルデータを送出し、機器を制御すること
ができる。
【００１２】図３は、図１に示した接続装置本体１の詳
細構成を説明する回路ブロック図である。
細構成を説明する回路ブロック図である。
【００１３】図において、１０，１１，１２はセレクタ
で、入力からの信号線を選択信号ａにより選択し出力す
る。セレクタ１０とセレクタ１１の間にはデータ２〜７
が省略してある。２０はエンコーダで、ストローブをエ
ンコードする。２１はラッチで、ラッチ信号ｂによりエ
ンコーダの出力をラッチし選択信号ａを生成する。３０
は論理和回路であり、いずれかのストローブによりラッ
チ信号ｂを生成する。４０はリトリガブルタイマ（タイ
マ）で、ラッチ信号ｂとストローブ信号ｄにより起動さ
れ、一定時間後にタイムアウトになるまで信号ｃを生成
する。５０はゲートであり、セレクタ１２からのストロ
ーブ信号を信号ｃによりゲートする。６０はシリアルデ
ータ受信回路であり、本実施例ではデータバスの信号デ
ータ１に送出されたシリアルデータを受信するように構
成されている。そして、切断のための有効なデータシー
ケンスを受信すると、リセット信号ｅを生成する。
で、入力からの信号線を選択信号ａにより選択し出力す
る。セレクタ１０とセレクタ１１の間にはデータ２〜７
が省略してある。２０はエンコーダで、ストローブをエ
ンコードする。２１はラッチで、ラッチ信号ｂによりエ
ンコーダの出力をラッチし選択信号ａを生成する。３０
は論理和回路であり、いずれかのストローブによりラッ
チ信号ｂを生成する。４０はリトリガブルタイマ（タイ
マ）で、ラッチ信号ｂとストローブ信号ｄにより起動さ
れ、一定時間後にタイムアウトになるまで信号ｃを生成
する。５０はゲートであり、セレクタ１２からのストロ
ーブ信号を信号ｃによりゲートする。６０はシリアルデ
ータ受信回路であり、本実施例ではデータバスの信号デ
ータ１に送出されたシリアルデータを受信するように構
成されている。そして、切断のための有効なデータシー
ケンスを受信すると、リセット信号ｅを生成する。
【００１４】このように構成された接続装置において、
接続手段（接続装置本体１）が複数のパラレル入力と複
数のパラレル出力の１つとを接続してデータバス上のパ
ラレルデータの送受信待機中に、信号検出手段（本実施
例ではシリアルデータ受信回路６０）がデータバスの任
意のデータライン（本実施例ではデータ１）を介して送
受信されるシリアルデータを検出して接続装置本体１の
動作を制御することを可能とする。
接続手段（接続装置本体１）が複数のパラレル入力と複
数のパラレル出力の１つとを接続してデータバス上のパ
ラレルデータの送受信待機中に、信号検出手段（本実施
例ではシリアルデータ受信回路６０）がデータバスの任
意のデータライン（本実施例ではデータ１）を介して送
受信されるシリアルデータを検出して接続装置本体１の
動作を制御することを可能とする。
【００１５】また、接続手段は、信号検出手段が検出す
るシリアルデータに基づいて接続中のパラレル入力部お
よびパラレル出力部との接続状態を切断し、切断処理時
間を短縮することを可能とする。
るシリアルデータに基づいて接続中のパラレル入力部お
よびパラレル出力部との接続状態を切断し、切断処理時
間を短縮することを可能とする。
【００１６】次に、接続処理動作について説明する。
【００１７】先ず、タイマ４０がタイムアウトしている
待機状態（何処にも接続されていない状態）において、
４つのホストマシンのいずれかからデータを出力するた
めにストローブが出力される。ホストからのストローブ
は論理和回路３０に入りラッチ信号ｂを生成する。ラッ
チ信号ｂはエンコーダ２０からの出力をラッチ２１でラ
ッチし、選択信号ａを生成すると共に、タイマ４０に起
動をかける。タイマ４０は起動がかかると信号ｃを生成
し、論理和回路３０をディセーブルし、他のホストから
のストローブにより切り換わるのを防ぐと共に、ゲート
５０をイネーブルし、ストローブ信号のゲートを開け
る。先に生成された選択信号ａはセレクタ１０〜１２に
入り、４つの入力のうち、１つが選択され、選ばれたデ
ータおよびストローブが出力される。
待機状態（何処にも接続されていない状態）において、
４つのホストマシンのいずれかからデータを出力するた
めにストローブが出力される。ホストからのストローブ
は論理和回路３０に入りラッチ信号ｂを生成する。ラッ
チ信号ｂはエンコーダ２０からの出力をラッチ２１でラ
ッチし、選択信号ａを生成すると共に、タイマ４０に起
動をかける。タイマ４０は起動がかかると信号ｃを生成
し、論理和回路３０をディセーブルし、他のホストから
のストローブにより切り換わるのを防ぐと共に、ゲート
５０をイネーブルし、ストローブ信号のゲートを開け
る。先に生成された選択信号ａはセレクタ１０〜１２に
入り、４つの入力のうち、１つが選択され、選ばれたデ
ータおよびストローブが出力される。
【００１８】以上のようにして接続がなされた後は、タ
イマ４０はストローブがホスト側から一定時間以内に来
る限りストローブ信号ｄにより再起動され、タイムアウ
トすることなく接続状態が維持される。ストローブが一
定時間以上途切れると、タイマ４０はタイムアウトとな
り信号ｃがＯＦＦすると、ストローブのゲート５０が閉
じられると共に、論理和回路３０をイネーブルにし、切
り換えを許可して待機状態に戻る。
イマ４０はストローブがホスト側から一定時間以内に来
る限りストローブ信号ｄにより再起動され、タイムアウ
トすることなく接続状態が維持される。ストローブが一
定時間以上途切れると、タイマ４０はタイムアウトとな
り信号ｃがＯＦＦすると、ストローブのゲート５０が閉
じられると共に、論理和回路３０をイネーブルにし、切
り換えを許可して待機状態に戻る。
【００１９】接続状態においてデータバスのデータ１に
ホストから切断を要求するシリアルデータによる指令が
出されシリアルデータ受信回路６０がこれを受信する
と、リセット信号ｅを生成し、タイマ４０をリセットす
る。タイマ４０は、タイムアウトになるのと同様に信号
ｃをＯＦＦして待機状態に戻る。
ホストから切断を要求するシリアルデータによる指令が
出されシリアルデータ受信回路６０がこれを受信する
と、リセット信号ｅを生成し、タイマ４０をリセットす
る。タイマ４０は、タイムアウトになるのと同様に信号
ｃをＯＦＦして待機状態に戻る。
【００２０】上記実施例ではシリアルデータの受信のみ
説明したが送信も可能であるし、他のデータ線を使用
し、送受信のチャネルを増やすことができるのは当然で
ある。また、タイマ４０はなくても本発明の主旨を損な
うものではない。
説明したが送信も可能であるし、他のデータ線を使用
し、送受信のチャネルを増やすことができるのは当然で
ある。また、タイマ４０はなくても本発明の主旨を損な
うものではない。
【００２１】
【発明の効果】以上説明したように、本発明は複数のパ
ラレル入力と複数のパラレル出力の１つとを接続する接
続手段と、データバス上のパラレルデータの送受信待機
中に、データバスの任意のデータラインを介して送受信
されるシリアルデータを検出する信号検出手段とを有す
るので、各インタフェースの接続動作状態を切り換える
ための制御情報を検出することができる。
ラレル入力と複数のパラレル出力の１つとを接続する接
続手段と、データバス上のパラレルデータの送受信待機
中に、データバスの任意のデータラインを介して送受信
されるシリアルデータを検出する信号検出手段とを有す
るので、各インタフェースの接続動作状態を切り換える
ための制御情報を検出することができる。
【００２２】また、接続手段は、信号検出手段が検出す
るシリアルデータに基づいて接続中のパラレル入力部と
パラレル出力部との接続状態を切断するように構成した
ので、各インタフェースの接続状態を高速に切断するこ
とができる。
るシリアルデータに基づいて接続中のパラレル入力部と
パラレル出力部との接続状態を切断するように構成した
ので、各インタフェースの接続状態を高速に切断するこ
とができる。
【００２３】従って、接続装置の出力側に接続される出
力手段の使用効率を大幅に高めることができる等の効果
を奏する。
力手段の使用効率を大幅に高めることができる等の効果
を奏する。
【図１】本発明の一実施例を示す接続装置の構成を説明
するブロック図である。
するブロック図である。
【図２】セントロニクスインタフェースのデータ転送動
作を説明するタイミングチャートである。
作を説明するタイミングチャートである。
【図３】図１に示した接続装置本体の詳細構成を説明す
る回路ブロック図である。
る回路ブロック図である。
１ 接続装置本体 ６０ シリアルデータ受信回路
Claims (2)
- 【請求項１】 所定のデータバスに接続可能な複数のパ
ラレル入力と複数のパラレル出力の１つとを接続する接
続手段と、前記データバス上のパラレルデータの送受信
待機中に、前記データバスの任意のデータラインを介し
て送受信されるシリアルデータを検出する信号検出手段
とを有することを特徴とする接続装置。 - 【請求項２】 接続手段は、信号検出手段が検出するシ
リアルデータに基づいて接続中のパラレル入力部および
パラレル出力部との接続状態を切断することを特徴とす
る請求項１記載の接続装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30276691A JPH05113838A (ja) | 1991-10-23 | 1991-10-23 | 接続装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP30276691A JPH05113838A (ja) | 1991-10-23 | 1991-10-23 | 接続装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05113838A true JPH05113838A (ja) | 1993-05-07 |
Family
ID=17912885
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP30276691A Pending JPH05113838A (ja) | 1991-10-23 | 1991-10-23 | 接続装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05113838A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2006013641A1 (ja) * | 2004-08-04 | 2006-02-09 | Hitachi, Ltd. | 集積回路装置及び信号伝送システム |
-
1991
- 1991-10-23 JP JP30276691A patent/JPH05113838A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2006013641A1 (ja) * | 2004-08-04 | 2006-02-09 | Hitachi, Ltd. | 集積回路装置及び信号伝送システム |
| JPWO2006013641A1 (ja) * | 2004-08-04 | 2008-05-01 | 株式会社日立製作所 | 集積回路装置及び信号伝送システム |
| US7657676B2 (en) | 2004-08-04 | 2010-02-02 | Hitachi, Ltd. | Integrated circuit device and signal transmission system |
| US7757022B2 (en) | 2004-08-04 | 2010-07-13 | Hitachi, Ltd. | Integrated circuit device and signal transmission system |
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