JPH0488877A - コンバータの制御方法 - Google Patents
コンバータの制御方法Info
- Publication number
- JPH0488877A JPH0488877A JP20013390A JP20013390A JPH0488877A JP H0488877 A JPH0488877 A JP H0488877A JP 20013390 A JP20013390 A JP 20013390A JP 20013390 A JP20013390 A JP 20013390A JP H0488877 A JPH0488877 A JP H0488877A
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- JP
- Japan
- Prior art keywords
- voltage
- winding
- transformer
- fet
- choke coil
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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- 238000004804 winding Methods 0.000 claims abstract description 33
- 101150015217 FET4 gene Proteins 0.000 description 6
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 2
- 101150079361 fet5 gene Proteins 0.000 description 2
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- 230000005855 radiation Effects 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
- Power Conversion In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、昇降圧形コンバータの降圧モード時のスイッ
チング素子の電圧上昇を抑制するコンバータの制御方法
に関する。
チング素子の電圧上昇を抑制するコンバータの制御方法
に関する。
〔従来の技術及び発明が解決しようとする課題〕第2図
及び第3図は、従来例を説明するための図である。第2
図において、直流電源Iを2次巻線を有するチョークコ
イル2の1次巻線を介してトランス3の1次巻線の中点
に接続し、そのトランス3の1次巻線の両端にそれぞれ
スイッチング素子である例えばFET4.5を接続し、
そのFET4゜5を制御回路6からの制御信号によって
オン・オフ制御することにより、上記トランス302次
巻線から出力を取り出し、その出力電圧をダイオード7
〜IO及びコンデンサ11からなる整流・平滑回路を介
して負荷12に供給する。ここで。
及び第3図は、従来例を説明するための図である。第2
図において、直流電源Iを2次巻線を有するチョークコ
イル2の1次巻線を介してトランス3の1次巻線の中点
に接続し、そのトランス3の1次巻線の両端にそれぞれ
スイッチング素子である例えばFET4.5を接続し、
そのFET4゜5を制御回路6からの制御信号によって
オン・オフ制御することにより、上記トランス302次
巻線から出力を取り出し、その出力電圧をダイオード7
〜IO及びコンデンサ11からなる整流・平滑回路を介
して負荷12に供給する。ここで。
FET4とFET5の導通が重なる動作を昇圧モードと
いい、非導通期間が生ずる動作を降圧モードというが、
この動作は公知なので説明を省略する。尚、 13はダ
イオード、 14.15はスナバ回路を示す。
いい、非導通期間が生ずる動作を降圧モードというが、
この動作は公知なので説明を省略する。尚、 13はダ
イオード、 14.15はスナバ回路を示す。
しかし、このような従来のコンバータの制御方法にあっ
ては、降圧モード時にFETのドレイン・ソース間電圧
が上昇する現象があった。このことを第3図を用いて詳
説する。時刻ti以前で、FE’I’4がオンでFET
5がオフの時、FET5のドレイン・ソース間電圧B5
は、第3図tblに示すように、トランス作用によりト
ランス3の2次側電圧E32の1次側換算電圧B°32
の2倍の電圧2 B’ 32に充電されている。時刻と
1でFET4がオフすると、チョークコイル2に流れて
いた電流はFET4のスナバ回路14に流入し、FET
4のドレイン・ソース間電圧B4は、第3図ta+に示
すように上昇する。そして、チョークコイル2の1次電
圧E21も図に矢印で示した方向に上昇していき、第3
図(C)に示すように9時刻t2でチョークコイル2の
1次電圧E21が直流電#lの電圧Elに達すると、巻
数比をl=1として、チョークコイル2の2次電圧も直
流電源Elに達するので、チョークコイル2の2次巻線
を介してチョークコイル2の電流122が流れ始め、直
流電源1に帰還される。この時。
ては、降圧モード時にFETのドレイン・ソース間電圧
が上昇する現象があった。このことを第3図を用いて詳
説する。時刻ti以前で、FE’I’4がオンでFET
5がオフの時、FET5のドレイン・ソース間電圧B5
は、第3図tblに示すように、トランス作用によりト
ランス3の2次側電圧E32の1次側換算電圧B°32
の2倍の電圧2 B’ 32に充電されている。時刻と
1でFET4がオフすると、チョークコイル2に流れて
いた電流はFET4のスナバ回路14に流入し、FET
4のドレイン・ソース間電圧B4は、第3図ta+に示
すように上昇する。そして、チョークコイル2の1次電
圧E21も図に矢印で示した方向に上昇していき、第3
図(C)に示すように9時刻t2でチョークコイル2の
1次電圧E21が直流電#lの電圧Elに達すると、巻
数比をl=1として、チョークコイル2の2次電圧も直
流電源Elに達するので、チョークコイル2の2次巻線
を介してチョークコイル2の電流122が流れ始め、直
流電源1に帰還される。この時。
チョークコイル2のl電圧E21に注目すると。
時刻tl以前は 図に矢印で示した方向とは逆方向に、
(El−[:’32)の電圧が発生している。そし
て、時刻tlでFET4がオフすると、チョークコイル
2の慣性作用により、チョークコイル2の1次電圧E2
1は直流電源電圧B1まで上昇する。この時、チョーク
コイル2の1次2次間の漏れインダクタンスにより、チ
ョークコイル2の1次電圧E21は直流を源電圧E1よ
りオーバーシュートする。
(El−[:’32)の電圧が発生している。そし
て、時刻tlでFET4がオフすると、チョークコイル
2の慣性作用により、チョークコイル2の1次電圧E2
1は直流電源電圧B1まで上昇する。この時、チョーク
コイル2の1次2次間の漏れインダクタンスにより、チ
ョークコイル2の1次電圧E21は直流を源電圧E1よ
りオーバーシュートする。
方9時刻tlでFET4がオフすると、FET5のドレ
イン・ソース間電圧B5は、トランス3の1次巻線N3
1にスナバ電流が流れることにより、トランス結合作用
でチョークコイル2の電流がスナバ回路15に分流し、
チョークコイル2の電圧E21の変化に応じて、第3図
fblに示すように上昇してい(。この結果、FET5
のドレイン・ソース間電圧E5は、FET4のオン期間
に加わる電圧2 E’ 32に最大(21E1−8’3
2)の電圧が加わることになる。このため、従来はFE
Tの耐圧を直流電源電圧Elの4倍以上に選択していた
。FETのオン抵抗は1周知のように、耐圧に対して指
数間数的に増加する。耐圧のランクが1つ上がると、電
流を流すだめにチップサイズを2ランク上げたり、並列
接続しなければならなくなる。このため1価格の上昇や
放熱、取り付は面積の増加等の問題があった。
イン・ソース間電圧B5は、トランス3の1次巻線N3
1にスナバ電流が流れることにより、トランス結合作用
でチョークコイル2の電流がスナバ回路15に分流し、
チョークコイル2の電圧E21の変化に応じて、第3図
fblに示すように上昇してい(。この結果、FET5
のドレイン・ソース間電圧E5は、FET4のオン期間
に加わる電圧2 E’ 32に最大(21E1−8’3
2)の電圧が加わることになる。このため、従来はFE
Tの耐圧を直流電源電圧Elの4倍以上に選択していた
。FETのオン抵抗は1周知のように、耐圧に対して指
数間数的に増加する。耐圧のランクが1つ上がると、電
流を流すだめにチップサイズを2ランク上げたり、並列
接続しなければならなくなる。このため1価格の上昇や
放熱、取り付は面積の増加等の問題があった。
本発明は以上の欠点を除去するために、直流電源を2次
巻線を有するチョークコイルの1次巻線を介してトラン
スの1次巻線の中点に接続し、該トランスの1次巻線の
両端にそれぞれスイッチング素子を接続し、該スイッチ
ング素子をオン・オフ制御することにより上記トランス
の2次巻線から出力を取り出すコンバータにおいて、上
記トランスに3次巻線を設けると共に、該3次巻線を上
記スイッチング素子の同時オフ期間に短絡することを特
徴とするコンバータの制御方法を提供するものである。
巻線を有するチョークコイルの1次巻線を介してトラン
スの1次巻線の中点に接続し、該トランスの1次巻線の
両端にそれぞれスイッチング素子を接続し、該スイッチ
ング素子をオン・オフ制御することにより上記トランス
の2次巻線から出力を取り出すコンバータにおいて、上
記トランスに3次巻線を設けると共に、該3次巻線を上
記スイッチング素子の同時オフ期間に短絡することを特
徴とするコンバータの制御方法を提供するものである。
このようなコンバータの制御方法によれば、トランスに
3次巻線を設け、スイッチング素子の同時オフ期間にこ
の3次巻線を短絡するようにしているので、スイッチン
グ素子の同時オフwi閾にスイッチング素子に印加され
る電圧は、直流を源電圧とチョークコイルの1次電圧の
和になり、スイッチング素子の電圧の上昇を抑制するこ
とができる。
3次巻線を設け、スイッチング素子の同時オフ期間にこ
の3次巻線を短絡するようにしているので、スイッチン
グ素子の同時オフwi閾にスイッチング素子に印加され
る電圧は、直流を源電圧とチョークコイルの1次電圧の
和になり、スイッチング素子の電圧の上昇を抑制するこ
とができる。
第1図は2本発明の一実施例を説明するための図である
。先ず構成を説明すると、第2図に示した昇降圧形コン
バータのトランス3に、3次巻線N33を設け、この3
次巻線N33を全波整流回路16の交流入力端子に接続
し、直流出力端子に補助スイッチング素子9例えばFE
T17を接続する。そして、このFET17のゲートに
、FET4,5の同時オフ期間にFET17をオフさせ
る論理回路I8を接続する。次に7作用を説明する。通
常の動作モードである昇圧モードで動作中は、FET1
7はオフ状態を保っているが、コンバータの起動時や出
力過負荷時等に、降圧モードになり、FET4、5が同
時にオフの状態になると、FETI了がオンする。する
と、トランス3の巻線は短絡されるので、FET4,5
の電圧は、直流電源lの電圧B1とチョークコイル2の
1次電圧E21の和の電圧(El+E21)になる。こ
の時、励磁電流は、トランス3のコイルが短絡されてい
るので、3次巻線に流れ続ける。そして、FET4,5
がオンすると、FET17はオフして通常の動作モード
に戻り、励磁電流も1次巻線に移る。
。先ず構成を説明すると、第2図に示した昇降圧形コン
バータのトランス3に、3次巻線N33を設け、この3
次巻線N33を全波整流回路16の交流入力端子に接続
し、直流出力端子に補助スイッチング素子9例えばFE
T17を接続する。そして、このFET17のゲートに
、FET4,5の同時オフ期間にFET17をオフさせ
る論理回路I8を接続する。次に7作用を説明する。通
常の動作モードである昇圧モードで動作中は、FET1
7はオフ状態を保っているが、コンバータの起動時や出
力過負荷時等に、降圧モードになり、FET4、5が同
時にオフの状態になると、FETI了がオンする。する
と、トランス3の巻線は短絡されるので、FET4,5
の電圧は、直流電源lの電圧B1とチョークコイル2の
1次電圧E21の和の電圧(El+E21)になる。こ
の時、励磁電流は、トランス3のコイルが短絡されてい
るので、3次巻線に流れ続ける。そして、FET4,5
がオンすると、FET17はオフして通常の動作モード
に戻り、励磁電流も1次巻線に移る。
以上説明したようにこの発明は、昇降圧形コンバータに
おいて、トランスに3次巻線を設け、スイッチング素子
の同時オフ時にその3次巻線を短絡するようにしたので
、同時オフ期間にスイッチング素子の電圧の上昇を抑制
でき、従って、耐電圧の低いスイッチング素子の使用が
可能となり。
おいて、トランスに3次巻線を設け、スイッチング素子
の同時オフ時にその3次巻線を短絡するようにしたので
、同時オフ期間にスイッチング素子の電圧の上昇を抑制
でき、従って、耐電圧の低いスイッチング素子の使用が
可能となり。
チップサイズの低減、損失や発熱の低減により。
価格低減、小形化が図れる。
第1図は本発明の一実施例を説明するための図、第2図
及び第3図は従来例を説明するための図である。 1・・・直流電# 2・チョークコイル3・・
・トランス 4.5・・・スイッチング素子 6・・・制御回路 7〜IO・・・ダイオード
11・・・コンデンサ 12・・負荷13・・・
ダイオード 14.15・・・スナバ回路16・
・・全波整流回路 17・・・補助スイッチング素子 18・・・論理回路
及び第3図は従来例を説明するための図である。 1・・・直流電# 2・チョークコイル3・・
・トランス 4.5・・・スイッチング素子 6・・・制御回路 7〜IO・・・ダイオード
11・・・コンデンサ 12・・負荷13・・・
ダイオード 14.15・・・スナバ回路16・
・・全波整流回路 17・・・補助スイッチング素子 18・・・論理回路
Claims (1)
- 直流電源を2次巻線を有するチョークコイルの1次巻線
を介してトランスの1次巻線の中点に接続し、該トラン
スの1次巻線の両端にそれぞれスイッチング素子を接続
し、該スイッチング素子をオン・オフ制御することによ
り上記トランスの2次巻線から出力を取り出すコンバー
タにおいて、上記トランスに3次巻線を設けると共に、
該3次巻線を上記スイッチング素子の同時オフ期間に短
絡することを特徴とするコンバータの制御方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20013390A JPH0488877A (ja) | 1990-07-27 | 1990-07-27 | コンバータの制御方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20013390A JPH0488877A (ja) | 1990-07-27 | 1990-07-27 | コンバータの制御方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0488877A true JPH0488877A (ja) | 1992-03-23 |
Family
ID=16419348
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP20013390A Pending JPH0488877A (ja) | 1990-07-27 | 1990-07-27 | コンバータの制御方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0488877A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP1085648A1 (en) * | 1995-10-04 | 2001-03-21 | Matsushita Electric Industrial Co., Ltd. | Switching power supply apparatus |
-
1990
- 1990-07-27 JP JP20013390A patent/JPH0488877A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP1085648A1 (en) * | 1995-10-04 | 2001-03-21 | Matsushita Electric Industrial Co., Ltd. | Switching power supply apparatus |
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