JPH04344511A - 活線挿抜方式 - Google Patents
活線挿抜方式Info
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- JPH04344511A JPH04344511A JP3116397A JP11639791A JPH04344511A JP H04344511 A JPH04344511 A JP H04344511A JP 3116397 A JP3116397 A JP 3116397A JP 11639791 A JP11639791 A JP 11639791A JP H04344511 A JPH04344511 A JP H04344511A
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- JP
- Japan
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- package
- signal
- processor
- gate
- bus
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- 230000005540 biological transmission Effects 0.000 claims abstract description 22
- 230000037431 insertion Effects 0.000 claims description 24
- 238000003780 insertion Methods 0.000 claims description 23
- 238000000034 method Methods 0.000 claims description 17
- 238000012545 processing Methods 0.000 abstract description 7
- 230000002411 adverse Effects 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 6
- 238000000605 extraction Methods 0.000 description 6
- 230000000694 effects Effects 0.000 description 2
- 238000011017 operating method Methods 0.000 description 2
- 230000004044 response Effects 0.000 description 2
- 238000012966 insertion method Methods 0.000 description 1
Landscapes
- Multi Processors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は、一つのマイクロプロセ
ッサを搭載するプロセッサパッケージが結合して稼働中
のプロセッサバスに、挿入して接続し、抜去して切離す
対象パッケージの活線挿抜方式に関する。
ッサを搭載するプロセッサパッケージが結合して稼働中
のプロセッサバスに、挿入して接続し、抜去して切離す
対象パッケージの活線挿抜方式に関する。
【０００２】
【従来の技術】従来、この種の活線挿抜方式は、挿抜の
対象パッケージが抜去されるときマイクロプロセッサと
のバスを引き込むバスドライバでバスに対して電気的に
切り離したのち物理的に抜かれる。
対象パッケージが抜去されるときマイクロプロセッサと
のバスを引き込むバスドライバでバスに対して電気的に
切り離したのち物理的に抜かれる。
【０００３】これについて、図４を参照して説明する。
図４は従来の一例を示すブロック図である。
【０００４】図示する対象パッケージ８０は複数がプロ
セッサバス３１を介して一つのプロセッサパッケージ９
０に接続する。
セッサバス３１を介して一つのプロセッサパッケージ９
０に接続する。
【０００５】対象パッケージ８０は抜去具８１、この抜
去具８１と連動する連動スイッチ８２、およびプロセッ
サバス３１を引き込むバスドライバ８３を有する。プロ
セッサパッケージ９０はマイクロプロセッサ９１を有し
、マイクロプロセッサ９１がプロセッサバス３１を介し
て対象パッケージ８０に接続し、信号およびデータを授
受してプログラムを実行する。
去具８１と連動する連動スイッチ８２、およびプロセッ
サバス３１を引き込むバスドライバ８３を有する。プロ
セッサパッケージ９０はマイクロプロセッサ９１を有し
、マイクロプロセッサ９１がプロセッサバス３１を介し
て対象パッケージ８０に接続し、信号およびデータを授
受してプログラムを実行する。
【０００６】対象パッケージ８０を抜き去るとき、まず
抜去具８１が抜去操作され留め具が外される。留め具が
外されたとき、これに連動する連動スイッチ８２が抜去
信号をバスドライバ８３へ送り、バスドライバ８３が内
蔵するゲートを閉じ、プロセッサバス３１に対して高イ
ンピーダンス状態として電気的に切り離したのち、物理
的な抜去が実行される。
抜去具８１が抜去操作され留め具が外される。留め具が
外されたとき、これに連動する連動スイッチ８２が抜去
信号をバスドライバ８３へ送り、バスドライバ８３が内
蔵するゲートを閉じ、プロセッサバス３１に対して高イ
ンピーダンス状態として電気的に切り離したのち、物理
的な抜去が実行される。
【０００７】対象パッケージ８０が挿入される場合には
、物理的に挿入挿着のとき、抜去具８１が留め具を所定
位置に動作させるので、連動スイッチ８２から挿着信号
がバスドライバ８３へ送信され、バスドライバ８３のゲ
ートが開放されて、プロセッサバス３１が電気的に内部
に接続される。
、物理的に挿入挿着のとき、抜去具８１が留め具を所定
位置に動作させるので、連動スイッチ８２から挿着信号
がバスドライバ８３へ送信され、バスドライバ８３のゲ
ートが開放されて、プロセッサバス３１が電気的に内部
に接続される。
【０００８】対象パッケージ８０が挿着されていない状
態を、マイクロプロセッサ９１は対象パッケージ８０の
呼び出しで応答がないことによって判定していた。
態を、マイクロプロセッサ９１は対象パッケージ８０の
呼び出しで応答がないことによって判定していた。
【０００９】
【発明が解決しようとする課題】上述した従来のパッケ
ージの活線挿抜方式は、対象パッケージが抜去される処
理動作がマイクロプロセッサの稼働状態に無関係のため
、マイクロプロセッサがアクセス処理開始時およびアク
セス処理中に対象パッケージが抜去処理された場合、マ
イクロプロセッサの動作が影響を受け、かつ、プロセッ
サバスに接続される他のパッケージにも動作に影響を与
えてしまうという問題点があった。
ージの活線挿抜方式は、対象パッケージが抜去される処
理動作がマイクロプロセッサの稼働状態に無関係のため
、マイクロプロセッサがアクセス処理開始時およびアク
セス処理中に対象パッケージが抜去処理された場合、マ
イクロプロセッサの動作が影響を受け、かつ、プロセッ
サバスに接続される他のパッケージにも動作に影響を与
えてしまうという問題点があった。
【００１０】本発明の目的は、連動スイッチの信号をマ
イクロプロセッサまで伝達させることにより、上記問題
点を解決する活線挿抜方式を提供することにある。
イクロプロセッサまで伝達させることにより、上記問題
点を解決する活線挿抜方式を提供することにある。
【００１１】
【課題を解決するための手段】本発明による活線挿抜方
式は、一つのマイクロプロセッサを搭載するプロセッサ
パッケージが結合して稼働中のプロセッサバスに、挿入
することで接続し、また抜去することで切離す対象パッ
ケージの活線挿抜方式において、挿着された前記プロセ
ッサパッケージおよび前記対象パッケージに接続する一
つの情報伝送路を備え、前記対象パッケージが抜去具と
連動して抜去および挿着の状態を通知するスイッチ信号
を前記情報伝送路へ送信したのち、この情報伝送路から
ゲートの開放・閉塞を指示するゲート信号を受信して、
前記プロセッサバスの接続・切離を実行する一方、前記
プロセッサパッケージが、前記情報伝送路から前記スイ
ッチ信号を受信したとき処理中のプログラムを保護する
所定の手順を実行して前記ゲート信号を前記情報伝送路
へ送信する。
式は、一つのマイクロプロセッサを搭載するプロセッサ
パッケージが結合して稼働中のプロセッサバスに、挿入
することで接続し、また抜去することで切離す対象パッ
ケージの活線挿抜方式において、挿着された前記プロセ
ッサパッケージおよび前記対象パッケージに接続する一
つの情報伝送路を備え、前記対象パッケージが抜去具と
連動して抜去および挿着の状態を通知するスイッチ信号
を前記情報伝送路へ送信したのち、この情報伝送路から
ゲートの開放・閉塞を指示するゲート信号を受信して、
前記プロセッサバスの接続・切離を実行する一方、前記
プロセッサパッケージが、前記情報伝送路から前記スイ
ッチ信号を受信したとき処理中のプログラムを保護する
所定の手順を実行して前記ゲート信号を前記情報伝送路
へ送信する。
【００１２】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明の活線挿抜方式の一実施例を示すブロ
ック図である。
る。図１は本発明の活線挿抜方式の一実施例を示すブロ
ック図である。
【００１３】図示するように、プロセッサパッケージ１
０はプロセッサバス３１で複数の対象パッケージ２０に
接続すると共に、情報伝送路３２でも接続する。
０はプロセッサバス３１で複数の対象パッケージ２０に
接続すると共に、情報伝送路３２でも接続する。
【００１４】プロセッサパッケージ１０はマイクロプロ
セッサ１１に加えて、入出力制御回路１２を有する。対
象パッケージ２０は引抜具２１，連動スイッチ２２およ
びバスドライバ２３に、更にゲート制御回路２４を有す
る。
セッサ１１に加えて、入出力制御回路１２を有する。対
象パッケージ２０は引抜具２１，連動スイッチ２２およ
びバスドライバ２３に、更にゲート制御回路２４を有す
る。
【００１５】プロセッサバス３１は、従来同様、一つの
マイクロプロセッサ１１を複数のバスドライバ２３に接
続する。
マイクロプロセッサ１１を複数のバスドライバ２３に接
続する。
【００１６】情報伝送路３２は、一つの入出力制御回路
１２を複数のゲート制御回路２４に接続する。
１２を複数のゲート制御回路２４に接続する。
【００１７】対象パッケージ２０は抜去具２１の挿脱に
よる留め具の状態を連動スイッチ２２からスイッチ信号
４１としてゲート制御回路２４へ送信する。ゲート制御
回路２４はゲート信号４２をバスドライバ２３へ送信し
てバスドライバ２３のゲートの開閉を制御する。
よる留め具の状態を連動スイッチ２２からスイッチ信号
４１としてゲート制御回路２４へ送信する。ゲート制御
回路２４はゲート信号４２をバスドライバ２３へ送信し
てバスドライバ２３のゲートの開閉を制御する。
【００１８】図２は図１の対象パッケージ２０の離脱・
挿入とスイッチ信号４１およびゲート信号４２の関係の
一例を示すタイムチャートであり、図３は図１および図
２における主要動作の一例を示す手順図である。
挿入とスイッチ信号４１およびゲート信号４２の関係の
一例を示すタイムチャートであり、図３は図１および図
２における主要動作の一例を示す手順図である。
【００１９】まず、図２に示すように、スイッチ信号４
１は抜去信号および挿着信号を、またゲート信号４２は
閉塞信号および開放信号を有し、Ａ点が抜去信号、Ｂ点
が閉塞信号、Ｃ点がパッケージ２０の離脱、Ｄ点がパッ
ケージ２０の挿入、Ｅ点が挿着信号、そしてＦ点が開放
信号、とそれぞれの時点で信号および動作が発生する。
１は抜去信号および挿着信号を、またゲート信号４２は
閉塞信号および開放信号を有し、Ａ点が抜去信号、Ｂ点
が閉塞信号、Ｃ点がパッケージ２０の離脱、Ｄ点がパッ
ケージ２０の挿入、Ｅ点が挿着信号、そしてＦ点が開放
信号、とそれぞれの時点で信号および動作が発生する。
【００２０】次に、図３に、図１および図２を併せ参照
して主要動作手順について説明する。
して主要動作手順について説明する。
【００２１】まず抜去手順では、対象パッケージ２０の
抜去具２１が引き抜き（１０１）され、留め具が外れた
とき、連動スイッチ２２が抜去信号を発生（Ａ）（１０
２）してゲート制御回路２４へ送信する。
抜去具２１が引き抜き（１０１）され、留め具が外れた
とき、連動スイッチ２２が抜去信号を発生（Ａ）（１０
２）してゲート制御回路２４へ送信する。
【００２２】ゲート制御回路２４は受信した抜去信号を
情報伝送路３２を介してプロセッサパッケージ１０へ送
信（１０３）する。
情報伝送路３２を介してプロセッサパッケージ１０へ送
信（１０３）する。
【００２３】プロセッサパッケージ１０は抜去信号を入
出力制御回路１２が受信してマイクロプロセッサ１１へ
転送し、マイクロプロセッサ１１が所定のパッケージ閉
塞プログラムを処理したのち、ゲート閉塞信号を、入出
力制御回路１２および情報伝送路３２を介して対象パッ
ケージ２０へ返信するパッケージ抜去手順を実行（１０
４）する。
出力制御回路１２が受信してマイクロプロセッサ１１へ
転送し、マイクロプロセッサ１１が所定のパッケージ閉
塞プログラムを処理したのち、ゲート閉塞信号を、入出
力制御回路１２および情報伝送路３２を介して対象パッ
ケージ２０へ返信するパッケージ抜去手順を実行（１０
４）する。
【００２４】ゲート閉塞信号をゲート制御回路２４で受
信（Ｂ）（１０５）した対象パッケージ２０はゲート閉
塞信号をバスドライバ２３へ転送し、バスドライバ２３
にゲートを閉塞（１０６）させる。
信（Ｂ）（１０５）した対象パッケージ２０はゲート閉
塞信号をバスドライバ２３へ転送し、バスドライバ２３
にゲートを閉塞（１０６）させる。
【００２５】これら一連の動作手順に待ち合わせがない
ように、抜去信号の転送に対して優先使用を認める情報
伝送路３２を設け、パッケージの離脱（Ｃ）（１０７）
が手順１０６の後になるように処理される。
ように、抜去信号の転送に対して優先使用を認める情報
伝送路３２を設け、パッケージの離脱（Ｃ）（１０７）
が手順１０６の後になるように処理される。
【００２６】対象パッケージ２０の挿着時手順は、パッ
ケージ２０が挿入（Ｄ）（２０１）されたとき、抜去具
２１が留め具を動作させ、連動スイッチ２２が挿着信号
を発生（Ｅ）（２０２）する。
ケージ２０が挿入（Ｄ）（２０１）されたとき、抜去具
２１が留め具を動作させ、連動スイッチ２２が挿着信号
を発生（Ｅ）（２０２）する。
【００２７】挿着信号は連動スイッチ２２からゲート制
御回路２４を介して情報伝送路３２へ送信（２０３）さ
れ、プロセッサパッケージ１０の入出力制御回路１２が
受信してマイクロプロセッサ１１へ転送される。
御回路２４を介して情報伝送路３２へ送信（２０３）さ
れ、プロセッサパッケージ１０の入出力制御回路１２が
受信してマイクロプロセッサ１１へ転送される。
【００２８】マイクロプロセッサ１１は挿着信号の受信
により所定のプログラムを処理してゲート開放信号を送
信するパッケージ挿着処理（２０４）を実行する。
により所定のプログラムを処理してゲート開放信号を送
信するパッケージ挿着処理（２０４）を実行する。
【００２９】ゲート開放信号は入出力制御回路１２を介
して情報伝送路３２へ送信され、対象パッケージ２０の
ゲート制御回路２４が受信（Ｆ）（２０５）する。ゲー
ト制御回路２４は開放信号をバスドライバ２３へ転送し
てドライバゲートを開放（２０６）させる。
して情報伝送路３２へ送信され、対象パッケージ２０の
ゲート制御回路２４が受信（Ｆ）（２０５）する。ゲー
ト制御回路２４は開放信号をバスドライバ２３へ転送し
てドライバゲートを開放（２０６）させる。
【００３０】マイクロプロセッサ１１の所定の処理とは
、対象パッケージ２０の状態メモリの書き替え、および
アクセス中の場合は退避処理への移行など、プログラム
進行上およびプロセッサバス上での誤手順を生じない対
策プログラム処理の実行である。
、対象パッケージ２０の状態メモリの書き替え、および
アクセス中の場合は退避処理への移行など、プログラム
進行上およびプロセッサバス上での誤手順を生じない対
策プログラム処理の実行である。
【００３１】図２に示すように、対象パッケージの挿抜
を示すスイッチ信号Ａ・Ｅによりプロセッサが所定処理
を実行して、ゲートの開閉を示すゲート信号Ｂ・Ｆを発
生するが、実際の対象パッケージの挿脱時点Ｃ・Ｄは時
点Ｂ−Ｅの間にあり、実質的にプロセッサに悪影響を与
えることはない。
を示すスイッチ信号Ａ・Ｅによりプロセッサが所定処理
を実行して、ゲートの開閉を示すゲート信号Ｂ・Ｆを発
生するが、実際の対象パッケージの挿脱時点Ｃ・Ｄは時
点Ｂ−Ｅの間にあり、実質的にプロセッサに悪影響を与
えることはない。
【００３２】ゲート信号の閉塞信号によるゲート閉塞の
後にパッケージ離脱行為を実施する確認には、更にゲー
ト閉塞またはゲート開放の何れかの表示が有効である。
後にパッケージ離脱行為を実施する確認には、更にゲー
ト閉塞またはゲート開放の何れかの表示が有効である。
【００３３】なお、プロセッサバスのゲート開放は、挿
着の対象パッケージからプロセッサバスを介して直接マ
イクロプロセッサと信号を授受して確認できる。
着の対象パッケージからプロセッサバスを介して直接マ
イクロプロセッサと信号を授受して確認できる。
【００３４】
【発明の効果】以上説明したように本発明は、マイクロ
プロセッサを搭載したパッケージと、マイクロプロセッ
サのバスに接続される複数の活線挿抜の対象パッケージ
を持つシステムで、活線挿抜の対象パッケージを挿抜す
る際の、マイクロプロセッサバスからの切り離し、また
はマイクロプロセッサバスへの接続を、マイクロプロセ
ッサの制御で行うことにより、マイクロプロセッサの動
作及びマイクロプロセッサバスに接続されている他のパ
ッケージの動作に、影響を与えることはなくパッケージ
挿抜が行えるという効果がある。
プロセッサを搭載したパッケージと、マイクロプロセッ
サのバスに接続される複数の活線挿抜の対象パッケージ
を持つシステムで、活線挿抜の対象パッケージを挿抜す
る際の、マイクロプロセッサバスからの切り離し、また
はマイクロプロセッサバスへの接続を、マイクロプロセ
ッサの制御で行うことにより、マイクロプロセッサの動
作及びマイクロプロセッサバスに接続されている他のパ
ッケージの動作に、影響を与えることはなくパッケージ
挿抜が行えるという効果がある。
【図１】本発明の一実施例を示すブロック図である。
【図２】図１によるスイッチ信号・ゲート信号およびパ
ッケージの挿脱時期の一例を示すタイムチャートである
。
ッケージの挿脱時期の一例を示すタイムチャートである
。
【図３】図１および図２による主要動作の一例を示す手
順図である。
順図である。
【図４】従来の一例を示すブロック図である。
１０，２０ パッケージ
１１ マイクロプロセッサ
１２ 入出力制御回路
２１ 抜去具
２２ スイッチ
２３ バスドライバ
２４ ゲート制御回路
３１ プロセッサバス
３２ 情報伝送路
４１ スイッチ信号
４２ ゲート信号
Claims (1)
- 【請求項１】 一つのマイクロプロセッサを搭載する
プロセッサパッケージが結合して稼働中のプロセッサバ
スに、挿入することで接続し、また抜去することで切離
す対象パッケージの活線挿抜方式において、挿着された
前記プロセッサパッケージおよび前記対象パッケージに
接続する一つの情報伝送路を備え、前記対象パッケージ
が抜去具と連動して抜去および挿着の状態を通知するス
イッチ信号を前記情報伝送路へ送信したのち、この情報
伝送路からゲートの開放・閉塞を指示するゲート信号を
受信して、前記プロセッサバスの接続・切離を実行する
一方、前記プロセッサパッケージが、前記情報伝送路か
ら前記スイッチ信号を受信したとき処理中のプログラム
を保護する所定の手順を実行して前記ゲート信号を前記
情報伝送路へ送信することを特徴とする活線挿抜方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3116397A JPH04344511A (ja) | 1991-05-22 | 1991-05-22 | 活線挿抜方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3116397A JPH04344511A (ja) | 1991-05-22 | 1991-05-22 | 活線挿抜方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04344511A true JPH04344511A (ja) | 1992-12-01 |
Family
ID=14686035
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3116397A Pending JPH04344511A (ja) | 1991-05-22 | 1991-05-22 | 活線挿抜方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04344511A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07200333A (ja) * | 1993-12-29 | 1995-08-04 | Nec Corp | 初期値設定装置 |
| JPH07319721A (ja) * | 1994-05-20 | 1995-12-08 | Nec Corp | 二重化情報処理装置 |
| JPH09167038A (ja) * | 1995-06-07 | 1997-06-24 | Samsung Electron Co Ltd | 高速システムにおけるクロックスキューを最小化してリタイムマージンを最大化するための構造 |
-
1991
- 1991-05-22 JP JP3116397A patent/JPH04344511A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07200333A (ja) * | 1993-12-29 | 1995-08-04 | Nec Corp | 初期値設定装置 |
| JPH07319721A (ja) * | 1994-05-20 | 1995-12-08 | Nec Corp | 二重化情報処理装置 |
| JPH09167038A (ja) * | 1995-06-07 | 1997-06-24 | Samsung Electron Co Ltd | 高速システムにおけるクロックスキューを最小化してリタイムマージンを最大化するための構造 |
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