JPH04277931A - 適応識別レベル判定回路 - Google Patents
適応識別レベル判定回路Info
- Publication number
- JPH04277931A JPH04277931A JP6404191A JP6404191A JPH04277931A JP H04277931 A JPH04277931 A JP H04277931A JP 6404191 A JP6404191 A JP 6404191A JP 6404191 A JP6404191 A JP 6404191A JP H04277931 A JPH04277931 A JP H04277931A
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- JP
- Japan
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- circuit
- level
- positive
- signal
- negative peak
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- Pending
Links
- 230000003044 adaptive effect Effects 0.000 title claims 2
- 238000001514 detection method Methods 0.000 claims abstract description 10
- 230000010354 integration Effects 0.000 description 4
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/06—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection
- H04L25/061—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection providing hard decisions only; arrangements for tracking or suppressing unwanted low frequency components, e.g. removal of dc offset
- H04L25/062—Setting decision thresholds using feedforward techniques only
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
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- H04L25/06—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection
- H04L25/061—Dc level restoring means; Bias distortion correction ; Decision circuits providing symbol by symbol detection providing hard decisions only; arrangements for tracking or suppressing unwanted low frequency components, e.g. removal of dc offset
- H04L25/066—Multilevel decisions, not including self-organising maps
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Manipulation Of Pulses (AREA)
- Dc Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【0001】
【産業上の利用分野】本発明は識別レベル判定回路にお
いて、検波信号の振幅変動、直流分変動に対して追従動
作する回路に関する。
いて、検波信号の振幅変動、直流分変動に対して追従動
作する回路に関する。
【0002】
【従来の技術】従来の復調回路では、受信信号と固定の
識別レベルとを対応させて判定しデータの復調を行って
いる。
識別レベルとを対応させて判定しデータの復調を行って
いる。
【0003】
【発明が解決しようとする課題】しかし、このような復
調手段では検波信号に振幅変動や直流分変動が生じた場
合、識別レベルと復調データとの関係に誤差が生じ、正
常に復調することができないという問題があった。
調手段では検波信号に振幅変動や直流分変動が生じた場
合、識別レベルと復調データとの関係に誤差が生じ、正
常に復調することができないという問題があった。
【0004】
【課題を解決するための手段】このような課題を解決す
るため、本発明は受信信号より正負のピーク値を検出し
、この電圧差から抵抗分割等で識別レベルを生成するこ
とにより受信信号の線形な変動に適応した動作を行うも
のである。
るため、本発明は受信信号より正負のピーク値を検出し
、この電圧差から抵抗分割等で識別レベルを生成するこ
とにより受信信号の線形な変動に適応した動作を行うも
のである。
【0005】又、識別レベルが、多値化した場合も抵抗
を直列多段接続することにより対応できるものである。
を直列多段接続することにより対応できるものである。
【0006】
【作用】上記のように入力信号の正負のピーク値に、識
別レベルが追従することにより受信信号と識別レベルの
関係を正常な関係に保つことができ、これにより受信状
態の変動による復調エラーを防止することができる。以
下実施例につき図面により詳細に説明する。
別レベルが追従することにより受信信号と識別レベルの
関係を正常な関係に保つことができ、これにより受信状
態の変動による復調エラーを防止することができる。以
下実施例につき図面により詳細に説明する。
【0007】
【実施例】図1は4値判定の例を示す構成図である。1
は受信信号入力端、2は入力バッファ、3は2ビットず
つ積分を行う2ビット積分回路、4は判定回路、5は判
定結果を2ビット分記憶する2ビットデータラッチ、6
は正のピーク電圧を検出する正ピーク検出回路、7は負
のピーク電圧を検出する負ピーク検出回路、8は固定抵
抗、9はデータセレクタ、10は受信データ出力端であ
る。
は受信信号入力端、2は入力バッファ、3は2ビットず
つ積分を行う2ビット積分回路、4は判定回路、5は判
定結果を2ビット分記憶する2ビットデータラッチ、6
は正のピーク電圧を検出する正ピーク検出回路、7は負
のピーク電圧を検出する負ピーク検出回路、8は固定抵
抗、9はデータセレクタ、10は受信データ出力端であ
る。
【0008】まず、受信信号が入力端1を経て入力バッ
ファ2に加えられる。このバッファ信号の上下のピーク
電圧を正ピーク検出回路6と、負ピーク検出回路7から
出力し、この電圧差を固定抵抗8で分圧し識別レベルと
して使用する。後に説明するように、これにより入力信
号にオフセット電圧や振幅変動があった場合も識別レベ
ルがこれに追従する動作となる。識別レベルを多値化す
る場合(本例では4値)には、固定抵抗8の分割抵抗R
1〜R5により4つの識別レベルを生成する。これらの
識別レベルは、データセレクタ9において2ビットデー
タラッチ5からのコントロール信号によりその1つが選
択され、判定識別レベルとして判定回路4に加えられる
。判定回路4では2ビット積分回路3で積分された受信
信号と比較判定され、“1”,“0”の2値に変換され
る。この値は2ビットデータラッチ5でラッチされた後
出力端10へ出力すると共に、コントロール信号として
データセレクタ9へ加えられる。データセレクタ9内で
は、このデータラッチが“H,H”の場合4つの識別レ
ベルのうち一番高いレベルが選択され、また“L,L”
の場合はその逆に一番低いレベルが選択される。即ち、
データセレクタ9では複数の入力識別レベルの中で現在
の状態に最適なものを2ビットデータラッチ5の状態に
より選択するように構成されている。
ファ2に加えられる。このバッファ信号の上下のピーク
電圧を正ピーク検出回路6と、負ピーク検出回路7から
出力し、この電圧差を固定抵抗8で分圧し識別レベルと
して使用する。後に説明するように、これにより入力信
号にオフセット電圧や振幅変動があった場合も識別レベ
ルがこれに追従する動作となる。識別レベルを多値化す
る場合(本例では4値)には、固定抵抗8の分割抵抗R
1〜R5により4つの識別レベルを生成する。これらの
識別レベルは、データセレクタ9において2ビットデー
タラッチ5からのコントロール信号によりその1つが選
択され、判定識別レベルとして判定回路4に加えられる
。判定回路4では2ビット積分回路3で積分された受信
信号と比較判定され、“1”,“0”の2値に変換され
る。この値は2ビットデータラッチ5でラッチされた後
出力端10へ出力すると共に、コントロール信号として
データセレクタ9へ加えられる。データセレクタ9内で
は、このデータラッチが“H,H”の場合4つの識別レ
ベルのうち一番高いレベルが選択され、また“L,L”
の場合はその逆に一番低いレベルが選択される。即ち、
データセレクタ9では複数の入力識別レベルの中で現在
の状態に最適なものを2ビットデータラッチ5の状態に
より選択するように構成されている。
【0009】このように識別レベルを多値化した場合は
、固定抵抗の数を増やすことにより変動への対応が可能
であり、抵抗値を変えることにより任意に入力信号と識
別レベルの関係を設定することができる。
、固定抵抗の数を増やすことにより変動への対応が可能
であり、抵抗値を変えることにより任意に入力信号と識
別レベルの関係を設定することができる。
【0010】本例は2ビット積分法を用いている為、2
ビット単位の処理を行っているが、通常の場合1ビット
単位の処理も可能である。
ビット単位の処理を行っているが、通常の場合1ビット
単位の処理も可能である。
【0011】
【発明の効果】以上説明したように、受信信号と識別レ
ベルの関係が最適な状態として一定に保たれるため、検
波信号の振幅変動や直流分変動に強く、符号誤り率特性
や同期引き込み時間の向上につながる利点があり、各種
の検波回路に使用することができる。
ベルの関係が最適な状態として一定に保たれるため、検
波信号の振幅変動や直流分変動に強く、符号誤り率特性
や同期引き込み時間の向上につながる利点があり、各種
の検波回路に使用することができる。
【図1】図1は本発明の実施例の構成図である。
1 受信信号入力端
2 入力バッファ
3 2ビット積分回路
4 判定回路
5 2ビットデータラッチ
6 正ピーク検出回路
7 負ピーク検出回路
8 固定抵抗
9 データセレクタ
10 受信データ出力端
Claims (1)
- 【請求項1】 検波された2値または多値信号の判定
回路において、検波信号より正負のピーク値を検出し、
正負のピーク値の電圧差から抵抗分割等を用いて識別レ
ベルを作成し、前記判定回路の出力によりその1つを選
択し入力信号の変動に対して判定識別レベルを追従させ
ることを特徴とする適応識別レベル判定回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6404191A JPH04277931A (ja) | 1991-03-05 | 1991-03-05 | 適応識別レベル判定回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6404191A JPH04277931A (ja) | 1991-03-05 | 1991-03-05 | 適応識別レベル判定回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH04277931A true JPH04277931A (ja) | 1992-10-02 |
Family
ID=13246634
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP6404191A Pending JPH04277931A (ja) | 1991-03-05 | 1991-03-05 | 適応識別レベル判定回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH04277931A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008160797A (ja) * | 2006-11-28 | 2008-07-10 | Seiko Epson Corp | データ転送を行う回路及び方法並びにクロックパルスを利用する回路及び方法 |
JP2009540442A (ja) * | 2006-06-08 | 2009-11-19 | 株式会社オプトエレクトロニクス | 耐周囲光ノイズ用デジタル化回路 |
US8396112B2 (en) | 2006-11-28 | 2013-03-12 | Seiko Epson Corporation | Circuitry and method for transferring data, and circuitry and method utilizing clock pulses |
JP2016146535A (ja) * | 2015-02-06 | 2016-08-12 | アンリツ株式会社 | 誤り率測定装置及び誤り率測定方法 |
-
1991
- 1991-03-05 JP JP6404191A patent/JPH04277931A/ja active Pending
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2009540442A (ja) * | 2006-06-08 | 2009-11-19 | 株式会社オプトエレクトロニクス | 耐周囲光ノイズ用デジタル化回路 |
JP2008160797A (ja) * | 2006-11-28 | 2008-07-10 | Seiko Epson Corp | データ転送を行う回路及び方法並びにクロックパルスを利用する回路及び方法 |
US8396112B2 (en) | 2006-11-28 | 2013-03-12 | Seiko Epson Corporation | Circuitry and method for transferring data, and circuitry and method utilizing clock pulses |
JP2016146535A (ja) * | 2015-02-06 | 2016-08-12 | アンリツ株式会社 | 誤り率測定装置及び誤り率測定方法 |
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