JPH0426471B2 - - Google Patents

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JPH0426471B2
JPH0426471B2 JP59167309A JP16730984A JPH0426471B2 JP H0426471 B2 JPH0426471 B2 JP H0426471B2 JP 59167309 A JP59167309 A JP 59167309A JP 16730984 A JP16730984 A JP 16730984A JP H0426471 B2 JPH0426471 B2 JP H0426471B2
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cursor
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raster
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JP59167309A
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JPS6055393A (ja
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Jeemusu Kuraaku Junia Chaaruzu
Hooru Sutatsugusu Keuin
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Honeywell Inc
Original Assignee
Honeywell Inc
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Publication date
Application filed by Honeywell Inc filed Critical Honeywell Inc
Publication of JPS6055393A publication Critical patent/JPS6055393A/ja
Publication of JPH0426471B2 publication Critical patent/JPH0426471B2/ja
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    • GPHYSICS
    • G09EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09GARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/08Cursor circuits

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Controls And Circuits For Display Device (AREA)

Description

【発明の詳細な説明】 〔発明の技術分野〕 本発明は、コンピユータにより発生されるラス
タグラフイツク・システムの分野に関し、さらに
詳細には、複数の形状から選択した1つの形状の
カーソルをラスタ上の任意の位置に表示する改良
した装置に関する。
〔従来技術〕
ラスタ走査CRT表示装置は、コンピユータ・
ユーザーとそのハードウエア/ソフトウエア・シ
ステムとの間の主交信リンクを形成する。コンピ
ユータにより発生されるラスタグラフイツク・シ
ステムの基本的表示装置は、標準形テレビ受像機
に近似したCRTモニタである。ラスタグラフイ
ツク・システムの可能性を十分に活用するには、
そのようなシステムは、通常のCRTモニタが必
要とするデジタル演算を実質的に上回るデジタル
演算の支援を必要とする。大規模集積回路及びマ
イクロコンピユータの開発により、そのような表
示装置を適正なコストで制御できるようになつ
た。通常、CRTの画素(ピクセル)のほほ矩形
のアレイにおいて、それぞれの画素には特定のア
ドレスが割当てられ、そのアドレスはアレイ内の
各画素のX座標及びY座標から構成される。画素
の表示(色及び輝度)を制御するための情報、す
なわち画素制御情報は、ランダムアクセス画素記
憶装置において、画素のアドレスに対応するアド
レス記憶領域に記憶される。そのような画素制御
情報の発生源は、通常、図形制御装置に配置され
るマイクロコンピユータである。そのような画素
制御情報は、アレイの各画素が走査されるときに
各画素の輝度と色を制御するために使用される2
進制御信号が記憶されるカラー・ルツクアツプ
(カラー索引)記憶装置の記憶領域のアドレスを
含む。
ラスタ走査の水平掃引信号及び垂直掃引信号
は、走査中の画素のアドレスを発生するためにデ
ジタル化される。システムのラスタ走査論理回路
により発生される2進アドレス信号は画素記憶装
置に印加される。この画素記憶装置には、画素の
表示決定用の画素制御信号ないし情報が、図形制
御装置により予め記憶されている。画素記憶装置
は、そのような画素制御信号をシステムのCRT
モニタにおける画素の走査に同期して発生する。
画素記憶装置のアドレスされる記憶領域に記憶さ
れる画素制御信号は、カラー・ルツクアツプ(索
引)記憶装置に印加するカラーアドレスを示す。
カラー・ルツクアツプ記憶装置に記憶されたデジ
タルカラー制御信号は、カラー・ルツクアツプ記
憶装置における上記アドレスの記憶領域から読出
される。デジタルカラー制御信号はデジタル/ア
ナログ(D/A)変換器によりアナログ信号に変
換され、そのアナログ信号はラスタの各画素の輝
度と色を制御するために通常のCRTモニタの3
つのカラーガンに印加される。
多くのラスタグラフイツク・システムは、カー
ソル(すなわち移動マーカー)を表示することが
できる。これまでに公知となつている従来のグラ
フイツク・システムは図形制御装置を次のように
プログラムすることによりカーソルを発生する。
すなわち、画素記憶装置における、カーソルの境
界内の画素アドレスに、カーソル形成用の画素制
御信号を書込み、その画素制御信号によりカーソ
ルの境界内の、カーソル形状に応じて選択された
画素をカーソル色及びカーソル輝度で表示させる
ように図形制御装置をプログラムすることにより
カーソルが発生される。このような先行技術のラ
スタグラフイツク・システムは、通常、カーソル
の表示可能な位置をたとえば8×12個の画素から
成る文字セルに制限する。
カーソルをラスタ内に表示させるため、ランダ
ムアクセス画素記憶装置に画素カラー情報を書込
むことにより、システムの図形制御装置と画素記
憶装置との間の通信量は著しく増大する。問題
は、カーソルを形成する選択された画素をカーソ
ル色及び輝度で表示させる画素制御信号を選択さ
れた画素領域に書込むことのみならず、画素記憶
装置における所定の記憶領域の画素カラー情報の
ような必要情報を、カーソルが移動又はオフされ
るまで別の場所にストアしておき、次にその画素
カラー情報を画素記憶装置の適正な記憶領域にリ
ストアしなければならないことである。従来のシ
ステムにカーソル表示機能を与えると、図形制御
装置のプログラミングの複雑さも増大する。
〔発明の概要〕
従つて、カラーラスタグラフイツク・システム
においては、図形制御装置によりカーソル画素制
御情報が書込まれる記憶領域に記憶されている画
素カラー情報を記憶したり更新したりする必要な
く、更に、カーソルが移動されたり表示されなく
なつたときに画素カラー情報ををリストアする必
要なく、また、複数の形状のうち任意の形状のカ
ーソルを発生する機能の提供が望まれる。また、
カーソルをラスタの任意の画素に位置決めできる
システムを提供すると共に、インターレース形垂
直走査装置を有するシステムにおいても適正に機
能するカーソルを発生することが望まれる。
本発明によれば、次のようなカラー・グラフイ
ツク・システムとともに使用するカーソル発生装
置が提供される。カラー・グラフイツク・システ
ムは、画素クロツク毎に発生されるラスタの画素
アドレスを用いて、カラー・ルツクアツプ記憶装
置へアクセスするためのカラーアドレスを発生す
る。そのカラーアドレスでのカラー・ルツクアツ
プ記憶装置へのアクセスにより、走査されようと
している画素が表示される時の色と輝度とを決定
するカラー制御信号を与える。本発明のカーソル
発生装置によりカーソル制御信号が発生される
と、カラー・グラフイツク・システムのカラーア
ドレスに従つてカラー・ルツクアツプ記憶装置か
らカラー制御信号を発生する代わりに、そのカー
ソル制御信号に応じて前記カラー・ルツクアツプ
記憶装置からカラー制御信号を発生させる。
発生されるカーソルは所定の境界内に複数のカ
ーソル画素位置を有し、その中の1つのカーソル
画素位置は、ラスタの走査に伴つて表示されるカ
ーソルの始点画素位置であり、所定の境界内のカ
ーソル画素位置のうちから選択されたカーソル画
素位置が、所定のカーソル色とカーソル輝度で、
複数の所定のカーソル形状の1つに従つて表示さ
れるものである。
本発明のカーソル発生装置は、カーソルの始点
画素位置のラスタ画素アドレスと、カラー・グラ
フイツク・システムのラスタ画素アドレスとが一
致したときに一致信号を発生する。この一致信号
を用いて、前記の所定の境界内のカーソル画素位
置に対応しているラスタの画素を特定し、特定さ
れたラスタの画素それぞれに関して、それが走査
されんとする度に、カーソルの特定されたカーソ
ル形状に対応するものに対してはカーソル制御信
号を発生する。上記のように、カラー・ルツクア
ツプ記憶装置に対するカラーアドレスに従つたア
クセスに優先して、このカーソル制御信号に応じ
てカラー・ルツクアツプ記憶装置からカラー制御
信号を発生させ、そのカラー制御信号により、走
査されて表示される画素を、選択されたカーソル
色で選択されたカーソル輝度で表示する。
本発明の目的は、カーソルを発生するための記
憶装置に対する入出力要求が最低限に抑えられる
ようなラスタグラフイツク・システムのカーソル
を発生する改良された装置を提供することであ
る。
本発明の別の目的は、カーソルの形状を容易に
変更できるようなラスタグラフイツク・システム
においてカーソルを発生する改良された装置を提
供することである。
本発明のさらに別の目的は、カーソルをラスタ
の任意の画素に対して配置することができるよう
なラスタグラフイツク・システムにおいてカーソ
ルを発生する改良された装置を提供することであ
る。
本発明のさらに別の目的は、インターレース形
垂直走査装置と共に機能するラスタグラフイツ
ク・システムにおいてカーソルを発生する改良さ
れた装置を提供することである。
〔実施例〕
以下、添付の図面に基づいて本発明を詳細に説
明する。
第1図は、コンピユータにより発生されるラス
タグラフイツク画像を制御する装置を示す。図形
制御装置10は次の機能を有する。すなわち、英
字用ランダムアクセス記憶装置12と、図形記憶
装置14と、カラー・ルツクアツプ記憶装置16
と、カーソル表示論理回路18とに対して、従来
のカラーCRTモニタ(図示せず)の各画素の輝
度と色を制御するために使用される2進デジタル
情報ないし信号を書込むと言う機能を有する。従
来のCRTモニタのラスタ走査論理回路20は、
CRTの画面の各画素について1つのアドレスを
割当てるように、CRTモニタの垂直掃引信号お
よび水平掃引信号をデジタル化する従来のデジタ
ル化回路を含む。標準形のCRTラスタの480本の
水平線それぞれ含まれる640個の画素をそれぞれ
特定して識別するためには、10ビツトから構成さ
れるX成分と、9ビツトから構成されるY成分と
を含む19ビツトのアドレスが必要とされる。Xア
ドレスはほぼ矩形のラスタの縦座標の画素に対応
し、Yアドレスは横座標の画素に対応する。第1
図には英数字記憶装置12、図形記憶装置14及
びカラー・ルツクアツプ記憶装置16は別個の装
置として図示されているが、それらを単一の従来
のランダムアクセス記憶装置の中に組み合わせ又
は配置しても良い。ここでは、英数字記憶装置1
2と図形記憶装置14とをまとめて画素記憶装置
22と呼ぶ。画素クロツク24は、ラスタ内の1
つの画素が走査されるたびに1つのクロツクパル
スを発生する。画素クロツク24の出力は、画素
記憶装置22及びカラー・ルツクアツプ記憶装置
16からデータを読出すために使用されると共
に、後述するようにカーソル表示論理回路18を
含む本発明の制御回路によつても使用される。
図示のシステムにおいて、画素クロツク24に
よりクロツクパルスが発生されるたびに、ラツチ
及びシフトレジスタ26から7ビツトの英数字カ
ラーアドレスと2つの優先順位ビツトPr0及び
Pr1がカラー・ルツクアツプ・アドレスセレクタ
28へ伝送される。同時に、5ビツトの図形カラ
ーアドレスがカラー・ルツクアツプ・アドレスセ
レクタ28へ伝送される。それらの5ビツトは画
素クロツクの各パルス毎にシフトレジスタ群30
のそれぞれから1ビツトずつシフトアウトされる
ものである。2つの優先順位ビツトPr0及びPr1
の値に基づいて、カラー・ルツクアツプ・アドレ
スセレクタ28はカラー・ルツクアツプ記憶装置
16にそのアドレスの下位ビツトとなる5ビツト
の図形カラーアドレス又は7ビツトの英数字カラ
ーアドレスを含む8ビツトのアドレスを印加す
る。
カラー・ルツクアツプ記憶装置16の記憶領域
であつて、カラー・ルツクアツプ・アドレスセレ
クタ28により印加されるカラーアドレスを有す
る記憶領域には、従来のカラーCRTモニタのカ
ラーガンの電子ビームの輝度を制御するために使
用され、各画素が走査されるときに各画素の色と
輝度すなわち表示を決定するカラー制御信号が記
憶されている。カラー・ルツクアツプ記憶装置1
6においてカラーアドレスに対応する記憶領域に
は8ビツトから成る1バイトが記憶される。画素
列すなわちラスタの各画素の走査と同期して、8
ビツトから成る1バイトのカラー制御信号がカラ
ー・ルツクアツプ記憶装置16から読出され、
D/A変換器32に印加される。D/A変換器3
2は、8つの2進信号のうち6つを、従来の
CRTモニタの赤色、緑色及び青色の電子銃の輝
度を制御するためのアナログ信号に変換する。さ
らに、好ましい実施例においては、カラー制御信
号の2ビツトが別のD/A変換器に印加される。
このD/A変換器は、それら2つのビツトを、先
行技術において良く知られているように従来の機
器を使用してラスタ表示の永久記録を作成するた
めに使用することができる単色アナログ信号に変
換する。
第2図は、非インターレースラスタ走査のため
のカーソル表示論理回路18を詳細に示す。図形
制御装置10は、ユーザーからの指令を受ける
と、表示されるべき所望のカーソル形状に割当て
られた番号をカーソル番号ラツチ34に書込む。
図形制御装置10は、さらに、カーソルの始点画
素位置(原点)のY座標をカーソル垂直方向位置
ラツチ36に書込むと共に、カーソルの始点画素
位置のX座標をカーソル水平方向位置ラツチ38
に書込む。それらのX及びY座標は、ラスタ上の
1画素のアドレスであつて、カーソルの始点画素
位置(原点)「0」(第4A図〜第4D図参照)の
位置を示すアドレスである。カーソル垂直方向位
置ラツチ36に記憶されるY座標は、垂直方向用
比較器40にその一方の入力として印加される。
その他方の入力は、ラスタ走査論理回路20によ
り発生される走査中の画素のアドレスのY座標で
ある。同様に、カーソル水平方向位置ラツチ38
に記憶されるカーソルの始点画素位置のX座標
は、水平方向用比較器42にその一方の入力とし
て印加され、その他方の入力は、ラスタ走査論理
回路20により発生される走査中の画素のアドレ
スのX座標である。走査中の画素のX座標がカー
ソル水平方向位置ラツチ38に記憶された表示す
べきカーソルの始点画素位置のX座標と同じであ
るとき、水平方向用比較器42は水平方向比較信
号を発生する。水平方向比較信号は水平方向エネ
イブル・フリツプフロツプ44に印加され、この
フリツプフロツプ44は、水平方向比較信号によ
りセツトされると、水平方向エネイブル信号を発
生する。水平方向エネイブル信号は水平方向カウ
ンタ46及びカーソル・エネイブル回路48に印
加される。好ましい実施例においては、水平方向
用カウンタ46は4ビツト・カウンタであり、カ
ーソル・エネイブル回路48はANDゲートであ
る。画素クロツク24からの画素クロツク信号は
水平方向用カウンタ46に印加され、そのカウン
タ46の出力が画素クロツク信号ごとに変化す
る。水平方向エネイブル信号が発生された後、16
個の画素クロツク信号がカウントされたとき、十
六カウント(カウント=16)信号が水平方向エネ
イブル・フリツプフロツプ44のリセツト入力端
子に印加され、それによりフリツプフロツプ44
はリセツトされ、カウンタ46は動作を停止す
る。
走査中のラスタの画素のY座標がカーソル垂直
方向位置ラツチ36に記憶されたカーソルの始点
画素位置のY座標と等しいとき、垂直方向用比較
器40は垂直方向比較信号を発生する。垂直方向
比較信号は垂直方向エネイブル・フリツプフロツ
プ50に印加され、これをセツトする。その結
果、垂直方向エネイブル・フリツプフロツプ50
は垂直方向エネイブル信号を発生し、この信号は
垂直方向カウンタ52及びカーソル・エネイブル
回路48に印加される。この実施例では4ビツト
カウンタである垂直方向用カウンタ52は、垂直
方向エネイブル信号によりエネイブルされると、
印加される垂直方向走査クロツクパルスをカウン
トする。16個の垂直方向走査クロツクパルスがカ
ウントされると、十六カウント(カウント=16)
信号が垂直方向エネイブル・フリツプフロツプ5
0のリセツト端子に印加される。垂直方向エネイ
ブル・フリツプフロツプ50及び水平方向エネイ
ブル・フリツプフロツプ44が共にセツトされる
と、カーソル・エネイブル回路48はカーソル・
エネイブル信号を発生し、この信号はカーソル・
シフトレジスタ54に印加される。
カーソル制御ビツトないし信号は、カーソル記
憶装置56のアドレス可能な記憶領域に記憶され
ている。好ましい実施例においては、カーソル記
憶装置56は8ビツト・アドレスを有するリード
オンリー(読出し専用)記憶装置であり、それぞ
れのアドレス可能な記憶領域に4つのカーソル制
御ビツトを記憶する。カーソル記憶装置56への
8ビツト・アドレスは、カーソル番号ラツチ34
からの2ビツトのカーソル番号と、垂直方向用カ
ウンタ52からの4ビツト垂直方向成分と、水平
方向用カウンタ46からの上位2ビツトの水平方
向成分とから構成される。水平方向用カウンタ4
6からの下位2ビツトの水平方向成分は、画素ク
ロツク24からの画素クロツク信号と共にカーソ
ル・シフトレジスタ54に印加される。カーソ
ル・エネイブル回路48からのカーソル・エネイ
ブル信号が真であるとき、カーソル・シフトレジ
スタ54はカーソル記憶装置56からクロツクの
4周期ごとに4つのカーソル制御ビツトを受け取
る。カーソル・シフトレジスタ54はクロツク周
期中に対応する画素の走査と同期してカーソル制
御信号を発生すなわちシフトアウトする。水平方
向用カウンタ46からの下位2ビツトは、カーソ
ル記憶装置56のアドレスされた記憶領域から読
出され、カーソル・シフトレジスタ54へとその
エネイブルによりシフトインされる4つのカーソ
ル制御ビツトのそれぞれをカウントするために使
用される。好ましい実施例においては、上記のエ
ネイブルは、水平方向用カウンタ46により発生
される下位2ビツトが共に論理値「0」であると
きに起こる。
第3図は、カラー・ルツクアツプ・アドレスセ
レクタ28の一部を示す。第1図のシステム及び
カラー・ルツクアツプ・アドレスセレクタ28の
十分な説明は、1982年1月18日に出願され、本願
出願人に譲渡されたKevin P.Staggs及び
Charles.J.Clarke,Jr.による出願番号06/340,
141,名称「Method and Apparatus for
Controlling the Display of a Computer
Generated Raster Graphic System」に開示さ
れている。
8ビツトのカラー・ルツクアツプ記憶装置用の
カラーアドレスは、図形アドレスレジスタ58及
び英数字アドレスレジスタ60に記憶される。カ
ラー・ルツクアツプ・アドレスセレクタ28に印
加される図形アドレス及び英数字アドレスは8ビ
ツトであるとは限らないので、セレクタ28の出
力を8ビツトのカラーアドレスとするために上位
ビツト位置を所定の論理値にする。図形アドレス
レジスタ58及び英数字アドレスレジスタ60の
出力は2つの8ビツトマルチプレクサ62,64
に印加される。8ビツトマルチプレクサ62,6
4により選択される8ビツトは、マルチプレクサ
62,64の選択端子「S」に印加される英数字
表示信号ANDSの値により決定される。ANDS
が真であれば、英数字アドレスレジスタ60から
の8ビツトはカラー・ルツクアツプ記憶装置16
に印加される。信号ANDSが偽であれば、図形
アドレスレジスタ58からの8ビツトがカラー・
ルツクアツプ記憶装置16に印加される。カーソ
ル・シフトレジスタ54からのカーソル制御ビツ
トは、8ビツトマルチプレクサ62,64のエネ
イブル端子「E」に印加され、真であるとき、マ
ルチプレクサ62,64の全ての出力を論理値
「0」にする。カラー・ルツクアツプ記憶装置1
6のゼロアドレス記憶領域には、カーソルを形成
する画素の色と輝度を決定するカラー制御信号が
記憶される。
第4A図から第4D図は、カーソル66の形状
の例を示す。好ましい実施例においては、カーソ
ル66は、一辺に16個までの画素を含む境界内の
画素(カーソル画素とも呼ばれる)により表示さ
れる。ただし第4A図に示される、クロスヘア
(十字線)を境界内の選択された画素により形成
するカーソル66aは、一辺に15個の画素を有
し、カーソルの色と輝度を表示する線セグメント
それぞれは7個の画素を有する。第4B図におい
ては、カーソル66bは、カーソル輝度でカーソ
ルの色をそれぞれ表示する16個の画素から成る最
上行と最下行を有する。第4C図のカーソル66
cは、カーソルの色と輝度を表示する最上行と最
下行に8個の画素を有する。第4D図のカーソル
66dは8×16個の画素から成る矩形である。
好ましい実施例においては、カーソルの始点画
素位置すなわち原点「0」は、カーソル66a〜
66dを形成する16×16個の画素位置の左上角に
ある画素位置である。カーソル66aの場合、始
点画素位置「0」に対応する画素はカーソルの色
と輝度で表示されないが、その他の全ての形態に
ついては始点画素位置は表示される。カーソルは
図示したもの以外の形状であつても良く、形状の
種類数も変えることができる。
第5図はメモリマツプの例を示す。この例は、
第4C図に示されるカーソル66cのメモリマツ
プである。論理値「1」は行0及び15のビツト位
置0〜7に書込まれる。この形態の場合、カーソ
ル記憶装置56の対応セグメントの他の全てのビ
ツト位置は論理値「0」になる。始点画素位置は
第5図に示されるビツト位置0,0に対応する。
第6図は、CRTモニタのラスタ走査がインタ
ーリーブされるときに使用される、変形したカー
ソル表示論理回路18′を示す。ラスタ走査がイ
ンターリーブされるとき、偶数番号の水平走査線
のすべてが走査され、それに続いて奇数番号の走
査線が走査される。奇数/偶数フレームビツトと
しても知られているY座標の最下位ビツト
(LSB),すなわち線アドレスは、奇数番号の走
査線群のフレーム(すなわち走査)又は偶数番号
の走査線群のフレーム(すなわち走査)を通して
一定である。走査をインターリーブすると、特に
始点画素位置が奇数番号の走査線上にある場合
に、垂直方向用比較器40は、カーソルの始点画
素位置の9ビツトのY座標のうち上位の8ビツト
のみを走査中の画素のY座標の上位8ビツトと比
較するために、カーソル表示論理回路に問題が生
じる。変形を加えないと、カーソル表示論理回路
18は偶数番号の走査線では始動するが奇数番号
の走査線では始動しないことになる。この問題を
解決するために、ラスタ走査論理回路20により
発生されるフレームビツトと、カーソル垂直方向
位置ラツチ36に記憶された始点画素位置のY座
標のLSBとを、排他的OR回路68に印加する。
排他的OR回路68の出力は、カーソル記憶装置
56に印加されるアドレスのY成分のLSBとな
る。カーソル表示論理回路18′のもう1つの変
形箇所は、垂直方向用カウンタ52′が3ビツト
カウンタであることである。第6図の変形例にお
いては、カーソル記憶装置56に印加されるアド
レス信号のY成分は垂直方向用カウンタ52′か
らの3ビツトと、排他的OR回路68からの1ビ
ツト(LSB)とから構成される。
垂直方向走査がインターレースされる場合に発
生する別の問題は、カーソルの始点画素位置が奇
数番号の走査線上にあり且つフレームビツトが偶
数であるとき、垂直方向エネイブル信号の発生を
走査線1本分、すなわち、垂直方向走査クロツク
パルス1つ分(すなわち、エンド・オブ・ライン
のタイミングパルス1つ分)だけ遅延させなけれ
ばならないことである。これを達成する回路は、
Dフリツプフロツプ70と、4:1マルチプレク
サ72とを含む。
走査中の画素のフレームビツトと、カーソルの
始点画素位置のY座標の最下位ビツトは、4:1
マルチプレクサ72のA端子とB端子に印加さ
れ、4つの入力のうちどれがカーソルエネイブル
回路48及び垂直方向用カウンタ52′に印加さ
れるかを選択する。これを実行するために、垂直
方向エネイブル・フリツプフロツプ50の出力は
Dフリツプフロツプ70のD入力端子と4:1マ
ルチプレクサ72の4つの入力端子のうち3つの
端子に印加される。マルチプレクサ72への第4
の入力はDフリツプフロツプ70のQ出力であ
る。Dフリツプフロツプ70のセツト端子には、
3ビツトの垂直方向用カウンタ52′により発生
され、Dフリツプフロツプ50をリセツトする八
カウント(カウント=8)信号が印加される。D
フリツプフロツプ70のクロツク信号入力端子に
はラスタ走査論理回路20により発生される垂直
方向走査クロツクパルスが印加される。
排他的OR回路68を含む回路は、カーソル記
憶装置56に印加されるカーソル・アドレスのY
成分の最下位ビツト(LSB)により、走査中の
画素の線がカーソルの始点画素位置と同じY座標
を有するときに、カーソル制御信号がカーソル記
憶装置56から読出されてカーソルシフトレジス
タ54から発生されることを確実に開始させる。
同様に、Dフリツプフロツプ70及び4:1マル
チプレクサ72を含む回路は、カーソルの始点画
素位置のY座標が奇数の2進数であり且つフレー
ムビツトが偶数である場合に、垂直方向用カウン
タ52′及びカーソル・エネイブル回路48への
垂直方向エネイブル信号の印加を水平走査線1本
だけ遅延させる。
本発明の装置によれば、ラスタグラフイツク・
システムにより、図形制御装置に最少限の付加条
件を課すだけでいくつかのカーソル形状の中の任
意のものを表示できることは明らかである。カー
ソル形状の変更はカーソル記憶装置56を置換え
ることにより可能である。カーソル記憶装置56
を大形にすれば、カーソル表示論理回路18,1
8′を別に適切に変形した場合に表示しうるカー
ソル形状の数をふやすこともできる。さらに、垂
直方向走査がインターレースないしインターリー
ブされるときに適正に機能するように本発明のカ
ーソル表示論理回路を変形することができる。
【図面の簡単な説明】
第1図は、表示装置の詳細部を省略したラスタ
グラフイツク・システムの概略的なブロツク線
図;第2図は、本発明のカーソル表示論理回路の
概略的なブロツク線図;第3図は、カーソル表示
論理回路と共に動作するように変形されたラスタ
グラフイツク・システムのカラー・ルツクアツ
プ・アドレスセレクタの一部分の概略的なブロツ
ク線図;第4A図から第4D図は、カーソルの
様々な形状を示す図;第5図は、カーソル記憶装
置の構成を示す略図;及び第6図は、垂直方向走
査がインターレースされるときに使用するための
カーソル表示論理回路の変形を示す第2図と同様
の概略的なブロツク線図である。 10……図形制御装置、16……カラー・ルツ
クアツプ記憶装置、18,18′……カーソル表
示論理回路、20……ラスタ走査論理回路、34
……カーソル番号ラツチ、36……カーソル垂直
方向位置ラツチ、38……カーソル水平方向位置
ラツチ、40……垂直方向用比較器、42……水
平方向用比較器、44…水平方向エネイブルフリ
ツプフロツプ、46……水平方向用カウンタ、4
8……カーソルエネイブル回路、50……垂直方
向エネイブルフリツプフロツプ、52,52′…
…垂直方向用カウンタ、54……カーソルシフト
レジスタ、56……カーソル記憶装置、68……
排他的OR回路、70……Dフリツプフロツプ、
72……4:1マルチプレクサ。

Claims (1)

  1. 【特許請求の範囲】 1 ラスタの各画素が画素アドレスを有するラス
    タ表示装置と、画素クロツクを発生する手段24
    と、ラスタにおいて走査されようとしている画素
    のラスタ画素アドレスを、画素クロツク毎に発生
    するラスタ画素アドレス発生手段20とを備え、
    前記ラスタ画素アドレスを用いてカラー・ルツク
    アツプ記憶装置16へのアクセス用のカラーアド
    レスを発生し、そのカラーアドレスでのカラー・
    ルツクアツプ記憶装置16へのアクセスにより、
    前記の走査されようとしている画素が表示される
    時の色と輝度とを決定するカラー制御信号を与え
    る、カラー・グラフイツク・システム ととに使用するカーソル発生装置であつて: 発生されるカーソルが、所定の境界内に複数の
    カーソル画素位置を有し、その中の1つのカーソ
    ル画素位置は、前記ラスタの走査に伴つて表示さ
    れるカーソルの始点画素位置であり、前記の所定
    の境界内のカーソル画素位置のうちから選択され
    たカーソル画素位置が、所定のカーソル色とカー
    ソル輝度で、複数の所定のカーソル形状の1つに
    従つて表示されるものであり; カーソル発生装置は、 カーソルのカーソル形状と、カーソルの始点画
    素位置とを特定する手段34,36,38と、 カーソルの始点画素位置のラスタ画素アドレス
    と、前記ラスタ画素アドレス発生手段20から発
    生されるラスタ画素アドレスとを、画素クロツク
    毎に比較し、それらが一致したときに一致信号を
    発生する手段40,50,42,44,48と; この一致信号を用いて、前記の所定の境界内の
    カーソル画素位置に対応しているラスタの画素を
    特定する手段52,46と、 この特定されたラスタの画素それぞれに関し
    て、それが走査されんとする度に、カーソルの特
    定されたカーソル形状に対応するものに対しては
    カーソル制御信号を発生する手段56,54と、 前記カラーアドレスでの前記カラー・ルツクア
    ツプ記憶装置16へのアクセスに優先して、この
    カーソル制御信号に応じて前記カラー・ルツクア
    ツプ記憶装置16からカラー制御信号を発生さ
    せ、そのカラー制御信号により、走査されて表示
    される画素を、選択されたカーソル色で選択され
    たカーソル輝度で表示する手段28と を備えたことを特徴とするカラー・グラフイツ
    ク・システムととに使用するカーソル発生装置。
JP59167309A 1983-08-11 1984-08-11 カラー・グラフィック・システムとともに使用するカーソル発生装置 Granted JPS6055393A (ja)

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