JPH04206658A - ハーメチックシール型電気回路装置 - Google Patents

ハーメチックシール型電気回路装置

Info

Publication number
JPH04206658A
JPH04206658A JP33060190A JP33060190A JPH04206658A JP H04206658 A JPH04206658 A JP H04206658A JP 33060190 A JP33060190 A JP 33060190A JP 33060190 A JP33060190 A JP 33060190A JP H04206658 A JPH04206658 A JP H04206658A
Authority
JP
Japan
Prior art keywords
board
electric circuit
circuit device
substrate
hermetically sealed
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
JP33060190A
Other languages
English (en)
Other versions
JP2925722B2 (ja
Inventor
Kunio Nishihara
邦夫 西原
Yoichi Hosono
細野 洋一
Takayuki Ishikawa
石川 孝幸
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsui Toatsu Chemicals Inc
Original Assignee
Mitsui Toatsu Chemicals Inc
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsui Toatsu Chemicals Inc filed Critical Mitsui Toatsu Chemicals Inc
Priority to JP33060190A priority Critical patent/JP2925722B2/ja
Publication of JPH04206658A publication Critical patent/JPH04206658A/ja
Application granted granted Critical
Publication of JP2925722B2 publication Critical patent/JP2925722B2/ja
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/19Details of hybrid assemblies other than the semiconductor or other solid state devices to be connected
    • H01L2924/191Disposition
    • H01L2924/19101Disposition of discrete passive components
    • H01L2924/19105Disposition of discrete passive components in a side-by-side arrangement on a common die mounting substrate
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/30Technical effects
    • H01L2924/301Electrical effects
    • H01L2924/3025Electromagnetic shielding
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/0284Details of three-dimensional rigid printed circuit boards
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/03Use of materials for the substrate
    • H05K1/05Insulated conductive substrates, e.g. insulated metal substrate
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/14Structural association of two or more printed circuits
    • H05K1/144Stacked arrangements of planar printed circuit boards

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明はICチップ、LSIチップなどの半導体チップ
や抵抗、コンデンサ、コイルなどのチップ部品を実装し
たハーメチックシール型の電気回路装置に関するもので
あり、特に放熱性、耐熱性、高実装密度に優れ、しかも
構成が簡単で安価に製造することができるハーメチック
シール型電気回路装置に関するものである。
(従来の技術) 半導体ICやLSIチップなどの半導体チップを気密に
実装したハーメチックシール型の電子部品は既知であり
、種々の構成のものが提案されている。例えば、メタル
キャップやセラミックケースを用いたハーメチックシー
ルのパッケージがある。メタルキャップを用いるもので
は、半導体チップを実装した基板に所定の形状に予め加
工した金属キャップを気密封止している。また、セラミ
ックケースを用いるものでは所定の形状に成形したセラ
ミックキャップに半導体チップを実装した後、気密に封
止している。このように半導体チップを1個づつパッケ
ージにハーメチックシールした電子部品を、例えばプリ
ント配線基板に実装して電気回路装置を構成している。
(発明が解決しようとする課題) 上述した従来のハーメチックシール型の電気回路装置に
おいては、個々の半導体チップをパッケージに封止して
いるため、電気回路装置を構成したときに実装密度が低
くなる欠点がある。また、メタルキャップやセラミック
ケースを用いているため高価となる欠点もある。
このような欠点を解決するために、金属板の表面に絶縁
膜を介して被着された導電箔を有し、この導電箔をパタ
ーニングして半導体チップやチップ部品を装着した第1
の基板をキャップ状に絞り加工を施し、平板状に構成し
た第2の基板の表面に、これら第1および第2の基板の
間に外部から遮蔽された空間が画成されるように気密に
結合したハーメチックシール型電気回路装置が提案され
ている。このようなハーメチックシール型電気回路装置
においては、絶縁膜としてエボキン系の絶縁膜を用いて
いるが、第1の基板の絞り加工性を良好とすると第1の
基板と第2の基板とをボンディングする際の耐熱性に劣
り、このボンディングの際の耐熱性を改善しようとする
と絞り加工性が悪くなるという欠点がある。
本発明の目的は上述した従来の欠点を除去し、耐熱性、
放熱性に優れているとともに高い実装密度が得られ、し
かも安価に構成することができるハーメチックシール型
電気回路装置を提供しようとするものである。
(課題を解決するための手段) 本発明によるハーメチックシール型電気回路装置は、金
属板の表面に絶縁性の熱可塑性ポリイミドを介して被着
された導電箔を有し、この導電箔をパターニングし、そ
の上に電子部品を装着し、絞り加工によりキャップ状に
構成された第1の基板と、金属板の表面に絶縁性の熱可
塑性ポリイミドを介して被着された導電箔を有する第2
の基板とを、これらの間に外部から遮蔽された空間が画
成され、前記第1および第2の基板の導電箔が互いに対
向するように気密に結合したことを特徴とするものであ
る。
実装密度をさらに向上した本発明によるハーメチックシ
ール型電気回路装置の好適な実施例においては、前記第
2の基板の導電箔をパターニングし、その上に電子部品
を装着する。
このような本発明によるハーメチックシール型電気回路
装置においては、絶縁膜として耐熱性の良い熱可塑性ポ
リイミドを用いているため第1の基板の絞り加工性を良
好とすることができるとともに第1および第2の基板を
、例えばはんだを用いて接合する際に加熱されても、絶
縁膜が劣化することもない。さらに、放熱性も良いため
半導体チップの過熱も有効に防止することができる。さ
らに、従来のメタルキャップやセラミックケースを用い
たものに比べてきわめて安価に構成することができる。
(実施例) 第1図〜第6図は本発明によるハーメチックシール型電
気回路装置の一実施例を製造する際の順次の工程を示す
断面図である。第1図は第1の基板11の構成を示すも
のであり、金属板12の表面に熱可塑性ポリイミド膜1
3を被着し、さらにその上に銅箔14を被着して構成す
る。金属板12は、アルミ、ステンレス、銅、銅クラツ
ドインバー、鉄などを以て構成することができる。この
第1の基板11の銅箔14をエツチングして第2図に示
すように導体回路を構成する。
次に、第3図に示すように第1の基板11に絞り加工を
施してキャップ状に形成し、さらに第4図に示すように
銅箔14に形成した所定のポンディングパッドに半導体
チップ15やチップ部品16を装着し、さらにボンディ
ングワイヤ17によって銅箔をエツチングして形成した
所定の導体パターンに接続する。
第5図に示すように、第1の基板11と同様に金属板2
2の表面に熱可塑性ポリイミド膜23を被着し、さらに
その上に銅箔24を被着して構成した第2の基板21を
準備し、その銅箔をエツチングして所定のボンディング
バノドおよび導体パターンを形成する。この第2の基板
21の金属Fii22は、第1の基板11の金属板12
と同様にアルミ、ステンレス、洞、銅クラットインバー
、鉄などを以て構成することができる。この第2基板2
1のボンディングパノトに半導体チップ25やチップ部
品26を接合するとともにボンディングワイヤ27によ
って所定の導体パターンに接続する。さらに、キャップ
状に構成した第1の基板11を平板状の第2の基板21
の所定の位置に載せる。この際第1の基板11に形成し
た所定の導体パターンと第2の基板21に形成した所定
の導体パターンとが電気的に接続されるようにして第1
および第2の基板をはんだ28によって接合する。さら
に第1および第2の基板11および21の接合箇所をエ
ポキシ樹脂、ビスマレイミド樹脂、シリコン樹脂、ポリ
イミド樹脂などのシール材29によって気密に封止する
。このようにして第1および第2の基板11および2I
によって囲まれた気密空間の内部に半導体チップ15.
25やチップ部品16、26が実装された構成を得るこ
とができる。
次に、第6図に示すように第2の基板21の周縁を折り
曲げ加工して銅箔24の導体パターンを下側に位置させ
て、ハーメチックシール型の電気回路装置を完成する。
第7図は上述したようにして構成した本発明のハーメチ
ックシール型電気回路装置31をプリント配線基板32
上に実装した状態を示す斜視図である。
第6図に示したように第2の基板21の周縁を折り返し
加工することによってその導電箔24が下側に位置する
ようになり、この導電箔をパターニングして形成した導
体パターンがプリント配線基板32に形成した所定の導
体パターンと接触して電気的接続が行われるようになる
本発明は上述した実施例だけに限定されるものではな(
、幾多の変更や変形が可能である。例えば、上述した実
施例では、第1の基板を絞り加工した後に半導体チップ
やチップ部品を実装したが、これらの半導体チ・ンプや
チップ部品を実装した後に第1基板を絞り加工してキャ
ップ状に形成することもできる。また、キャップ状に形
成した第1の基板を平板状の第2の基板に接合するため
にはんだの代わりに導電性接着材を用いることもできる
(発明の効果) 上述した本発明によるハーメチックシール型電気回路装
置によれば、従来のように高価なメタルキャップやセラ
ミックケースを用いる必要がないため安価に構成するこ
とができる。また、複数の半導体チップやチップ部品を
1つの気密空間に配置することができるので実装密度を
向上することができる。さらに、第1および第2の基板
を構成する絶縁膜を、耐熱性および放熱性に優れた熱可
塑性ポリイミドを以て構成したため、第1の基板を絞り
加工したり第2の基板にはんだを用いて接合する際にも
劣化するようなことはない。
【図面の簡単な説明】
第1図〜第6図は本発明にょるハーメチックシール型電
気回路装置の一実施例の順次の製造工程における構成を
示す断面図、 第7図は本発明によるハーメチックシール型電気回路装
置をプリント配線基板に実装した状態を示す斜視図であ
る。 IL 21・・・第1および第2の基板12、22・・
・金属板 13、23・・・熱可塑性ポリイミド 14、24・・・銅箔    15.25・・・半導体
チップ16、26・・・チップ部品 17、27・・・ボンディングワイヤ 28・・・はんだ     29・・・シール材3工・
・・ハーメチックシール型電気回路装置32・・・プリ
ント配線基板 第4図 第5図 第6図

Claims (1)

  1. 【特許請求の範囲】 1、金属板の表面に絶縁性の熱可塑性ポリイミドを介し
    て被着された導電箔を有し、この導電箔をパターニング
    し、その上に電子部品を装着し、絞り加工によりキャッ
    プ状に構成された第1の基板と、金属板の表面に絶縁性
    の熱可塑性ポリイミドを介して被着された導電箔を有す
    る第2の基板とを、これらの間に外部から遮蔽された空
    間が画成され、前記第1および第2の基板の導電箔が互
    いに対向するように気密に結合したことを特徴とするハ
    ーメチックシール型電気回路装置。 2、前記第2の基板の導電箔をパターニングし、その上
    に電子部品を装着したことを特徴とする請求項1記載の
    ハーメチックシール型電気回路装置。
JP33060190A 1990-11-30 1990-11-30 ハーメチックシール型電気回路装置 Expired - Fee Related JP2925722B2 (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP33060190A JP2925722B2 (ja) 1990-11-30 1990-11-30 ハーメチックシール型電気回路装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP33060190A JP2925722B2 (ja) 1990-11-30 1990-11-30 ハーメチックシール型電気回路装置

Publications (2)

Publication Number Publication Date
JPH04206658A true JPH04206658A (ja) 1992-07-28
JP2925722B2 JP2925722B2 (ja) 1999-07-28

Family

ID=18234482

Family Applications (1)

Application Number Title Priority Date Filing Date
JP33060190A Expired - Fee Related JP2925722B2 (ja) 1990-11-30 1990-11-30 ハーメチックシール型電気回路装置

Country Status (1)

Country Link
JP (1) JP2925722B2 (ja)

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08153828A (ja) * 1994-09-27 1996-06-11 Nec Corp 半導体装置用パッケージ
US5600179A (en) * 1994-09-27 1997-02-04 Nec Corporation Package for packaging a semiconductor device suitable for being connected to a connection object by soldering
US5739463A (en) * 1994-04-11 1998-04-14 Raychem Corporation Sealed electronic packaging for environmental protection of active electronics
JP2007288054A (ja) * 2006-04-19 2007-11-01 Toyota Motor Corp パワーモジュール
JP2008099271A (ja) * 2000-11-28 2008-04-24 Knowles Electronics Llc 小型シリコンコンデンサマイクロフォンおよびその製造方法
JP2011253976A (ja) * 2010-06-03 2011-12-15 Murata Mfg Co Ltd 複合モジュール
WO2020178279A1 (en) * 2019-03-05 2020-09-10 Signify Holding B.V. Flexible printed circuit board assembly

Cited By (8)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5739463A (en) * 1994-04-11 1998-04-14 Raychem Corporation Sealed electronic packaging for environmental protection of active electronics
JPH08153828A (ja) * 1994-09-27 1996-06-11 Nec Corp 半導体装置用パッケージ
US5600179A (en) * 1994-09-27 1997-02-04 Nec Corporation Package for packaging a semiconductor device suitable for being connected to a connection object by soldering
JP2008099271A (ja) * 2000-11-28 2008-04-24 Knowles Electronics Llc 小型シリコンコンデンサマイクロフォンおよびその製造方法
JP2007288054A (ja) * 2006-04-19 2007-11-01 Toyota Motor Corp パワーモジュール
JP2011253976A (ja) * 2010-06-03 2011-12-15 Murata Mfg Co Ltd 複合モジュール
WO2020178279A1 (en) * 2019-03-05 2020-09-10 Signify Holding B.V. Flexible printed circuit board assembly
JP2022516582A (ja) * 2019-03-05 2022-02-28 シグニファイ ホールディング ビー ヴィ フレキシブルプリント回路基板アセンブリ

Also Published As

Publication number Publication date
JP2925722B2 (ja) 1999-07-28

Similar Documents

Publication Publication Date Title
KR950006439B1 (ko) 반도체장치 및 그 제조방법
US4819041A (en) Surface mounted integrated circuit chip package and method for making same
GB2286084A (en) Electronic package with thermally conductive support
US20010030357A1 (en) Semiconductor apparatus substrate, semiconductor apparatus, and method of manufacturing thereof and electronic apparatus
JP2925722B2 (ja) ハーメチックシール型電気回路装置
US4639830A (en) Packaged electronic device
JP3656861B2 (ja) 半導体集積回路装置及び半導体集積回路装置の製造方法
JP2944768B2 (ja) 集積回路部品とその製造方法
JP2541494B2 (ja) 半導体装置
JPH0458189B2 (ja)
JPH06216492A (ja) 電子装置
JP2879503B2 (ja) 面実装型電子回路装置
JP2771567B2 (ja) 混成集積回路
JPH03255655A (ja) 半導体装置
JP2544272Y2 (ja) 混成集積回路
JP2599290Y2 (ja) ハイブリッドic
WO2003021678A1 (en) Package for electronic components and method for forming a package for electronic components
US20020030272A1 (en) Semiconductor apparatus substrate, semiconductor apparatus, and method of manufacturing thereof and electronic apparatus
JPS61225827A (ja) 半導体素子の実装構造
JP3405718B2 (ja) 半導体装置
KR100609760B1 (ko) 회로패턴이 인쇄된 다층세라믹 접합 반도체장치 및 그제조방법
JPS6225444A (ja) 連続配線基板
JPH07176681A (ja) 半導体回路パッケージ
KR19990006189A (ko) 패턴 필름 및 이를 이용한 적층형 패키지
JPS63137460A (ja) 半導体チツプ搭載用プリント配線板

Legal Events

Date Code Title Description
LAPS Cancellation because of no payment of annual fees