JPH04145835A - 電源投入装置 - Google Patents
電源投入装置Info
- Publication number
- JPH04145835A JPH04145835A JP2267002A JP26700290A JPH04145835A JP H04145835 A JPH04145835 A JP H04145835A JP 2267002 A JP2267002 A JP 2267002A JP 26700290 A JP26700290 A JP 26700290A JP H04145835 A JPH04145835 A JP H04145835A
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- JP
- Japan
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- power
- switch
- flip
- power supply
- flop
- Prior art date
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Landscapes
- Direct Current Feeding And Distribution (AREA)
Abstract
め要約のデータは記録されません。
Description
源投入方式に関するものである。
ンピュータ、2は機器の電源、3は電圧検出器、4は電
源2をON10 F Fする電源スィッチ、5は外部ス
イッチ、6は波形整形用のインバータ、1は電源スィッ
チ4を制御するフリップフロップである。
によシ、電圧検出器3が動作し、マイクロコンピュータ
1のリセットを解除しマイクロコンピュータ1が動作を
はじめる。そして、このマイクロコンピュータ1はリセ
ットが解除された時点で自分のイニシャライズを行い、
イニシャライズ終了後、外部スイッチ5が接続されたI
/Q ポートの条件を検出する。外部スイッチ5が押
下されていないことを確認すると、フリップフロップ1
をリセットすると共に各部へ電源を加えないように電源
スィッチ4をオフにする。
スイッチ5を押下することによって行え、その信号はイ
ンバータ6にょシ波形整形されフリップフロップIに加
えられる。
れ、電源スィッチ4をオンとする。このとき、このイン
バータ6からの信号をマイクロコンピュータ1でも検出
し、規定の時間外部スイッチ5が押されているかをモニ
ターし、押されていれば各部の電源を加えたままとし、
外部スイッチ5が規定時間押されていなければ、マイク
ロコンピュータ1よシフリップフロップ7へリセット信
・号を出し、各部に加えられている信号を断とする。
コンピュータ1からリセット信号をフリップフロップ1
に加えるとき、外部スイッチ5が押された状態であると
、マイクロコンピュータ1からリセットを受けたフリッ
プフロップ7は出力をリセットし、マイクロコンピュー
タ1の電源を断とするが、このとき外部スイッチ5の押
下がはなされると7リツプフロツブ7が誤動作し、マイ
クロコンピュータ1に電源が加わることがある。
マイクロコンピュータ1が確認した時点でリセット信号
を出力する。
ータ1で検出し、このマイクロコンピュタ1よシフリッ
プフロップ7にリセット信号を出力し、外部の電源を断
とする。
、フリップフロップの初期状態が不定になるという課題
があった。
、7リツブフロツプを不定な状態としない電源投入方式
を得ることを目的とする。
をON・OFFする回路において、入力信号を制御する
第1のフリップフロップと、この第1のフリップフロッ
プの出力によってセットされる第2のフリップフロップ
と、電源投入時に上記第1および第2のフリップフロッ
プをリセットするリセット回路を備えてなるものである
。
たときと電源スィッチにより電源を投入したときの条件
を検出し、各々の異なる動作を行い、電源スィッチの制
御を行う。
。
ブロック構成図である。
を示し、8は入力信号を制御するフリップフロップ、9
はこのフリップ70ツブ8の出力によってセットされ電
源スィッチ4をON10 F Fするフリップ70ツブ
、’10t;iマイクロコンピュータ1の制御出力を入
力とするインバータ、11はこのインバータ10の出力
とマイクロコンピュータ1の出力を入力とするゲートで
、この・インバータ10とゲート11によって電源投入
時にフリップフロップ8,9をリセットするリセット回
路を構成している。
をリセットし、インバータ10の出力によって7リツプ
フロツブ9をリセットするように構成されている。
フローの一部を示すフローチャートで、各ステップ10
1〜103においてはそれぞれ所定の処理を実行する。
明する。
,9およびマイクロコンピュータ1をリセット状態から
解除する。すなわち、いま、電源スィッチ4は押下され
ているとする。押下されていないときは電源投入シーケ
ンスによシミ源投入でない外部電源の投入により電源オ
ンだとマイクロコンピュータ1は判断する。
1は各初期設定を行い、第2図に示すシケンスによシ、
外部電源を接続されたときに行う処理である外部電源接
続シーケンスへと進む外部電源接続シーケンスを終了し
たマイクロコンピュータ1は電力消費をおさえるため、
フリップフロップ8および9に対しリセットパルスを送
出し、スタンバイ状態となる。このリセットパルスを入
力したフリップフロップ8および9は再度リセットされ
る。また、電源スィッチ4はフリップフロップ9がリセ
ットされた状態にあるため、電源をオフとしたままとな
る。
ついて説明する。
波形整形された信号はフリップフロップ8のクロック端
子に入力されフリップフロップ8を動作させQ出力に[
H−ルベルを出力する。これによシフリップフロップ9
がセットされ、電源スィッチ4がオンとなり各部へ電源
を供給する。
入力され、第2図のシーケンスにょシ、外部スイッチ5
が規定の時間弁されたかどうかを判定し、スイッチオン
シーケンスへと移行スる。
マイクロコンピュータ1にて規定の時間弁されたかを判
断し、フリップフロップ8および9に対しリセットパル
スを出力して、スタンバイとなる。そして、このリセッ
トパルスを入力されたフリップフロップ8および9はリ
セットとなシ、電源スィッチ4をオフとし、各部の電源
を断とする。
ある。
して説明を省略する。第3図において、12は第1図に
おける外部スイッチ5のがわシに設けた外部制御部で、
この外部制御部12から出力される制御信号に基づき電
源スィッチ4を0N10FFするように構成されている
。
電源スィッチについての説明を行ったが、他のアナログ
信号などの0N10FF装置であってもよく、上記実施
例と同様の効果を奏する。
段とし、電源スイツチ制御と外部スイッチの接断信号の
検出を2つのフリップフロップで行うように構成したの
で、安定でかつ精度の高いものが得られる効果がある。
ブロック構成図、第2図はこの発明におけるマイクロコ
ンピュータの制御フローの一部を示すフローチャート、
第3図はこの発明の他の実施例を示すブロック構成図、
第4図は従来の電源投入方式の一例を示すブロック構成
図である。 1・・−・マイクロコンピュータ、2・拳・・電源、4
・・・・電源スィッチ、8,9・・・・フリップフロッ
プ、10・−・・インバータ、ト ゲート。
Claims (1)
- 外部より電気的に電源をON−OFFする回路において
、入力信号を制御する第1のフリップフロップと、この
第1のフリップフロップの出力によつてセットされる第
2のフリップフロップと、電源投入時に前記第1および
第2のフリップフロップをリセットするリセット回路を
備えてなることを特徴とする電源投入方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2267002A JP2546051B2 (ja) | 1990-10-03 | 1990-10-03 | 電源投入装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2267002A JP2546051B2 (ja) | 1990-10-03 | 1990-10-03 | 電源投入装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH04145835A true JPH04145835A (ja) | 1992-05-19 |
JP2546051B2 JP2546051B2 (ja) | 1996-10-23 |
Family
ID=17438698
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2267002A Expired - Lifetime JP2546051B2 (ja) | 1990-10-03 | 1990-10-03 | 電源投入装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2546051B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5644259A (en) * | 1992-09-11 | 1997-07-01 | Kabushiki Kaisha Toshiba | Reset circuit and integrated circuit including the same |
-
1990
- 1990-10-03 JP JP2267002A patent/JP2546051B2/ja not_active Expired - Lifetime
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5644259A (en) * | 1992-09-11 | 1997-07-01 | Kabushiki Kaisha Toshiba | Reset circuit and integrated circuit including the same |
Also Published As
Publication number | Publication date |
---|---|
JP2546051B2 (ja) | 1996-10-23 |
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