JPH04109632A - 半導体装置 - Google Patents

半導体装置

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JPH04109632A
JPH04109632A JP2228831A JP22883190A JPH04109632A JP H04109632 A JPH04109632 A JP H04109632A JP 2228831 A JP2228831 A JP 2228831A JP 22883190 A JP22883190 A JP 22883190A JP H04109632 A JPH04109632 A JP H04109632A
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JP
Japan
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inp
gasb
alas
junction
layer
Prior art date
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Pending
Application number
JP2228831A
Other languages
English (en)
Inventor
Shigeru Nakajima
中島 成
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumitomo Electric Industries Ltd
Original Assignee
Sumitomo Electric Industries Ltd
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Publication date
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Priority to US07/748,946 priority patent/US5164800A/en
Priority to CA002050245A priority patent/CA2050245A1/en
Priority to EP19910114536 priority patent/EP0477580A3/en
Priority to KR1019910015132A priority patent/KR950007350B1/ko
Publication of JPH04109632A publication Critical patent/JPH04109632A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、InPから成る異種(ヘテロ)接合を使用す
る電界効果トランジスタ(FET)等の半導体装置に関
するものである。
〔従来の技術〕
InPは飽和電子速度がGaAsやInGaAsよりも
速く、しかも、熱伝導率がGaAsよりも高い。従って
、このInPを用いて形成されたFETは、高周波回路
における高出力の回路素子として適している。一方、I
nPを素材とするショットキ接合は、従来、良好な接合
状態で形成することが出来なかった。このため、S i
O2膜やSiN膜等の絶縁膜を接合面に形成したMIS
型のへテロ接合FETか開発されている。また、AΩG
 a A s / G a A sのへテロ接合界面に
形成される2次元電子ガスを利用したGaAs系の高電
子移動度トランジスタ(HEMT)が存在するか、In
Pから成るヘテロ接合を使用するHEMTも検討されて
いる。
このInP系のHEMTとしては、例えば、第4図に示
される構造のものがある。この構造は、文献[新規なA
、Q InAs/InP−HEMTJ(ELECTI?
O〜IC3LETTER3,10th May 199
0 Vol、2BNo、1.0.p851 )に開示さ
れたものである。InP半導体基板1上には、バッファ
層であるAglnAs層2および活性層であるInP層
3が形成されている。さらに、InP層3上には、アン
ドープのAjllnAs層4が形成され、AIInAs
層4上にはn+型のAfiInAs層5およびn+型の
InP層6が形成されている。そして、ゲート電極7か
AρInAs層5上に形成され、ドレイン電極8および
ソース電極9がInP層6上に形成されている。このA
J21nAs/InPのへテロ接合を使用したHEMT
も、高周波回路における高出力の回路素子として有望で
ある。
〔発明が解決しようとする課題〕
しかしながら、上記従来のInPを使用したMIs型F
ETにあっては、金属と半導体との接合面に絶縁膜が形
成されているため、半導体と絶縁膜との界面に高濃度の
界面準位が存在する。このため、この界面準位が原因に
なってドレイン電流にドリフト現象が発生し、また、低
周波数領域で伝達特性にヒステリシス現象が発生してし
まう。
一方、n−Al11 nAs/ I nPのへテロ接合
を使用したHEMTにあっては、AjllnAsとIn
Pとの界面におけるAN元素とP元素との相性が悪く、
結晶の整合性は良くなかった。このため、InP系のH
EMTにあっては、GaAs系のHEMTにおけるよう
な高移動度の電子を得ることか出来ず、良好な高周波特
性か達成されなかった。
〔課題を解決するだめの手段〕
本発明はこのような課題を解消するためになされたもの
で、組成比Xが0.4以上0,6以下で構成される(A
N As)   (GaSb)   とX      
        1x InPとのへテロ接合を備えて半導体装置を形成したも
のである。
〔作用〕
ANASの格子定数は5.65A、GaSbの格子定数
は6.10Aである。従って、AJ7Asの組成比Xを
0.4以上0.6以下の範囲内で(Aj7As)   
(GaSb)   を構成することX       l
−x により、(Ai)As)   (GaSb)   は格
子X              1−x定数か5.8
7AのInPに格子整合し、良好な接合状態のへテロ接
合が形成される。
また、この範囲内でのある組成比における(Ai)As
)   (GaSb)   のエネルギパンx    
          l−xド図は第1図(a)に示さ
れる。伝導帯の底のエネルギ準位Ecと価電子帯の頂上
のエネルギ準位Evとの差に相当するエネルギギャップ
Egは例えば1. 6QeVになり、伝導帯の底のエネ
ルギ準位Ecにある電子を真空準位EOに取り出す電子
親和力χ1は例えば約3,8eVと推定される。
また、InPのエネルギバンド図は同図(b)に示され
、エネルギギャップEgは1.35eV。
電子親和力χ2は約4.4eVになっている。従って、
これら(AlAs)x   (GaSb)    とx
             1−xInPとのへテロ接
合部における伝導帯には、同図(c)に示されるように
、両者の電子親和力の差(χ2−χ1)に相当する、大
きさΔEcが例えば約Q、  6eVのエネルギスパイ
クが生じる。
〔実施例〕
次に本発明によるヘテロ接合をHEMTに適用した場合
の一実施例について説明する。
第2図はこの一実施例によるInP系のHEMTの構造
を示す断面図であり、以下の各製造工程を経ることによ
り完成される。
まず、MBE (分子線エピタキシ)法などの結晶成長
技術により、半絶縁性のInP半導体基板11上にバッ
ファ層12.チャネル層13および電子供給層14を順
次形成する。バッファ層12の材質はアンドープのA、
17    In   Asであ0.48  0.52 す、その厚さは約1μmである。チャネル層13の材質
はアンドープのInPであり、その厚さは1000Aで
ある。また、電子供給層14の材質は、A、QAsの組
成比Xが0.4以上0.6以下に構成された(AlAs
)x   (GaSb)   でx       LX あり、この(A、QAs)   (GaSb)   に
はX       1.−x 濃度か1×10 個/cm3のドナー不純物が添加され
ている。この組成比において、n −(A、QAs) 
  (GaSb)   からなる電子供給層X    
   1−x 14はアンドープInPからなるチャネル層13と良好
な格子整合を形成している。また、電子供給層14の厚
さは500Aである。
次に、通常のフォトリソグラフィ技術を使用し、素子間
分離のためのマスクパターンを電子供給層14上に形成
する。そして、このパターンを利用したメサエッチング
により、各素子間を電気的に分離し、その後、形成した
マスクパターンを除去する。引き続いて露出した電子供
給層14上にAuGe/Niなどの金属を蒸着し、フォ
トリソグラフィ技術により蒸着した金属を選択的に除去
する。そして、合金化処理を施して金属と電子供給層1
4とのオーミック接触を取り、ソース電極15およびド
レイン電極16を形成する。
最後に、フォトリソグラフィ技術によりマスクパターン
を形成し、T i / P t / A u金属などを
選択的に形成する。そして、この金属と電子供給層14
とのショットキ接触を取り、ゲート電極17を形成する
。この結果、第2図に示される構造のHEMTが完成す
る。
本実施例によるHEMTのへテロ接合の界面、つまり、
n−A11GaAsSbからなる電子供給層14とアン
ドープのInPからなるチャネル層13との界面近傍の
チャネル層13には点線で示される2次元電子ガスが生
成される。この2次元電子ガスは、ゲート電極17領域
の第3図に示されるエネルギバンド図において次のよう
に表される。同図の左側はゲート電極17(ゲート金属
)、中央は電子供給層14 (n  (A 9 A s
 ) X(GaSb)   )、右側はチャネル層13
(ア−X ンドープInP)の領域に対応しており、伝導帯の底の
エネルギ準位Ecか実線、フェルミ準位EFが点線で示
されている。
電子供給層14とチャネル層13との接合部には、前述
した第1図に示される大きさΔEcが約600meVの
エネルギスパイクか現れる。電子供給層14に添加され
たトナー不純物から放出された電子はこのスパイク部に
図示の斜線のように蓄積し、2次元電子ガスか生成され
る。この2次元電子ガス濃度はゲート電極17への印加
電圧によって調整される。
本実施例における(AilAs)x (GaSb)   /InPのへテロ接合界面は、x 上述のように結晶格子の整合性が良く、高品質に形成さ
れている。このため、ヘテロ接合界面における界面準位
の濃度は低下し、従来のようにドレイン電流のドリフト
現象や、伝達特性のヒステリシス現象は発生しない。ま
た、2次元電子ガスはこの高品質な界面近傍のチャネル
層13中に形成され、かつ、このチャネル層13は高電
界での電子輸送特性に優れたInPによって形成されて
いる。このため、2次元電子ガスの移動度は高くなる。
従って、本実施例によるヘテロ接合は、HEMTの他に
、特に、高電界が印加される高周波回路素子に利用する
と効果的である。
また、(AΩAs)   (GaSb)   およびx
       LX InPの各電子親和力の差は前述のように約0.6eV
であり、一方、従来のAllInAs/InPのへテロ
接合における各半導体の電子親和力の差は約0.2eV
である。このため、第3図に示されるエネルギスパイク
の大きさΔEcは従来より大きくなり、2次元電子ガス
の蓄積量が増大してガス濃度を高くとれる。従って、H
EMTのチャネル層13に通電される電流量は増大し、
電流駆動能力に優れた高出力の高周波回路用素子が提供
される。
なお、上記実施例は本発明によるヘテロ接合をHEMT
に適用した場合について説明したが、これに限定される
ものではなく、例えば、ヘテロ接合バイポーラトランジ
スタ(HB T)に適用しても良く、上記実施例と同様
な効果を奏する。この場合のHBTは、エミッタに(A
 jllA S) x(GaSb)    (0,4≦
X≦0.6)、ベー−x スにp−1nP、  コレクタにn−1nPを使用して
形成する。
〔発明の効果〕
以上説明したように本発明によれば、組成比Xか0.4
以上0.6以下で構成される (AlAs)x   (GaSb)   とInPとの
へx       1−X テロ接合は、界面の結晶格子の整合性が良好な状態で形
成される。このため、ヘテロ接合界面の界面準位濃度は
低減し、高濃度の界面準位に起因する従来の種々の課題
は解決される。しかも、InPの有する速い飽和電子速
度、および高い熱伝導率といった特性が半導体装置に生
かされ、高周波特性の優れた高出力の素子を提供するこ
とが可能になる。
【図面の簡単な説明】
第1図は本発明によるヘテロ接合のエネルギバンド構造
を示す図、第2図は本発明の一実施例によるH E M
Tの構造を示す断面図、第3図は第2図に示されたHE
MTのゲート領域におけるエネルギバンド構造を示す図
、第4図は従来のHEMTの構造を示す断面図である。 11・・・半絶縁性基板(InP) 、12・・・バッ
ファ層(アンドープA、Q    In   As)、
0.48  0.52 13・・・チャネル層(アンドープInP)、14・・
・電子供給層(n−(AJ2As) x (GaSb)   ) 、15−・・ソース電極、16
−・・x ドレイン電極、17・・・ゲート電極。 代理人弁理士   長谷用  芳  樹間      
   塩   1)  辰   也従来のHEMTの構
造 竿4図

Claims (1)

    【特許請求の範囲】
  1. 組成比xが0.4以上0.6以下で構成される(AlA
    s)_x(GaSb)_1_−_xとInPとの異種接
    合を備えて形成されることを特徴とする半導体装置。
JP2228831A 1990-08-30 1990-08-30 半導体装置 Pending JPH04109632A (ja)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2228831A JPH04109632A (ja) 1990-08-30 1990-08-30 半導体装置
US07/748,946 US5164800A (en) 1990-08-30 1991-08-23 Semiconductor device
CA002050245A CA2050245A1 (en) 1990-08-30 1991-08-29 Semiconductor device
EP19910114536 EP0477580A3 (en) 1990-08-30 1991-08-29 Heterostructure semiconductor devices
KR1019910015132A KR950007350B1 (ko) 1990-08-30 1991-08-30 반도체장치

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