JPH0349424A - A/dコンバータ - Google Patents
A/dコンバータInfo
- Publication number
- JPH0349424A JPH0349424A JP18496989A JP18496989A JPH0349424A JP H0349424 A JPH0349424 A JP H0349424A JP 18496989 A JP18496989 A JP 18496989A JP 18496989 A JP18496989 A JP 18496989A JP H0349424 A JPH0349424 A JP H0349424A
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- JP
- Japan
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- speed
- transfer
- signal
- analog input
- input signal
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- Pending
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- 238000006243 chemical reaction Methods 0.000 claims abstract description 33
- 238000010586 diagram Methods 0.000 description 4
- 230000003287 optical effect Effects 0.000 description 2
- 238000007493 shaping process Methods 0.000 description 2
- 101100115215 Caenorhabditis elegans cul-2 gene Proteins 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000010355 oscillation Effects 0.000 description 1
Landscapes
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
(従来技術)
アナログ信号の波形分析、特にコンピュータ等を用いて
の波形分析には、A/D変換回路が不可欠である。そし
て、一般に信号の周波数が高い場合には、A/D変換回
路として高速のものが必要である。また、誤差を小さく
したい場合には必然的に高分解能のA/D変換回路を必
要とする。
の波形分析には、A/D変換回路が不可欠である。そし
て、一般に信号の周波数が高い場合には、A/D変換回
路として高速のものが必要である。また、誤差を小さく
したい場合には必然的に高分解能のA/D変換回路を必
要とする。
(51!明が解決しようとする問題点)ところで、高い
周波数成分のアナログ信号を高精度に、tmち小さな誤
差でディジタル信号に変換するには、高速性能で且つ高
分解能のA/Df換回路上回路とした。
周波数成分のアナログ信号を高精度に、tmち小さな誤
差でディジタル信号に変換するには、高速性能で且つ高
分解能のA/Df換回路上回路とした。
しかし、A/D変換回路は一般に高分解能なものは高速
性が低く、高速性に優れたものは分解能を高(すること
が難しい。勿論、高分解能で高速なA/Dコンバータは
あるが、非常に高価格になってしまうという問題があっ
た。
性が低く、高速性に優れたものは分解能を高(すること
が難しい。勿論、高分解能で高速なA/Dコンバータは
あるが、非常に高価格になってしまうという問題があっ
た。
そこで、この発明の目的は、低速のA/D変換回路を用
いて高い周波数のアナログ信号を高い分解能でA/D変
換ができるように構成したAl1)コンバータを提供せ
んとするにある。
いて高い周波数のアナログ信号を高い分解能でA/D変
換ができるように構成したAl1)コンバータを提供せ
んとするにある。
(問題点を解決するための手段)
上述した問題点を解決するためにこの発明は、A/D変
換回路の前段にアナログ入力信号を転送する転送手段を
設け、該転送手段に上記アナログ入力信号を第1の転送
速度で取り込み、次にそれより遅い第2の転送速度でそ
のアナログ信9号をA/D変換回路へ出力してΔ/D変
換を行うようにしたものである。
換回路の前段にアナログ入力信号を転送する転送手段を
設け、該転送手段に上記アナログ入力信号を第1の転送
速度で取り込み、次にそれより遅い第2の転送速度でそ
のアナログ信9号をA/D変換回路へ出力してΔ/D変
換を行うようにしたものである。
(作用)
この発明によれば5アナログ入力部号を転送り段に高速
(第1の転送速度)で取り込むので、アナログ入力信号
の周波数が高くても転送手段への取り込みができる。そ
して、転送手段からA/D変換回路への出力を低速(第
2の転送速度)で行うので、低速のA/D変換回路であ
−)てもA/D変換が可能である。従って、低速・高分
解能のA/D変換回路によって、高い周波数の信号を高
精度にA/D変換することが可能である。
(第1の転送速度)で取り込むので、アナログ入力信号
の周波数が高くても転送手段への取り込みができる。そ
して、転送手段からA/D変換回路への出力を低速(第
2の転送速度)で行うので、低速のA/D変換回路であ
−)てもA/D変換が可能である。従って、低速・高分
解能のA/D変換回路によって、高い周波数の信号を高
精度にA/D変換することが可能である。
(実施例)
以下にこの発明の一実施例を図面に基づいて詳細に説明
する。
する。
第1図はこの発明の一つの実施例を示す構成図である。
同図において、暑は人力アナログ信号Inを増幅するア
ンプ22はアノードが電源端子Vccに接続され、カソ
ードがアンプlの出力端子に接続された発光ダイオード (L E D )であり、この発光ダイオード2はアン
プ1の出力信号により変調される。3は発光ダイオード
2から発生した光を電気信号に変換して転送するMO3
CCDで、光を電気信号に変換する入力部4、信号(電
荷)を転送する転送部5.及び信号を出力する出力部6
からなる。7はCCD3の出力部6から出力されたアナ
ログ信号をディジタル信号に変換する低速・高分解能の
A/D変換回路であり、n(例えば16.32)ビット
のディジタル信号Outを出力する。8はMO3CCD
3を転送制御するパルスφ1、φ2を発生する転送制御
パルス発生回路で、スイッチ回路9からの1相のパルス
φに基づいて2相のパルスφ1、φ2をつくる。上記ス
イッチ回路9は一方の切換端子に分周されないパルス、
即ち分周回路10を経由しないパルスを受け、他方の切
換端子に分周されたパルス、即ち分周回路10を経由し
たパルスを受け、そして切損信号によってアナログ信号
の取り込み時には、上記一方の切換端子側に切り損えら
れ、アナログ信号の出力時(即ちA/D変換回路7にお
けるA/D変喚時)には、上記他方の切換端子側に切り
換えられる。11は整形回路で1発振回路(O3C)1
2で発生したパルスを適宜整形する。この整形回路11
の出力が、上記スイッチ回路9の一方の切換端子と分周
回路10に入力されるのである。
ンプ22はアノードが電源端子Vccに接続され、カソ
ードがアンプlの出力端子に接続された発光ダイオード (L E D )であり、この発光ダイオード2はアン
プ1の出力信号により変調される。3は発光ダイオード
2から発生した光を電気信号に変換して転送するMO3
CCDで、光を電気信号に変換する入力部4、信号(電
荷)を転送する転送部5.及び信号を出力する出力部6
からなる。7はCCD3の出力部6から出力されたアナ
ログ信号をディジタル信号に変換する低速・高分解能の
A/D変換回路であり、n(例えば16.32)ビット
のディジタル信号Outを出力する。8はMO3CCD
3を転送制御するパルスφ1、φ2を発生する転送制御
パルス発生回路で、スイッチ回路9からの1相のパルス
φに基づいて2相のパルスφ1、φ2をつくる。上記ス
イッチ回路9は一方の切換端子に分周されないパルス、
即ち分周回路10を経由しないパルスを受け、他方の切
換端子に分周されたパルス、即ち分周回路10を経由し
たパルスを受け、そして切損信号によってアナログ信号
の取り込み時には、上記一方の切換端子側に切り損えら
れ、アナログ信号の出力時(即ちA/D変換回路7にお
けるA/D変喚時)には、上記他方の切換端子側に切り
換えられる。11は整形回路で1発振回路(O3C)1
2で発生したパルスを適宜整形する。この整形回路11
の出力が、上記スイッチ回路9の一方の切換端子と分周
回路10に入力されるのである。
第2図は取り込み時、即ちMO3CCD3にアナログ信
号を取り込む時と、出力時(変換時)、即ち取り込んだ
アナログ信号を出力してA/D変換回路7にA/D変換
させる時における転送制御パルスφl、φ2を示す波形
図である。
号を取り込む時と、出力時(変換時)、即ち取り込んだ
アナログ信号を出力してA/D変換回路7にA/D変換
させる時における転送制御パルスφl、φ2を示す波形
図である。
ある時間内におけるアナログ信号InをA/D変換して
波形分析に供する場合、先ずそのアナログ信号Inをア
ンプ1に入力しアンプ1の出力を発光ダイオード2によ
って光信号に変換する。そして、その光信号をMO3C
OD2の入力部4によって光電変換し、更に転送部、5
を転送する。この時における転送制御パルスφl、φ2
は分周回路10によって分周されていないパルスに基づ
いてつくられているので、周波数が高い。このように取
り込み時における転送制御パルスφ1.φ2の周波数を
高くするのは、アナログ信号Inの高い周波数成分もサ
ンプリングできるように、換言すれば激しい信号レベル
の変化を把握できるようにするためである。この時の転
送速度をこの明細書において第1の転送速度ということ
としている。
波形分析に供する場合、先ずそのアナログ信号Inをア
ンプ1に入力しアンプ1の出力を発光ダイオード2によ
って光信号に変換する。そして、その光信号をMO3C
OD2の入力部4によって光電変換し、更に転送部、5
を転送する。この時における転送制御パルスφl、φ2
は分周回路10によって分周されていないパルスに基づ
いてつくられているので、周波数が高い。このように取
り込み時における転送制御パルスφ1.φ2の周波数を
高くするのは、アナログ信号Inの高い周波数成分もサ
ンプリングできるように、換言すれば激しい信号レベル
の変化を把握できるようにするためである。この時の転
送速度をこの明細書において第1の転送速度ということ
としている。
そして、上記したある時間か経過した時、具体的にはM
OS CCD a内が転送された信号で路溝たされた
時、スイッチ回路9を切換えて転送制御パルスφl、φ
2の周波数をA/D変換回路7のスピードに応じた小さ
い値にする。すると、MO3CCD3の出力部6から順
次アナログ信号がA/D変換回路7の速度特性に応じて
遅い速度で出力される。この時のその遅い速度を第2の
転送速度という。そして、その出力されたアナログ信号
はA/D変損変格回路7いて順次ディジタル信号に変換
される。
OS CCD a内が転送された信号で路溝たされた
時、スイッチ回路9を切換えて転送制御パルスφl、φ
2の周波数をA/D変換回路7のスピードに応じた小さ
い値にする。すると、MO3CCD3の出力部6から順
次アナログ信号がA/D変換回路7の速度特性に応じて
遅い速度で出力される。この時のその遅い速度を第2の
転送速度という。そして、その出力されたアナログ信号
はA/D変損変格回路7いて順次ディジタル信号に変換
される。
以上に述べたところから明らかなように、この発明によ
れば、アナログ入力信号を転送手段に高速に取り込み、
低速でA/D変換回路へ出力するので、低速のA/D変
換回路を用いて高い周波数の信号のA/D変換が可能で
ある6そして、A/D変換回路として高分解能のものを
用いれば、高い周波数の信号を高分解能でA/D変換す
ることが可能である。即ち、高速・高分解能の高価なA
/D変換回路を用いなくとも高速性、高分解能が実現で
きるものである。
れば、アナログ入力信号を転送手段に高速に取り込み、
低速でA/D変換回路へ出力するので、低速のA/D変
換回路を用いて高い周波数の信号のA/D変換が可能で
ある6そして、A/D変換回路として高分解能のものを
用いれば、高い周波数の信号を高分解能でA/D変換す
ることが可能である。即ち、高速・高分解能の高価なA
/D変換回路を用いなくとも高速性、高分解能が実現で
きるものである。
第1図はこの発明の一つの実施例を示す回路ブロック図
、第2図は転送制御パルスの波形図である。 3、、、、転送手段 71.、、A/D変換回路 In、、、アナログ入力信号 (発明の効果)
、第2図は転送制御パルスの波形図である。 3、、、、転送手段 71.、、A/D変換回路 In、、、アナログ入力信号 (発明の効果)
Claims (1)
- 【特許請求の範囲】 アナログ入力信号を転送する転送手段と、 上記転送手段から出力されたアナログ信号をディジタル
信号に変換するA/D変換回路と、から成り、 ある時間上記アナログ入力信号を第1の転送速度で上記
転送手段内に取り込み、その後その取り込んだアナログ
入力信号を上記第1の転送速度よりも低速の第2の転送
速度で1記A/D変換回路へ出力してA/D変換を行わ
せるようにしてなる、 ことを特徴とするA/Dコンバータ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18496989A JPH0349424A (ja) | 1989-07-18 | 1989-07-18 | A/dコンバータ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18496989A JPH0349424A (ja) | 1989-07-18 | 1989-07-18 | A/dコンバータ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0349424A true JPH0349424A (ja) | 1991-03-04 |
Family
ID=16162523
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP18496989A Pending JPH0349424A (ja) | 1989-07-18 | 1989-07-18 | A/dコンバータ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0349424A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008281097A (ja) * | 2007-05-10 | 2008-11-20 | Toyota Motor Corp | ブーツおよび動力伝達軸 |
-
1989
- 1989-07-18 JP JP18496989A patent/JPH0349424A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008281097A (ja) * | 2007-05-10 | 2008-11-20 | Toyota Motor Corp | ブーツおよび動力伝達軸 |
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