JPH0343842A - トレーサメモリ - Google Patents

トレーサメモリ

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Publication number
JPH0343842A
JPH0343842A JP1179312A JP17931289A JPH0343842A JP H0343842 A JPH0343842 A JP H0343842A JP 1179312 A JP1179312 A JP 1179312A JP 17931289 A JP17931289 A JP 17931289A JP H0343842 A JPH0343842 A JP H0343842A
Authority
JP
Japan
Prior art keywords
data
value
trace data
system clock
trace
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1179312A
Other languages
English (en)
Inventor
Masaya Kakigi
柿木 正也
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Ibaraki Ltd
Original Assignee
NEC Ibaraki Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Ibaraki Ltd filed Critical NEC Ibaraki Ltd
Priority to JP1179312A priority Critical patent/JPH0343842A/ja
Publication of JPH0343842A publication Critical patent/JPH0343842A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はトレーサメモリ、特に、CPUの動作履歴を記
憶するトレーサメモリに関する。
〔従来の技術〕
従来、CPUの動作履歴を記憶するトレーサメモリは、
通常のシステム動作中はシステム・りロックに同期して
アドレスカウンタをインクリメントすることにより、毎
クロックCPUの動作履歴を記憶していた。
〔発明が解決しようとする課題〕
上述した従来のトレーサメモリは、システムがストール
状態あるいは、マイクロ命令の実行抑止カ何クロ、り間
も続いた場合、トレーサメモリに記憶されるトレースデ
ータの内容が、同一の内容でしめられてしまい、解析に
必要なデータが得られないという欠点がある。
〔課題を解決するための手段〕
本発明のトレーサメモリは、電子計算機の操作盤からの
セット・リセットまたは、マイクロ命令によるセット・
リセットが可能であり、Oでシステム・クロックに同期
してデータのトレース条件ない、′1”でシステム・ク
ロックの1T前のトレースデータの値が、現在のトレー
スデータの値と一致しない場合のみデータのトレースを
行なうことを示す第1のフリップ・フロップと、第1の
フリップ・フロップの状態値が1であるときに、システ
ム・クロックの1T前のトレースデータの値が、現在の
トレースデータの値の一致した場合に有効信号を出力す
る比較回路と、トレースデータの値がシステム・クロッ
クの1T前と比較して変化した時のみデータのトレース
を行なうモードにおいて、前記比較回路の有効信号が出
力された時有効となる第2のフリップ・フロップと、ト
レースデータを格納するレジスタと、前記第2のフリッ
プ・フロップが有効でない時、システム・クロックに同
期しインクリメントされるアドレス・カウンタと、シス
テム・クロックの1T前のトレースデータの値と、現在
のトレースデータの値カ一致している時間をカウントす
るカウンタとを含んで構成される。
〔実施例〕
次に、本発明について図面を参照して説明する。
第1図は、本発明の一実施例のブロック図である。
lは第1のフリ、ブ・フロップ3に対するセット条件と
なるマイクロ命令のデコード信号、2は第1の7リツプ
・フロップ3に対するセット条件となる電子計算機の操
作盤による入力信号、3はマイクロ命令または、電子計
算機の操作盤からセット・リセットが可能である第1の
フリップ・フロップ、4は第1のフリップ・フPツブ3
の状態値が“1”であり、比較回路9が有効である時、
有効となる第2のフリップ・フロップ、5はトレーサメ
モリに格納されるトレース・データ、6はトレーサメモ
リに格納するトレース・データを格納するレジスタ、7
はトレース・ブータラ格納するレジスタの出力、8は比
較回路9が有効となっている期間をカウントするカウン
タ、9はトレース・データ5とトレース・データを格納
するレジスタの出力が一致するとき有効となる比較回路
、10はトレーサメモリ12のアドレスカウンタ、11
は比較回路9が有効となった時、状態値が“1″となる
トレース・データ一致信号、12はトレーサメモリであ
る。
第1のフリップフロップ3は、トレーサメモリ12のト
レース条件を示すフリップフロップで、この第1のクリ
ップフロップ3の状態値が“0″(7)、!:キ、)レ
ーサメモリ12がシステム・クロックに同期して毎クロ
ック・データを格納することを示し、状態値が“1”の
ときトレーサメモリ12がトレーサ・データの値がシス
テム・クロックの1T前と比較して変化した時のみデー
タの格納を行なうことを示す。
この第1のフリップ・フロップ3はマイクロ命令または
電子計算機の操作盤からのセット・リセットが可能であ
る。
第2のフリップ・フロップ4は、第1のフリップ・フロ
ップ3の状態値が“1″であり、トレーサメモリ12の
トレース条件が、トレースデータの値がシステム・クロ
ックの1T前と比較して変化した時のみデータの格納を
行なうモードとなっている時、トレースデータ一致信号
11の状態値が“1″であるとき状態値1を示す。
この第2のフリップ・フロップ4の状態値が“1”のと
きトレーサメモリ12のアドレスカウンタ10は、カウ
ンタの更新が抑止される。
つまり、アドレスカウンタ1oは第2の7リツプフロツ
プ4の状態値が0”である時、システム・クロックに同
期してインクリメントされるが、状態値が“1”の時、
トレース・データ5とトレース・データ格納用レジスタ
出力信号7が一致した時有効となる比較回路9の出力信
号であるトレース・データ一致信号11の状態値が”1
″であるときのみ、カウントはシステム・クロックに同
期してインクリメントされ、それ以外はホールド状態と
なりトレーサメモリ12の同一アドレスを示したままと
なりトレース・データ5はトレーサメモリ12にうわ書
きされる。
カウンタ8は、トレース・データ5とトレース・データ
格納用レジスタの出力信号7と値が一致した時、有効と
なる比較回路9の出力であるトレースデータ一致信号1
1の状態値が“1″である間はシステムクμ、りに同期
してインクリメントされ、状態値が“0″になった時リ
セットされる。
このカウンタ8をトレーサメモリ12のトレース情報に
加えておくことによりトレースデータが変化しなかった
期間を知ることが可能になる。
〔発明の効果〕
以上説明したように本発明は、通常はトレーサメモリの
トレース条件をシステム・クロックに同期して毎タロツ
ク・データを格納するモードにして使用し、システムの
ストール時等のデバッグには、トレース・データが1T
前の値と変化した時のみデータを格納するモードに切替
えることにより、トレーサメモリの容量が小さくても解
析に有効なデータをメモリに格納できるという効果があ
る。
【図面の簡単な説明】
第1図は本発明の一実施例を示すブロック図である。 l・・・・・・マイクロ命令のデコード信号、2・・・
・・・電子計算機の操作盤による入力信号、3・・・・
・・第1のフリップフロップ、4・・・・・・第2のフ
リップ・フロップ、5・・・・・・トレーサメモリに格
納されるトレースデータ、6・・・・・・トレースデー
タ格納用レジスタ、7・・・・・・トレースデータ格納
用レジスタ出力信号、8・・・・・・カウンタ、9・・
・・・・比較回路、10・・・・・・アドレスカウンタ
、11・・・・・・トレースデーター致信号、12・・
・・・・トレーサメモリ。

Claims (1)

    【特許請求の範囲】
  1.  電子計算機におけるCPUの動作履歴を記憶するため
    のトレーサメモリにおいて、トレース条件がシステムク
    ロックに同期して毎クロックデータのトレースを行なう
    モードであるのかトレースデータの値がシステムクロッ
    クの1T前と比較して変化した時のみデータのトレース
    を行なうモードであるのかを示す第1のフリップ・フロ
    ップと、システム・クロックの1T前のトレースデータ
    の値と現在のトレースデータの値とを比較し一致した時
    に有効信号を出力する比較回路と、トレースデータの値
    がシステムクロックの1T前と比較して変化した時のみ
    データのトレースを行なうモードにおいて前記比較回路
    の有効信号が出力された時有効となる第2のフリップ・
    フロップと、トレースデータを格納するレジスタと、前
    記第2のフリップ・フロップが有効でない時システムク
    ロックに同期しインクリメントされるアドレス・カウン
    タとを有し毎クロックのデータのトレースを行なうモー
    ドと、トレースデータの値がシステムクロックの1T前
    と比較して変化した時のみデータのトレースを行なうモ
    ードとの切替えが可能でありまた前記比較回路の有効信
    号が出力されている間システム・クロックに同期しカウ
    ントするカウンタを有し該カウンタのカウンタ値をトレ
    ース情報として記憶する手段を含むことを特徴とするト
    レーサメモリ。
JP1179312A 1989-07-11 1989-07-11 トレーサメモリ Pending JPH0343842A (ja)

Priority Applications (1)

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JP1179312A JPH0343842A (ja) 1989-07-11 1989-07-11 トレーサメモリ

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JP1179312A JPH0343842A (ja) 1989-07-11 1989-07-11 トレーサメモリ

Publications (1)

Publication Number Publication Date
JPH0343842A true JPH0343842A (ja) 1991-02-25

Family

ID=16063633

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Application Number Title Priority Date Filing Date
JP1179312A Pending JPH0343842A (ja) 1989-07-11 1989-07-11 トレーサメモリ

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JP (1) JPH0343842A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100372510B1 (ko) * 2000-11-22 2003-02-15 한국타이어 주식회사 타이어의 고무혼련용 컨베이어 시스템

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