JPH03259294A - ビットブロック転送ｌｓｉ - Google Patents
ビットブロック転送ｌｓｉInfo
- Publication number
- JPH03259294A JPH03259294A JP2058942A JP5894290A JPH03259294A JP H03259294 A JPH03259294 A JP H03259294A JP 2058942 A JP2058942 A JP 2058942A JP 5894290 A JP5894290 A JP 5894290A JP H03259294 A JPH03259294 A JP H03259294A
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- JP
- Japan
- Prior art keywords
- kanji
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- register
- rom
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims abstract description 8
- 238000010586 diagram Methods 0.000 description 2
- 101100524639 Toxoplasma gondii ROM3 gene Proteins 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Memory System (AREA)
- Controls And Circuits For Display Device (AREA)
- Document Processing Apparatus (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はビットマツプデイスプレィを用いたグラフィッ
ク表示装置に関し、特に二次元矩形領域をビットバウン
ダリ転送するビットブロック転送ＬＳＩに関する。
ク表示装置に関し、特に二次元矩形領域をビットバウン
ダリ転送するビットブロック転送ＬＳＩに関する。
従来、この種のビットブロック転送ＬＳＩでは、転送元
アドレスは転送先アドレスと同様に物理アドレスを設定
していた。また漢字をデイスプレィ上に表示する際には
、漢字のフォントパターンデータを、これが格納されて
いる漢字ＲＯＭからメモリへ転送するのであるが、ソフ
トウェアにはその漢字と一対−に対応している漢字コー
ドが与えられるのみである。
アドレスは転送先アドレスと同様に物理アドレスを設定
していた。また漢字をデイスプレィ上に表示する際には
、漢字のフォントパターンデータを、これが格納されて
いる漢字ＲＯＭからメモリへ転送するのであるが、ソフ
トウェアにはその漢字と一対−に対応している漢字コー
ドが与えられるのみである。
上述した従来のビットブロック転送ＬＳＩは、漢字ＲＯ
Ｍからメモリへ漢字のフォントパターンデータを転送す
る為には、漢字と一対一に対応する漢字コードから、そ
の漢字のフォントパターンが格納されている漢字ＲＯＭ
上での物理アドレスへと、ソフトウェアにてアドレス変
換処理を行なう必要がある為に、漢字表示性能が著しく
低下するという欠点がある。
Ｍからメモリへ漢字のフォントパターンデータを転送す
る為には、漢字と一対一に対応する漢字コードから、そ
の漢字のフォントパターンが格納されている漢字ＲＯＭ
上での物理アドレスへと、ソフトウェアにてアドレス変
換処理を行なう必要がある為に、漢字表示性能が著しく
低下するという欠点がある。
本発明の目的は前記課題を解決したビットブロック転送
ＬＳＩを提供することにある。
ＬＳＩを提供することにある。
前記目的を達成するため、本発明に係るビットブロック
転送ＬＳＩにおいては、ＣＰＵからコマンドやパラメー
タを受け収り二次元矩形領域をビットバウンダリ転送す
るビットブロック転送ＬＳＩであって、 レジスタとアドレス変換回路とを有し、前記レジスタは
文字コードを設定するものであり、 前記アドレス変換回路は設定された文字コードから漢字
ＲＯＭの物理アドレスへ変換するものであるものである
。
転送ＬＳＩにおいては、ＣＰＵからコマンドやパラメー
タを受け収り二次元矩形領域をビットバウンダリ転送す
るビットブロック転送ＬＳＩであって、 レジスタとアドレス変換回路とを有し、前記レジスタは
文字コードを設定するものであり、 前記アドレス変換回路は設定された文字コードから漢字
ＲＯＭの物理アドレスへ変換するものであるものである
。
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例を示すブロック図である。
図において、ビットブロック転送ＬＳＩＩはＣＰＵから
コマンドやパラメータを受けとり二次元矩形領域データ
をピットバウンダリ転送する。ＣＰＵはまず表示すべき
漢字に対応した漢字コードを漢字コードレジスタ２に設
定する。ａ定された漢字コードはアドレス変換テーブル
ＲＯＭ３を参照して漢字ＲＯＭの物理アドレスに変換さ
れ、転送元アドレスレジスタ４に格納され物理アドレス
の生成の為に使用される。ＣＰＬＪはその他に転送元で
ある漢字ＲＯＭのフォントデータピッチを転送元ピッチ
レジスタ５に、転送方向やラスタ演算を指示するパラメ
ータをモードレジスタ６に、転送する漢字のフォントパ
ターンデータ領域の水平及び垂直サイズをそれぞれ水平
転送サイズレジスタ７、垂直転送サイズレジスタ８に設
定する。また転送先であるメモリをデイスプレィに表示
する為に二次元メモリとして見た時の水平ピッチを転送
先ピッチレジスタ９に、メモリ上の転送開始物理アドレ
スを転送先アドレスレジスタ１０に各々設定する。すべ
てのパラメータを設定し終えて起動がかかると、ビット
ブロック転送ＬＳＩＩは転送元アドレス生成回Ｆ＃１１
１から漢字ＲＯＭ １２に対して物理アドレスを転送元
アドレスレジスタ４に格納されたアドレスから始めて順
次転送元ピッチレジスタ５に設定されたフォントデータ
ピッチを加算しながら出力する。漢字ＲＯＭ １２は与
えられた物理アドレスに従って漢字のフォントパターン
データを出力する。同様に転送先アドレス生成回路１３
は表示用メモリ１４に対して転送先アドレスを矩形領域
を意識して出力する。漢字ＲＯＭ １２から出力された
フォントパターンデータはデータハンドリング回路１５
によりラスタ演算処理を受け、あるいはビットシフトさ
れて表示メモリ１４に出力される。
コマンドやパラメータを受けとり二次元矩形領域データ
をピットバウンダリ転送する。ＣＰＵはまず表示すべき
漢字に対応した漢字コードを漢字コードレジスタ２に設
定する。ａ定された漢字コードはアドレス変換テーブル
ＲＯＭ３を参照して漢字ＲＯＭの物理アドレスに変換さ
れ、転送元アドレスレジスタ４に格納され物理アドレス
の生成の為に使用される。ＣＰＬＪはその他に転送元で
ある漢字ＲＯＭのフォントデータピッチを転送元ピッチ
レジスタ５に、転送方向やラスタ演算を指示するパラメ
ータをモードレジスタ６に、転送する漢字のフォントパ
ターンデータ領域の水平及び垂直サイズをそれぞれ水平
転送サイズレジスタ７、垂直転送サイズレジスタ８に設
定する。また転送先であるメモリをデイスプレィに表示
する為に二次元メモリとして見た時の水平ピッチを転送
先ピッチレジスタ９に、メモリ上の転送開始物理アドレ
スを転送先アドレスレジスタ１０に各々設定する。すべ
てのパラメータを設定し終えて起動がかかると、ビット
ブロック転送ＬＳＩＩは転送元アドレス生成回Ｆ＃１１
１から漢字ＲＯＭ １２に対して物理アドレスを転送元
アドレスレジスタ４に格納されたアドレスから始めて順
次転送元ピッチレジスタ５に設定されたフォントデータ
ピッチを加算しながら出力する。漢字ＲＯＭ １２は与
えられた物理アドレスに従って漢字のフォントパターン
データを出力する。同様に転送先アドレス生成回路１３
は表示用メモリ１４に対して転送先アドレスを矩形領域
を意識して出力する。漢字ＲＯＭ １２から出力された
フォントパターンデータはデータハンドリング回路１５
によりラスタ演算処理を受け、あるいはビットシフトさ
れて表示メモリ１４に出力される。
表示用メモリ１４は与えられたアドレスにより所定の領
域にデータが書き込まれてこれをビットマツプデイスプ
レィ上に表示する。
域にデータが書き込まれてこれをビットマツプデイスプ
レィ上に表示する。
以上説明したように本発明は、漢字コードから漢字ＲＯ
Ｍの物理アドレスをハードウェア化することにより、ソ
フトウェアの負担を軽減すると同時に、漢字を表示させ
ることはグラフィック表示装置の運用上頻繁に行なうこ
とから表示性能を大幅に改善できる効果がある。
Ｍの物理アドレスをハードウェア化することにより、ソ
フトウェアの負担を軽減すると同時に、漢字を表示させ
ることはグラフィック表示装置の運用上頻繁に行なうこ
とから表示性能を大幅に改善できる効果がある。
第１図は本発明のビットブロック転送ＬＳＩを示すブロ
ック図である。 １・・・ビットブロック転送ＬＳＩ ２・・・漢字コードレジスタ ３・・・アドレス変換テーブルＲＯＭ ４・・・転送元アドレスレジスタ ５・・・転送元ピッチレジスタ ６・・・モードレジスタ ７・・・水平転送サイズレジスタ ８・・・垂直転送サイズレジスタ ９・・・転送先ピッチレジスタ １０・・・転送先アドレスレジスタ １１・・・転送元アドレス生成回路 １２・・・漢字ＲＯＭ １３・・・転送先アドレス生成回路 １４・・・表示用メモリ １５・・・データハンドリング回路
ック図である。 １・・・ビットブロック転送ＬＳＩ ２・・・漢字コードレジスタ ３・・・アドレス変換テーブルＲＯＭ ４・・・転送元アドレスレジスタ ５・・・転送元ピッチレジスタ ６・・・モードレジスタ ７・・・水平転送サイズレジスタ ８・・・垂直転送サイズレジスタ ９・・・転送先ピッチレジスタ １０・・・転送先アドレスレジスタ １１・・・転送元アドレス生成回路 １２・・・漢字ＲＯＭ １３・・・転送先アドレス生成回路 １４・・・表示用メモリ １５・・・データハンドリング回路
Claims (1)
- （１）ＣＰＵからコマンドやパラメータを受け取り二次
元矩形領域をビットバウンダリ転送するビットブロック
転送ＬＳＩであって、 レジスタとアドレス変換回路とを有し、 前記レジスタは文字コードを設定するものであり、 前記アドレス変換回路は設定された文字コードから漢字
ＲＯＭの物理アドレスへ変換するものであることを特徴
とするビットブロック転送ＬＳＩ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2058942A JPH03259294A (ja) | 1990-03-09 | 1990-03-09 | ビットブロック転送ｌｓｉ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2058942A JPH03259294A (ja) | 1990-03-09 | 1990-03-09 | ビットブロック転送ｌｓｉ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03259294A true JPH03259294A (ja) | 1991-11-19 |
Family
ID=13098887
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2058942A Pending JPH03259294A (ja) | 1990-03-09 | 1990-03-09 | ビットブロック転送ｌｓｉ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03259294A (ja) |
-
1990
- 1990-03-09 JP JP2058942A patent/JPH03259294A/ja active Pending
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