JPH0325036B2 - - Google Patents

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JPH0325036B2
JPH0325036B2 JP59111441A JP11144184A JPH0325036B2 JP H0325036 B2 JPH0325036 B2 JP H0325036B2 JP 59111441 A JP59111441 A JP 59111441A JP 11144184 A JP11144184 A JP 11144184A JP H0325036 B2 JPH0325036 B2 JP H0325036B2
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JP
Japan
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magnetic
layer
pattern
conductive layer
conductive
Prior art date
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JP59111441A
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English (en)
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JPS60254781A (ja
Inventor
Akira Hirano
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10NELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10N50/00Galvanomagnetic devices
    • H10N50/01Manufacture or treatment

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  • Engineering & Computer Science (AREA)
  • Manufacturing & Machinery (AREA)
  • Hall/Mr Elements (AREA)

Description

【発明の詳細な説明】 (1) 発明の技術分野 本発明はバーバー・ポール型の磁気抵抗素子で
ある磁気検出器(磁気センサ)の製造方法、特に
セルフアラインメントの手法により正確に位置合
せを行なえるようにした磁気検出器の製造方法に
関する。
(2) 技術の背景 磁気抵抗効果を利用して磁界を検出するために
は磁界と出力との直線性を得る必要がある。その
一つの手段として磁性薄帯に45度傾けて多数の導
電性薄帯を設けることにより磁界の変化に比例し
た磁気抵抗の変化を得ることができる。すなわ
ち、素子の抵抗ρは、磁化の方向(M)と電流
()との成す角θに関係し、ρ=ρ⊥+Δρ〓cos2θ
で表される。ここでΔρ〓≡ρ‖−ρ⊥であり、ρ‖
とρ⊥は各々磁化の方向と電流が平行および直角
の時の比抵抗を示す。従つてθが45度になるよう
に、抵抗の低い導電性薄帯中に電流を流すと第1
図の線に示すようにある範囲で磁界と出力との線
型性(直線性)を得ることができる。
第2図は従来例をaの断面図とbの平面図に示
し、図において1は表面に二酸化シリコン
(SiO2)層が形成されたシリコンウエハまたはパ
イレツクス基板を示す。パーマロイ、ニツケル−
コバルト等の磁性薄膜が蒸着法およびスパツタ法
で付着され、リングラフイーおよびエツチング技
術によつて短冊形の磁性薄膜2が形成される。磁
化の方向がパターンに平行に向いているようにす
ると前記した直線性が良くなるから、真空中で温
度を上げ、短冊に平行に磁界を加え、磁界容易軸
をパターンの長手方向に作る。または、磁界中で
磁性膜を付着させて異方性を生じせしめても良
い。
次に当該薄膜2上にチタン(Ti)、クロム
(Cr)等の密着層6を介して金等の導電性膜が積
層され、リソグラフイーにより磁性薄帯に対して
45度傾けて導電性薄帯3が作られる。なお、シリ
コンウエハを用いるときはその上に絶縁膜を形成
する。
(3) 従来技術と問題点 バーバー・ポール型の検出器は磁性薄帯上に導
電性薄帯が形成されて成るが、従来下層の磁性薄
帯から順次積層されて形成されていた。しかし、
この方法によると当該上下層の位置合せを厳密に
行わないと出力効率が落ちる欠点があつた。
(4) 発明の目的 本発明は上記従来の問題に鑑み、磁性薄帯と導
電性薄帯を正確に位置合せをするための効率の良
い磁気検出器の製造方法を提供することを目的と
する。
(5) 発明の構成 そしてこの目的は本発明によると、ガラスまた
は二酸化シリコン(SiO2)が表面に形成された
シリコン基板上に磁性層、密着層および導電層の
3層を同一烝着機内で真空を破ることなく順次蒸
着する工程、磁性パターン上に形成する導電層を
磁性パターン幅よりも長く形成する工程、および
前記工程で形成された導電層パターンに合わせた
磁性パターン用のレジストパターンを用いて導電
層、密着層、磁性層のすべてを同時にイオンミリ
ングで物理的にエツチングして磁性抵抗パターン
を形成する工程を含むことを特徴とする磁気検出
器の製造方法を提供することによつて達成され
る。
(6) 発明の実施例 以下本発明の実施例を図面によつて詳述する。
本発明は正確な位置合せを行う手段として導電
性薄帯(長さl)を磁性薄帯(幅W)より長くし
(W<l)、両薄膜を順次上層からエツチングして
パターンを形成するものである。
第3図A…Eの断面図と同図b…eの平面図に
本発明実施例を示すが、平面図b…eは断面図B
…Eに対応する。第3図Aに示される如く基板1
1上に磁性層(膜厚300〜500Å)12、密着層
(膜厚250〜1000Å)16、導電層(膜厚500〜
2000Å)13を連続して成膜する。磁化容易軸の
形成は従来の場合と同様である。
リソグラフイーとエツチング技術(ケミカル、
プラズマ、イオンミリング)を用い磁性層12の
幅(W)よりも長い導電層13を作製する。(第
3図B)。このとき、密着層16も同時にエツチ
ングする。次に新たなレジスト膜18を用い磁性
層12をリソグラフイーによりパターニングする
が(第3図c)、lがWより長いために厳密に位
置合せを行う必要はない(第3図b,c参照)。
磁性薄帯よりはみ出た導電体層13は磁性薄帯を
形成する際に同時にエツチングされる(第3図
D,d)。
最後にSiO2等の保護層14が作製され、Au等
の導体によつて第2図の外部端子5に対応する端
子が形成されて完成する(第3図E,e)。
本発明によれば、Wより長い導電性薄帯を用い
上層より順次パターンを形成してゆくことによ
り、簡略な位置合せにより正確な磁性層と導電層
の位置関係を実現することができるので、出力効
率の低下を防ぐことができ、その効果は大きい。
なお、薄帯や密着層等用いる材料は実施例に限
らない。また薄帯の幅、形状等も図示の場合限定
されず又つづら折り形状にした場合のコーナ部分
等にも適用できる。シリコンウエハを用いるとき
は従来の場合と同様にその上に絶縁膜を設けなけ
ればならないが、パイレツクス基板を用いるとき
はその必要がない。エツチングをケミカルエツチ
ングでなすときは基板11は影響を受けないが、
イオンミリングのときは基板も若干エツチングさ
れる。しかし、基板は磁気抵抗素子をのせる台と
して設けらるものであるから、それのエツチング
は別に問題はない。
(7) 発明の効果 以上詳細に説明した如く本発明によれば、同じ
パターンを用いたセルフアラインメントの位置合
せにより正確に磁性層と導電層の位置関係を実現
することができるので出力効率の低下をなくす効
果がある。
【図面の簡単な説明】
第1図は本検出器の原理を説明する図、第2図
は従来例の断面図と平面図、第3図は本発明の実
施例を示す図である。 11……基板、12……磁性層、13……導電
層、14……保護層、15……外部端子、16…
…密着層、17,18……レジスト膜。

Claims (1)

  1. 【特許請求の範囲】 1 ガラスまたは二酸化シリコン(SiO2)が表
    面に形成されたシリコン基板上に磁性層、密着層
    および導電層の3層を同一烝着機内で真空を破る
    ことなく順次蒸着する工程、 磁性パターン上に形成する導電層を磁性パター
    ン幅よりも長く形成する工程、および 前記工程で形成された導電層パターンに合わせ
    た磁性パターン用のレジストパターンを用いて導
    電層、密着層、磁性層のすべてを同時にイオンミ
    リングで物理的にエツチングして磁性抵抗パター
    ンを形成する工程を含むことを特徴とする磁気検
    出器の製造方法。
JP59111441A 1984-05-31 1984-05-31 磁気検出器の製造方法 Granted JPS60254781A (ja)

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JPS60254781A JPS60254781A (ja) 1985-12-16
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JP2720442B2 (ja) * 1988-02-04 1998-03-04 ソニー株式会社 磁気抵抗素子の製造方法

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Publication number Priority date Publication date Assignee Title
JPS4843237A (ja) * 1971-09-30 1973-06-22

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JPS57102160U (ja) * 1980-12-15 1982-06-23

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