JPH0324871A - 撮像装置 - Google Patents

撮像装置

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Publication number
JPH0324871A
JPH0324871A JP1158234A JP15823489A JPH0324871A JP H0324871 A JPH0324871 A JP H0324871A JP 1158234 A JP1158234 A JP 1158234A JP 15823489 A JP15823489 A JP 15823489A JP H0324871 A JPH0324871 A JP H0324871A
Authority
JP
Japan
Prior art keywords
fade
circuit
fading
evf
display
Prior art date
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Pending
Application number
JP1158234A
Other languages
English (en)
Inventor
Kyoji Tamura
田村 恭二
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Canon Inc
Original Assignee
Canon Inc
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Filing date
Publication date
Application filed by Canon Inc filed Critical Canon Inc
Priority to JP1158234A priority Critical patent/JPH0324871A/ja
Priority to US07/522,811 priority patent/US5287187A/en
Publication of JPH0324871A publication Critical patent/JPH0324871A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) この発明は、撮像装置、特に、フェード機能を有する撮
像装!iに関するものである。
(従来の技術) 従来、ビデオカメラが有する特殊機能の一つとして、撮
像素子から得られた映像信号を徐々に消し、画面全体を
白もしくは黒レベルとしたり、逆に白もしくは黒の画面
に徐々に映像信号をミックスするフェード機能がある。
第4図は従来例の撮像装置の構成を示す構成図である.
図面第4図において、lはレンズから入射した光を電気
信号に変換する撮像素子、2は撮像素子lから出力され
た信号をサンプルホールドするS/H回路、3はS/H
回路2で得られた映像信号をAGC (自動利##調整
),γ処理等を行うAGC回路、4は映像信号に同期信
号をミックスするENC回路、5はフェード動作を行う
FADE回路、6は撮像素子1を駆動させるためのパル
スを発生させるDRIVE回路、7は同期信号.クラン
ブパルス等を発生させるSG回路、9はフェード時2徐
々に映像が変化する様に時定数をもたせる時定数回路%
 lOはフェードのON,OFFスイッチである。
次に,この従来例の動作を第4図を用いて説明する。
先ず,撮像素子1から得られた映像信号はサンプルホー
ルド回路2を通り、AGC回路3で、AGCおよびγ処
理を行いFADE回路5に入る。FADE回路5は外部
に取付けたフェードスイッチ10により、時定数回路9
からフェード信号が出力され、フェード機能が働く。そ
の後ENC回路4において、同期信号がミックスされ、
標準ビデオ信号としてレコーダに出力される。また、同
じ様にENC回路4の出力が電子ファインダ(以下EV
Fという)12へ出力され、撮影中に映像を確認するこ
とができる。
〔発明が解決しようとする課題〕
以上のように、従来例では、フェード機能を動作させた
場合、EVF12の入力信号は、FADE回路5を通っ
た後の信号のためEVF12内の画面はフェード信号に
応じて白もしくは黒一色になる。そのため、フェード状
態では撮像素子1から出力される映像信号を撮影者は確
認することが不可能となる。特に、画面が白もしくは黒
一色のフェード状態から映像信号を徐々にミックスし、
撮影をスタートさせる場合(フェードイン時)は、最初
の映像を確認することが不可能なため、撮影者の意図と
は反した映像で撮影がスタートすることになり、フェー
ド機能が十分に活用されないという問題点があった。
この発明は上記のような従来例の問題点を解消するため
になされたものであり、フェード機能を動作させた場合
も.EVF内の映像はフェードされることなく、常に撮
像素子の出力を確認することができ、更にフェードの動
作状態が確認でき、フェードイン時における撮影ミスが
おきることがなく、フェード機能を充分に生かせた撮影
を可能とすることを目的とする。
(課題を解決するための手段〕 このため、この発明においては、フェード機能を有する
撮像装置において、前記フェード機能を動作した場合に
、電子ファインダ内の映像をフェードすることなく、常
に撮像素子の出力映像を確認する出力映像確認手段と、
前記フェードの動作状態を確認して表示するフェード確
認表示手段とを具備して成ることにより前記目的を達成
しようとするものである。
〔作用〕
この発明における撮像装置は、フェード機能を動作した
場合、出力映像確認手段で、電子ファインダ内の映像を
フェードしないで、常に撮像素子の出力映像を確認し、
フェード確認表示手段で前記フェードの動作状態を確認
して表示する。
〔実施例〕
以下この発明の二実施例を図面に基づいて説明する。
第1図はこの発明の撮像装置における第1実施例の構成
を示す構成図、第2図はこの発明の第2実施例の構成を
示す構成図、第3図はこの発明の表示手段による表示図
であり、第3図(a)は第1実施例の表示、第3図(b
)は第2実施例の表示である。
図面第1図において、前記従来例におけると同一または
相当構成要素は同一符号で表わし、重複説明は省略する
また、第1図ないし第3図において、Aは出力映像確認
手段であり、FADE回路5への入力前の接点Xに接続
されたEVF12で構成され、撮像装置の前記フェード
機能を動作した場合に、電子ファインダl2内の映像を
フェードすることなく、常に撮像素子の出力映像を確認
する手段(詳細後記)である。Bは確認表示手段であり
、表示回路8およびインジケータ20(第3図(a〉)
もしくは映像周辺部21(第3図(b))で構成され、
フェードの動作状態を確認して表示する手段である。ま
た、前記表示回路8はEVF12内にフェードの動作レ
ベルをインジケータ表示するための回路である。
次にこの第1実施例の動作を第1図および第3図を用い
て説明する。
図面第1図において、撮像素子1から出力された信号は
S/H回路2,AGC回路3,ENC回路4において信
号処理がなされて標準ビデオ信号となる。レコーダには
FADE回路5を通った後の映像信号を入力する。一方
、EVF42にはFADE回路5に入力する前の接点X
から分岐したENC回路4の出力を人力する。撮影者が
フェード動作スイッチ10を押した時(フェードアウト
時)、FADE回路5にフェード信号が入力し、ENC
回路5からの入力信号のレベルが徐々に下がり、画面が
白もしくは黒一面の映像信号がFADE回路5からレコ
ーダ出力される。逆にフェード動作スイッチ10を押し
た状態から離した時(フェードイン時)は白もしくは黒
一面の映像信号から徐々にENC回路4の出力映像信号
がFADE回路5からレブーダに出力される。
EVF12の入力信号は前記のようにFADE回路5の
入力前の信号であるから、前記のフェードアウト,フェ
ードインの動作に関係なく、常に、撮像素子1から得ら
れる映像信号が入力し撮影状態が確認できる.また、E
VF12に入力する映像信号には第3図(a)に示す様
に、フェード信号に応じてインジケータ20のレベルが
変化し、フェード動作時の動作状態が確認できるインジ
ケータ表示信号が表示回路8から出力されミックスされ
る。そのため、フェード動作時においてもEVF12内
のインジケータ表示によりフェードの動作状態が確認で
きる。
次に、この発明の第2実施例について第2図および第3
図を用いて説明する。
図面第2図において、前記第1実施例におけると同一ま
たは相当構成要素は同一符号で表わし、重複説明は省略
する。
また、第2図において、Aは出力映像確認手段であり、
EVF12と、EVF12および接点XならびにSG回
路7に接続されたEVF−FADE回路11とで構成さ
れている。Bは確認表示手段であり、EVF12で構成
されている。
次にこの第2実施例の動作を第2図を用いて説明する. 図面第2図において、ENC回路4の出力信号はFAD
E回路5及びEVF−FADE回路11に入力する,F
ADE回路5ではフェード信号に応じて映像信号が全て
フェードされレコーダ側に出力サレル.一方、EVF−
FADE回路11ではパルスを発生するSG回路7から
W−BLKバルス等の映像信号部に入り込んだパルスを
取り込み、該パルス期間だけフェードする。フェード動
作時のEVF12内の映像は第4図(b)の様に、該W
−BLKバルス期間であるEVF12の周辺部21だけ
がフェードの動作に連動して変化し、中心部は常に撮像
素子1から得られた映像が確認できる。
上記の様にフェードの動作状態を表示する方法として第
1実施例のEVF12内のインジケータ20の表示、第
2実施例のEVF12の映像信号の周辺部21だけをフ
ェードに連動化する方法を説明したが、EVF12のす
べての映像信号がフェードの動作に連動することなく、
フェードの動作状態が確認できる構成を有している撮像
装置であれば良い。
〔発明の効果〕 以上説明したように、この発明によれば、フェード機能
を動作させた場合、EVF内の映像はフェードされるこ
となく、常に撮像素子の出力を確認することができ、更
に、フェードの動作状態が確認でき、フェードイン時に
おける撮影ミスが起きることがなく、フェード機能を十
分にいかせた撮影が可能になる効果がある。
【図面の簡単な説明】
第1図はこの発明の撮像装置における第1実施例の構成
を示す構成図、第2図はこの発明の第2実施例の構成を
示す構成図、第3図はこの発明の表示手段による表示図
であり、第3図(a)は第1実施例の表示、第3図(b
)は第2実施例の表示である。第4図は従来例の撮像装
置の構成を示す構成図である。 A −−−−−出力映像確認手段 B・・・一確認表示手段 1一一・撮像素子 2 −− −− S / H回路 3 −− −− A G C回路 5 −− −−− F A D E回路6 −−− −
−− D R I V E回路7−−−SG回路 8 −−−−−−表示回路 9 −−−−−時定数設定回路 10…−FADHスイッチ 1 1−−EVF−FADE回路 20一・−インジケータ 21−−−一周辺部 なお、図中同一符号は同一もしく 示す。 は相当部分を

Claims (1)

    【特許請求の範囲】
  1. フェード機能を有する撮像装置において、前記フェード
    機能を動作した場合に、電子ファインダ内の映像をフェ
    ードすることなく、常に撮像素子の出力映像を確認する
    出力映像確認手段と、前記フェードの動作状態を確認し
    て表示するフェード確認表示手段とを具備して成ること
    を特徴とする撮像装置。
JP1158234A 1989-05-15 1989-06-22 撮像装置 Pending JPH0324871A (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP1158234A JPH0324871A (ja) 1989-06-22 1989-06-22 撮像装置
US07/522,811 US5287187A (en) 1989-05-15 1990-05-14 Video signal processing apparatus displaying image and process information

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1158234A JPH0324871A (ja) 1989-06-22 1989-06-22 撮像装置

Publications (1)

Publication Number Publication Date
JPH0324871A true JPH0324871A (ja) 1991-02-01

Family

ID=15667208

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Application Number Title Priority Date Filing Date
JP1158234A Pending JPH0324871A (ja) 1989-05-15 1989-06-22 撮像装置

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JP (1) JPH0324871A (ja)

Cited By (2)

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Publication number Priority date Publication date Assignee Title
US9731489B2 (en) 2013-05-29 2017-08-15 H.B. Fuller Company Material application system
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