JPH03104152A - 混成集積回路装置 - Google Patents
混成集積回路装置Info
- Publication number
- JPH03104152A JPH03104152A JP1241515A JP24151589A JPH03104152A JP H03104152 A JPH03104152 A JP H03104152A JP 1241515 A JP1241515 A JP 1241515A JP 24151589 A JP24151589 A JP 24151589A JP H03104152 A JPH03104152 A JP H03104152A
- Authority
- JP
- Japan
- Prior art keywords
- substrate
- integrated circuit
- chip
- microcomputer chip
- microcomputer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000000758 substrate Substances 0.000 claims abstract description 87
- 239000000463 material Substances 0.000 claims abstract description 36
- 230000002093 peripheral effect Effects 0.000 claims abstract description 34
- 238000007789 sealing Methods 0.000 claims abstract description 7
- 229920005989 resin Polymers 0.000 claims description 41
- 239000011347 resin Substances 0.000 claims description 41
- 229910052751 metal Inorganic materials 0.000 claims description 9
- 239000002184 metal Substances 0.000 claims description 9
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 8
- 239000011889 copper foil Substances 0.000 claims description 6
- 239000003990 capacitor Substances 0.000 claims description 3
- 230000000903 blocking effect Effects 0.000 claims 1
- 239000000565 sealant Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 10
- 239000011521 glass Substances 0.000 description 6
- 238000001514 detection method Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 238000004806 packaging method and process Methods 0.000 description 5
- 239000000853 adhesive Substances 0.000 description 4
- 230000001070 adhesive effect Effects 0.000 description 4
- 230000008901 benefit Effects 0.000 description 4
- 229910000679 solder Inorganic materials 0.000 description 4
- 229910052720 vanadium Inorganic materials 0.000 description 4
- UHOVQNZJYSORNB-UHFFFAOYSA-N Benzene Chemical group C1=CC=CC=C1 UHOVQNZJYSORNB-UHFFFAOYSA-N 0.000 description 3
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 3
- 230000017525 heat dissipation Effects 0.000 description 3
- 238000002844 melting Methods 0.000 description 3
- 230000008018 melting Effects 0.000 description 3
- 238000007747 plating Methods 0.000 description 3
- 239000004593 Epoxy Substances 0.000 description 2
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 description 2
- 239000004642 Polyimide Substances 0.000 description 2
- 230000002159 abnormal effect Effects 0.000 description 2
- 125000003118 aryl group Chemical group 0.000 description 2
- 238000005219 brazing Methods 0.000 description 2
- 239000000919 ceramic Substances 0.000 description 2
- 239000004020 conductor Substances 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 229910052737 gold Inorganic materials 0.000 description 2
- 239000010931 gold Substances 0.000 description 2
- 230000020169 heat generation Effects 0.000 description 2
- BASFCYQUMIYNBI-UHFFFAOYSA-N platinum Chemical compound [Pt] BASFCYQUMIYNBI-UHFFFAOYSA-N 0.000 description 2
- 229920001721 polyimide Polymers 0.000 description 2
- 230000008569 process Effects 0.000 description 2
- 238000007650 screen-printing Methods 0.000 description 2
- 239000003566 sealing material Substances 0.000 description 2
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- BQCADISMDOOEFD-UHFFFAOYSA-N Silver Chemical compound [Ag] BQCADISMDOOEFD-UHFFFAOYSA-N 0.000 description 1
- 230000005856 abnormality Effects 0.000 description 1
- 229910052782 aluminium Inorganic materials 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- -1 and for example Chemical group 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 239000011093 chipboard Substances 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 230000006872 improvement Effects 0.000 description 1
- 230000001678 irradiating effect Effects 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
- 125000002496 methyl group Chemical group [H]C([H])([H])* 0.000 description 1
- 229910052759 nickel Inorganic materials 0.000 description 1
- 229910000510 noble metal Inorganic materials 0.000 description 1
- 230000003647 oxidation Effects 0.000 description 1
- 238000007254 oxidation reaction Methods 0.000 description 1
- TWNQGVIAIRXVLR-UHFFFAOYSA-N oxo(oxoalumanyloxy)alumane Chemical compound O=[Al]O[Al]=O TWNQGVIAIRXVLR-UHFFFAOYSA-N 0.000 description 1
- 238000001259 photo etching Methods 0.000 description 1
- 229910052697 platinum Inorganic materials 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 229920001296 polysiloxane Polymers 0.000 description 1
- 239000010970 precious metal Substances 0.000 description 1
- 239000003507 refrigerant Substances 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 239000000523 sample Substances 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 229920002379 silicone rubber Polymers 0.000 description 1
- 239000004945 silicone rubber Substances 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 239000004332 silver Substances 0.000 description 1
- 229920003002 synthetic resin Polymers 0.000 description 1
- 239000000057 synthetic resin Substances 0.000 description 1
- 229920005992 thermoplastic resin Polymers 0.000 description 1
Landscapes
- Insulated Metal Substrates For Printed Circuits (AREA)
- Combinations Of Printed Boards (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(イ〉産業上の利用分野
本発明は集積回路基板にチップ型のEPROM内蔵マイ
クロコンピュータを実装してなるEPROM内蔵マイク
ロコンピュータ搭載の混成集積回路装置に関する。
クロコンピュータを実装してなるEPROM内蔵マイク
ロコンピュータ搭載の混成集積回路装置に関する。
(口)従来の技術
紫外線を照射することによって既に書込まれた記憶情報
を消去し、再書込みが可能な紫外線照射窓を有するEP
ROM内蔵のマイクロコンビュー夕素子は各種電子機器
に好んで用いられている.このEPROM内蔵マイクロ
コンピュータは、制御用あるいは駆動用集積回路と共に
現在、その殆んどがプリント配線板に実装されている.
各種電子機器で小型軽量化が要求される機器は、チップ
・才ン・ボードと称される技法によってプリント配線板
に半導体集積回路(IC)チップが直接搭載され、所要
の配線が施された後この配線部分を含んで前記ICチッ
プが合成樹脂によって被覆され、極めて小型軽量化が達
成されている。
を消去し、再書込みが可能な紫外線照射窓を有するEP
ROM内蔵のマイクロコンビュー夕素子は各種電子機器
に好んで用いられている.このEPROM内蔵マイクロ
コンピュータは、制御用あるいは駆動用集積回路と共に
現在、その殆んどがプリント配線板に実装されている.
各種電子機器で小型軽量化が要求される機器は、チップ
・才ン・ボードと称される技法によってプリント配線板
に半導体集積回路(IC)チップが直接搭載され、所要
の配線が施された後この配線部分を含んで前記ICチッ
プが合成樹脂によって被覆され、極めて小型軽量化が達
成されている。
かかる従来のEPROM内蔵マイクロコンピュータの実
装構造を第13図に従って説明すると、第13図は従来
のEPROM内蔵マイクロコンピュータの一部断面を有
する斜視図であって、主表面上に導電性配線パターン(
41〉が形成されたガラス・エボキシ樹脂などから構成
された絶縁性基板(42〉のスルーホール(43〉にサ
ーディップ型バックー−ジに組込まれたEPROM内蔵
マイクロコンピュータ(44)が搭載されている。この
EPROM内蔵マイクロコンピュータ(44)はヘッタ
−(45)及びキャップ(46)を有し、前記ヘッダー
(45)はセラミック基材(47)に外部導出リード(
48)か低融点ガラス材で接着されている。又このヘッ
ダー(45)はガラスに金粉が多量に混入したいわゆる
金ペーストを焼結した素子搭載部(50〉が前記低融点
ガラス材上あるいはセラミック基材(47)上に接着さ
れており、この素子搭載部(50)にEPROM内蔵マ
イクロコンピュータチップ(51)が装着され、このチ
ップ(51〉の電極と前記外部導出リード(48)とが
金属細線(52)によって接続されている。このキャッ
プ(46)は低融点ガラスによってヘッダー(45)に
配置されたEPROM内蔵マイクロコンピュータチップ
(51)を密封している.この様にEPROM内蔵マイ
クロコンピュータチップ(51)を密封したEPROM
内蔵マイクロコンピュータ(44)は、前記絶縁性基板
(42〉のスルーホール(43〉に外部導出リード〈4
8)を挿通させ半田によって固定される。このスルーホ
ール(43)は導電性配線パターン(41)によって所
要の配線引回しが施され、前記絶縁性基板の端部に設け
られた雄型コネクタ端子部(55)から図示しない雌型
コネクタへと接続される。
装構造を第13図に従って説明すると、第13図は従来
のEPROM内蔵マイクロコンピュータの一部断面を有
する斜視図であって、主表面上に導電性配線パターン(
41〉が形成されたガラス・エボキシ樹脂などから構成
された絶縁性基板(42〉のスルーホール(43〉にサ
ーディップ型バックー−ジに組込まれたEPROM内蔵
マイクロコンピュータ(44)が搭載されている。この
EPROM内蔵マイクロコンピュータ(44)はヘッタ
−(45)及びキャップ(46)を有し、前記ヘッダー
(45)はセラミック基材(47)に外部導出リード(
48)か低融点ガラス材で接着されている。又このヘッ
ダー(45)はガラスに金粉が多量に混入したいわゆる
金ペーストを焼結した素子搭載部(50〉が前記低融点
ガラス材上あるいはセラミック基材(47)上に接着さ
れており、この素子搭載部(50)にEPROM内蔵マ
イクロコンピュータチップ(51)が装着され、このチ
ップ(51〉の電極と前記外部導出リード(48)とが
金属細線(52)によって接続されている。このキャッ
プ(46)は低融点ガラスによってヘッダー(45)に
配置されたEPROM内蔵マイクロコンピュータチップ
(51)を密封している.この様にEPROM内蔵マイ
クロコンピュータチップ(51)を密封したEPROM
内蔵マイクロコンピュータ(44)は、前記絶縁性基板
(42〉のスルーホール(43〉に外部導出リード〈4
8)を挿通させ半田によって固定される。このスルーホ
ール(43)は導電性配線パターン(41)によって所
要の配線引回しが施され、前記絶縁性基板の端部に設け
られた雄型コネクタ端子部(55)から図示しない雌型
コネクタへと接続される。
さて、かかる従来のEPROM内蔵マイクロコンピュー
タ素子の実装構造は、EPROM内蔵マイクロコンピュ
ータチップ(51〉に比べパッケージ外形が極めて大き
く、平面占有率もさることながら三次元、つまり高さも
チップの高さの数倍となり、薄型化に極めて不利である
。更にスルーホール〈43〉に外部導出リードを挿通し
た後、半田などで固定する必要も生ずる。更に特筆すべ
き大きな欠点は、絶縁性基板への実装に先立ってEPR
OM内蔵マイクロコンピュータ素子を一旦パッケージに
組立てることである。
タ素子の実装構造は、EPROM内蔵マイクロコンピュ
ータチップ(51〉に比べパッケージ外形が極めて大き
く、平面占有率もさることながら三次元、つまり高さも
チップの高さの数倍となり、薄型化に極めて不利である
。更にスルーホール〈43〉に外部導出リードを挿通し
た後、半田などで固定する必要も生ずる。更に特筆すべ
き大きな欠点は、絶縁性基板への実装に先立ってEPR
OM内蔵マイクロコンピュータ素子を一旦パッケージに
組立てることである。
ここではサーディップパッケージタイプのEPROM内
蔵マイクロコンピュータ素子について述べたが樹脂封止
型パッケージについても上述した問題は発生する。
蔵マイクロコンピュータ素子について述べたが樹脂封止
型パッケージについても上述した問題は発生する。
斯る問題を解決するために第14図に示した実装構造が
既に使用されている。
既に使用されている。
以下に第14図に示したEPROM内蔵マイクロコンピ
ュータ実装構造について説明する。
ュータ実装構造について説明する。
主表面(60a)に導電性配線パターン(60b)が形
成されたガラス・エポキシ樹脂板などの絶縁性基板(6
0〉上には、EPROM内蔵マイクロコンピュータチッ
プ(61)を載置するチップ搭載エリア(60c)を有
し、前記配線パターン(60b)は、このエリア近傍か
ら主表面(60a)上を引回されて図示しない雄型コネ
クタ端子部に接続されている。前記エリア(60c)に
は、EPROM内蔵マイクロコンピュータチップ(61
)が搭載され、このチップ(61〉の表面電極と前記配
線パターン(60b)とが金属細線(62)により接続
されている.勿論金属細線(62〉の1本は前記チップ
(61)のサブストレートと接続する為に、このチップ
(61)が搭載された配線パターン(60b)とワイヤ
リングされている。
成されたガラス・エポキシ樹脂板などの絶縁性基板(6
0〉上には、EPROM内蔵マイクロコンピュータチッ
プ(61)を載置するチップ搭載エリア(60c)を有
し、前記配線パターン(60b)は、このエリア近傍か
ら主表面(60a)上を引回されて図示しない雄型コネ
クタ端子部に接続されている。前記エリア(60c)に
は、EPROM内蔵マイクロコンピュータチップ(61
)が搭載され、このチップ(61〉の表面電極と前記配
線パターン(60b)とが金属細線(62)により接続
されている.勿論金属細線(62〉の1本は前記チップ
(61)のサブストレートと接続する為に、このチップ
(61)が搭載された配線パターン(60b)とワイヤ
リングされている。
上述した様にEPROM内蔵マイクロコンピュータチッ
プを直接基板上に搭載することが既に周知技術として知
られている。
プを直接基板上に搭載することが既に周知技術として知
られている。
(ハ〉発明が解決しようとする課題
第14図で示したEPROM内蔵マイクロコンピュータ
実装構造ではEPROM内蔵マイクロコンピュータのチ
ップをプリント基板上にグイポンディングしているため
、小型化となることはいうまでもない。しかしながら、
ここでいう小型化はあくまでEPROM内蔵マイクロコ
ンピュータ自体の小型化である。即ち、第14図からは
明らかにされていないがEPROM内蔵マイクロコンピ
ュータの周辺に固着されているその周辺回路素子はディ
スクリート等の電子部品で構成されているために、EP
ROM内蔵マイクロコンピュータを搭載したプリント基
板用の集積回路としてのシステム全体を見た場合なんら
小型化とはならず従来通りプリント基板の大型化、即ち
システム全体が大型化になる問題がある. また、第13図に示した実装構造においても第14図と
同様にEPROM内蔵マイクロコンピュータの周辺の回
路、即ちLSI,IC等の回路素子がディスクリート等
の電子部品で構成されているため、プリント基板の大型
化、即ちシステム全体が大型化となりユーザが要求され
る軽薄短小のEPROM内蔵マイクロコンピュータ搭載
の集積回路を提供することができない大きな問題がある
。
実装構造ではEPROM内蔵マイクロコンピュータのチ
ップをプリント基板上にグイポンディングしているため
、小型化となることはいうまでもない。しかしながら、
ここでいう小型化はあくまでEPROM内蔵マイクロコ
ンピュータ自体の小型化である。即ち、第14図からは
明らかにされていないがEPROM内蔵マイクロコンピ
ュータの周辺に固着されているその周辺回路素子はディ
スクリート等の電子部品で構成されているために、EP
ROM内蔵マイクロコンピュータを搭載したプリント基
板用の集積回路としてのシステム全体を見た場合なんら
小型化とはならず従来通りプリント基板の大型化、即ち
システム全体が大型化になる問題がある. また、第13図に示した実装構造においても第14図と
同様にEPROM内蔵マイクロコンピュータの周辺の回
路、即ちLSI,IC等の回路素子がディスクリート等
の電子部品で構成されているため、プリント基板の大型
化、即ちシステム全体が大型化となりユーザが要求され
る軽薄短小のEPROM内蔵マイクロコンピュータ搭載
の集積回路を提供することができない大きな問題がある
。
更に第13図および第14図で示したEPROM内蔵マ
イクロコンピュータ実装構造では、上述した様にシステ
ム全体が大型化になると共にEPROM内蔵マイクロコ
ンピュータおよびその周辺の回路素子を互いに接続する
導電パターンが露出されているため信頼性が低下する問
題がある.更に第13図および第14図で示したEPR
OM内蔵マイクロコンピュータ実装構造ではEPROM
内蔵マイクロコンピュータと、その周辺のIC,LSI
等の回路素子が露出されているため、基板上面に凹凸が
生じて取扱いにくく作業性が低下する問題がある。
イクロコンピュータ実装構造では、上述した様にシステ
ム全体が大型化になると共にEPROM内蔵マイクロコ
ンピュータおよびその周辺の回路素子を互いに接続する
導電パターンが露出されているため信頼性が低下する問
題がある.更に第13図および第14図で示したEPR
OM内蔵マイクロコンピュータ実装構造ではEPROM
内蔵マイクロコンピュータと、その周辺のIC,LSI
等の回路素子が露出されているため、基板上面に凹凸が
生じて取扱いにくく作業性が低下する問題がある。
(二〉課題を解決するための手段
本発明は上述した課題に鑑みて為されたものであり、基
板上にチップのEPROM内蔵マイクロコンピュータを
搭載すると共に、且つ、ケース材と両基板によってその
周辺の回路素子全てが密封封止されてEPROM内蔵マ
イクロコンピュータだけが一方の基板の周端辺に設けら
れたくぼみによって露出された他方の基板上に搭載され
た構造を有することを特徴とする。
板上にチップのEPROM内蔵マイクロコンピュータを
搭載すると共に、且つ、ケース材と両基板によってその
周辺の回路素子全てが密封封止されてEPROM内蔵マ
イクロコンピュータだけが一方の基板の周端辺に設けら
れたくぼみによって露出された他方の基板上に搭載され
た構造を有することを特徴とする。
従ってEPROM内蔵マイクロフンビュータを搭載した
混成集積回路を小型化で且っEPROM内蔵マイクロコ
ンピュータのデータの消去が容易に行えるEPROM内
蔵マイクロコンピュータ内蔵の混成集積回路装置を提供
することができる。
混成集積回路を小型化で且っEPROM内蔵マイクロコ
ンピュータのデータの消去が容易に行えるEPROM内
蔵マイクロコンピュータ内蔵の混成集積回路装置を提供
することができる。
(ネ)作用
この様に本発明に依れば、二枚の基板の一方の基板の周
端辺の所定位置にくぼみを設け、そのくぼみで露出した
他方の基板上の導電路にEPマイコンチップを接続して
いるので、EPマイコンチップの載置位置を任意に設定
できるので、もっとも関連深い回路素子との電気的接続
を考慮して、効率良<EPマイコンチップとを接続する
ことができ、信号線即ち導電路の引回し線を不要にする
ことができる. 更にEPROM内蔵マイクロコンピュータの隣接する位
置に最も関連の深い周辺回路素子を配置でき、EPRO
M内蔵マイクロコンピュータと周辺回路素子との間のデ
ータのやりとりを行うデータ線を最短距離あるいは最小
距離で実現でき、データ線の引回しによる実装密度のロ
スを最小限に抑制することになり、高密度の実装が行え
る.更に本発明ではEPROM内蔵マイクロコンピュー
タチップ以外の全ての素子がチップ状でケース材と両基
板間で形成された封止空間内に収納されるため小型化で
しかも取扱い性の優れた混成集積回路装置を提供するこ
とができる.(へ)実施例 以下に第1図乃至第12図に示した実施例に基づいて本
発明の混成集積回路装置を詳細に説明する。
端辺の所定位置にくぼみを設け、そのくぼみで露出した
他方の基板上の導電路にEPマイコンチップを接続して
いるので、EPマイコンチップの載置位置を任意に設定
できるので、もっとも関連深い回路素子との電気的接続
を考慮して、効率良<EPマイコンチップとを接続する
ことができ、信号線即ち導電路の引回し線を不要にする
ことができる. 更にEPROM内蔵マイクロコンピュータの隣接する位
置に最も関連の深い周辺回路素子を配置でき、EPRO
M内蔵マイクロコンピュータと周辺回路素子との間のデ
ータのやりとりを行うデータ線を最短距離あるいは最小
距離で実現でき、データ線の引回しによる実装密度のロ
スを最小限に抑制することになり、高密度の実装が行え
る.更に本発明ではEPROM内蔵マイクロコンピュー
タチップ以外の全ての素子がチップ状でケース材と両基
板間で形成された封止空間内に収納されるため小型化で
しかも取扱い性の優れた混成集積回路装置を提供するこ
とができる.(へ)実施例 以下に第1図乃至第12図に示した実施例に基づいて本
発明の混成集積回路装置を詳細に説明する。
第1図および第2図には、本発明の一実施例の混成集積
回路装置(1)が示されている.この混成集積回路装置
(1)は独立した電子部品として用いられインバータエ
アコン等の幅広いインバータモータの分野で機能を独立
して有する集積回路として用いられる。
回路装置(1)が示されている.この混成集積回路装置
(1)は独立した電子部品として用いられインバータエ
アコン等の幅広いインバータモータの分野で機能を独立
して有する集積回路として用いられる。
この混成集積回路装置〈1)は第1図および第2図に示
す様に、二枚の集積回路基板(2)(3)と、二枚の集
積回路基板(2)(3)の一方の基板(2)の周端辺の
所定位置に設けられたくぼみ(4)と、二枚の集積回路
基板(2)(3)上に形成された所望形状の導電路〈5
)と、他方の基板(3)上に形成された導電路(5)と
接続されたEPROM内蔵マイクロコンピュータチップ
(6)(以下EPマイコンチップという)と、二枚の基
板(2)(3)上の導電路(5)と接続された周辺の回
路素子(8)と、二枚の基板(2〉(3)を離間して一
体化するケース材(7)とから構成される. 二枚の集積回路基板(2)(3)はセラミックス、ガラ
スエボキシあるいは金属等の硬質基板が用いられ、本実
施例では放熱性および機械的強度に優れた金属基板を用
いるものとする。
す様に、二枚の集積回路基板(2)(3)と、二枚の集
積回路基板(2)(3)の一方の基板(2)の周端辺の
所定位置に設けられたくぼみ(4)と、二枚の集積回路
基板(2)(3)上に形成された所望形状の導電路〈5
)と、他方の基板(3)上に形成された導電路(5)と
接続されたEPROM内蔵マイクロコンピュータチップ
(6)(以下EPマイコンチップという)と、二枚の基
板(2)(3)上の導電路(5)と接続された周辺の回
路素子(8)と、二枚の基板(2〉(3)を離間して一
体化するケース材(7)とから構成される. 二枚の集積回路基板(2)(3)はセラミックス、ガラ
スエボキシあるいは金属等の硬質基板が用いられ、本実
施例では放熱性および機械的強度に優れた金属基板を用
いるものとする。
金属基板としては例えば0.5〜i. own厚のアル
ミニウム基板を用いる。その基板(2)(3)の表面に
は第4図に示す如く、周知の陽極酸化により酸化アルミ
ニウム膜(9)(アルマイト層)が形成され、その一主
面側に10〜70μ厚のエボキシあるいはポリイミド等
の絶縁樹脂層(10〉が貼着される。更に絶縁樹脂層(
10)上には10〜70μ厚の銅箔(11〉が絶縁樹脂
層(10〉と同時にローラーあるいはホットプレス等の
手段により貼着されている。ところで、二枚の基板(2
)(’3)はフレキシブル性を有する絶縁樹脂層(10
〉によって所定の間隔離間されて連結された状態となっ
ている.本実施例ではフイルムを用いて夫々の基板(2
)(3)を接続するがフイルムを用いらずに夫々の基板
(2)(3)を独立させてあとで金属製リードで接続す
ることも可能である. 二枚の基板(2)(3)の一生面上に設けられた銅箔(
11〉表面上にはスクリーン印刷によって所望形状の導
電路を露出してレジストでマスクされ、貴金属(金、銀
、白金)メッキ層が銅箔(11)表面にメッキされる。
ミニウム基板を用いる。その基板(2)(3)の表面に
は第4図に示す如く、周知の陽極酸化により酸化アルミ
ニウム膜(9)(アルマイト層)が形成され、その一主
面側に10〜70μ厚のエボキシあるいはポリイミド等
の絶縁樹脂層(10〉が貼着される。更に絶縁樹脂層(
10)上には10〜70μ厚の銅箔(11〉が絶縁樹脂
層(10〉と同時にローラーあるいはホットプレス等の
手段により貼着されている。ところで、二枚の基板(2
)(’3)はフレキシブル性を有する絶縁樹脂層(10
〉によって所定の間隔離間されて連結された状態となっ
ている.本実施例ではフイルムを用いて夫々の基板(2
)(3)を接続するがフイルムを用いらずに夫々の基板
(2)(3)を独立させてあとで金属製リードで接続す
ることも可能である. 二枚の基板(2)(3)の一生面上に設けられた銅箔(
11〉表面上にはスクリーン印刷によって所望形状の導
電路を露出してレジストでマスクされ、貴金属(金、銀
、白金)メッキ層が銅箔(11)表面にメッキされる。
然る後、レジストを除去して貴金属メッキ層をマスクと
して銅箔(11〉のエッチングを行い所望の導電路(5
)が形成される。ここでスクリーン印刷による導電路(
5)の細さは0.5冊が限界であるため、極細配線パタ
ーンを必要とするときは周知の写真蝕刻技術に依り約2
μまでの極細導電路(5)の形成が可能となる。
して銅箔(11〉のエッチングを行い所望の導電路(5
)が形成される。ここでスクリーン印刷による導電路(
5)の細さは0.5冊が限界であるため、極細配線パタ
ーンを必要とするときは周知の写真蝕刻技術に依り約2
μまでの極細導電路(5)の形成が可能となる。
一方の基板(2〉上に形成された導電路(5)は図示さ
れないが、大信号用のパワー系の太い導電路が形成され
、他方の基板(3〉上には小信号用の細い導電路が形成
されている。
れないが、大信号用のパワー系の太い導電路が形成され
、他方の基板(3〉上には小信号用の細い導電路が形成
されている。
他方の基板(3)上の導電路(5)にはEPマイコンチ
ップ(6)とそのEPマイコンチップ(6)からのデー
タを供給される複数の回路素子(8)が搭載され、一方
の基板(2)および他方の基板(3〉上の導電路(5)
にその周辺の回路素子(8)が搭載されている.また両
基板(2)(3)の同一側辺あるいは対向する側辺周端
部に導電路(5)が延在され外部リード端子(12)(
13)を固着するための複数のパッドが形成されている
。このパッドには外部リード端子(12)(13)が半
田によって固着されている。また両基板(2>(3)上
に形成されている導電路(5)はフレキシブル樹脂層(
10)上に形成されているので二枚の基板(2)(3)
を股がる様にバターニングされ両基板(2)(3)の接
続が所定の位置でしかも任意に行えることができる。
ップ(6)とそのEPマイコンチップ(6)からのデー
タを供給される複数の回路素子(8)が搭載され、一方
の基板(2)および他方の基板(3〉上の導電路(5)
にその周辺の回路素子(8)が搭載されている.また両
基板(2)(3)の同一側辺あるいは対向する側辺周端
部に導電路(5)が延在され外部リード端子(12)(
13)を固着するための複数のパッドが形成されている
。このパッドには外部リード端子(12)(13)が半
田によって固着されている。また両基板(2>(3)上
に形成されている導電路(5)はフレキシブル樹脂層(
10)上に形成されているので二枚の基板(2)(3)
を股がる様にバターニングされ両基板(2)(3)の接
続が所定の位置でしかも任意に行えることができる。
EPマイコンチップ(6)は周知の如く、プログラムプ
ロセッサ(CPU)を中心にプログラムメモリにRAM
,EPROM、周辺装置に入出力インターフェイスを組
合せている素子である。EPマイコンチップ(6)は市
販されているものであり、ここではEPマイコンチップ
(6)の説明を省略する。
ロセッサ(CPU)を中心にプログラムメモリにRAM
,EPROM、周辺装置に入出力インターフェイスを組
合せている素子である。EPマイコンチップ(6)は市
販されているものであり、ここではEPマイコンチップ
(6)の説明を省略する。
一方、本発明では二枚の基板(2)(3)の一方の基板
(2)の周端辺の所定位置にくぼみ(4)が設けられて
いる.この両基板(2)(3)は後述するケース材(7
)によって所定間隔離間され固着される。このとき、一
方の基板(2〉に設けたくぼみ(4)で露出する他方の
基板(3)上の導電路(5)上にはEPマイコンチップ
(6)がAgペースト、半田等のろう材によって固着搭
載され、くぼみ(4)で露出した他方の基板ク3〉上に
it E Pマイコンチップ《6)と接続される複数の
導電路(5)の一端が延在されている.その導電路(5
)とEPマイコンチップ(6)とはlワイヤ線で超音波
ポンディング接続が行われている。
(2)の周端辺の所定位置にくぼみ(4)が設けられて
いる.この両基板(2)(3)は後述するケース材(7
)によって所定間隔離間され固着される。このとき、一
方の基板(2〉に設けたくぼみ(4)で露出する他方の
基板(3)上の導電路(5)上にはEPマイコンチップ
(6)がAgペースト、半田等のろう材によって固着搭
載され、くぼみ(4)で露出した他方の基板ク3〉上に
it E Pマイコンチップ《6)と接続される複数の
導電路(5)の一端が延在されている.その導電路(5
)とEPマイコンチップ(6)とはlワイヤ線で超音波
ポンディング接続が行われている。
EPマイコンチップ(6)の所定のプログラム・データ
を選択して供給されるその周辺の回路素子(8)はチッ
プ部品で所望の導電路〈5)上に半田付けあるいはAg
ペースト等のろう材によって付着され、近傍の導電路(
5)に超音波ポンディング接続されている,更に導電路
(5)間にはスクリーン印刷によるカーボン抵抗体ある
いはニッケルメッキによるニッケルメッキ抵抗体が抵抗
素子として形成されている。
を選択して供給されるその周辺の回路素子(8)はチッ
プ部品で所望の導電路〈5)上に半田付けあるいはAg
ペースト等のろう材によって付着され、近傍の導電路(
5)に超音波ポンディング接続されている,更に導電路
(5)間にはスクリーン印刷によるカーボン抵抗体ある
いはニッケルメッキによるニッケルメッキ抵抗体が抵抗
素子として形成されている。
更に詳述するとEPマイコンチップ(6).!:モっと
も関連する回路素子(8)はくぼみ(4)が設けられて
いない他方の基板(3)上の導電路(5)と接続され、
その他の全ての回路素子(8)は一方および他方の基板
(2)(3)の所定位置の導電路(5)上に付着されて
いる. ケース材(7)は絶縁部材の熱可塑性樹脂から形成され
、第3図に示す如く、二枚の基板(2)(3)を所定間
隔離間して封止空間を形成するために枠状に形成されて
いる。ケース材(7)には一方の基板(2)の周端辺に
設けたくぼみ(4)の周囲とくぼみ(4)によって露出
された他方の基板(3)表面の周囲と当接される一定の
厚みを有した枠体く18)が設けられている。この枠体
く18)は基板(2〉に設けられたくぼみ(4)に沿っ
てくぼませて形成されている。また、ケース材〈7)の
一側辺は両基板(2)(3>を配置したときにフィルム
樹脂層(10)が容易に折曲される様に円弧状に形成さ
れている。
も関連する回路素子(8)はくぼみ(4)が設けられて
いない他方の基板(3)上の導電路(5)と接続され、
その他の全ての回路素子(8)は一方および他方の基板
(2)(3)の所定位置の導電路(5)上に付着されて
いる. ケース材(7)は絶縁部材の熱可塑性樹脂から形成され
、第3図に示す如く、二枚の基板(2)(3)を所定間
隔離間して封止空間を形成するために枠状に形成されて
いる。ケース材(7)には一方の基板(2)の周端辺に
設けたくぼみ(4)の周囲とくぼみ(4)によって露出
された他方の基板(3)表面の周囲と当接される一定の
厚みを有した枠体く18)が設けられている。この枠体
く18)は基板(2〉に設けられたくぼみ(4)に沿っ
てくぼませて形成されている。また、ケース材〈7)の
一側辺は両基板(2)(3>を配置したときにフィルム
樹脂層(10)が容易に折曲される様に円弧状に形成さ
れている。
ケース材(7)と二枚の基板(2)(3)との固着は接
着シートによって行われ、フィルム樹脂層(10)によ
って連結された両基板(2)(3)でケース材(7)を
挾む様に且つ搭載された回路素子を対向させる様にして
固着される。このとき、両基板(2)(3)を連結する
フイルム樹脂層(10〉は上述したケース材(7)に設
けられた円弧状部と当接されて折曲げされるため折曲げ
部分の導電路(5)が折曲時に切断する恐れはない。ケ
ース材(7)と両基板(2)(3)とを一体化したのち
、連結部の樹脂層(lO)が露出されるため、本実施例
では蓋体(2o)で露出した連結部分を完全に封止する
ものとする。尚、蓋体(2o〉はケース材(7)と同一
材料で形成され、その接着は上述した接着シート等の所
定の手段によって行われている。
着シートによって行われ、フィルム樹脂層(10)によ
って連結された両基板(2)(3)でケース材(7)を
挾む様に且つ搭載された回路素子を対向させる様にして
固着される。このとき、両基板(2)(3)を連結する
フイルム樹脂層(10〉は上述したケース材(7)に設
けられた円弧状部と当接されて折曲げされるため折曲げ
部分の導電路(5)が折曲時に切断する恐れはない。ケ
ース材(7)と両基板(2)(3)とを一体化したのち
、連結部の樹脂層(lO)が露出されるため、本実施例
では蓋体(2o)で露出した連結部分を完全に封止する
ものとする。尚、蓋体(2o〉はケース材(7)と同一
材料で形成され、その接着は上述した接着シート等の所
定の手段によって行われている。
一方の基板(2〉の周端辺に設けられたくぼみ(4)で
露出した他方の基板〈3〉上にはEPマイコンチップ(
6)と接続される複数の導電路(5)の一端が形成され
、その導電路(5)の先端部にEPマイコンチップ(6
)が固着される。EPマイコンチップ(6)が固着され
た導電路(5)の他端はもっとも関連する回路素子(8
)の近傍に効率よく引回しされポンディングワイヤで接
続される。
露出した他方の基板〈3〉上にはEPマイコンチップ(
6)と接続される複数の導電路(5)の一端が形成され
、その導電路(5)の先端部にEPマイコンチップ(6
)が固着される。EPマイコンチップ(6)が固着され
た導電路(5)の他端はもっとも関連する回路素子(8
)の近傍に効率よく引回しされポンディングワイヤで接
続される。
ここでEPマイコンチップ(6)とそのチップ(6)と
もっとも関連深い回路素子(8)との位置関係について
述べる。第1図に示す如く、EPマイコンチップ(6)
ともっとも関連する回路素子(8)とは多数本の導電路
(5)を介して接続されるため、その導電路ク5)の引
回しを短くするためにEPマイコンチップク6)ともっ
とも関連する回路素子(8)吐夫々、隣接する位置かあ
るいはできるだけ近傍に位置する様に配置される.従っ
てEPマイコンチップ(6)ともっとも関連する回路素
子(8)との導電路(5)の引回しは最短距離で形成で
き基板上の実装面積を有効に使用することができる。E
Pマイコンチップ(6)とその近傍あるいは隣接した位
置に配置されたもっとも関連する回路素子(8)は第1
図の如く、回路素子(8)の近傍に延在された導電路(
5)の先端部とAj!ワイヤ線によって超音波ボンデイ
ング接続されEPマイコンチップ(6)と電気的に接続
される。
もっとも関連深い回路素子(8)との位置関係について
述べる。第1図に示す如く、EPマイコンチップ(6)
ともっとも関連する回路素子(8)とは多数本の導電路
(5)を介して接続されるため、その導電路ク5)の引
回しを短くするためにEPマイコンチップク6)ともっ
とも関連する回路素子(8)吐夫々、隣接する位置かあ
るいはできるだけ近傍に位置する様に配置される.従っ
てEPマイコンチップ(6)ともっとも関連する回路素
子(8)との導電路(5)の引回しは最短距離で形成で
き基板上の実装面積を有効に使用することができる。E
Pマイコンチップ(6)とその近傍あるいは隣接した位
置に配置されたもっとも関連する回路素子(8)は第1
図の如く、回路素子(8)の近傍に延在された導電路(
5)の先端部とAj!ワイヤ線によって超音波ボンデイ
ング接続されEPマイコンチップ(6)と電気的に接続
される。
EPマイコンチップ(6)Cま第1図および第2図から
明らかな如く、一方の基板(2)の周端辺に設けたくぼ
み(4)で露出した他方の基板(3)上に搭載され、ケ
ース材(7)の枠体く18)で囲まれた構造となる。更
に詳述すると枠体く18)によって囲まれるのはEPマ
イコンチップ(6)とそのEPマイコンチップ(6)と
近傍の導電路(5)とボンディング接続するワイヤ線と
が囲まれることになる.更に枠体く18)によって囲ま
れた空間(19a)には1層以上の樹脂が充填され、E
Pマイコンチップ(6)およびワイヤ線がその樹脂層に
よって完全に被覆される。EPマイコンチップ(6)上
に直接被覆される第1層目の樹脂はEPマイコンチップ
(6)のデータを消去する場合に紫外線を透過する必要
があるために紫外線透過性樹脂(21a)が用いられる
。紫外線透過性樹脂(21a)は非芳香族系であれば限
定されず、例えばメチル系シリコンゴムあるいはシリコ
ンゲルが用いられる。
明らかな如く、一方の基板(2)の周端辺に設けたくぼ
み(4)で露出した他方の基板(3)上に搭載され、ケ
ース材(7)の枠体く18)で囲まれた構造となる。更
に詳述すると枠体く18)によって囲まれるのはEPマ
イコンチップ(6)とそのEPマイコンチップ(6)と
近傍の導電路(5)とボンディング接続するワイヤ線と
が囲まれることになる.更に枠体く18)によって囲ま
れた空間(19a)には1層以上の樹脂が充填され、E
Pマイコンチップ(6)およびワイヤ線がその樹脂層に
よって完全に被覆される。EPマイコンチップ(6)上
に直接被覆される第1層目の樹脂はEPマイコンチップ
(6)のデータを消去する場合に紫外線を透過する必要
があるために紫外線透過性樹脂(21a)が用いられる
。紫外線透過性樹脂(21a)は非芳香族系であれば限
定されず、例えばメチル系シリコンゴムあるいはシリコ
ンゲルが用いられる。
本実施例では第1層目の樹脂層(21a)上に第2層目
の樹脂層(2lb)が充填されている。第2層目の樹脂
層は第1層目とは異なりEPマイコンチップ(6)の誤
消去を防止するために紫外線を遮断する紫外線不透過性
樹脂(2lb)が用いられる。この樹脂(21b)は芳
香環(ベンゼン環)を含んだ樹脂であれば限定されず例
えばエポキシ系あるいはボノイミド系の樹脂が用いられ
、一方の基板ク2〉の上面と略一致するまで充填される
。
の樹脂層(2lb)が充填されている。第2層目の樹脂
層は第1層目とは異なりEPマイコンチップ(6)の誤
消去を防止するために紫外線を遮断する紫外線不透過性
樹脂(2lb)が用いられる。この樹脂(21b)は芳
香環(ベンゼン環)を含んだ樹脂であれば限定されず例
えばエポキシ系あるいはボノイミド系の樹脂が用いられ
、一方の基板ク2〉の上面と略一致するまで充填される
。
従ってEPマイコンチップ(6)だけが枠体(18)に
よって囲まれ且つ2層の樹脂で被覆され、その他の回路
素子(8)は両基板(2)(3)とケース材(7)とで
形成される封止空間(21 ’ )内に配置されること
になる。
よって囲まれ且つ2層の樹脂で被覆され、その他の回路
素子(8)は両基板(2)(3)とケース材(7)とで
形成される封止空間(21 ’ )内に配置されること
になる。
上述の如<.EPマイコンチップ(6)と接続されるそ
の周辺の回路素子(8)は二枚の基板(2)(3)とケ
ース材(7)で形成された封止空間部(2F)に配置す
る様に設定されている。即ち、チップ状の電子部品およ
び印刷抵抗、メッキ抵抗等の抵抗素子の全ての素子が封
止仝間部(14)内に設けられている。
の周辺の回路素子(8)は二枚の基板(2)(3)とケ
ース材(7)で形成された封止空間部(2F)に配置す
る様に設定されている。即ち、チップ状の電子部品およ
び印刷抵抗、メッキ抵抗等の抵抗素子の全ての素子が封
止仝間部(14)内に設けられている。
ところで本実施例では枠体く18)で囲まれた空間(1
9a)に紫外線透過性樹脂(21a)および不透過性樹
脂(2lb)の2層の樹脂構造からなるが、不透過性樹
脂(2lb)の代りに第5図に示す如く、遮光用のシー
ル材(22゜)を一方の基板(2)のくぼみ(4)上に
接着しても不透過性樹脂(2lb>と同様に紫外線を完
全に遮断することができる。
9a)に紫外線透過性樹脂(21a)および不透過性樹
脂(2lb)の2層の樹脂構造からなるが、不透過性樹
脂(2lb)の代りに第5図に示す如く、遮光用のシー
ル材(22゜)を一方の基板(2)のくぼみ(4)上に
接着しても不透過性樹脂(2lb>と同様に紫外線を完
全に遮断することができる。
本実施例でEPマイコンチップ(6)のデータ消去を行
う場合は紫外線不透過性樹脂(21b)あるいはシール
材(22)を剥離して紫外線を照射し、再書込みをする
場合はEPマイコンチップ(6)上の紫外線透過性樹脂
(21a)も剥してボンディングされた近傍の導電路ク
5)にブロープ等の端子を当損させ、書込み装置よりデ
ータを書込む。このとき、紫外線透過性樹脂(21a)
を剥す場合、樹脂(21a)はあまり接着力が強くない
ためにワイヤ線が切断することはない. 以下に本発明を用いたモータ駆動用のインバータの混成
集積回路装置の具体例を示す。
う場合は紫外線不透過性樹脂(21b)あるいはシール
材(22)を剥離して紫外線を照射し、再書込みをする
場合はEPマイコンチップ(6)上の紫外線透過性樹脂
(21a)も剥してボンディングされた近傍の導電路ク
5)にブロープ等の端子を当損させ、書込み装置よりデ
ータを書込む。このとき、紫外線透過性樹脂(21a)
を剥す場合、樹脂(21a)はあまり接着力が強くない
ためにワイヤ線が切断することはない. 以下に本発明を用いたモータ駆動用のインバータの混成
集積回路装置の具体例を示す。
モータ駆動用インバータとは、一般的に直流電源から任
意の交流電源を作り、例えば三相モータの回転数を任意
にコントロールするものである。
意の交流電源を作り、例えば三相モータの回転数を任意
にコントロールするものである。
即ち、商用交流電源を整流回路を用いて整流した直流電
源を電源として用いる。その入力直流電源をインバータ
主回路と呼び、三相ブリッジ構或されたスイッチ素子を
用いて所定のコントロール信号のもとでチョッピングし
て擬似交流を負荷に出力する.コントロール信号を変化
させることにより出力交流の電圧、周波数を可変にする
ことができモータの回転数やトルクを可変に調整すると
とができる。
源を電源として用いる。その入力直流電源をインバータ
主回路と呼び、三相ブリッジ構或されたスイッチ素子を
用いて所定のコントロール信号のもとでチョッピングし
て擬似交流を負荷に出力する.コントロール信号を変化
させることにより出力交流の電圧、周波数を可変にする
ことができモータの回転数やトルクを可変に調整すると
とができる。
第6図に示したブロック図に基づいてモータ駆動用イン
バータを簡単に説明する。
バータを簡単に説明する。
第6図は集積回路基板<2)(3)上にモータ駆動用イ
ンバータを搭載したときのブロック図である。
ンバータを搭載したときのブロック図である。
モータ駆動用インバータは、交流電源を入力し直流に変
換する整流回路(2l)と、その整流回路(21〉から
出力された直流電源を所定の間隔でチョッピングし負荷
(モータ)に擬似交流を供給するインバータ主回路(2
2)と、インバータ主回路(22)を所定間隔でチョッ
ピングさせる出力信号および他の装置の動作を行わせる
出力信号を供給するEPROM内蔵マイクロコンピュー
タ(6)(以下EPマイコンチップと称する)と、EP
マイコンチップ(6)から出力された出力信号を所望に
増幅させるバッファ(23〉と、バッファ(23〉によ
り増幅された信号を電位の異なるベースアンプ(25)
に伝達する第1のインターフェイス(24)と、第1の
インターフェイス(24)から伝達された信号をインバ
ータ主回路(22)に増幅して供給するベースアンプ(
25)と、整流回路(21〉からインバータ主回路(2
2〉に供給される電流を検出すると共にインバータ主回
路(22〉の発熱を検出して第1のインターブエイス(
24)を介してEPマイコンチップ(6)に所定の信号
をフィードバックさせてインバータ主回路(22〉およ
び周辺回路を保護する保護回路(26)と、マイコン(
6)に電位の異なる信号を入出力する第2のインターフ
ェイス(27)と、EPマイコンチップ(6)から出力
される出力信号を外部装置に供給するために増幅させる
出力バッファ(28)とから構或されている。以下に上
述した各構成について簡単に説明する. 先ず整流回路は周知のダイ才一ドのブリッジ回路で構成
され、商用交流を直流に順変換するものである。本実施
例において、整流回路は基板上にチップ部品で構成され
ているが、整流回路のみを外付によって構成する場合も
使用目的によって発生するが本発明には何んら支障はな
い。
換する整流回路(2l)と、その整流回路(21〉から
出力された直流電源を所定の間隔でチョッピングし負荷
(モータ)に擬似交流を供給するインバータ主回路(2
2)と、インバータ主回路(22)を所定間隔でチョッ
ピングさせる出力信号および他の装置の動作を行わせる
出力信号を供給するEPROM内蔵マイクロコンピュー
タ(6)(以下EPマイコンチップと称する)と、EP
マイコンチップ(6)から出力された出力信号を所望に
増幅させるバッファ(23〉と、バッファ(23〉によ
り増幅された信号を電位の異なるベースアンプ(25)
に伝達する第1のインターフェイス(24)と、第1の
インターフェイス(24)から伝達された信号をインバ
ータ主回路(22)に増幅して供給するベースアンプ(
25)と、整流回路(21〉からインバータ主回路(2
2〉に供給される電流を検出すると共にインバータ主回
路(22〉の発熱を検出して第1のインターブエイス(
24)を介してEPマイコンチップ(6)に所定の信号
をフィードバックさせてインバータ主回路(22〉およ
び周辺回路を保護する保護回路(26)と、マイコン(
6)に電位の異なる信号を入出力する第2のインターフ
ェイス(27)と、EPマイコンチップ(6)から出力
される出力信号を外部装置に供給するために増幅させる
出力バッファ(28)とから構或されている。以下に上
述した各構成について簡単に説明する. 先ず整流回路は周知のダイ才一ドのブリッジ回路で構成
され、商用交流を直流に順変換するものである。本実施
例において、整流回路は基板上にチップ部品で構成され
ているが、整流回路のみを外付によって構成する場合も
使用目的によって発生するが本発明には何んら支障はな
い。
次にインバータ主回路(22〉は第7図に示す如く、直
列接続された2個のスイッチング素子(22a〉(トラ
ンジスタ、MOSFET,IGBT等)を夫々並列接続
(ブリッジ接続)されている.本実施例においてはトラ
ンジスタ素子を用いて説明するものとする。以下に説明
をつづける.主回路(22)の夫々のトランジスタのコ
レクターエミッタ間にはフライホイル用のダイ才一ドが
接続されると共に夫々の直列接続された各トランジスタ
間と負荷とを結ぶための出力端子(U,V,W)が設け
られている.また、(22b)は入力用の入力端子であ
る。
列接続された2個のスイッチング素子(22a〉(トラ
ンジスタ、MOSFET,IGBT等)を夫々並列接続
(ブリッジ接続)されている.本実施例においてはトラ
ンジスタ素子を用いて説明するものとする。以下に説明
をつづける.主回路(22)の夫々のトランジスタのコ
レクターエミッタ間にはフライホイル用のダイ才一ドが
接続されると共に夫々の直列接続された各トランジスタ
間と負荷とを結ぶための出力端子(U,V,W)が設け
られている.また、(22b)は入力用の入力端子であ
る。
次にEPマイコンチップ(6)は例えば、LM8051
P(三洋製)のICチップ化されたものが用いられてい
る。
P(三洋製)のICチップ化されたものが用いられてい
る。
第8図はマイコンの基本構成を示すブロック図であり、
命令の取出しと実行を行うC P U (4a)と、所
定のプログラムデータが記憶されているメモリ一部(4
b)と外部装置とのデータの入出力を行うためのI/O
ポート部(4C〉から構成されている。EPマイコンチ
ップ(6)自体には新規なところがないため、ここでは
詳細に説明しないものとする.このEPマイコンチップ
(6)によってインバータ主回路(22〉および所望の
外部装置はコントロールされる。
命令の取出しと実行を行うC P U (4a)と、所
定のプログラムデータが記憶されているメモリ一部(4
b)と外部装置とのデータの入出力を行うためのI/O
ポート部(4C〉から構成されている。EPマイコンチ
ップ(6)自体には新規なところがないため、ここでは
詳細に説明しないものとする.このEPマイコンチップ
(6)によってインバータ主回路(22〉および所望の
外部装置はコントロールされる。
次にバッファ(23〉はLC4049B(三洋製)等の
ICチップ化されたものが用いられる。このバッファ(
23〉はEPマイコンチップ(6)からの出力信号を所
定に増幅させるものである.次に第1のインターブエイ
ス(24)は複数のフォトカプラから構成され、例えば
、PC817(シャープ製)等のICチップにより構或
されている.第1のインターフェイス(24)は上述し
た如く、バッファ(23〉から出力された出力信号を光
でベースアンプ(25)に伝達させるものである。
ICチップ化されたものが用いられる。このバッファ(
23〉はEPマイコンチップ(6)からの出力信号を所
定に増幅させるものである.次に第1のインターブエイ
ス(24)は複数のフォトカプラから構成され、例えば
、PC817(シャープ製)等のICチップにより構或
されている.第1のインターフェイス(24)は上述し
た如く、バッファ(23〉から出力された出力信号を光
でベースアンプ(25)に伝達させるものである。
次にベースアンブ(25)は第8図に示す如く、第1の
インターブエイス(24)から出力された信号が入力さ
れる信号入力端子(25a)と、入力端子(25a)か
ら入力された信号が供給されON,OFFされる第1お
よび第3のトランジスタ(trt )(Trs)と、第
3のトランジスタ(Trs)のコレクタとそのベースが
接続された第1のトランジスタ(Trs)とマイナスラ
イン間に接続された第2のトランジスタクTrt)と、
電源ライン間に接続された抵抗およびダイ才−ドと、ダ
イ才−ドと並列に接続されたコンデンサーとから構成さ
れている.また、第1および第2のトランジスタ間とイ
ンバータ主回路の各トランジスタのベースとエミッタと
を接続する出力端子(25b)が設けられている。例え
ば、ベースアンプ(25)の信号入力端子(25a)に
ON信号が入力されると第1のトランジスタ(τr+>
と第3のトランジスタ(Trs)がONし、第2のトラ
ンジスタ(Try)がOFFする。すると、電源V。か
ら第1のトランジスタ(TrI)、制御抵抗R+を介し
てインバータ主回路(22〉のベースに所望の電流が供
給される。また、信号OFF時には第1のトランジスタ
(τr+)および第3のトランジスタ(1’r.)がO
FFし、第2のトランジスタ(Try)をONさせる.
そしてダイオードとコンデンサーより作られた電源から
インバータ主回路(22〉のオフを早くさせるものであ
る。
インターブエイス(24)から出力された信号が入力さ
れる信号入力端子(25a)と、入力端子(25a)か
ら入力された信号が供給されON,OFFされる第1お
よび第3のトランジスタ(trt )(Trs)と、第
3のトランジスタ(Trs)のコレクタとそのベースが
接続された第1のトランジスタ(Trs)とマイナスラ
イン間に接続された第2のトランジスタクTrt)と、
電源ライン間に接続された抵抗およびダイ才−ドと、ダ
イ才−ドと並列に接続されたコンデンサーとから構成さ
れている.また、第1および第2のトランジスタ間とイ
ンバータ主回路の各トランジスタのベースとエミッタと
を接続する出力端子(25b)が設けられている。例え
ば、ベースアンプ(25)の信号入力端子(25a)に
ON信号が入力されると第1のトランジスタ(τr+>
と第3のトランジスタ(Trs)がONし、第2のトラ
ンジスタ(Try)がOFFする。すると、電源V。か
ら第1のトランジスタ(TrI)、制御抵抗R+を介し
てインバータ主回路(22〉のベースに所望の電流が供
給される。また、信号OFF時には第1のトランジスタ
(τr+)および第3のトランジスタ(1’r.)がO
FFし、第2のトランジスタ(Try)をONさせる.
そしてダイオードとコンデンサーより作られた電源から
インバータ主回路(22〉のオフを早くさせるものであ
る。
次に保護回路(26)4ま第10図に示す如く、インバ
ータ主回路(22)の近傍に設けられインバータ主回路
(22〉の発熱による温度上昇を検出するダイ才−ド等
より構或される温度検出部(26a)と、整流回路(2
1〉からインバータ主回路(22)に供給される電流を
検出する抵抗より構成される電流検出部(26b)と、
内部基準電圧を形成する基準電圧部(26C)と、夫々
の検出部(26a)(26b)からの出力信号と基準電
圧部(26c)から出力される信号を比較する電圧比較
部(26d)と、電圧比較部( 26d )からの信号
をEPマイコンチップ《6)にフィードバックさせる保
護、制御信号出力部(26e)とから構成されている。
ータ主回路(22)の近傍に設けられインバータ主回路
(22〉の発熱による温度上昇を検出するダイ才−ド等
より構或される温度検出部(26a)と、整流回路(2
1〉からインバータ主回路(22)に供給される電流を
検出する抵抗より構成される電流検出部(26b)と、
内部基準電圧を形成する基準電圧部(26C)と、夫々
の検出部(26a)(26b)からの出力信号と基準電
圧部(26c)から出力される信号を比較する電圧比較
部(26d)と、電圧比較部( 26d )からの信号
をEPマイコンチップ《6)にフィードバックさせる保
護、制御信号出力部(26e)とから構成されている。
次に第2のインターフェイス(27)は第1のインター
フエイス〈24)と同様に複数個のフォトカブラから構
成され、EPマイコンチップ(6)と入力端子S.,S
.から入出力される信号をEPマイコンチップ(6)に
伝達するものである。
フエイス〈24)と同様に複数個のフォトカブラから構
成され、EPマイコンチップ(6)と入力端子S.,S
.から入出力される信号をEPマイコンチップ(6)に
伝達するものである。
最後に出力バッファ(28)はバッファ(23〉と同様
にLC4049B(三洋製)等のICチップ化されたも
のが用いられ、EPマイコンチップ(6)からの信号を
増幅し、出力端子PO,〜PO.に信号を出力するもの
である。
にLC4049B(三洋製)等のICチップ化されたも
のが用いられ、EPマイコンチップ(6)からの信号を
増幅し、出力端子PO,〜PO.に信号を出力するもの
である。
以下にモータ駆動用インバータの動作について簡単に説
明する。
明する。
商用交流が端子(21X)から入力されると、上述した
様に整流回路(21)によって直流に変換される.その
変換された直流電流はインバータ主回路(22〉に供給
される。インバータ主回路〈22〉の出力端子(U,V
,W)は負荷(モータ)に接続され負荷に所望の電流を
供給する。
様に整流回路(21)によって直流に変換される.その
変換された直流電流はインバータ主回路(22〉に供給
される。インバータ主回路〈22〉の出力端子(U,V
,W)は負荷(モータ)に接続され負荷に所望の電流を
供給する。
入出力端子S @ + S (%デジタル入力端子D.
〜DS1アナログ入力端子A0〜A.の各入力端子から
所定の制御あるいは指令信号が入力されるとEPマイコ
ンチップ(6)はその入力信号に基づいて動作する。即
ち、入力信号に基づいて、EPマイコンチップ(6)内
に記憶されているメモリー内ノプログラム・データに基
づいた所定の処理が実行されるコントロール信号を出力
する.そのコントロール信号はバッファ(23〉により
増幅され第1のインターフエイス(24)を介してベー
スアンプ(25)?供給される。
〜DS1アナログ入力端子A0〜A.の各入力端子から
所定の制御あるいは指令信号が入力されるとEPマイコ
ンチップ(6)はその入力信号に基づいて動作する。即
ち、入力信号に基づいて、EPマイコンチップ(6)内
に記憶されているメモリー内ノプログラム・データに基
づいた所定の処理が実行されるコントロール信号を出力
する.そのコントロール信号はバッファ(23〉により
増幅され第1のインターフエイス(24)を介してベー
スアンプ(25)?供給される。
ペースアンプ〈25)に供給された信号はインバータ主
回路(22)の各トランジスタ素子のベースに供給され
、インバータ主回路(22)の各トランジスタ素子をO
N,OFFさせて直流をチョッピングして擬似交流を形
成し、出力端子(U,V,W)を介して負荷へ交流を供
給させて負荷を所定の回転数で回転させる。
回路(22)の各トランジスタ素子のベースに供給され
、インバータ主回路(22)の各トランジスタ素子をO
N,OFFさせて直流をチョッピングして擬似交流を形
成し、出力端子(U,V,W)を介して負荷へ交流を供
給させて負荷を所定の回転数で回転させる。
即ち、EPマイコンチップ(6)内の所定のプログラム
・データに基づいてインバータ主回路(22)で直流を
チョッピングして交流に変換されている.また、ベース
アンブ(25)には別電源がV■〜V D4端子を介し
て常時印加されている.上述したEPマイコンチップ(
6)内のプログラム・データを変換すると、即ち別のマ
イコンに変換すればそのEPマイコン内に内蔵されたプ
ログラム●データに応じた回転にコントロールすること
ができる。
・データに基づいてインバータ主回路(22)で直流を
チョッピングして交流に変換されている.また、ベース
アンブ(25)には別電源がV■〜V D4端子を介し
て常時印加されている.上述したEPマイコンチップ(
6)内のプログラム・データを変換すると、即ち別のマ
イコンに変換すればそのEPマイコン内に内蔵されたプ
ログラム●データに応じた回転にコントロールすること
ができる。
出力端子PO.〜PO,から出力される信号はEPマイ
コンチップ(6)に入力される入力指令に基づいてEP
マイコンチップ(6)が所定の信号処理を行った結果に
基づいた信号を出力する。出力端子PO.〜PO,から
出力される出力信号は外部の機器あるいは装置をコント
ロールする。例えばインバータエアコンであれば電磁リ
レー、冷媒調整する弁等を室内の温度変化に対応して所
定にコントロールする。
コンチップ(6)に入力される入力指令に基づいてEP
マイコンチップ(6)が所定の信号処理を行った結果に
基づいた信号を出力する。出力端子PO.〜PO,から
出力される出力信号は外部の機器あるいは装置をコント
ロールする。例えばインバータエアコンであれば電磁リ
レー、冷媒調整する弁等を室内の温度変化に対応して所
定にコントロールする。
上述したインバータ動作を行っている際にはインバータ
システム、即ち、基板(2)(3)上の温度は定格最大
温度以下になる様に設計されているが、システム自体を
異常な環境下(高温、高湿下)での使用、あるいは放熱
が正常に行われない場合にはインバータ主回路(22〉
や周辺の温度が異常に上昇し、システムあるいはセット
を破壊する恐れはあるが、本実施例では保護回路(26
)の温度検出部(26a)によって異常温度を検出して
インバータの動作を止めてインバータの発熱をおさえて
セットあるいはシステムを保護するものである.また、
インバータ主回路(22)には負荷が接続されているが
、この負荷内部の配線の異常による短絡、出力端子(U
,V,W)の短絡、あるいは外部ノイズによるEPマイ
コンチップ(6)の誤動作でインバータ主回路(22〉
の直列された素子が同時ONLたりすると異常な大電流
がインバータ主回路(22〉に流れるが、この場合にお
いても、保護回路(26)内の電流検出部(26b)で
その大電流を検出しただちに動作を停止させて保護する
。
システム、即ち、基板(2)(3)上の温度は定格最大
温度以下になる様に設計されているが、システム自体を
異常な環境下(高温、高湿下)での使用、あるいは放熱
が正常に行われない場合にはインバータ主回路(22〉
や周辺の温度が異常に上昇し、システムあるいはセット
を破壊する恐れはあるが、本実施例では保護回路(26
)の温度検出部(26a)によって異常温度を検出して
インバータの動作を止めてインバータの発熱をおさえて
セットあるいはシステムを保護するものである.また、
インバータ主回路(22)には負荷が接続されているが
、この負荷内部の配線の異常による短絡、出力端子(U
,V,W)の短絡、あるいは外部ノイズによるEPマイ
コンチップ(6)の誤動作でインバータ主回路(22〉
の直列された素子が同時ONLたりすると異常な大電流
がインバータ主回路(22〉に流れるが、この場合にお
いても、保護回路(26)内の電流検出部(26b)で
その大電流を検出しただちに動作を停止させて保護する
。
上述した動作を行うことでモータ駆動用インバータの動
作が行われて負荷(モータ)の回転コントロールおよび
外部機器の動作を所定にコントロールして例えば、イン
バータエアコン等の制御を正常に動作させる。
作が行われて負荷(モータ)の回転コントロールおよび
外部機器の動作を所定にコントロールして例えば、イン
バータエアコン等の制御を正常に動作させる。
第11図は第6図で示したモータ駆動用インバータ回路
を本実施例の他方の基板(3〉上に実装した場合を示す
平面図であり、実装される各回路素子の符号は第6図の
ブロック図で示した符号と同一にしてある。尚、複数の
各回路素子を接続する導電路は煩雑となるため矢印にて
示すものとする。
を本実施例の他方の基板(3〉上に実装した場合を示す
平面図であり、実装される各回路素子の符号は第6図の
ブロック図で示した符号と同一にしてある。尚、複数の
各回路素子を接続する導電路は煩雑となるため矢印にて
示すものとする。
第11図に示す如く、他方の基板(3)の周端部には外
部リード端子(12〉が固着される複数の固着用パッド
(3a)が設けられている.固着パッド(3a〉から延
在される導電路〈5)上所定位置には複数の回路素子お
よびEPマイコンチップ(6)が固着されている。即ち
、斯る他方の基板(3)上にはEPマイコンチップ(6
)および複数の回路素子(8)が固着されており、(2
1)は整流回路、(25)はベースアンプ、(23)は
バッファ、(24)は第1のインターフエイス、(27
)ハ第2のインターブエイス、(2g)は出力バッファ
、(26)は保護回路である。なお、一方の基板(2〉
にはポリイミド等のフィルム樹脂層(10〉を介して他
方の基板(3〉より複数の導電路(5)が延在されてお
り、一方の基板(2)上にはインバータ主回路(22)
等のインバータに必要な一部の回路あるいはオプション
用回路が配置されている。
部リード端子(12〉が固着される複数の固着用パッド
(3a)が設けられている.固着パッド(3a〉から延
在される導電路〈5)上所定位置には複数の回路素子お
よびEPマイコンチップ(6)が固着されている。即ち
、斯る他方の基板(3)上にはEPマイコンチップ(6
)および複数の回路素子(8)が固着されており、(2
1)は整流回路、(25)はベースアンプ、(23)は
バッファ、(24)は第1のインターフエイス、(27
)ハ第2のインターブエイス、(2g)は出力バッファ
、(26)は保護回路である。なお、一方の基板(2〉
にはポリイミド等のフィルム樹脂層(10〉を介して他
方の基板(3〉より複数の導電路(5)が延在されてお
り、一方の基板(2)上にはインバータ主回路(22)
等のインバータに必要な一部の回路あるいはオプション
用回路が配置されている。
第11図から明らかな如く、EPマイコンチップ(6)
と一番関連深い回路素子の近傍(ここではバッフ7、出
力バッファ)に隣接する位置にEPマイコンチップ(6
)が固着される。
と一番関連深い回路素子の近傍(ここではバッフ7、出
力バッファ)に隣接する位置にEPマイコンチップ(6
)が固着される。
EPマイコンチップ(6)ともっとも関連する回路素子
(8)をEPマイコンチップ(6)の近傍に配置するこ
とにより、両者を接続させる導電路(5)の引回し線の
距離を最短でしかも最小で配置形成でき、その結果、他
の実装パターンを有効に使用できると共に高密度実装が
行える。また、一点鎖線で囲まれた領域辻接着シートで
ケース材(7)が固着される固着領域であることを示す
. 第12図は第11図で示した他方の基板(3)上にケー
ス材(7)を介して一寅の基板(2)を固着したときの
インバータ用の混成集積回路装置の完戒品の平面図であ
り、一方の基板(2〉の上面からほEPマイコンチップ
(6)上に被覆された第2の樹脂層(tsb)の上面の
みが露出された状態となる。即ち、EPマイコンチップ
《6)以外の他の素子は全てケース材(7)と両基板(
2)(3)とで形戒された封止空間(2F)内に封止さ
れる。
(8)をEPマイコンチップ(6)の近傍に配置するこ
とにより、両者を接続させる導電路(5)の引回し線の
距離を最短でしかも最小で配置形成でき、その結果、他
の実装パターンを有効に使用できると共に高密度実装が
行える。また、一点鎖線で囲まれた領域辻接着シートで
ケース材(7)が固着される固着領域であることを示す
. 第12図は第11図で示した他方の基板(3)上にケー
ス材(7)を介して一寅の基板(2)を固着したときの
インバータ用の混成集積回路装置の完戒品の平面図であ
り、一方の基板(2〉の上面からほEPマイコンチップ
(6)上に被覆された第2の樹脂層(tsb)の上面の
みが露出された状態となる。即ち、EPマイコンチップ
《6)以外の他の素子は全てケース材(7)と両基板(
2)(3)とで形戒された封止空間(2F)内に封止さ
れる。
即ち、本実施例では第11図および第12図に示す如く
、二枚の基板(2)(3)上にはインバータ制御に必要
な全ての周辺回路だけが形成されていることになる。即
ち、基板(2)(3)上にはインバータ制御に必要な周
辺回路のみが形成されていることになり、一方の基板(
2)の周端辺に設けられたくぼみ(4)によってEPマ
イコンチップ(6)のみがケース材(7)より露出され
ていることになる。更に詳述すると、EPマイコンチッ
プ〈6)を搭載したままの状態でEPマイコンチップ(
6)内のプログラム・データの消去および書込みが可能
となり、ユーザ側で専用のプログラム・データを書込み
することができる。
、二枚の基板(2)(3)上にはインバータ制御に必要
な全ての周辺回路だけが形成されていることになる。即
ち、基板(2)(3)上にはインバータ制御に必要な周
辺回路のみが形成されていることになり、一方の基板(
2)の周端辺に設けられたくぼみ(4)によってEPマ
イコンチップ(6)のみがケース材(7)より露出され
ていることになる。更に詳述すると、EPマイコンチッ
プ〈6)を搭載したままの状態でEPマイコンチップ(
6)内のプログラム・データの消去および書込みが可能
となり、ユーザ側で専用のプログラム・データを書込み
することができる。
斯る本発明に依れば、一方の基板(2〉の周端辺の所望
位置にくぼみ(4)を設け、そのくぼみ(4)で露出し
た他方の基板(3〉上の導電路〈5)にEPマイコンチ
ップ(6)を接続し、隣接する導電路(5)とワイヤ線
で接続し両基板(2)(3)とケース材(7)とで形成
された封止空間(2F〉に他の回路素子(8)を固着す
ることにより、混成集積回路とEPマイコンチップとの
一体化した装置ができる。
位置にくぼみ(4)を設け、そのくぼみ(4)で露出し
た他方の基板(3〉上の導電路〈5)にEPマイコンチ
ップ(6)を接続し、隣接する導電路(5)とワイヤ線
で接続し両基板(2)(3)とケース材(7)とで形成
された封止空間(2F〉に他の回路素子(8)を固着す
ることにより、混成集積回路とEPマイコンチップとの
一体化した装置ができる。
クト)発明の効果
以上に詳述した如く、本発明に依れば、第1に一方の基
板(2)の周端辺の所望位置にくぼみ(4)を設け、く
ぼみ(4)で露出した他方の基板(3〉上の導電路(5
)にEPマイコンチップ(6)を接続しているので、E
Pマイコンチップ(6)の載置位置を任意に選定できる
利点を有する.それにより,EPマイコンチップ(6)
の隣接する位置に最も関連の深い回路素子(8)を配置
でき、その結果EPマイコンチップ(6)ともっとも関
連深い回路素子(8)間のデータのやりとりを行うデー
タ線を最短距離あるいは最も設計容易なレイアウトで実
現でき、データ線の引回しによる実装密度のロスを最小
限に抑制できる.更に二枚の基板(2)(3)より形成
されているため高密度で且つ小型化の混成集積回路装置
を提供することができる。
板(2)の周端辺の所望位置にくぼみ(4)を設け、く
ぼみ(4)で露出した他方の基板(3〉上の導電路(5
)にEPマイコンチップ(6)を接続しているので、E
Pマイコンチップ(6)の載置位置を任意に選定できる
利点を有する.それにより,EPマイコンチップ(6)
の隣接する位置に最も関連の深い回路素子(8)を配置
でき、その結果EPマイコンチップ(6)ともっとも関
連深い回路素子(8)間のデータのやりとりを行うデー
タ線を最短距離あるいは最も設計容易なレイアウトで実
現でき、データ線の引回しによる実装密度のロスを最小
限に抑制できる.更に二枚の基板(2)(3)より形成
されているため高密度で且つ小型化の混成集積回路装置
を提供することができる。
第2に一方の基板〈2〉の所望位置のくぼみ(4)にE
Pマイコンチップ(6)を配置すると共に二枚の集積回
路基板(2)(3)上の組み込むその周辺回路素子の実
装密度を向上することにより、従来必要とされたプリン
ト基板を廃止でき、極めて小型化のEPマイコンチップ
(6)を内蔵する混成集積回路装置を実現できる。
Pマイコンチップ(6)を配置すると共に二枚の集積回
路基板(2)(3)上の組み込むその周辺回路素子の実
装密度を向上することにより、従来必要とされたプリン
ト基板を廃止でき、極めて小型化のEPマイコンチップ
(6)を内蔵する混成集積回路装置を実現できる。
第3に集積回路基板(2)(3)として金属基板を用い
ることにより、その放熱効果をプリント基板に比べて大
幅に向上でき、より実装密度の向上に寄与できる。また
導電路〈5)として銅箔〈11〉を用いることにより、
導電路(5)の抵抗値を導電ペーストより大幅に低減で
き、実装される回路をプリント基板と同等以上に拡張で
きる. 第4にEPマイコンチップ(6)と接続されるその周辺
回路素子(8)はケース材(7)と二枚の集積回路基板
(2)(3)とで形成される封止空間(21’)にグイ
形状あるいはチップ形状で組み込まれるので、従来のプ
リント基板の様に樹脂モールドしたものに比較して極め
て占有面積が小さくなり、実装密度の大幅に向上できる
利点を有する. 第5にケース材(7)と二枚の集積回路基板(2〉(3
〉の周端を実質的に一致させることにより、集積回路基
板(2)(3)のほぼ全面を封止空間(2F〉として利
用でき、実装密度の向上と相まって極めてコンパクトな
混成集積回路装置を実現できる.第6にEPマイコンチ
ップ(6)上には遮光用の樹脂層(2lb)が設けられ
ているため、EPマイコンチップ(6)を保護すること
ができると共にEPマイコンチップ(6)への遮光がで
き且っEPマイコンチップ《6)と一方の基板(2〉の
すき間も封止できる利点を有する. 第7に二枚の集積回路基板(2)(3)の同一側辺ある
いは相対向する辺から外部リード(12)(13)を導
出でき、極めて多ピンの混成集積回路装置を実現できる
利点を有する。
ることにより、その放熱効果をプリント基板に比べて大
幅に向上でき、より実装密度の向上に寄与できる。また
導電路〈5)として銅箔〈11〉を用いることにより、
導電路(5)の抵抗値を導電ペーストより大幅に低減で
き、実装される回路をプリント基板と同等以上に拡張で
きる. 第4にEPマイコンチップ(6)と接続されるその周辺
回路素子(8)はケース材(7)と二枚の集積回路基板
(2)(3)とで形成される封止空間(21’)にグイ
形状あるいはチップ形状で組み込まれるので、従来のプ
リント基板の様に樹脂モールドしたものに比較して極め
て占有面積が小さくなり、実装密度の大幅に向上できる
利点を有する. 第5にケース材(7)と二枚の集積回路基板(2〉(3
〉の周端を実質的に一致させることにより、集積回路基
板(2)(3)のほぼ全面を封止空間(2F〉として利
用でき、実装密度の向上と相まって極めてコンパクトな
混成集積回路装置を実現できる.第6にEPマイコンチ
ップ(6)上には遮光用の樹脂層(2lb)が設けられ
ているため、EPマイコンチップ(6)を保護すること
ができると共にEPマイコンチップ(6)への遮光がで
き且っEPマイコンチップ《6)と一方の基板(2〉の
すき間も封止できる利点を有する. 第7に二枚の集積回路基板(2)(3)の同一側辺ある
いは相対向する辺から外部リード(12)(13)を導
出でき、極めて多ピンの混成集積回路装置を実現できる
利点を有する。
第1図は本実施例を示す斜視図、第2図は第1図のI−
I断面図、第3図は本実施例で用いられるケース材を示
す斜視図、第4図は本実施例で用いる基板の断面図、第
5図は他の実施例を示す断面図、第6図は本実施例で用
いたモータ駆動用インバータを示すブロック図、第7図
は第6図で示したインバータの主回路を示す回路図、第
8図は第6図で示したインバータのマイフンを示すブロ
ック図、第9図は第6図で示したインバータのベースア
ンプを示す回路図、第10図は第6図で示したインバー
タの保護回路を示すブロック図、第11図は第6図で示
したブロック図を基板上に実装したときの平面図、第1
2図は第11図に示した基板上にケース材を固着したと
きの平面図、第13図および第14図は従来のマイコン
実装構造を示す斜視図である。 (1)・・・混成集積回路装置、 (2)(3)・・・
集積回路基板、 (5)・・・導電路、(6)・・・E
Pマイコンチップ、 (8)・・・回路素子、 (4)
・・・くぼみ、 (7)・・・ケース材、 (21a)
・・・紫外線透過性樹脂、 (2lb)・・・紫外線不
透過性樹脂。
I断面図、第3図は本実施例で用いられるケース材を示
す斜視図、第4図は本実施例で用いる基板の断面図、第
5図は他の実施例を示す断面図、第6図は本実施例で用
いたモータ駆動用インバータを示すブロック図、第7図
は第6図で示したインバータの主回路を示す回路図、第
8図は第6図で示したインバータのマイフンを示すブロ
ック図、第9図は第6図で示したインバータのベースア
ンプを示す回路図、第10図は第6図で示したインバー
タの保護回路を示すブロック図、第11図は第6図で示
したブロック図を基板上に実装したときの平面図、第1
2図は第11図に示した基板上にケース材を固着したと
きの平面図、第13図および第14図は従来のマイコン
実装構造を示す斜視図である。 (1)・・・混成集積回路装置、 (2)(3)・・・
集積回路基板、 (5)・・・導電路、(6)・・・E
Pマイコンチップ、 (8)・・・回路素子、 (4)
・・・くぼみ、 (7)・・・ケース材、 (21a)
・・・紫外線透過性樹脂、 (2lb)・・・紫外線不
透過性樹脂。
Claims (10)
- (1)二枚の相対向して配置された集積回路基板と 前記基板の対向する主面に形成された所望のパターンを
有する導電路と 前記導電路に接続され且つ所望のプログラム・データを
内蔵したEPROM内蔵マイクロコンピュータチップと 前記EPROM内蔵マイクロコンピュータチップの所定
の制御出力信号が供給され且つ前記基板上の導電路と接
続されたその周辺回路素子と 前記両基板に一体化されたケース材とを具備し、前記一
方の基板の周端辺の所望位置にくぼみを設け、前記くぼ
みで露出した前記他方の基板上の前記導電路に前記マイ
クロコンピュータチップを固着し、前記EPROM内蔵
マイクロコンピュータチップの電極と所望の前記導電路
をボンディングワイヤで接続し前記両基板と前記ケース
で形成された封止空間に前記周辺回路素子を配置したこ
とを特徴とする混成集積回路装置。 - (2)前記集積回路基板として表面を絶縁した金属基板
を用いたことを特徴とする請求項1記載の混成集積回路
装置。 - (3)前記導電路として銅箔を用いたことを特徴とする
請求項1記載の混成集積回路装置。 - (4)前記くぼみに紫外線を透過する樹脂を注入した封
止樹脂層で前記EPROM内蔵マイクロコンピュータチ
ップを封止することを特徴とする請求項1記載の混成集
積回路装置。 - (5)前記くぼみ内の封止樹脂層上に紫外線を遮断する
シール樹脂層を設けたことを特徴とする請求項4記載の
混成集積回路装置。 - (6)前記シール樹脂層の上面と前記一方の基板の上面
とを実質的に一致させたことを特徴とする請求項5記載
の混成集積回路装置。 - (7)前記周辺回路素子としてチップ抵抗、チップコン
デンサーを用いていることを特徴とする請求項1記載の
混成集積回路装置。 - (8)前記ケース材を前記両基板の周端部とほぼ一致さ
せた一定の厚みを有する枠体を有することを特徴とする
請求項1記載の混成集積回路装置。 - (9)前記枠体を前記一方の基板に設けた前記くぼみの
周囲に沿って前記両基板間に配置することを特徴とする
請求項8記載の混成集積回路装置。 - (10)前記くぼみを覆うように前記一方の基板上面に
遮光用シール材を接着することを特徴とする請求項1記
載の混成集積回路装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1241515A JPH03104152A (ja) | 1989-09-18 | 1989-09-18 | 混成集積回路装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP1241515A JPH03104152A (ja) | 1989-09-18 | 1989-09-18 | 混成集積回路装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH03104152A true JPH03104152A (ja) | 1991-05-01 |
Family
ID=17075489
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP1241515A Pending JPH03104152A (ja) | 1989-09-18 | 1989-09-18 | 混成集積回路装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH03104152A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5438216A (en) * | 1992-08-31 | 1995-08-01 | Motorola, Inc. | Light erasable multichip module |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61198769A (ja) * | 1985-02-28 | 1986-09-03 | Nec Corp | 混成集積回路 |
JPS6314492A (ja) * | 1986-07-04 | 1988-01-21 | 富士通株式会社 | プリント基板への部品実装構造 |
-
1989
- 1989-09-18 JP JP1241515A patent/JPH03104152A/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS61198769A (ja) * | 1985-02-28 | 1986-09-03 | Nec Corp | 混成集積回路 |
JPS6314492A (ja) * | 1986-07-04 | 1988-01-21 | 富士通株式会社 | プリント基板への部品実装構造 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5438216A (en) * | 1992-08-31 | 1995-08-01 | Motorola, Inc. | Light erasable multichip module |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
WO2009042546A2 (en) | Stacked dual-die packages, methods of making, and systems incorporating said packages | |
JPH03104152A (ja) | 混成集積回路装置 | |
JPH03222354A (ja) | 混成集積回路装置 | |
JPH03104153A (ja) | 混成集積回路装置 | |
JPH03242965A (ja) | 混成集積回路装置 | |
KR20040048818A (ko) | 회로 장치 | |
JPH03218058A (ja) | 混成集積回路装置 | |
JPH03242964A (ja) | 混成集積回路装置 | |
JPH03104154A (ja) | 混成集積回路装置 | |
JPH0397255A (ja) | 混成集積回路装置 | |
JPH03222353A (ja) | 混成集積回路装置 | |
JPH0770681B2 (ja) | 混成集積回路装置 | |
JPH03174756A (ja) | 混成集積回路装置 | |
JPH03174746A (ja) | 混成集積回路装置 | |
JPH03174757A (ja) | 混成集積回路装置 | |
JPH03174753A (ja) | 混成集積回路装置 | |
JPH0770680B2 (ja) | 混成集積回路装置 | |
JPH03129758A (ja) | 混成集積回路装置 | |
JPH03174754A (ja) | 混成集積回路装置 | |
JPH03174761A (ja) | 混成集積回路装置 | |
JPH03174758A (ja) | 混成集積回路装置 | |
JPH03174760A (ja) | 混成集積回路装置 | |
JPH0397256A (ja) | 混成集積回路装置 | |
JPH03174752A (ja) | 混成集積回路装置 | |
JPH03174750A (ja) | 混成集積回路装置 |