JPH0265402A - 分布定数線路型振幅変調器 - Google Patents
分布定数線路型振幅変調器Info
- Publication number
- JPH0265402A JPH0265402A JP21703388A JP21703388A JPH0265402A JP H0265402 A JPH0265402 A JP H0265402A JP 21703388 A JP21703388 A JP 21703388A JP 21703388 A JP21703388 A JP 21703388A JP H0265402 A JPH0265402 A JP H0265402A
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- JP
- Japan
- Prior art keywords
- high frequency
- distributed constant
- input line
- frequency input
- gate
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- Pending
Links
- 230000005669 field effect Effects 0.000 claims description 8
- 230000009977 dual effect Effects 0.000 abstract description 15
- 239000003990 capacitor Substances 0.000 description 5
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Amplitude Modulation (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は高周波振幅変調器に関し、特に振幅変調素子と
してデュアルゲートFETを用いた高周波振幅変調器に
関する。
してデュアルゲートFETを用いた高周波振幅変調器に
関する。
従来の高周波振幅変調器としてはデュアルグー)FET
を1箇用いた振幅変調器またはダブルバランス型変調器
がある。
を1箇用いた振幅変調器またはダブルバランス型変調器
がある。
高周波振幅変調器として、デュアルゲートFETが1箇
だけの振幅変調器を用いると、使用する周波数ごとに入
出力回路を設計せねばならず、それによって周波数帯域
が制限されてしまう。
だけの振幅変調器を用いると、使用する周波数ごとに入
出力回路を設計せねばならず、それによって周波数帯域
が制限されてしまう。
また、高周波振幅変調器としてバランス壓変詞器を用い
ると、使用する周波数の波長に制限される長さの線路を
有しているから、やはり周波数帯城が広くとれない。こ
のように、上述した従来の高周波振幅変調器においては
使用する周波数ごとに回路を設計しなおさねばならず、
この点が解決すべき課題であった。
ると、使用する周波数の波長に制限される長さの線路を
有しているから、やはり周波数帯城が広くとれない。こ
のように、上述した従来の高周波振幅変調器においては
使用する周波数ごとに回路を設計しなおさねばならず、
この点が解決すべき課題であった。
前述の課題を解決するために本発明が提供する手段は、
n(nは正の整数)筒のプーアルゲートl効果トランジ
スタと、n+1箇の分布定数線路を縦続に接続してなる
第1の高周波入力線路と、n+1箇の分布定数線路を縦
続に接続してなる第2の高周波入力線路と、n+1箇の
分布定数線路をR続に接続してなる高周波出力&!路と
からなシ、前記n11+の電界効果トランジスタのml
のゲートは前記第1の高周波入力線路における前記分布
定数線路間の接続点にそれぞれ接続されておシ、前記n
箇の電界効果トランジスタの第2のゲートは前記第2の
高周波入力線路における前記分布定数線路間の接続点に
それぞれ接続されており、前記n箇の電界効果トランジ
スタのドレインは前記高周波出力線路における前記分布
定数線路間の接続点にそれぞれ接続されていることを特
徴とする分布定数線路型振幅変調器である。
n(nは正の整数)筒のプーアルゲートl効果トランジ
スタと、n+1箇の分布定数線路を縦続に接続してなる
第1の高周波入力線路と、n+1箇の分布定数線路を縦
続に接続してなる第2の高周波入力線路と、n+1箇の
分布定数線路をR続に接続してなる高周波出力&!路と
からなシ、前記n11+の電界効果トランジスタのml
のゲートは前記第1の高周波入力線路における前記分布
定数線路間の接続点にそれぞれ接続されておシ、前記n
箇の電界効果トランジスタの第2のゲートは前記第2の
高周波入力線路における前記分布定数線路間の接続点に
それぞれ接続されており、前記n箇の電界効果トランジ
スタのドレインは前記高周波出力線路における前記分布
定数線路間の接続点にそれぞれ接続されていることを特
徴とする分布定数線路型振幅変調器である。
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例の回路図である。図において
、la〜ICはデュアルゲート電界効果トランジスタ(
FET)、2a〜2dは第1の高周波入力線路をなす分
布定数線路、3a〜3dは第2の高周波入力線路をなす
分布定数線路、48〜4dは高周波出力線路をなす分布
定数線路である。デュアルゲートFET1a−1cO第
1のゲートは第1の高周波入力線路における分布定数線
路28〜2d間の接続点22a〜22cにそれぞれ接続
され、第1の高周波入力線路は抵抗15で終端されてい
る。抵抗15には高周波的に接地の為のコンデンサ21
とゲートバイアス電圧印加のための抵抗18とが接続さ
れている。またデュアルゲートFET1a〜1cの第2
のゲートは第2の高周波入力線路における分布定数線路
33〜3d間の接続点23a〜23cにそれぞれ接続さ
れ、第2の高周波入力線路は抵抗16で終端されている
。抵抗16にはそこから高周波的に接地するためのコン
デンサ22とゲートバイアス電圧印加のための抵抗19
が接続されている。またデュアルゲートFET1a−I
Cのドレインは高周波出力線路における分布定数線路4
3〜4d間の接続点24a〜24cにそれぞれ接続され
、高周波出力1腺路は抵抗17により終端され、抵抗1
7には高周波的に接地するためのコンデンサ23と直流
バイアス電流を供給する端子14とが接続されている。
、la〜ICはデュアルゲート電界効果トランジスタ(
FET)、2a〜2dは第1の高周波入力線路をなす分
布定数線路、3a〜3dは第2の高周波入力線路をなす
分布定数線路、48〜4dは高周波出力線路をなす分布
定数線路である。デュアルゲートFET1a−1cO第
1のゲートは第1の高周波入力線路における分布定数線
路28〜2d間の接続点22a〜22cにそれぞれ接続
され、第1の高周波入力線路は抵抗15で終端されてい
る。抵抗15には高周波的に接地の為のコンデンサ21
とゲートバイアス電圧印加のための抵抗18とが接続さ
れている。またデュアルゲートFET1a〜1cの第2
のゲートは第2の高周波入力線路における分布定数線路
33〜3d間の接続点23a〜23cにそれぞれ接続さ
れ、第2の高周波入力線路は抵抗16で終端されている
。抵抗16にはそこから高周波的に接地するためのコン
デンサ22とゲートバイアス電圧印加のための抵抗19
が接続されている。またデュアルゲートFET1a−I
Cのドレインは高周波出力線路における分布定数線路4
3〜4d間の接続点24a〜24cにそれぞれ接続され
、高周波出力1腺路は抵抗17により終端され、抵抗1
7には高周波的に接地するためのコンデンサ23と直流
バイアス電流を供給する端子14とが接続されている。
抵抗58〜5Cはデュアルゲートル’ET11〜1cの
ンースを直流的にゲートより高い電位にするために挿入
され、コンデンサ6a〜6Cは該ンースを高周波的に接
地するために挿入されている。
ンースを直流的にゲートより高い電位にするために挿入
され、コンデンサ6a〜6Cは該ンースを高周波的に接
地するために挿入されている。
高周波入力端子11から入力された高周波電力は、高周
波入力端子12から入力された高周波電力でデュアルゲ
ー)FET1a−1cにおいて振幅変調を受け、高周波
出力端子13から出力される。また本変調器は分布定数
線路増幅器としての特性も合わせ持つから、利得を有す
る変調器となる。
波入力端子12から入力された高周波電力でデュアルゲ
ー)FET1a−1cにおいて振幅変調を受け、高周波
出力端子13から出力される。また本変調器は分布定数
線路増幅器としての特性も合わせ持つから、利得を有す
る変調器となる。
以上罠説明したように、本発明によれば、デュアルゲー
)FETを用いて分布定数線路増幅器を構成し、デーア
ルゲー)FETの第1のゲートが順次接続される第1の
高周波入力線路と第2のゲートが順次接続される第2の
高周波入力線路とを独立に設けることによシ、広帯域の
汎用のある振幅変調器を得る事ができる。tた振幅変調
素子としてのデュアルゲー) F E Tの数を適幽に
選ぶ事で、広帯域に渡夕、利得を持つ振幅変調器とする
事ができる。
)FETを用いて分布定数線路増幅器を構成し、デーア
ルゲー)FETの第1のゲートが順次接続される第1の
高周波入力線路と第2のゲートが順次接続される第2の
高周波入力線路とを独立に設けることによシ、広帯域の
汎用のある振幅変調器を得る事ができる。tた振幅変調
素子としてのデュアルゲー) F E Tの数を適幽に
選ぶ事で、広帯域に渡夕、利得を持つ振幅変調器とする
事ができる。
第1図は本発明の一実施例である分布定数線路型振幅変
調器の回路図である。 la、Ib、1c=デユアルゲートFET12a〜2d
・・・・・・第1の高周波入力線路をなす分布定数線路
、3a〜3d・・・・・・第2の高周波入力線路をなす
分布定数線路、4a〜4d・・・・・・高周波出力線路
をなす分布定数線路、11.12・・・・・・高周波入
力端子、13・・・・・・高周波出力端子、15〜17
・・・・・・終端抵抗、5a〜5C,18,19・・・
・・・抵抗、6a 〜6c 、21〜21−・□コンデ
ンサ、149.。 ・・・バイアス印加端子。 代理人 弁理士 本 庄 伸 介
調器の回路図である。 la、Ib、1c=デユアルゲートFET12a〜2d
・・・・・・第1の高周波入力線路をなす分布定数線路
、3a〜3d・・・・・・第2の高周波入力線路をなす
分布定数線路、4a〜4d・・・・・・高周波出力線路
をなす分布定数線路、11.12・・・・・・高周波入
力端子、13・・・・・・高周波出力端子、15〜17
・・・・・・終端抵抗、5a〜5C,18,19・・・
・・・抵抗、6a 〜6c 、21〜21−・□コンデ
ンサ、149.。 ・・・バイアス印加端子。 代理人 弁理士 本 庄 伸 介
Claims (1)
- n(nは正の整数)箇のデュアルゲート電界効果トラン
ジスタと、n+1箇の分布定数線路を縦続に接続してな
る第1の高周波入力線路と、n+1箇の分布定数線路を
縦続に接続してなる第2の高周波入力線路と、n+1箇
の分布定数線路を縦続に接続してなる高周波出力線路と
からなり、前記n箇の電界効果トランジスタの第1のゲ
ートは前記第1の高周波入力線路における前記分布定数
線路間の接続点にそれぞれ接続されており、前記n箇の
電界効果トランジスタの第2のゲートは前記第2の高周
波入力線路における前記分布定数線路間の接続点にそれ
ぞれ接続されており、前記n箇の電界効果トランジスタ
のドレインは前記高周波出力線路における前記分布定数
線路間の接続点にそれぞれ接続されていることを特徴と
する分布定数線路型振幅変調器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21703388A JPH0265402A (ja) | 1988-08-31 | 1988-08-31 | 分布定数線路型振幅変調器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP21703388A JPH0265402A (ja) | 1988-08-31 | 1988-08-31 | 分布定数線路型振幅変調器 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0265402A true JPH0265402A (ja) | 1990-03-06 |
Family
ID=16697786
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP21703388A Pending JPH0265402A (ja) | 1988-08-31 | 1988-08-31 | 分布定数線路型振幅変調器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0265402A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6078133B1 (ja) * | 2015-10-06 | 2017-02-08 | 日本電信電話株式会社 | 分布型回路 |
JP2018196003A (ja) * | 2017-05-18 | 2018-12-06 | 日本電信電話株式会社 | 分布スイッチ |
-
1988
- 1988-08-31 JP JP21703388A patent/JPH0265402A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP6078133B1 (ja) * | 2015-10-06 | 2017-02-08 | 日本電信電話株式会社 | 分布型回路 |
JP2018196003A (ja) * | 2017-05-18 | 2018-12-06 | 日本電信電話株式会社 | 分布スイッチ |
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