JPH025192A - Ｉｃカードリーダライタ装置 - Google Patents
Ｉｃカードリーダライタ装置Info
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- JPH025192A JPH025192A JP63154620A JP15462088A JPH025192A JP H025192 A JPH025192 A JP H025192A JP 63154620 A JP63154620 A JP 63154620A JP 15462088 A JP15462088 A JP 15462088A JP H025192 A JPH025192 A JP H025192A
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- card
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- clock
- data
- clock pulse
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- 238000010586 diagram Methods 0.000 description 7
- 238000000034 method Methods 0.000 description 4
- 230000005540 biological transmission Effects 0.000 description 3
- 238000011017 operating method Methods 0.000 description 2
- 239000004973 liquid crystal related substance Substances 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K7/00—Methods or arrangements for sensing record carriers, e.g. for reading patterns
- G06K7/0008—General problems related to the reading of electronic memory record carriers, independent of its reading method, e.g. power transfer
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、ＩＣカードの装着で各種の取引処理を実行す
るカード取引処理装置に組込まれるＩＣカードリーダラ
イタ装置に関する。
るカード取引処理装置に組込まれるＩＣカードリーダラ
イタ装置に関する。
（従来の技術）
最近ではＩＣカードが普及しているため、このＩＣカー
ドにて各種の取引処理を行なうことができるカード取引
処理装置が実用化されている。
ドにて各種の取引処理を行なうことができるカード取引
処理装置が実用化されている。
第５図はカード取引処理装置の外観斜視図である。この
第５図において、カード取引処理装置１はキーボード２
と、表示部３と、印刷部４と、ＩＣカードリーダライタ
装置５と、ピンパッド６とから構成されている。
第５図において、カード取引処理装置１はキーボード２
と、表示部３と、印刷部４と、ＩＣカードリーダライタ
装置５と、ピンパッド６とから構成されている。
キーボード２は装置の前部上面に配置され、複数のキー
を有している。表示部３は装置の操作案内や入力データ
を表示する液晶デイスプレィ等から成る表示装置から構
成されている。印刷部４は取引伝票等を印刷するサーマ
ルプリンタ装置等から構成されている。ＩＣカードリー
ダライタ装置５はＩＣカードのデータの読込み及び書込
みを実行する装置である。ピンパッド６は個人の暗証番
号等を入力する操作ユニットであり、ケーブル６ａにて
カード取引処理装置１に接続されている。
を有している。表示部３は装置の操作案内や入力データ
を表示する液晶デイスプレィ等から成る表示装置から構
成されている。印刷部４は取引伝票等を印刷するサーマ
ルプリンタ装置等から構成されている。ＩＣカードリー
ダライタ装置５はＩＣカードのデータの読込み及び書込
みを実行する装置である。ピンパッド６は個人の暗証番
号等を入力する操作ユニットであり、ケーブル６ａにて
カード取引処理装置１に接続されている。
以上の構成を有するカード取引処理装置１において、電
源の投入後にＩＣカードをＩＣカードリーダライタ装置
５に装着すると、このリーダライタ装置５はＩＣカード
に書込まれている取引相手先のデータや各ｆ１取引処理
指示データ等を読込み、これらデータを図示しない記憶
部に送出する。この状態で係員がキーボード２を操作し
て所望する取引指示やキーを押下すると、対応する操作
手順が表示部３に表示される。係員がこの操作手順によ
って更にキーボード２にて所定のデータを入力すると、
図示しない伝送制御部がデータをセンタ装置に伝送し、
センタ装置側で所定データ処理を実行した上でその終了
を知らせてくるので、印刷部４が作動して取引伝票が印
刷される。
源の投入後にＩＣカードをＩＣカードリーダライタ装置
５に装着すると、このリーダライタ装置５はＩＣカード
に書込まれている取引相手先のデータや各ｆ１取引処理
指示データ等を読込み、これらデータを図示しない記憶
部に送出する。この状態で係員がキーボード２を操作し
て所望する取引指示やキーを押下すると、対応する操作
手順が表示部３に表示される。係員がこの操作手順によ
って更にキーボード２にて所定のデータを入力すると、
図示しない伝送制御部がデータをセンタ装置に伝送し、
センタ装置側で所定データ処理を実行した上でその終了
を知らせてくるので、印刷部４が作動して取引伝票が印
刷される。
これにより、取引処理が終了する。
さて、第６図は上記カード取引処理装置１に組込まれる
従来のＩＣカードリーダライタ装置のブロック図である
。
従来のＩＣカードリーダライタ装置のブロック図である
。
この第６図において、７はワンチップのＣＰＵ（Ｃｅｎ
ｔｒａｌ Ｐｒｏｃｅｓｓｉｎｇ Ｕｎｉｔ）であり、
このＣＰＵ７は装置全体を制御する。ＣＰＵ７にはＭＰ
Ｕ（Ｍｉｃｒｏ Ｐｒｏｃｅｓｓｉｎｇ Ｕｎｉｔ）
８がバス７ａを介して接続されている。このＭＰＵ８は
ＣＰＵ７の制御でＩＣカード１０との間でデータの授受
を行なう。ＩＣカード１ｏは装置に装着されると、その
各電源端子ｖｅ。、ＯＶ、■、２に電源供給回路９が接
続する。ＩＣカード１０のクロック入力にはクロック発
生器工１が接続されている。このクロック発生器１１は
各種の発振器より成り、ＩＣカード１０を動作させるた
めに一定周波数（例えば、３、５７９５４５Ｍｔｌｚ）
のクロックパルスを発生する。
ｔｒａｌ Ｐｒｏｃｅｓｓｉｎｇ Ｕｎｉｔ）であり、
このＣＰＵ７は装置全体を制御する。ＣＰＵ７にはＭＰ
Ｕ（Ｍｉｃｒｏ Ｐｒｏｃｅｓｓｉｎｇ Ｕｎｉｔ）
８がバス７ａを介して接続されている。このＭＰＵ８は
ＣＰＵ７の制御でＩＣカード１０との間でデータの授受
を行なう。ＩＣカード１ｏは装置に装着されると、その
各電源端子ｖｅ。、ＯＶ、■、２に電源供給回路９が接
続する。ＩＣカード１０のクロック入力にはクロック発
生器工１が接続されている。このクロック発生器１１は
各種の発振器より成り、ＩＣカード１０を動作させるた
めに一定周波数（例えば、３、５７９５４５Ｍｔｌｚ）
のクロックパルスを発生する。
尚、ＣＰＵ７のクロック入力に接続されている他のクロ
ック発生器１２はＣＰＵ７を動作させるための、例えば
、４．９１５２Ｍ）Ｉｚのクロックパルスな発生する。
ック発生器１２はＣＰＵ７を動作させるための、例えば
、４．９１５２Ｍ）Ｉｚのクロックパルスな発生する。
以上の構成を有するＩＣカードリーダライタ装置におい
て、ＭＰＵ８がＩＣカード１０にリセット信号Ｒ８を出
力すると、ＩＣカード１０はそれに応答してＩ１０信号
線８ａを介して応答（Ａｎｓｗｅｒ ｔｏ Ｒｅ５ｅｔ
）信号をＭＰＵ８に送出する。
て、ＭＰＵ８がＩＣカード１０にリセット信号Ｒ８を出
力すると、ＩＣカード１０はそれに応答してＩ１０信号
線８ａを介して応答（Ａｎｓｗｅｒ ｔｏ Ｒｅ５ｅｔ
）信号をＭＰＵ８に送出する。
ＭＰＵ８はこの応答信号を受けると、ＩＣカード１０が
装着されたと判断し、ＩＣカード１０のフォーマットデ
ータ、インタフェースデータ、取引相手先のデータ、そ
の他取引処理に必要なデータを読込む。これらの読込ん
だデータはＣＰＵ７にて図示しない記憶部に送出されて
記憶される。
装着されたと判断し、ＩＣカード１０のフォーマットデ
ータ、インタフェースデータ、取引相手先のデータ、そ
の他取引処理に必要なデータを読込む。これらの読込ん
だデータはＣＰＵ７にて図示しない記憶部に送出されて
記憶される。
そして、上述したようにセンタ装置側で所定データ処理
が実行されて取引処理が行なわれる。
が実行されて取引処理が行なわれる。
ところで、ＩＣカード１０は発行される時点で自己の動
作クロック周波数が設定されており、例えば、日本国で
は主として ４．９１５２ＭＩＩｚモードに設定され、
又米国や仏国等では主として３、５７９５４５ＭＨｚモ
ードに設定されている。
作クロック周波数が設定されており、例えば、日本国で
は主として ４．９１５２ＭＩＩｚモードに設定され、
又米国や仏国等では主として３、５７９５４５ＭＨｚモ
ードに設定されている。
そこで、従来のＩＣカードリーダライタ装置においては
、３．５７９５４５ＭＨｚのクロックパルスを発生する
発振器若しくは４．９１５２Ｍ）Ｉｚのクロックパルス
を発生する発振器のいずれか一方をクロック発生器１１
として利用している。
、３．５７９５４５ＭＨｚのクロックパルスを発生する
発振器若しくは４．９１５２Ｍ）Ｉｚのクロックパルス
を発生する発振器のいずれか一方をクロック発生器１１
として利用している。
（発明が解決しようとする課題）
しかるに、一方の発振器のみをクロック発生器１１とし
て用いると、動作クロック周波数の異なるＩＣカードが
装置に装着された場合該ＩＣカードよりデータを読込む
ことが不能なため、取引処理を行なうことができず、汎
用性の点で問題がある。
て用いると、動作クロック周波数の異なるＩＣカードが
装置に装着された場合該ＩＣカードよりデータを読込む
ことが不能なため、取引処理を行なうことができず、汎
用性の点で問題がある。
クロック周波数の相違する二つのクロック発生器を用い
ることが考えられるが、クロック発生器は比較的高価な
ためＩＣカードリーダライタ装置も高価になってしまう
上に、いずれかのクロック発生器をオペレータが予め切
替える必要が生じるため、その操作が煩わしくなってし
まう虞れがある。
ることが考えられるが、クロック発生器は比較的高価な
ためＩＣカードリーダライタ装置も高価になってしまう
上に、いずれかのクロック発生器をオペレータが予め切
替える必要が生じるため、その操作が煩わしくなってし
まう虞れがある。
本発明は以上の点に着目してなされたもので、動作クロ
ック周波数の相違するＩＣカードであっても共通に使用
することができる上に安価な構成を有するＩＣカードリ
ーダライタ装置を提供することを目的とする。
ック周波数の相違するＩＣカードであっても共通に使用
することができる上に安価な構成を有するＩＣカードリ
ーダライタ装置を提供することを目的とする。
（課題を解決するための手段）
本発明のＩＣカードリーダライタ装置は、ＩＣカードが
判定可能な周波数モードに設定されているか否かを判別
する周波数モード判別手段と、判定可能と判別した場合
にＩＣカードの周波数データより動作クロック周波数を
判定する周波数判定手段と、その判定信号に基づいてク
ロック発生器からの基準クロックパルスをＩＣカードに
対応するクロックパルスに設定して供給する周波数設定
回路とを含むことを特徴とする。
判定可能な周波数モードに設定されているか否かを判別
する周波数モード判別手段と、判定可能と判別した場合
にＩＣカードの周波数データより動作クロック周波数を
判定する周波数判定手段と、その判定信号に基づいてク
ロック発生器からの基準クロックパルスをＩＣカードに
対応するクロックパルスに設定して供給する周波数設定
回路とを含むことを特徴とする。
（作用）
ＩＣカードが判定可能な周波数モードに設定されている
ことを判別した上で、ＩＣカードの周波数データにより
該ＩＣカード固有の動作クロック周波数を判定する。こ
の判定結果によりクロック発生器の基準クロックパルス
をＩＣカードに対応するクロックパルスに設定して供給
する。これにより、一つのＩＣカートリーダライタ装置
にて動作クロック周波数の相違する二辺上のＩＣカード
を動作させる。
ことを判別した上で、ＩＣカードの周波数データにより
該ＩＣカード固有の動作クロック周波数を判定する。こ
の判定結果によりクロック発生器の基準クロックパルス
をＩＣカードに対応するクロックパルスに設定して供給
する。これにより、一つのＩＣカートリーダライタ装置
にて動作クロック周波数の相違する二辺上のＩＣカード
を動作させる。
（実施例）
以下、本発明の実施例を図面を参照して詳細に説明する
。
。
第１図は本発明に係るＩＣカードリーダライタ装置のブ
ロック図である。この第１図において、２０はワンチッ
プのＣＰＵであり、このＣＰＵ２０は装置全体を制御す
る。ＣＰＵ２０のクロック入力にはクロック発生器２１
が接続されている。このクロック発生器２１はＣＰＵ２
０を動作させるために１４．７４５６Ｍ）Ｉｚのクロッ
クパルスを発生するが、後述するようにＩＣカードを動
作させるためにも利用される。ＣＰＵ２０にはバス２０
ａを介してＭＰＵ２２が接続されている。このＭＰＵ２
２はＣＰＵ２０の制御によりＩＣカード２３との間でデ
ータの授受を行なう。ＩＣカード２３は装置に装着され
ると、その各電源端子ｖｃｃ、ｏｖ、ｖ、、に電源供給
回路２４が接続する。電源端子Ｏｖには基準入力電圧と
して「０」■が印加され、電源端子ｖ０゜、ｖｐｐには
読込動作時と書込動作時にそれぞれ所定電圧が印加され
る。
ロック図である。この第１図において、２０はワンチッ
プのＣＰＵであり、このＣＰＵ２０は装置全体を制御す
る。ＣＰＵ２０のクロック入力にはクロック発生器２１
が接続されている。このクロック発生器２１はＣＰＵ２
０を動作させるために１４．７４５６Ｍ）Ｉｚのクロッ
クパルスを発生するが、後述するようにＩＣカードを動
作させるためにも利用される。ＣＰＵ２０にはバス２０
ａを介してＭＰＵ２２が接続されている。このＭＰＵ２
２はＣＰＵ２０の制御によりＩＣカード２３との間でデ
ータの授受を行なう。ＩＣカード２３は装置に装着され
ると、その各電源端子ｖｃｃ、ｏｖ、ｖ、、に電源供給
回路２４が接続する。電源端子Ｏｖには基準入力電圧と
して「０」■が印加され、電源端子ｖ０゜、ｖｐｐには
読込動作時と書込動作時にそれぞれ所定電圧が印加され
る。
ＭＰＵ２２にはバス２２ａを介して周波数設定回路２５
が接続されている。第２図はこの周波数設定回路２５の
ブロック図であり、この設定回路２５は分周器２６と切
替器２７とから成る。分周器２６の信号入力端子にはバ
ス２２ａが接続され、その制御端子は信号線２８を介し
てＭＰＵ２２に接続されている。また、分周器２６の出
力端子はクロック信号線２９を介してＩＣカード２３の
クロック入力に接続されている。一方、切替器２７のＡ
端子にはクロック信号線３０を介してＣＰＵ２０のクロ
ック出力に接続され、そのＢ端子にはクロック信号線３
１を介して発振器から成るクロック発生器３２が接続さ
れている。このクロック発生器３２は７．１５９０９Ｍ
Ｈｚの基準クロックパルスＰｓを発生する。また、切替
器２７の制御端子Ｃは信号線３３を介してＭＰＵ２２に
接続され、その出力はクロック信号線３４を介して分周
器２６のクロック入力端子に接続されている。
が接続されている。第２図はこの周波数設定回路２５の
ブロック図であり、この設定回路２５は分周器２６と切
替器２７とから成る。分周器２６の信号入力端子にはバ
ス２２ａが接続され、その制御端子は信号線２８を介し
てＭＰＵ２２に接続されている。また、分周器２６の出
力端子はクロック信号線２９を介してＩＣカード２３の
クロック入力に接続されている。一方、切替器２７のＡ
端子にはクロック信号線３０を介してＣＰＵ２０のクロ
ック出力に接続され、そのＢ端子にはクロック信号線３
１を介して発振器から成るクロック発生器３２が接続さ
れている。このクロック発生器３２は７．１５９０９Ｍ
Ｈｚの基準クロックパルスＰｓを発生する。また、切替
器２７の制御端子Ｃは信号線３３を介してＭＰＵ２２に
接続され、その出力はクロック信号線３４を介して分周
器２６のクロック入力端子に接続されている。
ところで、第３図はＩＣカード２３の応答（Ａｎｓｗｅ
ｒ ｔｏ Ｒｅ５ｅｔ）信号の内容を示すデータフォー
マットである。即ち、ＩＣカード２３にはＩＳＯ／ＤＩ
Ｓ ７８１６−３ ＡＮＮＥＸ Ａニ規定されティる信
号形態で各種データ（キャラクタ）が記録されており、
ＴＳは初期化データ、ＴＯはフォーマットデータ、ＴＡ
Ｉは動作クロック周波数データ、ＴＢＩは動作電圧デー
タ、ＴＣＩはデータブロック間の遅延時間データ、ＴＤ
Ｉはブロック伝送のためのプロトコル形式、ＴＡ２は１
ブロツクの送信単位、ＴＢ２は他の動作電圧データ（Ｔ
ＢＩに優先）、ＴＯ２はデータ間の待時間データをそれ
ぞれ示し、動作クロック周波数データＴＡＩ以゛下はイ
ンタフェースキャラクタを示している。尚、ＩＣカード
２３にはその他の各種データ、例えば、取引相手先デー
タや各種取引処理指示データ等が記録されている。
ｒ ｔｏ Ｒｅ５ｅｔ）信号の内容を示すデータフォー
マットである。即ち、ＩＣカード２３にはＩＳＯ／ＤＩ
Ｓ ７８１６−３ ＡＮＮＥＸ Ａニ規定されティる信
号形態で各種データ（キャラクタ）が記録されており、
ＴＳは初期化データ、ＴＯはフォーマットデータ、ＴＡ
Ｉは動作クロック周波数データ、ＴＢＩは動作電圧デー
タ、ＴＣＩはデータブロック間の遅延時間データ、ＴＤ
Ｉはブロック伝送のためのプロトコル形式、ＴＡ２は１
ブロツクの送信単位、ＴＢ２は他の動作電圧データ（Ｔ
ＢＩに優先）、ＴＯ２はデータ間の待時間データをそれ
ぞれ示し、動作クロック周波数データＴＡＩ以゛下はイ
ンタフェースキャラクタを示している。尚、ＩＣカード
２３にはその他の各種データ、例えば、取引相手先デー
タや各種取引処理指示データ等が記録されている。
次に、本発明に係るＩＣカードリーダライタ装置の動作
を第４図を参照して説明する。この第４図は同装置の動
作フローチャートである。
を第４図を参照して説明する。この第４図は同装置の動
作フローチャートである。
先ず、電源投入後にＩＣカード２３を装置に装着すると
、ＭＰＵ２２は内部レジスタに分周パラメータデータ１
／ｘ（例えば、ｘ＝２）をセットし、バス２２ａにこの
分周パラメータデータ１ ／ ｘをパラレル信号として
出力する。また、同時にＭＰＵ２２は信号線２８に分周
パラメータセット信号を出力する。この分周パラメータ
セット信号はｒＨＪ又はｒＬＪの信号として分周器２６
の制御端子に入力され、この信号人力で分周器２６に分
周パラメータ１ ／ ｘが設定される。−方、切替器２
７は電源投入直後にはＭＰＵ２２よりｒＨＪ又はｒＬＪ
の切替信号が信号線３３を介して制御端子Ｃに入力され
、Ｂ端子がクロック信号線３４に接続されている。従っ
て、クロック発生器３２より出力されている７、 １５
９０９ＭＨｚの基準クロックパルスＰ３はクロック信号
線３４を介して分周器２６に供給される。この場合分周
器２６は分周パラメータ１ ／ Ｘ （ａ２）が設定さ
れているので、７．１５９０９ ｘ １／２ ＝ ３
．５７９５４５ＭＨｚの動作クロッグパルスＰｃを出力
する。この動作クロックパルスＰ（：はＩＣカード２３
のクロック入力に供給され、これにより、ステップＳ。
、ＭＰＵ２２は内部レジスタに分周パラメータデータ１
／ｘ（例えば、ｘ＝２）をセットし、バス２２ａにこの
分周パラメータデータ１ ／ ｘをパラレル信号として
出力する。また、同時にＭＰＵ２２は信号線２８に分周
パラメータセット信号を出力する。この分周パラメータ
セット信号はｒＨＪ又はｒＬＪの信号として分周器２６
の制御端子に入力され、この信号人力で分周器２６に分
周パラメータ１ ／ ｘが設定される。−方、切替器２
７は電源投入直後にはＭＰＵ２２よりｒＨＪ又はｒＬＪ
の切替信号が信号線３３を介して制御端子Ｃに入力され
、Ｂ端子がクロック信号線３４に接続されている。従っ
て、クロック発生器３２より出力されている７、 １５
９０９ＭＨｚの基準クロックパルスＰ３はクロック信号
線３４を介して分周器２６に供給される。この場合分周
器２６は分周パラメータ１ ／ Ｘ （ａ２）が設定さ
れているので、７．１５９０９ ｘ １／２ ＝ ３
．５７９５４５ＭＨｚの動作クロッグパルスＰｃを出力
する。この動作クロックパルスＰ（：はＩＣカード２３
のクロック入力に供給され、これにより、ステップＳ。
が実行されて分周器２６が初期化される。
次に、ＭＰＵ２２はＣＰＵ２０の制御でリセット信号Ｒ
３を信号線３５を介してＩＣカード２３に送出（ステッ
プＳ１）し、ＩＣカード２３はこれにより応答信号をＩ
１０信号線３６を介してＭＰＵ２２に出力する（ステッ
プＳ２）。この応答信号のビット長（スタートビット）
は統一的に定められた転送レート、例えば、９８００Ｂ
ＳＰに設定されており、ＭＰＵ２２はスタートビット長
を測定してＩＣカード２３が判定可能な周波数モードを
有しているか否かを判別する。
３を信号線３５を介してＩＣカード２３に送出（ステッ
プＳ１）し、ＩＣカード２３はこれにより応答信号をＩ
１０信号線３６を介してＭＰＵ２２に出力する（ステッ
プＳ２）。この応答信号のビット長（スタートビット）
は統一的に定められた転送レート、例えば、９８００Ｂ
ＳＰに設定されており、ＭＰＵ２２はスタートビット長
を測定してＩＣカード２３が判定可能な周波数モードを
有しているか否かを判別する。
スタートビット長が３．５７９５４５Ｍｔｌｚの周波数
モードを有している場合にはＭＰＵ２２はＩＣカード２
３が判定可能な周波数モードに設定されていると判別し
、応答信号を受信して初期化データＴＳにより装置の各
部を初期化すると共にフォーマットデータＴＯによりＩ
Ｃカード２３のフォーマットを確認する（ステップＳ４
）。
モードを有している場合にはＭＰＵ２２はＩＣカード２
３が判定可能な周波数モードに設定されていると判別し
、応答信号を受信して初期化データＴＳにより装置の各
部を初期化すると共にフォーマットデータＴＯによりＩ
Ｃカード２３のフォーマットを確認する（ステップＳ４
）。
ひき続き、ＭＰＵ２２はステップＳ４を実行し、動作ク
ロック周波数データＴＡＩを確認する。このデータＴＡ
Ｉが３゜５７９５４５ＭＨｚを示すと判定すると、ステ
ップＳ５に進み、このデータＴＡＩで示すクロック周波
数のクロック発生器３２における基準クロックパルスＰ
。
ロック周波数データＴＡＩを確認する。このデータＴＡ
Ｉが３゜５７９５４５ＭＨｚを示すと判定すると、ステ
ップＳ５に進み、このデータＴＡＩで示すクロック周波
数のクロック発生器３２における基準クロックパルスＰ
。
（７，１５９０９ＭＨｚ）に対する倍率ｎ ／ ｍを演
算する。
算する。
この倍率ｎ ／ ｍが、例えば、１／２であると判断す
ると、ＭＰＵ２２は内部レジスタに分周パラメータデー
タ１／２をセットし、バス２２ａにこの分周パラメータ
データ１／２をパラレル信号として出力する（ステップ
Ｓ６）。また、同時にＭＰＵ２２はステップＳ７を実行
し、信号線２８に分周パラメータセット信号を出力する
。従って、分周器２６は分周パラメータ１／２が設定さ
れる。一方、切替器２７は上記したように、Ｂ端子がク
ロック信号線３４に接続された状態に保持されているの
で、クロック発生器３２より出力されている７、 １５
９０９Ｍ）ｌｚの基準クロックパルスｐＨはクロック信
号線３４を介して分周器２６に供給されるＪこの結果、
ＩＣカード２３のクロック入力には３．５７９５４５Ｍ
Ｈｚの動作クロックパルスＰｃが供給されるので、該カ
ード２３はその動作クロック周波数が３．５７９５４５
ＭＨｚであることから動作する。
ると、ＭＰＵ２２は内部レジスタに分周パラメータデー
タ１／２をセットし、バス２２ａにこの分周パラメータ
データ１／２をパラレル信号として出力する（ステップ
Ｓ６）。また、同時にＭＰＵ２２はステップＳ７を実行
し、信号線２８に分周パラメータセット信号を出力する
。従って、分周器２６は分周パラメータ１／２が設定さ
れる。一方、切替器２７は上記したように、Ｂ端子がク
ロック信号線３４に接続された状態に保持されているの
で、クロック発生器３２より出力されている７、 １５
９０９Ｍ）ｌｚの基準クロックパルスｐＨはクロック信
号線３４を介して分周器２６に供給されるＪこの結果、
ＩＣカード２３のクロック入力には３．５７９５４５Ｍ
Ｈｚの動作クロックパルスＰｃが供給されるので、該カ
ード２３はその動作クロック周波数が３．５７９５４５
ＭＨｚであることから動作する。
これに対して、ステップＳ３でスタートビット長が３．
５７９５４５ＭＨｚモードを示していないと判断すると
、ＭＰＵ２２はステップＳ８に進み、ｒＬＪ又はｒＨＪ
の切替信号を信号線３３を介して切替器２７の制御端子
Ｃに出力する。これにより、切替器２７は切替制御され
てＡ端子がクロック信号線３４に接続される。Ａ端子は
、上述したように、クロック発生器２１からのクロック
パルスを出力するＣＰＵ２０のクロック出力に信号線３
０を介して接続されている。従って、分周器２６には１
４．７４５６Ｍ）Ｉｚの基準クロックパルスＰ、が供給
される。
５７９５４５ＭＨｚモードを示していないと判断すると
、ＭＰＵ２２はステップＳ８に進み、ｒＬＪ又はｒＨＪ
の切替信号を信号線３３を介して切替器２７の制御端子
Ｃに出力する。これにより、切替器２７は切替制御され
てＡ端子がクロック信号線３４に接続される。Ａ端子は
、上述したように、クロック発生器２１からのクロック
パルスを出力するＣＰＵ２０のクロック出力に信号線３
０を介して接続されている。従って、分周器２６には１
４．７４５６Ｍ）Ｉｚの基準クロックパルスＰ、が供給
される。
次に、ＭＰＵ２２はステップＳ９に移り、内部のレジス
タに分周パラメータデータ１／ｙ（例えばｙ＝３）をセ
ットし、バス２２ａにこの分周パラメータデータ１／ｙ
をパラレル信号として出力する。また、同時にＭＰＵ２
２は信号線２８に分周パラメータセット信号を出力する
。従って、分周器２６には分周パラメータ１／ｙが設定
されるので、１４．７４５６ Ｘ １／３ ＝ ４．
９１５２ＭＨｚの動作クロックパルスＰｓがＩＣカード
２３のクロック入力に供給され、これにより分周器２６
が初期化される。
タに分周パラメータデータ１／ｙ（例えばｙ＝３）をセ
ットし、バス２２ａにこの分周パラメータデータ１／ｙ
をパラレル信号として出力する。また、同時にＭＰＵ２
２は信号線２８に分周パラメータセット信号を出力する
。従って、分周器２６には分周パラメータ１／ｙが設定
されるので、１４．７４５６ Ｘ １／３ ＝ ４．
９１５２ＭＨｚの動作クロックパルスＰｓがＩＣカード
２３のクロック入力に供給され、これにより分周器２６
が初期化される。
次いで、ＭＰＵ２２はＣＰＵ２０の制御でノセット信号
Ｒｓを信号線３５を介してＩＣカード２３に送出（ステ
ップ５ＩＯ）Ｌ、ＩＣカード２３はこれにより応答信号
をＩ１０信号線３６を介してＭＰＵ２２に出力する（ス
テップ５１１）。
Ｒｓを信号線３５を介してＩＣカード２３に送出（ステ
ップ５ＩＯ）Ｌ、ＩＣカード２３はこれにより応答信号
をＩ１０信号線３６を介してＭＰＵ２２に出力する（ス
テップ５１１）。
ひき続き、ＭＰＵ２２は応答信号のスタートビット長を
測定し、ＩＣカード２３が判定可能な周波数モードを有
しているか否かを判別する（ステップ５１２）。スター
トビット長が９６００８ＰＳに設定されている場合には
ＭＰＵ２２はＩＣカード２３が４．９１５２ＭＨｚモー
ドに設定されていると判別し、応答信号を受信して初期
化データＴＳにより装置の各部を初期化すると共に、フ
ォーマットデータＴｏによりＩＣカード２３のフォーマ
ットを確認する（ステップ５１３）。
測定し、ＩＣカード２３が判定可能な周波数モードを有
しているか否かを判別する（ステップ５１２）。スター
トビット長が９６００８ＰＳに設定されている場合には
ＭＰＵ２２はＩＣカード２３が４．９１５２ＭＨｚモー
ドに設定されていると判別し、応答信号を受信して初期
化データＴＳにより装置の各部を初期化すると共に、フ
ォーマットデータＴｏによりＩＣカード２３のフォーマ
ットを確認する（ステップ５１３）。
ステップＳＬ２での判別が４．９１５２ＭＨｚモードで
ない場合にはステップＳ１７に移り、ＩＣカート２３の
処理が不能と判断し、エラーカード処理を行なう。
ない場合にはステップＳ１７に移り、ＩＣカート２３の
処理が不能と判断し、エラーカード処理を行なう。
さて、ＭＰＵ２２は４．９１５２Ｍ）ｌｚモードと判別
した場合にはひき続きステップＳ１３を実行し、ＩＣカ
ード２３の動作クロック周波数データＴＡＩを確認する
。このデータＴＡＩが４．９１５２Ｍ１（ｚを示すと判
定すると、ステップＳ１４に進み、このデータＴＡＩで
示すクロック周波数のクロック発生器２１における基準
クロックパルスＰ ｓ （１４，７４５６ＭＨｚ）に対
する倍率ｎ ／ ｍを演算する。
した場合にはひき続きステップＳ１３を実行し、ＩＣカ
ード２３の動作クロック周波数データＴＡＩを確認する
。このデータＴＡＩが４．９１５２Ｍ１（ｚを示すと判
定すると、ステップＳ１４に進み、このデータＴＡＩで
示すクロック周波数のクロック発生器２１における基準
クロックパルスＰ ｓ （１４，７４５６ＭＨｚ）に対
する倍率ｎ ／ ｍを演算する。
この倍率が１／３であると演算すると、ＭＰＵ２２は内
部のレジスタに分周パラメータデータ１／３をセットし
、バス２２ａにこの分周パラメータデータ１／３をパラ
レル信号として出力する（ステップ５１５）。また、同
時にＭＰＵ２２はステップＳ１６を実行し、信号線２８
に分周パラメータセット信号を出力し、分周器２６に分
周パラメータ１／３を設定する。分周器２６はクロック
発生器２１より１４．７４５６ＭＨｚの基準クロックパ
ルスＰ、が供給されている。この結果、ＩＣカード２３
のクロック入力には４．９１５２ＭＨｚの動作クロック
パルスＰ、が供給されるので、 ４．９１５２ＭＨｚの
クロックパルスを必要とするＩＣカード２３であっても
同様に動作させることができる。
部のレジスタに分周パラメータデータ１／３をセットし
、バス２２ａにこの分周パラメータデータ１／３をパラ
レル信号として出力する（ステップ５１５）。また、同
時にＭＰＵ２２はステップＳ１６を実行し、信号線２８
に分周パラメータセット信号を出力し、分周器２６に分
周パラメータ１／３を設定する。分周器２６はクロック
発生器２１より１４．７４５６ＭＨｚの基準クロックパ
ルスＰ、が供給されている。この結果、ＩＣカード２３
のクロック入力には４．９１５２ＭＨｚの動作クロック
パルスＰ、が供給されるので、 ４．９１５２ＭＨｚの
クロックパルスを必要とするＩＣカード２３であっても
同様に動作させることができる。
尚、ＩＣカード２３に所定の動作クロックパルスＰ、を
供給した後にはＩＣカードより所定の取引データを読取
り、通常の取引処理を実行する。
供給した後にはＩＣカードより所定の取引データを読取
り、通常の取引処理を実行する。
（発明の効果）
以上説明したように、本発明によれば、周波数判定手段
にてＩＣカードの周波数データによりカード固有の動作
クロック周波数を判定し、その判定信号に基づいて周波
数設定回路にてクロック発生器からの基準クロックパル
スをＩＣカードに対応するクロックパルスに設定するの
で、周波数の相違するクロックパルスを発生ずる複数の
クロック発生器を用いずに動作クロック周波数の異なる
ＩＣカードを共通に使用することができる汎用性を有す
る安価なＩＣカードリードライタ装置を提供することが
できる。
にてＩＣカードの周波数データによりカード固有の動作
クロック周波数を判定し、その判定信号に基づいて周波
数設定回路にてクロック発生器からの基準クロックパル
スをＩＣカードに対応するクロックパルスに設定するの
で、周波数の相違するクロックパルスを発生ずる複数の
クロック発生器を用いずに動作クロック周波数の異なる
ＩＣカードを共通に使用することができる汎用性を有す
る安価なＩＣカードリードライタ装置を提供することが
できる。
第１図は本発明に係るＩＣカードリーダライタ装置のブ
ロック図、第２図は本発明に係る周波数設定回路のブロ
ック図、第３図はＩＣカードのデータフォーマットを示
す図、第４図は第１図の装置の動作フローチャート、第
５図はカード取弓装置の外観斜視図、第６図は従来の工
Ｃカードリーダライタ装置のブロック図である。 ２０・・・ＣＰＵ、２１・・・クロック発生器、２２・
・・ＭＰＵ、２３・・・ＩＣカード、２５・・・周波数
設定回路、２６・・・分周器、２７・・・切替器。 ＩＣカードのデータ７オ マ・ノド 第３図
ロック図、第２図は本発明に係る周波数設定回路のブロ
ック図、第３図はＩＣカードのデータフォーマットを示
す図、第４図は第１図の装置の動作フローチャート、第
５図はカード取弓装置の外観斜視図、第６図は従来の工
Ｃカードリーダライタ装置のブロック図である。 ２０・・・ＣＰＵ、２１・・・クロック発生器、２２・
・・ＭＰＵ、２３・・・ＩＣカード、２５・・・周波数
設定回路、２６・・・分周器、２７・・・切替器。 ＩＣカードのデータ７オ マ・ノド 第３図
Claims (1)
- 【特許請求の範囲】 自己の動作クロック周波数を示す周波数データの書込
まれているＩＣカードが装着され、かつ該ＩＣカードに
クロックパルスを供給するために一定周波数の基準クロ
ックパルスを発生するクロック発生器を備えるＩＣカー
ドリーダライタ装置において、 前記ＩＣカードが判定可能な周波数モードに設定されて
いるか否かを判別する周波数モード判別手段と、 前記周波数モードが判定可能と判別した場合に前記ＩＣ
カードの周波数データを読込んで前記動作クロック周波
数を判定する周波数判定手段と、該周波数判定手段の判
定信号に基づいて前記基準クロックパルスを前記ＩＣカ
ードに対応するクロックパルスに設定して該ＩＣカード
に供給する周波数設定回路とを含むことを特徴とするＩ
Ｃカードリーダライタ装置。
Priority Applications (7)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63154620A JPH025192A (ja) | 1988-06-24 | 1988-06-24 | Ｉｃカードリーダライタ装置 |
| NZ229581A NZ229581A (en) | 1988-06-24 | 1989-06-15 | Ic card reader detects card operating frequency |
| US07/367,728 US5070233A (en) | 1988-06-24 | 1989-06-19 | Ic card reader/writer and ic card transactions processing apparatus capable of producing various frequency clock pulses |
| AU36582/89A AU607620B2 (en) | 1988-06-24 | 1989-06-19 | Ic card reader/writer and ic card transactions processing apparatus |
| EP89111333A EP0347894B1 (en) | 1988-06-24 | 1989-06-22 | Method for operating an IC card reader/writer |
| CA000603605A CA1319195C (en) | 1988-06-24 | 1989-06-22 | Ic card reader/writer and ic card transactions processing apparatus capable of producing various frequency clock pulses |
| DE68922439T DE68922439T2 (de) | 1988-06-24 | 1989-06-22 | Verfahren zum Betreiben eines IC-Kartenlesers/-schreibers. |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63154620A JPH025192A (ja) | 1988-06-24 | 1988-06-24 | Ｉｃカードリーダライタ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH025192A true JPH025192A (ja) | 1990-01-10 |
Family
ID=15588161
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63154620A Pending JPH025192A (ja) | 1988-06-24 | 1988-06-24 | Ｉｃカードリーダライタ装置 |
Country Status (7)
| Country | Link |
|---|---|
| US (1) | US5070233A (ja) |
| EP (1) | EP0347894B1 (ja) |
| JP (1) | JPH025192A (ja) |
| AU (1) | AU607620B2 (ja) |
| CA (1) | CA1319195C (ja) |
| DE (1) | DE68922439T2 (ja) |
| NZ (1) | NZ229581A (ja) |
Families Citing this family (33)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US5579528A (en) * | 1991-12-31 | 1996-11-26 | Dell Usa, L.P. | Computer system employing docking bay with spring loaded connector pins and file coherency method |
| JPH05273823A (ja) * | 1992-03-26 | 1993-10-22 | Minolta Camera Co Ltd | 複写機 |
| JP3425177B2 (ja) * | 1993-03-24 | 2003-07-07 | 株式会社東芝 | データ伝送システム |
| GB9306805D0 (en) * | 1993-04-01 | 1993-05-26 | Jonhig Ltd | Smart card reader |
| JPH0830749A (ja) * | 1994-07-13 | 1996-02-02 | Mitsubishi Electric Corp | 非接触ｉｃカード |
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| US5583933A (en) * | 1994-08-05 | 1996-12-10 | Mark; Andrew R. | Method and apparatus for the secure communication of data |
| FR2729775B1 (fr) * | 1995-01-23 | 1997-02-21 | France Telecom | Terminal a lecteur de carte et procede de traitement multi-applicatif d'un tel terminal |
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| DE19523275C1 (de) * | 1995-06-27 | 1996-12-12 | Orga Kartensysteme Gmbh | Verfahren zur Beschleunigung der Kommunikation zwischen einer Chipkarte und einem Datenaustauschgerät |
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Citations (2)
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-
1988
- 1988-06-24 JP JP63154620A patent/JPH025192A/ja active Pending
-
1989
- 1989-06-15 NZ NZ229581A patent/NZ229581A/en unknown
- 1989-06-19 US US07/367,728 patent/US5070233A/en not_active Expired - Lifetime
- 1989-06-19 AU AU36582/89A patent/AU607620B2/en not_active Ceased
- 1989-06-22 CA CA000603605A patent/CA1319195C/en not_active Expired - Lifetime
- 1989-06-22 EP EP89111333A patent/EP0347894B1/en not_active Expired - Lifetime
- 1989-06-22 DE DE68922439T patent/DE68922439T2/de not_active Expired - Lifetime
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|---|---|
| DE68922439D1 (de) | 1995-06-08 |
| EP0347894B1 (en) | 1995-05-03 |
| US5070233A (en) | 1991-12-03 |
| EP0347894A2 (en) | 1989-12-27 |
| AU607620B2 (en) | 1991-03-07 |
| AU3658289A (en) | 1990-05-03 |
| NZ229581A (en) | 1991-03-26 |
| EP0347894A3 (en) | 1991-07-24 |
| CA1319195C (en) | 1993-06-15 |
| DE68922439T2 (de) | 1996-01-25 |
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