JPH0250606A - 周波数シンセサイザ - Google Patents

周波数シンセサイザ

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JPH0250606A
JPH0250606A JP63201276A JP20127688A JPH0250606A JP H0250606 A JPH0250606 A JP H0250606A JP 63201276 A JP63201276 A JP 63201276A JP 20127688 A JP20127688 A JP 20127688A JP H0250606 A JPH0250606 A JP H0250606A
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JP
Japan
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controlled oscillator
voltage
resistor
modulation
bias
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JP63201276A
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Ritsu Kojima
小島　立
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NEC Corp
Original Assignee
NEC Corp
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Publication date
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    • H03C3/02—Details
    • H03C3/09—Modifications of modulator for regulating the mean frequency
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    • H03C3/095—Modifications of modulator for regulating the mean frequency using a phase locked loop applying frequency modulation to the loop in front of the voltage controlled oscillator
    • H—ELECTRICITY
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  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
  • Superheterodyne Receivers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、移動無線システムに利用するに適する。特に
、変調をかけることのできる電圧制御発振器をもつ周波
数シンセサイザに関する。
〔概要〕
本発明は、電圧制御発振器が有する可変ダイオードに印
加する逆バイアスを変化させてＦＭ変調波を生成する周
波数シンセサイザにおいて、逆バイアスを電圧制御発振
器の制御電圧に応じて変化させることにより、 発振周波数の相異による変調感度の変化を補正すること
ができるようにしたものである。
〔従来の技術〕
第３図に従来の周波数シンセサイザの構成を示す。電圧
制御発振器２の出力は増幅回路３に入力され、出力端子
３１からシンセサイザ出力信号として取り出される。一
方、この出力は第一分周器４で分周され、位相比較回路
６に入力される。基準発振器８の出力も第二分周器７で
分周され位相比較回路６に入力される。位相比較回路６
で第一分周器４および第二分周器７の出力が位相比較さ
れてその位相差に応じた電圧が出力され、ローパスフィ
ルタ５を通って制御電圧２０として電圧制御発振器２の
発振周波数をコントロールする。
従来、変調用に可変容量ダイオードを持つ電圧制御発振
器に変調をかけると第５図に示すように発振周波数によ
って変調感度が変化するので、変調トラッキング回路９
で変調信号のレベルを変えて等価的に変調入力端子３０
にあける変調感度が変化しないようにしてバイアス回路
１０を経由して可変容量ダイオードに逆電圧を与えてい
る。変調トラッキング回路９は、第４図に示すように、
チャンネル指定情報に応じてアナログスイッチを切り換
え、変調信号のレベルを変化させる。
〔発明が解決しようとする問題点〕
このような従来例では、発振周波数帯域が広くなるほど
、また、変調感度偏差が大きくなるほど変調トラッキン
グ回路の部品点数が増える欠点がある。
本発明はこのような欠点を除去するもので、簡単な部品
の付加により発振周波数の相異による変調感度の変化を
補正できる周波数シンセサイザを提供することを目的と
する。
【問題点を解決するための手段〕
本発明は、変調信号が到来する入力端子と、可変容量ダ
イオードを有する電圧制御発振器と、方の端が電源に接
続された第一抵抗、一方の端が共通電位に接続された第
二抵抗およびこの第一抵抗および第二抵抗のそれぞれの
他方の端が接続された接続点と上記入力端子との間の経
路に挿入されたコンデンサを有し、この接続点の電位を
上記可変容量ダイオードのバイアス電圧として与えるバ
イアス回路とを備えた周波数シンセサイザにおいて、上
記バイアス回路は、上記接続点に出力電極が接続され、
上記第二抵抗の他方の端に入力電極が接続され、上記電
圧制御発振器の制御電圧が制御電極に与えられる電界効
果トランジスタを備えたことを特徴とする。
〔作用〕
電圧制御発振器はその発振周波数の増加に伴って変調感
度が高くなり、発振周波数が異なると均一の変調感度を
有する周波数シン乍すイザを実現する要求が満たされな
い。本発明では、可変容量ダイオードに与えるバイアス
電圧を電圧制御発振器の制御電圧に応じて変化させてこ
の要求を実現するものである。すなわち、電源電圧が印
加された二つの抵抗の間にＦＥＴを挿入し、このＦＥＴ
のゲート電極に電圧制御発振器の制御電圧を与えると、
発振周波数が高いときにＦＥＴのドレイン電位が下がり
、これに伴って可変容量ダイオードの容量値が増加し、
容量変化による周波数変化すなわち変調感度が下がり、
発振周波数の上昇に伴う変調感度の上昇を抑制すること
ができる。
〔実施例〕
以下、本発明の一実施例を図面に基づき説明する。第１
図はこの実施例の構成を示すブロック構成図である。第
２図は、この実施例のバイアス回路の構成を示す回路構
成図である。
この実施例は、第１図に示すように、変調入力端子３０
を経由して与えられる変調信号にバイアス電圧を加える
バイアス回路１と、このバイアス回路１の出力が与えら
れる可変容量ダイオードを有する電圧制御発振器２と、
この電圧制御発振器２の出力が与えられ出力端子３１を
経由してシンセサイザ出力信号を出力する増幅回路３と
、電圧制御発振器２の出力を分周する第一分周器４と、
基準周波数信号を発振する基準発振器８と、この基準発
振器８の出力を分周する第二分周器７と、第一分周器４
の出力の位相と第二分周器の出力の位相とを比較する位
相比較器６と、この位相比較器６の出力が与えられ、バ
イアス回路１のバイアス値制御手段および電圧制御発振
器２の制御電圧を生成するローパスフィルタ５とを備え
る。ここで、本発明の特徴とするところのバイアス回路
１は、変調信号が与えられる端子７０と、ローパスフィ
ルタ５が与える制御電圧がゲート端子６１に印加され、
ソース電極が抵抗５１を介して共通電位に接続され、ド
レイン電極が抵抗５０を介して電源ＶＣＣに接続された
電圧制御発振器２の可変容量ダイオードのカソードに端
子７１を経由して接続された電界効果トランジスタ　（
以下、ＦＥＴという。）６０と、端子７０とＦ　Ｅ　Ｔ
２Ｏのドレインとの間に挿入されたコンデンサ４０とを
備える。すなわち、この実施例は、変調信号が到来する
入力端子である変調入力端子３０と、可変容量ダイオー
ドを有する電圧制御発振器２と、一端が電源に接続され
た第一抵抗である抵抗５０、一端が共通電位に接続され
た第二抵抗である抵抗５１、この第一抵抗および第二抵
抗のそれぞれの他端が接続された接続点と上記入力端子
との間の経路に挿入されたコンデンサ４０、および上記
接続点に出力電極が接続され、上記第二抵抗の他端に入
力電極が接続され、電圧制御発振器２の制御電圧が制御
電極に与えられる電界効果トランジスタ６０を有し、こ
の接続点の電位を上記可変容量ダイオードのバイアス電
圧として与えるバイアス回路１とを備える。
次に、本発明の特徴とするバイアス回路１の動作を説明
する。
制御電圧２０はＮチャンネルのＦ　Ｅ　Ｔ２Ｏのゲート
に加えられ、変調信号はコンデンサ４０を介してＦＥ　
Ｔ２Ｏのドレインに接続され、ＤＣバイアスが重畳され
て電圧制御発振器２の可変容量ダイオードに加えられる
。さて、電圧制御発振器２の発振周波数が高い場合には
、Ｆ　Ｅ　Ｔ２Ｏのゲート端子６１に印加される制御電
圧２０も高くなり、あらかじめ抵抗５０および５１の抵
抗値をＦ　Ｅ　Ｔ２Ｏのドレイン電流が飽和するように
選ぶと、Ｆ　Ｅ　Ｔ２Ｏのドレインの電位すなわちＤＣ
バイアスはドレイン電流の増加分ΔＩＰＳと抵抗５０の
抵抗値Ｒとの積ＲΔＩＰＳだけ下がる。ＤＣバイアスが
下がると第６図に示すように可変容量ダイオードの容量
値が増え、容量変化による周波数変化が減り、したがっ
て変調感度が下がり、第５図に示す発振周波数と変調感
度の関係をフラットに補正することができる。
ここで、ＦＥＴ０代わりにトランジスタを用いると、同
じ動作をするが、ベース電流を必要とするので制御電圧
のリークが起こってリファレンスリークが現れ、シンセ
サイザの性能に悪影響を与える。
〔発明の効果〕
本発明は、以上説明したように、バイアス回路にＦＥＴ
を追加するだけで発振周波数による変調感度偏差を補正
することができるので、変調トラッキング回路のように
部品点数の多い回路を省くことができ、コスト低減およ
び実装効率の向上が図れる効果がある。
【図面の簡単な説明】
第１図は本発明実施例の構成を示すブロック構成図。 第２図は本発明実施例のバイアス回路の構成を示す回路
接続図。 第３図は従来例の構成を示すブロック構成図。 第４図は従来例の変調トラッキング回路の構成を示す回
路接続図。 第５図は電圧制御発振器の発振周波数と変調感度の関係
を示す図。 第６図は可変容量ダイオードの逆バイアスと容量の関係
を示す図。 １．１０・・・バイアス回路、２・・・電圧制御発振器
、３・・・増幅回路、４・・・第一分周器、５・・・ロ
ーパスフィルタ、６・・・位相比較回路、７・・・第二
分周器、８・・・基準発振器、９・・・変調トラッキン
グ回路、２０・・・制御電圧、３０・・・変調入力端子
、３１・・・出力端子、４０・・・コンデンサ、５０．
５１・・・抵抗、６０・・・ＦＥＴ、。 特許出願人　日本電気株式会社、＜１．、。 代理人　　弁理士　井　出　直　孝 −４５＝

Claims (1)

  1. 【特許請求の範囲】 １、変調信号が到来する入力端子と、 可変容量ダイオードを有する電圧制御発振器と、一端が
    電源に接続された第一抵抗、一端が共通電位に接続され
    た第二抵抗およびこの第一抵抗および第二抵抗のそれぞ
    れの他端が接続された接続点と上記入力端子との間の経
    路に挿入されたコンデンサを有し、この接続点の電位を
    上記可変容量ダイオードのバイアス電圧として与えるバ
    イアス回路と を備えた周波数シンセサイザにおいて、 上記バイアス回路は、上記接続点に出力電極が接続され
    、上記第二抵抗の他端に入力電極が接続され、上記電圧
    制御発振器の制御電圧が制御電極に与えられる電界効果
    トランジスタ を備えたことを特徴とする周波数シンセサイザ。
JP63201276A 1988-08-12 1988-08-12 周波数シンセサイザ Pending JPH0250606A (ja)

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EP89114902A EP0357996B1 (en) 1988-08-12 1989-08-11 Frequency modulator utilizing frequency synthesizer
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