JPS61161006A - 変調回路 - Google Patents
変調回路Info
- Publication number
- JPS61161006A JPS61161006A JP130485A JP130485A JPS61161006A JP S61161006 A JPS61161006 A JP S61161006A JP 130485 A JP130485 A JP 130485A JP 130485 A JP130485 A JP 130485A JP S61161006 A JPS61161006 A JP S61161006A
- Authority
- JP
- Japan
- Prior art keywords
- modulation
- control voltage
- controlled oscillator
- source
- voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Inductance-Capacitance Distribution Constants And Capacitance-Resistance Oscillators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、周波数シンセサイザ部に使用される変調回路
に関する。
に関する。
（従来の技術）
従来より周波数シンセサイザ部の電圧制御発振器に変調
をかける場合には、その結合素子の特性により変調感度
が発振周波数に対して一定ではなく、変調感度が発振周
波数に依存していた。したがって、高帯域化が要求され
ている装置では最大周波数偏差および歪率に斯かる特性
が影響を及ぼしていたため、周波数シンセサイザ部の外
部より制御されたアナログスイッチを使用して、電圧制
御発振器に入力される変調信号のレベルを切換えていた
。
をかける場合には、その結合素子の特性により変調感度
が発振周波数に対して一定ではなく、変調感度が発振周
波数に依存していた。したがって、高帯域化が要求され
ている装置では最大周波数偏差および歪率に斯かる特性
が影響を及ぼしていたため、周波数シンセサイザ部の外
部より制御されたアナログスイッチを使用して、電圧制
御発振器に入力される変調信号のレベルを切換えていた
。
第３図は、従来技術によるこの種の変調回路の一例を示
すブロック図である。第３図において、１は電圧制御発
振器、２はＰＬＬ位相調整器、３はアナログスイッチ、
４〜７はそれぞれ抵抗器である。
すブロック図である。第３図において、１は電圧制御発
振器、２はＰＬＬ位相調整器、３はアナログスイッチ、
４〜７はそれぞれ抵抗器である。
第９図および第１０図は第３図に示す電圧制御発振器１
の発振周波数に対する変調感度を示す説明図である。発
振周波数がｆ１％ｆ、の間に含まれている場合には、第
３図におけるアナログスイッチ３は抵抗器４ （Ｒ１）
の側に倒し、発振周波数がｆ、〜・ｆ３の間に含まれて
いる場合には、アナログスイッチ３は抵抗器６（Ｒ２）
の側に倒して接続されるように制御信号ＶＣＯＮＴによ
って制御されている。ここで抵抗器４（Ｒ１）および抵
抗器６（Ｒ２）はＲ１＜Ｒ２なる関係が満足されるよう
に選択されているものとする。したがって、電圧制御発
振器１に入力される変調信号のレベルは、ｆ１〜ｆ２
の間におけ・るものがｆｌ−ｆ、の間におけるものよ
りも大きくなっている。したがって、第３図の構成にお
いて発振周波数ｆ１〜ｆ３の範囲内での変調感匿の変化
は第１０図において示される電圧制御発振器１の変調感
度の偏差よシ小さい。
の発振周波数に対する変調感度を示す説明図である。発
振周波数がｆ１％ｆ、の間に含まれている場合には、第
３図におけるアナログスイッチ３は抵抗器４ （Ｒ１）
の側に倒し、発振周波数がｆ、〜・ｆ３の間に含まれて
いる場合には、アナログスイッチ３は抵抗器６（Ｒ２）
の側に倒して接続されるように制御信号ＶＣＯＮＴによ
って制御されている。ここで抵抗器４（Ｒ１）および抵
抗器６（Ｒ２）はＲ１＜Ｒ２なる関係が満足されるよう
に選択されているものとする。したがって、電圧制御発
振器１に入力される変調信号のレベルは、ｆ１〜ｆ２
の間におけ・るものがｆｌ−ｆ、の間におけるものよ
りも大きくなっている。したがって、第３図の構成にお
いて発振周波数ｆ１〜ｆ３の範囲内での変調感匿の変化
は第１０図において示される電圧制御発振器１の変調感
度の偏差よシ小さい。
（発明が解決しようとする問題点）
しかしながら、上記従来技術による周波数シンセサイザ
の変調回路では、アナログスイッチと抵抗回路網とによ
って変調波信号を制御電圧入力端子に加えていたため、
回路構成が複雑であって、外部とのインターフェースが
複雑化するという問題点があった。
の変調回路では、アナログスイッチと抵抗回路網とによ
って変調波信号を制御電圧入力端子に加えていたため、
回路構成が複雑であって、外部とのインターフェースが
複雑化するという問題点があった。
本発明の目的は、発振周波数制御電圧（ＶＡＰＣ）を電
界効果トランジスタを介して帰還し、変調信号と共に電
圧制御発振器に加えて発振周波数を制御することにより
上記欠点を除去し、構成を簡易化すると共に外部インタ
ーフェースの複雑さを低減できるように構成した周波数
シンセサイザ部の変調回路を提供することにある。
界効果トランジスタを介して帰還し、変調信号と共に電
圧制御発振器に加えて発振周波数を制御することにより
上記欠点を除去し、構成を簡易化すると共に外部インタ
ーフェースの複雑さを低減できるように構成した周波数
シンセサイザ部の変調回路を提供することにある。
（問題点を解決するための手段）
本発明による周波数シンセサイザ部の変調回路は、電圧
制御発振器と、第１の抵抗器と、電界効果トランジスタ
と、第２および第３の抵抗器とを具備して構成したもの
である。
制御発振器と、第１の抵抗器と、電界効果トランジスタ
と、第２および第３の抵抗器とを具備して構成したもの
である。
電圧制御発振器は、制御電圧によって発振電圧を変化さ
せることができるものである。
せることができるものである。
第１の抵抗器は、電圧制御発振器の制御電圧入力端子に
接続されたものである。
接続されたものである。
電界効果トランジスタは、電圧制御発振器の制御電圧出
力端子にゲートが接続され、ソースがあらかじめ設定さ
れた共通電位点に接続されたものである。
力端子にゲートが接続され、ソースがあらかじめ設定さ
れた共通電位点に接続されたものである。
第２の抵抗器は、電界効果トランジスタのドレーンを制
御電圧入力端子に接続するだめのものである。
御電圧入力端子に接続するだめのものである。
第３の抵抗器は、制御電圧入力端子と外部変調信号入力
端子との間に接続されたものである。
端子との間に接続されたものである。
（実施例）
次に、本発明について図面を参照して詳細に説明する。
第４図は、本発明による周波数シンセサイザ部の変調回
路における第１の実施例を示すブロック図である。第１
図において、１は電圧制御発振器、２は分局器、８〜１
０はそれぞれ抵抗器、１１は電界効果トランジスタであ
る。
路における第１の実施例を示すブロック図である。第１
図において、１は電圧制御発振器、２は分局器、８〜１
０はそれぞれ抵抗器、１１は電界効果トランジスタであ
る。
電界効果トランジスタ１１のゲートと電圧制御発振器１
の発振周波数制御電圧入力端子とが接続されている。
の発振周波数制御電圧入力端子とが接続されている。
第２図は、電圧制御発振器１の制御電圧（ＶＡＰＣ）に
対する発振周波数の変化の一例を示す説明図である。
対する発振周波数の変化の一例を示す説明図である。
第３図は、制御電圧（ＶＡＰＣ）に対する変調感度の一
例を示す説明図である。
例を示す説明図である。
第４図は、電界効果トランジスタ１１のゲートとソース
との間の電圧（ＶＧＳ）Ｉｃ対するドレーンとソースと
の間の抵抗（ＲＤＳ）の変化の一例を示す説明図である
。抵抗器８〜１０を適当に選び、第３図に示すような変
調感度の変化を打消すようにすれば電圧制御発振器１の
発振周波数に対する変調感度は第５図に示すようＫｉｔ
ぼ一定になる。
との間の電圧（ＶＧＳ）Ｉｃ対するドレーンとソースと
の間の抵抗（ＲＤＳ）の変化の一例を示す説明図である
。抵抗器８〜１０を適当に選び、第３図に示すような変
調感度の変化を打消すようにすれば電圧制御発振器１の
発振周波数に対する変調感度は第５図に示すようＫｉｔ
ぼ一定になる。
電圧制御発振器１の制御電圧（ＶＡＰＣ）Ｋより変調信
号のレベルを可変する時に、可変範囲が狭いならば、あ
らかじめ電界効果トランジスタ１１のソースに直流バイ
アスを与えて大きくしておけばよい。すなわち、電界効
果トランジスタ１１のゲートとソースとの間の電圧（Ｖ
Ｑ３）を第４図に示すように、Ｖ、−Ｖ、からＶ、〜Ｖ
、 Ｉｃ低下させればドレーンとソースとの間の抵抗（
Ｒ１）３）の変化を急峻にさせることができるので、変
調信号のレベルの可変範囲を大きくすることができるわ
けである。
号のレベルを可変する時に、可変範囲が狭いならば、あ
らかじめ電界効果トランジスタ１１のソースに直流バイ
アスを与えて大きくしておけばよい。すなわち、電界効
果トランジスタ１１のゲートとソースとの間の電圧（Ｖ
Ｑ３）を第４図に示すように、Ｖ、−Ｖ、からＶ、〜Ｖ
、 Ｉｃ低下させればドレーンとソースとの間の抵抗（
Ｒ１）３）の変化を急峻にさせることができるので、変
調信号のレベルの可変範囲を大きくすることができるわ
けである。
第６図は、上記考察にもとづいて構成した本発明の第２
の実施例を示すブロック図である。第６図において、第
１図と同様な要素には同様な記号が付しである。また、
１２．１３はそれぞれ抵抗器、１４はバイパス用のコン
デンサである。
の実施例を示すブロック図である。第６図において、第
１図と同様な要素には同様な記号が付しである。また、
１２．１３はそれぞれ抵抗器、１４はバイパス用のコン
デンサである。
第７図は、第６図に示すシンセサイザ部の変調回路にお
ける変調感度特性を示す説明図である。
ける変調感度特性を示す説明図である。
次に、電圧制御発振器１０制御電圧（ＶＡＰＣ，）に対
する変調度の変化が第３図とは逆の関係を満足するよう
になっている場合には、電圧制御発振器１の制御電圧出
力端子と電界効果トランジスタ１１との間にインバータ
を挿入して構成することにより変調感度を一定にするこ
とができる。
する変調度の変化が第３図とは逆の関係を満足するよう
になっている場合には、電圧制御発振器１の制御電圧出
力端子と電界効果トランジスタ１１との間にインバータ
を挿入して構成することにより変調感度を一定にするこ
とができる。
（発明の効果）
本発明は以上説明したように、発振周波数制御電圧（Ｖ
ＡＰＣ）を電界効果トランジスタを介して帰還し、変調
信号と共に電圧制御発振器に加えて発振周波数を制御す
ることによシ、外部から制御電圧を加えなくても内部で
変調感度を調整でき、またＭＯ３集積回路を採用すれば
回路構成が簡略化されるという効果がある。
ＡＰＣ）を電界効果トランジスタを介して帰還し、変調
信号と共に電圧制御発振器に加えて発振周波数を制御す
ることによシ、外部から制御電圧を加えなくても内部で
変調感度を調整でき、またＭＯ３集積回路を採用すれば
回路構成が簡略化されるという効果がある。
第１図は、本発明による周波数シンセサイザ部の変調回
路における第１の実施例を示すブロック図である。 第２図、第３図、および第５図は、それぞれ第１図に示
す変調回路の変調感度特性を示す説明図である。 第４図は、第１図に使用する電界効果トランジスタのド
レーン・ソース間抵抗を示す説明図である。 第６図は、本発明による周波数シンセサイザ部の変調回
路における第２の実施例を示すブロック図である。 第７図は、第６図に示す変調回路の変調感度特性を示す
説明図である。 第３図は、従来技術による周波数シンセサイザ部の変調
回路の実例を示すブロック図である。 第９図、および第１０図は、第３図に示す変調回路の変
調感度特性を示す説明図である。 １・・・電圧制御発振器 ２・・・分局器 ３・・・アナログスイッチ ４〜１０．１２．１３・・・抵抗器 １１・＠−電界効果トランジスタ １４・・・コンデンサ
路における第１の実施例を示すブロック図である。 第２図、第３図、および第５図は、それぞれ第１図に示
す変調回路の変調感度特性を示す説明図である。 第４図は、第１図に使用する電界効果トランジスタのド
レーン・ソース間抵抗を示す説明図である。 第６図は、本発明による周波数シンセサイザ部の変調回
路における第２の実施例を示すブロック図である。 第７図は、第６図に示す変調回路の変調感度特性を示す
説明図である。 第３図は、従来技術による周波数シンセサイザ部の変調
回路の実例を示すブロック図である。 第９図、および第１０図は、第３図に示す変調回路の変
調感度特性を示す説明図である。 １・・・電圧制御発振器 ２・・・分局器 ３・・・アナログスイッチ ４〜１０．１２．１３・・・抵抗器 １１・＠−電界効果トランジスタ １４・・・コンデンサ
Claims (1)
- 制御電圧によつて発振電圧を変化させることができる電
圧制御発振器と、前記電圧制御発振器の制御電圧入力端
子に接続された第１の抵抗器と、前記電圧制御発振器の
制御電圧出力端子にゲートが接続されソースがあらかじ
め設定された共通電位点に接続された電界効果トランジ
スタと、前記電界効果トランジスタのドレーンを前記制
御電圧入力端子に接続するための第２の抵抗器と、前記
制御電圧入力端子と外部変調信号入力端子との間に接続
された第３の抵抗器とを具備して構成したことを特徴と
する周波数シンセサイザ部の変調回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP130485A JPS61161006A (ja) | 1985-01-08 | 1985-01-08 | 変調回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP130485A JPS61161006A (ja) | 1985-01-08 | 1985-01-08 | 変調回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61161006A true JPS61161006A (ja) | 1986-07-21 |
Family
ID=11497741
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP130485A Pending JPS61161006A (ja) | 1985-01-08 | 1985-01-08 | 変調回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61161006A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6372204A (ja) * | 1986-09-12 | 1988-04-01 | Matsushita Electric Ind Co Ltd | 電圧制御発振器の変調感度補正回路 |
| JPH0250606A (ja) * | 1988-08-12 | 1990-02-20 | Nec Corp | 周波数シンセサイザ |
| JPH02113421U (ja) * | 1989-02-28 | 1990-09-11 |
-
1985
- 1985-01-08 JP JP130485A patent/JPS61161006A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6372204A (ja) * | 1986-09-12 | 1988-04-01 | Matsushita Electric Ind Co Ltd | 電圧制御発振器の変調感度補正回路 |
| JPH0250606A (ja) * | 1988-08-12 | 1990-02-20 | Nec Corp | 周波数シンセサイザ |
| JPH02113421U (ja) * | 1989-02-28 | 1990-09-11 | ||
| JPH0540571Y2 (ja) * | 1989-02-28 | 1993-10-14 |
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