JPH023920A - エッチング方法 - Google Patents
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- JPH023920A JPH023920A JP63335737A JP33573788A JPH023920A JP H023920 A JPH023920 A JP H023920A JP 63335737 A JP63335737 A JP 63335737A JP 33573788 A JP33573788 A JP 33573788A JP H023920 A JPH023920 A JP H023920A
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-
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B41/00—Electrically erasable-and-programmable ROM [EEPROM] devices comprising floating gates
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
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- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31105—Etching inorganic layers
- H01L21/31111—Etching inorganic layers by chemical means
- H01L21/31116—Etching inorganic layers by chemical means by dry-etching
-
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はMOS装置をエツチングおよび洗浄する方法の
分野に関するものであり、更に詳しくいえば、MOS装
置をプラズマエツチングし、化学的に湿式洗浄する分野
に関するものである。
分野に関するものであり、更に詳しくいえば、MOS装
置をプラズマエツチングし、化学的に湿式洗浄する分野
に関するものである。
MOS装置のエツチング方法の分野においては、いくつ
かの方法が知られている。各方法にはそれぞれ利点およ
び欠点がある。本発明の目的は、終点を制御することに
より、得られたシリコン基板表面に高品質および完全性
の高いMOSゲート酸化物を生ずる、5i02 、 S
i3N4およびオキシニドリッド(oxynftrid
e )化合物のエツチングを行えるようにするフォトレ
ジストマスキングに適合する方法を得ることである。更
に、その方法を用いた時に妥当な生産性を達成すること
が望まれる。
かの方法が知られている。各方法にはそれぞれ利点およ
び欠点がある。本発明の目的は、終点を制御することに
より、得られたシリコン基板表面に高品質および完全性
の高いMOSゲート酸化物を生ずる、5i02 、 S
i3N4およびオキシニドリッド(oxynftrid
e )化合物のエツチングを行えるようにするフォトレ
ジストマスキングに適合する方法を得ることである。更
に、その方法を用いた時に妥当な生産性を達成すること
が望まれる。
半導体薄膜および誘電体をエツチングする1つの公知方
法は湿式エツチング法である。この方法の利点の1つは
生産性が比較的高いことである。
法は湿式エツチング法である。この方法の利点の1つは
生産性が比較的高いことである。
しかし、この方法は方法が等方性であるために重要な寸
法を精密に制御することができないことである。更に、
この方法では、得られた表面上で成長する酸化物の完全
性に影響を及ぼすことがある化学残渣が残ることである
。
法を精密に制御することができないことである。更に、
この方法では、得られた表面上で成長する酸化物の完全
性に影響を及ぼすことがある化学残渣が残ることである
。
半導体の処理に用いられる第2の良く知られているエツ
チング法は、大電力プラズマエツチングである。このプ
ラズマエツチング法は異方性エツチングを行うことがで
き、生産性も比較的高い。
チング法は、大電力プラズマエツチングである。このプ
ラズマエツチング法は異方性エツチングを行うことがで
き、生産性も比較的高い。
しかし、大電力プラズマエツチングを用いると注入され
た種、格子欠陥およびエツチングされた表面における位
置のずれのような、イオンの照射によpひき起される損
傷を生ずる結果となる。
た種、格子欠陥およびエツチングされた表面における位
置のずれのような、イオンの照射によpひき起される損
傷を生ずる結果となる。
半導体をエツチングする別の公知方法は、小電力プラズ
マエツチングを用いる方法である。この方法では大電力
プラズマエツチング法で見られるようなイオン照射によ
りひき起される小電力プラズマエツチング法は処理時間
が長くなり、そのために生産性が低いことが欠点である
。
マエツチングを用いる方法である。この方法では大電力
プラズマエツチング法で見られるようなイオン照射によ
りひき起される小電力プラズマエツチング法は処理時間
が長くなり、そのために生産性が低いことが欠点である
。
最後に、大電力プラズマエツチング法と、それに続いて
、イオン照射によυひき起された損傷を無くして、精密
な寸法をある程度制御できるようにするために湿式エツ
チングを行う方法が知られている。この方法は工程数が
増し、複雑であり、かつエツチングされた表面に化学残
渣が残ることがある。
、イオン照射によυひき起された損傷を無くして、精密
な寸法をある程度制御できるようにするために湿式エツ
チングを行う方法が知られている。この方法は工程数が
増し、複雑であり、かつエツチングされた表面に化学残
渣が残ることがある。
この明細書においては、多段電力低減法およびそれに続
く、得られた表面の洗浄を用いるMOS装置をエツチン
グする方法を開示するものである。
く、得られた表面の洗浄を用いるMOS装置をエツチン
グする方法を開示するものである。
この方法により、欠陥レベルが低い高品質の薄いゲート
酸化物を成長させることができる表面が得られる。この
方法は、そのような乾式エツチングが異方性を有するた
めに重要な寸法を精密に制御できるプラズマエツチング
を用いる。イオン照射による損傷は多段電力低減法の使
用により減少する。
酸化物を成長させることができる表面が得られる。この
方法は、そのような乾式エツチングが異方性を有するた
めに重要な寸法を精密に制御できるプラズマエツチング
を用いる。イオン照射による損傷は多段電力低減法の使
用により減少する。
エツチングの後で洗浄することは、欠陥密度が低い酸化
物を成長させる表面を生じさせるのに極めて重要である
ことも開示されている。好適な実施例は、アールシーニ
ー(RCA、規格の洗浄法を修正した洗浄法の後に硫黄
洗浄法を用いる。RCA規格洗浄法はアールシーニー・
Aエンジニャ(RCA Engineer ) 28−
4巻、1983年7/8月号、99〜105ページ所載
の[ハイドロゲン・パーオキサイド・ソリューションズ
・フォー・シリコン・ウェハー書クリーニング(Hyd
rogen PeroxydeSolutions f
or 5ilicon+Wafer Cleaning
) jと題するダブリュー・カーノ(W、Kern)
の論文に記載されている。
物を成長させる表面を生じさせるのに極めて重要である
ことも開示されている。好適な実施例は、アールシーニ
ー(RCA、規格の洗浄法を修正した洗浄法の後に硫黄
洗浄法を用いる。RCA規格洗浄法はアールシーニー・
Aエンジニャ(RCA Engineer ) 28−
4巻、1983年7/8月号、99〜105ページ所載
の[ハイドロゲン・パーオキサイド・ソリューションズ
・フォー・シリコン・ウェハー書クリーニング(Hyd
rogen PeroxydeSolutions f
or 5ilicon+Wafer Cleaning
) jと題するダブリュー・カーノ(W、Kern)
の論文に記載されている。
この明細書において開示する、洗浄法に組合わされた多
段電力低減法は、欠陥密度が零に近い薄い酸化物を成長
させる表面を形成できることが見出されている。また、
それらの酸化物の誘電体降伏強度は従来の方法を用いて
得られる誘電体降伏強度に匹敵する。このエツチング法
は薄い窒化物層、薄い酸化物層および薄い酸化物−窒化
物−酸fヒ物層を含む各種の薄膜に適用できる。また、
本発明は単一エツチング剤またはバッチエツチングにお
いて利用できる。単一ウニバーエツチングはバッチエツ
チングよりも高い電力密度で行うことができるために、
単一ウニバーエツチングにおいては一層劇的な結果を見
ることができる。
段電力低減法は、欠陥密度が零に近い薄い酸化物を成長
させる表面を形成できることが見出されている。また、
それらの酸化物の誘電体降伏強度は従来の方法を用いて
得られる誘電体降伏強度に匹敵する。このエツチング法
は薄い窒化物層、薄い酸化物層および薄い酸化物−窒化
物−酸fヒ物層を含む各種の薄膜に適用できる。また、
本発明は単一エツチング剤またはバッチエツチングにお
いて利用できる。単一ウニバーエツチングはバッチエツ
チングよりも高い電力密度で行うことができるために、
単一ウニバーエツチングにおいては一層劇的な結果を見
ることができる。
以下、図面を参照して本発明の詳細な説明する。
この明細書においては、イオン照射による損傷を減少さ
せるために、多段電力低減プラズマエツチング法を利用
して金属−酸化物一半導体(MOS)装置をエツチング
する方法について説明する。本発明を完全に理解できる
ようにするために、以下の説明においては、ガス圧、電
力レベル等のような特定の事項の詳細について数多く述
べている。
せるために、多段電力低減プラズマエツチング法を利用
して金属−酸化物一半導体(MOS)装置をエツチング
する方法について説明する。本発明を完全に理解できる
ようにするために、以下の説明においては、ガス圧、電
力レベル等のような特定の事項の詳細について数多く述
べている。
しかし、そのような特定の詳細事項なしに本発明を実施
できることが当業者には明らかであろう。
できることが当業者には明らかであろう。
その他の場合には、本発明を不必要に詳しく説明して本
発明をあいまいにしないようにするために、周知の処理
工程は説明しない。
発明をあいまいにしないようにするために、周知の処理
工程は説明しない。
金属−酸化物一半導体(MOS)装置の処理においては
、薄い窒化物のエツチング、薄い酸化物のエツチングお
よび酸化物−窒化物一酸化物(ONO)エツチングを含
めて、いくつかの種類のプリゲート誘電体エツチングが
ある。
、薄い窒化物のエツチング、薄い酸化物のエツチングお
よび酸化物−窒化物一酸化物(ONO)エツチングを含
めて、いくつかの種類のプリゲート誘電体エツチングが
ある。
従来のやり方では、薄い酸化物をエツチングするために
フッ酸(HF)のような湿式エツチング剤が用いられる
。しかし、ある場合には、プリゲート表面を用意するた
めにプラズマエツチングを全面的に、または部分的に用
いることが必要であり、または望ましい。しかし、プラ
ズマエツチングではイオン照射を用いるが、イオン照射
により、ゲート酸化物が成長する活性領域に基板格子が
損傷を受ける。この問題は激しく変化するが、バッチエ
ツチングよシ高い電力密度で行われる単一ウニバーエツ
チングにおいては一層厳しくなることがちる。ウェハー
をエツチングするために用いられる電力を減少すると、
イオン照射によりひき起される損傷が減少することが判
明している。しかしそのような低電力エツチング法はウ
ェハーの生産性が低いことが欠点である。プラズマエツ
チングでは表面が汚染されることがあり、とくに、アル
ミニウム、鉄、ニッケル、クロムのような金属が汚染さ
れる。
フッ酸(HF)のような湿式エツチング剤が用いられる
。しかし、ある場合には、プリゲート表面を用意するた
めにプラズマエツチングを全面的に、または部分的に用
いることが必要であり、または望ましい。しかし、プラ
ズマエツチングではイオン照射を用いるが、イオン照射
により、ゲート酸化物が成長する活性領域に基板格子が
損傷を受ける。この問題は激しく変化するが、バッチエ
ツチングよシ高い電力密度で行われる単一ウニバーエツ
チングにおいては一層厳しくなることがちる。ウェハー
をエツチングするために用いられる電力を減少すると、
イオン照射によりひき起される損傷が減少することが判
明している。しかしそのような低電力エツチング法はウ
ェハーの生産性が低いことが欠点である。プラズマエツ
チングでは表面が汚染されることがあり、とくに、アル
ミニウム、鉄、ニッケル、クロムのような金属が汚染さ
れる。
本発明は、イオン照射による損傷の問題を、電力低減傾
斜法を用いることにより解決するものである。それによ
り、プリゲート薄膜の上側部分が比較的高い電力で短時
間でエツチングされる。次にブリゲート薄膜の下側部分
をエツチングする時、および基板表面をオーバーエツチ
ング(over et−ching )する間に電力を
低減させる。単一工程低電力エツチング法と比較してこ
の多段電力低減プラズマエツチング法を用いるとウェハ
ー製造の生産性を高くできる。
斜法を用いることにより解決するものである。それによ
り、プリゲート薄膜の上側部分が比較的高い電力で短時
間でエツチングされる。次にブリゲート薄膜の下側部分
をエツチングする時、および基板表面をオーバーエツチ
ング(over et−ching )する間に電力を
低減させる。単一工程低電力エツチング法と比較してこ
の多段電力低減プラズマエツチング法を用いるとウェハ
ー製造の生産性を高くできる。
エツチングされた表面の品質/清浄さを向上させる第2
の要因は、プラズマエツチングの後で行う清浄工程にち
ることが判明した。適切な清浄法を用いると、エツチン
グ法と少くとも同程度の効果がある。本発明は、有機物
および金属性の汚染物質の除去、および誘電体として高
い完全性を持ち、欠陥密度が零に近いゲート酸化物を成
長させることが可能である表面を残すのに有効である標
準的なRCA清浄法を修正したものを用いるものである
。
の要因は、プラズマエツチングの後で行う清浄工程にち
ることが判明した。適切な清浄法を用いると、エツチン
グ法と少くとも同程度の効果がある。本発明は、有機物
および金属性の汚染物質の除去、および誘電体として高
い完全性を持ち、欠陥密度が零に近いゲート酸化物を成
長させることが可能である表面を残すのに有効である標
準的なRCA清浄法を修正したものを用いるものである
。
先に説明したように、本発明の1つの応用例は、基板表
面に損傷を与えることなしに、酸化物−窒化物一酸化物
(ONO)層を除去することである。
面に損傷を与えることなしに、酸化物−窒化物一酸化物
(ONO)層を除去することである。
本発明をそのようなONO層の除去をとくに対象として
説明することにする。本発明の方法は薄い酸化物および
薄い窒化物のような他の層の除去にも等しく応用できる
。
説明することにする。本発明の方法は薄い酸化物および
薄い窒化物のような他の層の除去にも等しく応用できる
。
まず第1図を参照する。この図には、インターボリイ(
1nterpoly )誘電体応用のためのHMO8不
揮発性メモリ技術において一般に用いられる複合ONO
誘電体層3が示されている。そのONO層3は第1の5
i02層7と、5i3N413と、第2の5j02層9
とで典型的に構成される。第1図に示すように、従来の
フォトリングラフィ技術によりポリシリコン層2のパタ
ーンが形成されて、ポリシリコン層2と、ONO誘電体
層3と、ポリシリコン層4との自動位置合わせされたM
OS (SAMO8)エツチングを行う。酸化物層5が
シリコン基板6内へのエツチングを阻止するエツチング
停止層として機能する。
1nterpoly )誘電体応用のためのHMO8不
揮発性メモリ技術において一般に用いられる複合ONO
誘電体層3が示されている。そのONO層3は第1の5
i02層7と、5i3N413と、第2の5j02層9
とで典型的に構成される。第1図に示すように、従来の
フォトリングラフィ技術によりポリシリコン層2のパタ
ーンが形成されて、ポリシリコン層2と、ONO誘電体
層3と、ポリシリコン層4との自動位置合わせされたM
OS (SAMO8)エツチングを行う。酸化物層5が
シリコン基板6内へのエツチングを阻止するエツチング
停止層として機能する。
ある技術においては、ONO誘電体層3を形成した結果
として、活性拡散領域の上(すなわち、シリコン基板6
の上に直接)ONO誘電体層が形成されることを阻止す
ることは避けられないかもしれない。その場合には、後
で行うMO8装置の処理(たとえば、ゲート酸化、ポリ
シリコン層の付着等)を容易にするために、活性拡散領
域上の望ましくないONO誘電体層3を除去することが
必要であるかもしれない。
として、活性拡散領域の上(すなわち、シリコン基板6
の上に直接)ONO誘電体層が形成されることを阻止す
ることは避けられないかもしれない。その場合には、後
で行うMO8装置の処理(たとえば、ゲート酸化、ポリ
シリコン層の付着等)を容易にするために、活性拡散領
域上の望ましくないONO誘電体層3を除去することが
必要であるかもしれない。
次に、フォトレジストマスキング13が施されているO
NO誘電体層10が示されている第2図を参照する。こ
のONO誘電体層11j活性拡散領域に接触する(すな
わち、シリコン基板11に直接接触する)。活性領域か
ら望ましくないONO誘電体層10を除去することが望
ましい。
NO誘電体層10が示されている第2図を参照する。こ
のONO誘電体層11j活性拡散領域に接触する(すな
わち、シリコン基板11に直接接触する)。活性領域か
ら望ましくないONO誘電体層10を除去することが望
ましい。
先に説明したように、領域12からONO誘電体層10
を除去することはいくつかの制約によυ禁止される。第
1に、エツチング法は従来のフォトレジスト処理に適合
できなければならない。この制約により、LPCVD窒
化物層を除去するために最も一般的に用いられている湿
式エツチング剤である、高温のりん酸の使用が禁止され
る。第2に、ONOエツチング法は、得られるンリコン
表面の固有の表面品質を保持せねばならない。
を除去することはいくつかの制約によυ禁止される。第
1に、エツチング法は従来のフォトレジスト処理に適合
できなければならない。この制約により、LPCVD窒
化物層を除去するために最も一般的に用いられている湿
式エツチング剤である、高温のりん酸の使用が禁止され
る。第2に、ONOエツチング法は、得られるンリコン
表面の固有の表面品質を保持せねばならない。
一般に、本発明は、シリコン基板11が受ける損傷を減
少させるために、しだいに低減される一連の電力レベル
を用いて、ONO誘電体層10をエツチングし、シリコ
ン基板11内にオーバーエツチングするエツチング法を
開示するものである。
少させるために、しだいに低減される一連の電力レベル
を用いて、ONO誘電体層10をエツチングし、シリコ
ン基板11内にオーバーエツチングするエツチング法を
開示するものである。
効果が異なる数多くの電力低減法が試験された。
そのような電力低減法の目的は妥当な生産性を維持し、
イオン照射によpひき起された基板表面の損傷を減少す
ることである。
イオン照射によpひき起された基板表面の損傷を減少す
ることである。
本発明の一実施例は電極間隔を調整できるようにして、
時間プラズマエツチングに1枚のウェハーを利用するも
のである。この場合には、第1の電力レベルは約275
ワットで、圧力が600mT、間隙が約0.3 Cm、
C2F 6の流量が約125SCCM fある。OH
2層の上側レベルをエツチングした後で、電力レベルを
約150ワットまで低減し、基板11の内部へのオーバ
ーエツチングが行われるまでエツチングを続ける。
時間プラズマエツチングに1枚のウェハーを利用するも
のである。この場合には、第1の電力レベルは約275
ワットで、圧力が600mT、間隙が約0.3 Cm、
C2F 6の流量が約125SCCM fある。OH
2層の上側レベルをエツチングした後で、電力レベルを
約150ワットまで低減し、基板11の内部へのオーバ
ーエツチングが行われるまでエツチングを続ける。
275ワットから始まって150ワット、lOOワット
、最後に75ワットまでの連続する4つの電力レベルを
用いる電力低減法を含むものである。この電力低減法に
より酸化物の欠陥密度が僅かに低くなる。しかし、生産
性も低下する。この方法は好適な方法である。
、最後に75ワットまでの連続する4つの電力レベルを
用いる電力低減法を含むものである。この電力低減法に
より酸化物の欠陥密度が僅かに低くなる。しかし、生産
性も低下する。この方法は好適な方法である。
このエツチング法によp ONO層10を除去した後で
、表面を清浄にする。この好適な方法の清浄法ハ、標準
的なバレル型アッシャ−(1)arrel ty−pe
asher )内での酸素(02)中の30分間のプ
ラズマアッシュ(ash )と、その後に行われる硫黄
洗浄法/過酸化物清浄、ビランハ清浄(piranha
clean)としても知られている、清浄法を利用す
る。この清浄工程の次に、RCA規格清浄サイクルを修
正したものを用いる。前記したように、RCA規格清浄
サイクル、SC1およびSC2はこの分野において良く
知られている。それらのサイクルについては、たとえば
、前記RCAエンジニャ誌に記載されている。
、表面を清浄にする。この好適な方法の清浄法ハ、標準
的なバレル型アッシャ−(1)arrel ty−pe
asher )内での酸素(02)中の30分間のプ
ラズマアッシュ(ash )と、その後に行われる硫黄
洗浄法/過酸化物清浄、ビランハ清浄(piranha
clean)としても知られている、清浄法を利用す
る。この清浄工程の次に、RCA規格清浄サイクルを修
正したものを用いる。前記したように、RCA規格清浄
サイクル、SC1およびSC2はこの分野において良く
知られている。それらのサイクルについては、たとえば
、前記RCAエンジニャ誌に記載されている。
その規格清浄1サイクル(scl)は、水(H2O)と
、水酸化アンモニウム(NH4OH)と、過酸化水素(
H20□)との約75〜80℃の温度における溶液中で
の有機不純物の酸化の促進と、基板表面への溶解を促進
させるために構成されたものである。規格清浄2サイク
ル(SC2)は水(H2O)と、塩酸(HCt)、過酸
化水素(H2O2) との約75〜80℃の温度にお
ける溶液中に溶解させるために構成されたものである。
、水酸化アンモニウム(NH4OH)と、過酸化水素(
H20□)との約75〜80℃の温度における溶液中で
の有機不純物の酸化の促進と、基板表面への溶解を促進
させるために構成されたものである。規格清浄2サイク
ル(SC2)は水(H2O)と、塩酸(HCt)、過酸
化水素(H2O2) との約75〜80℃の温度にお
ける溶液中に溶解させるために構成されたものである。
本発明の好適な実施例は、溶液を高周波攪拌する超音波
浴槽中で常温(典型的には20〜40℃)でそれらの溶
液を利用する。
浴槽中で常温(典型的には20〜40℃)でそれらの溶
液を利用する。
本発明は単一ウニバーエツチングまたはパッチエツチン
グに利用できることが当業者には明らかであろう。更に
、本発明の利点は、以上の説明で示した特定の処理パラ
メータに限定されるものではなく、効果が異なる別の電
力低減法を利用することによυ得られることも明らかで
あろう。更に、欠陥が少く、妥当な生産性ゲート酸化物
を成長させたい場合に、各種の表面に本発明を適用でき
ることもわかる。
グに利用できることが当業者には明らかであろう。更に
、本発明の利点は、以上の説明で示した特定の処理パラ
メータに限定されるものではなく、効果が異なる別の電
力低減法を利用することによυ得られることも明らかで
あろう。更に、欠陥が少く、妥当な生産性ゲート酸化物
を成長させたい場合に、各種の表面に本発明を適用でき
ることもわかる。
以上、得られる基板表面にイオン照射によりひき起され
る損傷を減少するために電力低減法を用い、その後でプ
ラズマエツチングにより生じた金属汚染物質を除去し、
かつ欠陥密度が低く、誘電体の完全性が高いゲート酸化
物を成長させる清浄法とを用いて、金属−酸化物一半導
体(MOS)装置をプラズマエツチングする方法につい
て説明した。
る損傷を減少するために電力低減法を用い、その後でプ
ラズマエツチングにより生じた金属汚染物質を除去し、
かつ欠陥密度が低く、誘電体の完全性が高いゲート酸化
物を成長させる清浄法とを用いて、金属−酸化物一半導
体(MOS)装置をプラズマエツチングする方法につい
て説明した。
第1図および第2図は本発明の方法を用いてエツチング
できるMO3装置の種々の部分の横断面図である。 1.13・・・・フォトレジスト、2,4・・・・ポリ
シリコン層、3・・・・酸化物−窒化物−酸化物層、5
・・・・酸化物層、6.11・・・・シリコン基板。
できるMO3装置の種々の部分の横断面図である。 1.13・・・・フォトレジスト、2,4・・・・ポリ
シリコン層、3・・・・酸化物−窒化物−酸化物層、5
・・・・酸化物層、6.11・・・・シリコン基板。
Claims (3)
- (1)金属−酸化物−半導体(MOS)薄膜を電力レベ
ルでプラズマエッチングする工程と、 前記薄膜を前記第1の電力レベルより低い第2の電力レ
ベルでプラズマエッチングする工程と、を備えることを
特徴とする金属−酸化物−半導体薄膜をプリゲートエッ
チングする方法。 - (2)金属−酸化物−半導体(MOS)装置をプラズマ
エッチングでエッチングする工程を含む、金属−酸化物
−半導体(MOS)装置上で薄膜表面をプリゲートエッ
チングする方法において、 前記装置を約275ワットの第1の電力レベル、約60
0mTの圧力、約0.8cmの間隙、および約125S
CCMの流量でエッチングする工程と、 前記装置を約150ワットの第2の電力レベル、約60
0mTの圧力、約0.8cmの間隙、および約125S
CCMの流量でエッチングする工程と、前記基板の得ら
れた表面を水(H_2O)、水酸化アンモニウム(NH
_4OH)、および過酸化水素(H_2O_2)の第1
の溶液中で、約20〜40℃の温度において洗浄する工
程と、 前記基板表面を水(H_2O)、塩酸(HCl)、およ
び過酸化水素(H_2O_2)の溶液中で更に洗浄する
工程と、 を備えることを特徴とする金属−酸化物−半導体(MO
S)装置上で薄膜表面をプリゲートエッチングする方法
。 - (3)金属−酸化物−半導体(MOS)装置中の薄膜を
除去するために前記装置をエッチングする工程と、 得た表面を洗浄する工程と、 を備え、この洗浄工程は、 (a)第1の溶液中の第1の不純物群を酸化し、かつ溶
解させる工程と、 (b)第2の温度において第2の不純物群を溶解させる
工程と、 を備え、前記酸化は常温で行うことを特徴とする金属−
酸化物−半導体(MOS)装置内の薄膜をプラズマエッ
チングする方法。
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US07/147,450 US4808259A (en) | 1988-01-25 | 1988-01-25 | Plasma etching process for MOS circuit pregate etching utiliizing a multi-step power reduction recipe |
US147450 | 1988-01-25 |
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---|---|---|---|
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---|---|
JPH023920A true JPH023920A (ja) | 1990-01-09 |
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Family
ID=22521612
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---|---|---|---|
JP63335737A Expired - Fee Related JP3066593B2 (ja) | 1988-01-25 | 1988-12-30 | エッチング方法 |
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---|---|---|---|
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---|---|
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JP3683398B2 (ja) | 1997-12-22 | 2005-08-17 | 株式会社ルネサステクノロジ | 半導体集積回路及びその製造方法 |
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-
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- 1999-07-08 JP JP11194660A patent/JP2000036492A/ja active Pending
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