JPH0228933A - 半導体装置用バンプ - Google Patents
半導体装置用バンプInfo
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- JPH0228933A JPH0228933A JP63179932A JP17993288A JPH0228933A JP H0228933 A JPH0228933 A JP H0228933A JP 63179932 A JP63179932 A JP 63179932A JP 17993288 A JP17993288 A JP 17993288A JP H0228933 A JPH0228933 A JP H0228933A
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
Landscapes
- Electroplating Methods And Accessories (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置のバンプの形状に関するものである
。
。
本発明は半導体のバンプの形状をバンプ配列方向を短辺
とし、この方向と直角方向を長辺とする長方形の平面形
状とすることにより、バンプが高密度化しても、バンプ
密着強度を確保できるようにしたものである。
とし、この方向と直角方向を長辺とする長方形の平面形
状とすることにより、バンプが高密度化しても、バンプ
密着強度を確保できるようにしたものである。
従来、半導体装置のバンプの平面形状は第3図に示す様
に正方形が一般的であった。
に正方形が一般的であった。
しかしながら、このような形状においては、バンプが高
密度化し、バンプピッチが小さくなってくると、バンプ
平面形状も必然的に縮小され、それに伴い、バンプと電
極部の接合面積も小さくなりバンプ密着強度が低下する
という問題があり、半導体装の際、接合不良が発生しや
すいという問題もあった。
密度化し、バンプピッチが小さくなってくると、バンプ
平面形状も必然的に縮小され、それに伴い、バンプと電
極部の接合面積も小さくなりバンプ密着強度が低下する
という問題があり、半導体装の際、接合不良が発生しや
すいという問題もあった。
本発明はこのような問題を解決するためなされたもので
、バンプ平面形状をバンプ配列方向を短辺とし、これと
直交する方向を長辺とした長方形とした。
、バンプ平面形状をバンプ配列方向を短辺とし、これと
直交する方向を長辺とした長方形とした。
このような形状とすることにより、バンプが高密度化し
、バンプピッチが小さくなった場合においても長辺の長
さを調節することにより接合面積を大きくすることが出
来、密着強度の低下を防ぐことができる。
、バンプピッチが小さくなった場合においても長辺の長
さを調節することにより接合面積を大きくすることが出
来、密着強度の低下を防ぐことができる。
以下本発明の実施例について、図面に基づいて説明する
。
。
第1図は、本発明による半導体装置用バンプの一実施例
を示す概略図、第2図(al〜+d+は、本発明による
半導体装置用バンプの製造工程断面図である。
を示す概略図、第2図(al〜+d+は、本発明による
半導体装置用バンプの製造工程断面図である。
1は半導体ウェハであり、電子回路が形成され、更に、
バンド電極部としてのM電極部2が形成され、PSG膜
、シリコン窒化膜等に代表されるパシベーション膜3が
形成されている。該半導体ウェハl上全面に、下地と密
着性の良いクロム、チタン等のバリア膜4.及びめっき
性の良い金等のめっき用導電膜を順次形成する(第2図
(al) 。
バンド電極部としてのM電極部2が形成され、PSG膜
、シリコン窒化膜等に代表されるパシベーション膜3が
形成されている。該半導体ウェハl上全面に、下地と密
着性の良いクロム、チタン等のバリア膜4.及びめっき
性の良い金等のめっき用導電膜を順次形成する(第2図
(al) 。
該半導体ウェハl上に、フォトレジストによりバンプ形
成部のみ開口しためっきレジスト層を形成する(第2図
山))。
成部のみ開口しためっきレジスト層を形成する(第2図
山))。
この際、M電極部2及びパシベーション膜3開口部は、
バンプ配列方向(A!電極配列方向)を短辺とし、これ
と直交する方向を長辺とした長方形とした。同時に、バ
ンプ形成部も、前記長方形と同様な長方形の開口とした
。
バンプ配列方向(A!電極配列方向)を短辺とし、これ
と直交する方向を長辺とした長方形とした。同時に、バ
ンプ形成部も、前記長方形と同様な長方形の開口とした
。
次に、金バンプめっきを15〜30ミクロン行い、金バ
ンプ6を形成する(第2図(C))。
ンプ6を形成する(第2図(C))。
その後、めっきレジスト層6を除去し、前記バリア膜4
及びめっき用導電膜5を除去し、長方形の平面形状の金
バンプ7を有する半導体ウェハ1を作製した(第2図c
d))。
及びめっき用導電膜5を除去し、長方形の平面形状の金
バンプ7を有する半導体ウェハ1を作製した(第2図c
d))。
この金バンプにおいては、従来の正方形面形状の金バン
プと比較しても、製造性等は変わることなく、特に、第
1図に示す様に、バンプが高密度化しても、短辺の減少
を、長辺の増加により、バンプ密着強度の低下を防止す
ることができた。
プと比較しても、製造性等は変わることなく、特に、第
1図に示す様に、バンプが高密度化しても、短辺の減少
を、長辺の増加により、バンプ密着強度の低下を防止す
ることができた。
以上述べてきたように、本発明によれば金バンプ平面形
状を長方形とすることにより、バンプが高密度化し、バ
ンプ配列方向のバンブ長が短かくなっても、これと直交
方向のバンプ長を調節することにより、バンプ強度の低
下を防ぐことができる。
状を長方形とすることにより、バンプが高密度化し、バ
ンプ配列方向のバンブ長が短かくなっても、これと直交
方向のバンプ長を調節することにより、バンプ強度の低
下を防ぐことができる。
またこのようなバンプ形状としても、実装上は何ら問題
がなく、接合が可能であり、バンブ密着強度の低下が防
止できた分、実装不良の発生も低減することができる。
がなく、接合が可能であり、バンブ密着強度の低下が防
止できた分、実装不良の発生も低減することができる。
尚、バンプ形状を長方形とすることは、金バンプに限ら
ず、はんだバンプ、銀バンブなど地金属によるバンプに
応用しても同様な効果を得ることができる。
ず、はんだバンプ、銀バンブなど地金属によるバンプに
応用しても同様な効果を得ることができる。
さらに、長方形の長辺の長さは、バンプピッチにより短
辺がどのようになるかという点と、バンプ強度としてど
のくらい必要かという点から計算上合理的な値で設定で
きることは言うまでもない。
辺がどのようになるかという点と、バンプ強度としてど
のくらい必要かという点から計算上合理的な値で設定で
きることは言うまでもない。
である。
■ ・ ・
2 ・ ・
3 ・ ・
4 ・ ・
5 ・ ・
6 ・ ・
7 ・ ・
半導体ウェハ
M電極部
パシベーション膜
バリア膜
めっき用導電膜
めっき用レジスト層
金バンブ
以上
出願人 セイコー電子工業株式会社
代理人 弁理士 林 敬 之 助
第1図は本発明による半導体装置用バンプの一実施例を
示す概略図、第2図(al〜+dlは本発明による半導
体装置用バンプ製造工程断面図、第3図は従来技術によ
る半導体装置用バンプを示す概略図第1図 第3図 第2図
示す概略図、第2図(al〜+dlは本発明による半導
体装置用バンプ製造工程断面図、第3図は従来技術によ
る半導体装置用バンプを示す概略図第1図 第3図 第2図
Claims (1)
- 半導体装置のバンプの形状において、バンプ配列方向を
短辺とし、この方向と直角方向を長辺とする長方形の平
面形状としたことを特徴とする半導体装置用バンプ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63179932A JPH0228933A (ja) | 1988-07-19 | 1988-07-19 | 半導体装置用バンプ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63179932A JPH0228933A (ja) | 1988-07-19 | 1988-07-19 | 半導体装置用バンプ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH0228933A true JPH0228933A (ja) | 1990-01-31 |
Family
ID=16074452
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63179932A Pending JPH0228933A (ja) | 1988-07-19 | 1988-07-19 | 半導体装置用バンプ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0228933A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5473197A (en) * | 1993-05-28 | 1995-12-05 | Kabushiki Kaisha Toshiba | Semiconductor device having bump electrodes with a trapezoidal cross-section along one axis |
EP0918355A3 (en) * | 1997-11-24 | 2001-04-25 | Delphi Technologies, Inc. | Solder bump input/output pad for a surface mount circuit device |
-
1988
- 1988-07-19 JP JP63179932A patent/JPH0228933A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5473197A (en) * | 1993-05-28 | 1995-12-05 | Kabushiki Kaisha Toshiba | Semiconductor device having bump electrodes with a trapezoidal cross-section along one axis |
US5587337A (en) * | 1993-05-28 | 1996-12-24 | Kabushiki Kaisha Toshiba | Semiconductor process for forming bump electrodes with tapered sidewalls |
EP0918355A3 (en) * | 1997-11-24 | 2001-04-25 | Delphi Technologies, Inc. | Solder bump input/output pad for a surface mount circuit device |
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