JPH02287593A - ディスプレイの接続状態判別方式 - Google Patents

ディスプレイの接続状態判別方式

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JPH02287593A
JPH02287593A JP1110549A JP11054989A JPH02287593A JP H02287593 A JPH02287593 A JP H02287593A JP 1110549 A JP1110549 A JP 1110549A JP 11054989 A JP11054989 A JP 11054989A JP H02287593 A JPH02287593 A JP H02287593A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ［発明の目的］ （産業上の利用分野） この発明は、パーソナルコンピュータに用いて好適なデ
ィスプレイの接続状態判別方式に関する。
（従来の技術） ＣＲＴの接続状態を判別するためのハードウェアをサポ
ートしている表示制御システムにＶＧＡなるものがある
。ＶＧＡとは、ｖＩｄｅ。
ＧｒｎｐｈＣ８Ａｒｒａｙの略であり、高解像度、多色
同時表示を実現するディスプレイコントローラである。
上述したＶＧＡにおいて、ＣＲＴの接続状態はインプッ
トステータスレジスタ０と呼ばれるレジスタのビット４
に示され、ＣＲＴが接続されていると“１゛、接続され
ていないと　“０”で表現される。
インプットステータスレジスタ０のビット４は、表示期
間中しか正しい値を示さないためＣＲＴの接続状態を判
別する方法として、従来は表示期間であるかどうかをチ
エツクし、表示期間であると判断したならばインプット
ステータスレジスタ０をリードし、ビット４が“０”か
１′かでＣＲＴが接続されているかどうか判別していた
。
（発明が解決しようとする課題） ところが上記従来例によれば、表示期間は約２５ミリ秒
（ｍｓｅｃ）と短いため、ＣＰＵの処理速度が遅い場合
、表示期間であると判断してがらインプットステータス
レジスタＯをリードするまでの間に２５ナノ秒（ｎ　ｓ
ｅｅ　）以上かかつてしまい、その結果として非表示期
間中にインプットステータスレジスタ０をリードしてし
まい、ＣＲＴの接続状態を正しく判別できない等の問題
があった。
この発明は上記！１に情に鑑みてなされたものであり、
ＣＰＵの処理速度が遅くても、確実にディスプレイの接
続状態を判別することのできるデブレイの接続状態判別
方式を提供することを目的とする。
［発明の構成〕 （課題を解決するための手段） 本発明は、ディスプレイの接続状態をレジスタのある特
定ビットの内容を参照することにより判別出来る表示制
御システムにおいて、上記レジスタの特定ビットの内容
を無条件に一定回数読み、その結果有意とするデータが
何度読めるかカウントシ、そのカウント値がディスプレ
イが接続されていると判断するのに定る値か否か判断し
、ディスプレイの接続状態を判別することを特徴とする
。
（作　用） インプットステータスレジスタ０のビット４は、ＣＲＴ
が接続されていない場合は非表示期間中に示す直は不定
であるが、ＣＲＴが接続されている場合は表示期間に関
係なく常に１°を示す。本発明はこの特性を利用し、無
条件に一定回数インプットステータスレジスタ０をリー
ドし、一定回数リードした内、何回ビット４が“１”と
読めたかカウントすることにより、“１“と読めた回数
がＣＲＴが接続されていると判断するのに充分な回数以
上であるかどうか判別する。こうしてディスプレイの接
続状態の判別を実現する。
このことにより、ＣＰＵの処理速度が遅くても確実にＣ
ＲＴの接続状態が判別できる。また、ノイズによりイン
プットステータスレジスタ０の値が正しく読めないこと
があってもその影響をほとんど受けないため、システム
全体の信頼性が向上する。
（実施例） 以下、図面を使用して本発明の実施例について説明する
。
第１図は本発明の実施例を示すブロック図である。
図において、符号１１はＣＰＵであり、本発明における
ディスプレイ接続状態の判別を行う。符号１２はメモリ
であり、ＣＰＵＩＩが実行すべきディスプレイ接続状態
ｔ、ＩＩ別のためのプログラムを格納する。７１号１３
はインプットステータスレジスタ０であり、コネクタ１
４の出力ビンの電圧の状態をビット４に示す。符号１４
はコネクタであり、ＣＲＴ１５が接続されている場合、
出力ビンの電圧は下がり、ＣＲＴ１５が接続されていな
い場合出力ビンの電圧は上がる。符号１５はＣＲＴディ
スプレイであり、コネクタ１４に接続される。
第２図は本発明実施例の動作を示すフローチャートであ
る。比較対照のため、第３図に従来例を示す。図中、２
１はインプットステータスレジスタ０をリードするステ
ップであり、ＣＲＴが接続されているかどうかを示すス
テータスビットをリードする。２２はＣＲＴの接続状態
を判別するステップであり、インプットステータス０が
、ＣＲＴが接続されていると思われる値を示した場合は
ステップ２３の処理へ分岐する。２３はカウントをイン
クリメントするステップであり、インプットステータス
レジスタ０が、ＣＲＴが接続されていると思われる値を
何回示したかをカウントする。２４は繰返し数をチエツ
クするステップであり、インプットステータス０をリー
ドし、ＣＲＴが接続されているかどうか判別する処理を
“４００″（１１）回繰返すようにする。２５はＣＲＴ
の接続状態を判断するステップであり、“４００”（１
１）回申、“３ＦＥ”（１１）回置上インプットステー
タスレジスタＯが、ＣＲＴが接続されていると思われる
値を示した場合、ＣＲＴが接続されていると判断する。
以下、本発明実施例の動作について説明する。
まず、ＣＰＵＩＩは、インプットステータスレジスタ１
３をリードし、ビット４が１”かどうかを判１１ｉする
。“１”であればカウントをインクリメントし、′】１
と読めた回数をカウントする。
インプットステータスレジスタ１３のビット４が“１″
と読めるのは、ＣＲＴが接続されている時、あるいは、
ＣＲＴが接続されていない状態でかつ非表示期間の時で
ある。表示期間と非表示期間の割合は約５＝１であるか
ら、インプットステータスレジスタ１３をリードする処
理を“４００“（１１）回繰り返すようにすると（ステ
ップ２４）、ＣＲＴか接続されていない場合、“４００
″（ｌり×５．６回程度ビット４が“０“と読め、ＣＲ
Ｔが接続されている場合、ノイズによる読み誤りが起き
ることを含めても約“４００“（１１）回は“１”と読
める。従って４００　（Ｉ＋）回インプットステータス
レジスタ１３をリードしたうち、“３ＦＥ”（１１）同
以上ビット４が“１”と読めた場合にＣＲＴは接続され
ていると判断する。
”３ＦＥ”（１１）回を判定基準としたのは、ノイズに
よる読み間違いが起きる確率が非常に小さく、２回のマ
ージンで充分システムの信頼性を満足するからである。
尚、本発明実施例では接続されるディスプレイとしてＣ
ＲＴを例示したがこれに限られるものではなく、プラズ
マ、ＬＣＤ等フラットパネルタイプのものであって構わ
ない。
［発明の効果］ 以上説明のように本発明によれば、ＣＰＵの処理速度が
遅くても、確実にディスプレイの接続状態が判別できる
。また、ノイズによりインプットステータスレジスタＯ
の値が正しく読めないことがあってもその影響をほとん
ど受けないため、システム全体の信頼性が高い。
【図面の簡単な説明】
第１図は本発明の実施例を示すブロック図、第２図は本
発明実施例の動作を示すフローチャート、第３図は従来
例の動作を示すフローチャートである。 １１・・・ＣＰＵ、１２・・・メモリ、１３・・・イン
プットステータスレジスタ、１４・・・コネクタ、１５
・・・ＣＲＴディスプレイ。 第 図 第 図

Claims (1)

    【特許請求の範囲】
  1. ディスプレイの接続状態をレジスタのある特定ビットの
    内容を参照することにより判別出来る表示制御システム
    において、上記レジスタの特定ビットの内容を無条件に
    一定回数読み、その結果有意とするデータが何度読める
    かカウントし、そのカウント値からディスプレイの接続
    状態を判別することを特徴とするディスプレイ接続状態
    判別方式。
JP1110549A 1989-04-28 1989-04-28 ディスプレイの接続状態判別方式 Pending JPH02287593A (ja)

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