JPH0225574B2 - - Google Patents
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- Publication number
- JPH0225574B2 JPH0225574B2 JP58124437A JP12443783A JPH0225574B2 JP H0225574 B2 JPH0225574 B2 JP H0225574B2 JP 58124437 A JP58124437 A JP 58124437A JP 12443783 A JP12443783 A JP 12443783A JP H0225574 B2 JPH0225574 B2 JP H0225574B2
- Authority
- JP
- Japan
- Prior art keywords
- output
- read
- time
- counter
- frame synchronization
- Prior art date
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- Expired - Lifetime
Links
- 239000013078 crystal Substances 0.000 claims description 5
- 238000000034 method Methods 0.000 claims description 5
- 230000005540 biological transmission Effects 0.000 claims description 4
- 238000004891 communication Methods 0.000 claims description 3
- 230000008929 regeneration Effects 0.000 description 4
- 238000011069 regeneration method Methods 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 230000001360 synchronised effect Effects 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000011084 recovery Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/02—Details
- H04J3/06—Synchronising arrangements
- H04J3/062—Synchronisation of signals having the same nominal but fluctuating bit rates, e.g. using buffers
Landscapes
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
Description
〔発明の属する技術分野〕
本発明は、一つの親局とこれらの周りに散在す
る多数の子局とで構成されるマルチアクセス時分
割多方向多重通信方式（以下「TDMA方式」と
いう。）に関する。特に、子局が自局に割当てら
れたタイムスロツトの信号を送受する時刻の制御
に関する。 〔従来技術の説明〕 一般に、TDMA方式では親局と複数の子局と
の間の距離はそれぞれ異なるので、親局と子局と
の間の電波伝搬時間は一様ではない。このため、
親局では子局それぞれからの電波が時間的に重な
らないように、子局では親局送信信号内に含まれ
るフレーム同期信号に同期し、しかも遅延等価を
行つた上で送信する必要があることは公知の通り
である。子局が希望するタイムスロツトのみで送
受信を行うためには、１フレーム中の各タイムス
ロツトの時間位置を正しく知る必要がある。その
他、装置の内部処理のため、時間の流れに沿つて
発生させる必要のある制御信号はすべて親局から
放送されるフレーム同期信号に同期しなければな
らない。 従来、これら制御信号の時間関係を確保するた
めにカウンタを用いたタイマが使用されていた。
例えば第１図のように、各受信タイムスロツト
（TS0、TS1……）の始まり（t1、t2……）を示す
タイムスロツトパルス（TSパルス）を発生させ
る場合、第２図に示すようにカウンタ３とゲート
４，５，７，８，９などを組合せ希望する時間位
置を決めるように構成されていた。従つてタイム
スロツト（TS）の長さ（ａ、ｂ……）が１フレ
ームの中でまちまち例えばａ＞ｂの場合や、装置
の内部にて多種の制御信号を必要とする場合など
になると、回路は膨大になり複雑になるうえ時間
位置の変更などに対する柔軟性に欠ける欠点があ
つた。 〔発明の目的〕 本発明は、上記従来の問題点を解決するもので
あり、多種の制御信号をタイムスロツトの長さに
関係なく自由な時間位置で発生できるようにする
とともに、構成が簡単で、変更も簡単に行える新
しい時間軸発生方式を提供することを目的とす
る。 〔発明の特徴〕 本発明は、親局送信信号に含まれるフレーム同
期信号により同期がとれている子局のクロツク用
発振器の出力によりカウンタが進められ、かつフ
レーム同期信号により再スタートするカウンタ
と、前記カウンタの出力により順次記憶データが
読出されるリードオンリメモリ（ROM）によつ
て構成され、このROMにあらかじめ各制御信号
の時間位置を記憶させておき、このROMの記憶
内容を順次読出すことにより、単純な構成で多種
類の制御信号を１フレーム内の時間位置を自由に
出力することができ、かつROMを取り替えるか
あるいは書替えれば変更も簡単に行える時間軸発
生方式を提供するものである。 〔実施例による説明〕 本発明の実施例を第３図のブロツク構成図によ
つて説明する。親局から受信したデータは入力端
子１１を介してシフトレジスタ１４およびクロツ
ク再生回路１５に入力する。クロツク再生回路１
５の出力は上記シフトレジスタ１４のクロツク端
子に入力する。シフトレジスタ１４の複数の各段
出力は、それぞれ排他的論理和ゲート１３に入力
する。またフレーム同期用基準パターン発生器１
２の出力はそれぞれ上記排他的論理和ゲート１３
の他方の入力に接続される。一方水晶発振器１６
の出力は、分周器であるカウンタ１７に入力す
る。このカウンタ１７のリセツト入力Ｒおよび前
記排他的論理和１３の全出力はカウンタ１８のリ
セツト入力Ｒに入力する。またカウンタ１７の分
周出力は上記カウンタ１８とラツチ回路２０のク
ロツク端子に入力する。上記カウンタ１８の出力
はそれぞれリードオンリメモリ（ROM）１９の
アドレス入力に与えられ、その出力は上記ラツチ
回路２０の入力端子A0〜A4に入力し、その出力
端子D1〜D5は出力端子２１−（１〜５）に接続さ
れる。 次に第３図に示す回路の動作について説明す
る。端子１１からの入力データ列からクロツク再
生回路１５（例えばPLLなど）が再生したクロ
ツクで、シフトレジスタ１４に入力データが１ビ
ツトごとシフト入力され、排他的論理和ゲート１
３でフレーム同期用の基準パターン発生器１２と
パターン比較される。これが一致するとカウンタ
１８および１７をリセツトする。クロツク用水晶
発振器１６の出力を分周している分周カウンタ１
７は上記リセツトにより出力の位相に合わせられ
たことになり、その出力は時間的に見て次に同期
信号が親局から送られてくるまでの間は子局の基
準クロツクとなる。カウンタ１８はリセツト解除
されてからカウンタ１７の出力をクロツクとして
カウントアツプを始める。カウンタ１８の出力は
リードオンリメモリ（ROM）１９のアドレス端
子に接続され１クロツク毎に順次アドレスを更新
してゆく。ラツチ回路２０はクロツクの立上りま
たは立下りのエツジでROMの出力をラツチし、
カウンタ１８の出力変化時の不安定期間の上記リ
ードオンリメモリ（ROM）出力を出力端子２１
（１〜５）へ送信しないように構成される。カウ
ンタ１８によつてアドレス指定された上記リード
オンリメモリ（ROM）１９は指定された記憶エ
リアの内容を出力する。 第３図に示す本発明実施例の動作のタイムチヤ
ートを第４図に示す。また第４図の端子D0〜D4
の制御信号を送信するためのリードオンリメモリ
（ROM）１９の内容を表に示す。
る多数の子局とで構成されるマルチアクセス時分
割多方向多重通信方式（以下「TDMA方式」と
いう。）に関する。特に、子局が自局に割当てら
れたタイムスロツトの信号を送受する時刻の制御
に関する。 〔従来技術の説明〕 一般に、TDMA方式では親局と複数の子局と
の間の距離はそれぞれ異なるので、親局と子局と
の間の電波伝搬時間は一様ではない。このため、
親局では子局それぞれからの電波が時間的に重な
らないように、子局では親局送信信号内に含まれ
るフレーム同期信号に同期し、しかも遅延等価を
行つた上で送信する必要があることは公知の通り
である。子局が希望するタイムスロツトのみで送
受信を行うためには、１フレーム中の各タイムス
ロツトの時間位置を正しく知る必要がある。その
他、装置の内部処理のため、時間の流れに沿つて
発生させる必要のある制御信号はすべて親局から
放送されるフレーム同期信号に同期しなければな
らない。 従来、これら制御信号の時間関係を確保するた
めにカウンタを用いたタイマが使用されていた。
例えば第１図のように、各受信タイムスロツト
（TS0、TS1……）の始まり（t1、t2……）を示す
タイムスロツトパルス（TSパルス）を発生させ
る場合、第２図に示すようにカウンタ３とゲート
４，５，７，８，９などを組合せ希望する時間位
置を決めるように構成されていた。従つてタイム
スロツト（TS）の長さ（ａ、ｂ……）が１フレ
ームの中でまちまち例えばａ＞ｂの場合や、装置
の内部にて多種の制御信号を必要とする場合など
になると、回路は膨大になり複雑になるうえ時間
位置の変更などに対する柔軟性に欠ける欠点があ
つた。 〔発明の目的〕 本発明は、上記従来の問題点を解決するもので
あり、多種の制御信号をタイムスロツトの長さに
関係なく自由な時間位置で発生できるようにする
とともに、構成が簡単で、変更も簡単に行える新
しい時間軸発生方式を提供することを目的とす
る。 〔発明の特徴〕 本発明は、親局送信信号に含まれるフレーム同
期信号により同期がとれている子局のクロツク用
発振器の出力によりカウンタが進められ、かつフ
レーム同期信号により再スタートするカウンタ
と、前記カウンタの出力により順次記憶データが
読出されるリードオンリメモリ（ROM）によつ
て構成され、このROMにあらかじめ各制御信号
の時間位置を記憶させておき、このROMの記憶
内容を順次読出すことにより、単純な構成で多種
類の制御信号を１フレーム内の時間位置を自由に
出力することができ、かつROMを取り替えるか
あるいは書替えれば変更も簡単に行える時間軸発
生方式を提供するものである。 〔実施例による説明〕 本発明の実施例を第３図のブロツク構成図によ
つて説明する。親局から受信したデータは入力端
子１１を介してシフトレジスタ１４およびクロツ
ク再生回路１５に入力する。クロツク再生回路１
５の出力は上記シフトレジスタ１４のクロツク端
子に入力する。シフトレジスタ１４の複数の各段
出力は、それぞれ排他的論理和ゲート１３に入力
する。またフレーム同期用基準パターン発生器１
２の出力はそれぞれ上記排他的論理和ゲート１３
の他方の入力に接続される。一方水晶発振器１６
の出力は、分周器であるカウンタ１７に入力す
る。このカウンタ１７のリセツト入力Ｒおよび前
記排他的論理和１３の全出力はカウンタ１８のリ
セツト入力Ｒに入力する。またカウンタ１７の分
周出力は上記カウンタ１８とラツチ回路２０のク
ロツク端子に入力する。上記カウンタ１８の出力
はそれぞれリードオンリメモリ（ROM）１９の
アドレス入力に与えられ、その出力は上記ラツチ
回路２０の入力端子A0〜A4に入力し、その出力
端子D1〜D5は出力端子２１−（１〜５）に接続さ
れる。 次に第３図に示す回路の動作について説明す
る。端子１１からの入力データ列からクロツク再
生回路１５（例えばPLLなど）が再生したクロ
ツクで、シフトレジスタ１４に入力データが１ビ
ツトごとシフト入力され、排他的論理和ゲート１
３でフレーム同期用の基準パターン発生器１２と
パターン比較される。これが一致するとカウンタ
１８および１７をリセツトする。クロツク用水晶
発振器１６の出力を分周している分周カウンタ１
７は上記リセツトにより出力の位相に合わせられ
たことになり、その出力は時間的に見て次に同期
信号が親局から送られてくるまでの間は子局の基
準クロツクとなる。カウンタ１８はリセツト解除
されてからカウンタ１７の出力をクロツクとして
カウントアツプを始める。カウンタ１８の出力は
リードオンリメモリ（ROM）１９のアドレス端
子に接続され１クロツク毎に順次アドレスを更新
してゆく。ラツチ回路２０はクロツクの立上りま
たは立下りのエツジでROMの出力をラツチし、
カウンタ１８の出力変化時の不安定期間の上記リ
ードオンリメモリ（ROM）出力を出力端子２１
（１〜５）へ送信しないように構成される。カウ
ンタ１８によつてアドレス指定された上記リード
オンリメモリ（ROM）１９は指定された記憶エ
リアの内容を出力する。 第３図に示す本発明実施例の動作のタイムチヤ
ートを第４図に示す。また第４図の端子D0〜D4
の制御信号を送信するためのリードオンリメモリ
（ROM）１９の内容を表に示す。
【表】
以上のように、親局からの同期信号に同期して
カウントが進むカウンタとリードオンリメモリを
組合せることにより、多種の制御信号を自由な時
間間隔で出力させることが可能で新規な時間軸を
形成することができる。
カウントが進むカウンタとリードオンリメモリを
組合せることにより、多種の制御信号を自由な時
間間隔で出力させることが可能で新規な時間軸を
形成することができる。
第１図は従来から知られている受信タイムスロ
ツト、フレーム同期パルスおよびタイムスロツト
（TS）パルスのタイムチヤート。第２図は第１図
のタイムスロツト（TS）パルス発生用従来例装
置のブロツク構成図。第３図は本発明実施例装置
のブロツク構成図。第４図は本発明実施例装置の
各部分の信号タイムチヤート。 １……フレーム同期パルス入力端子、２……再
生クロツク入力端子、３……カウンタ、４，５，
８……アンドゲート、６……インバータ、７……
フリツプフロツプ、９……オアゲート、１１……
入力端子、１２……フレーム同期用基準パターン
発生器、１３……排他的論理和ゲート、１４……
シフトレジスタ、１５……クロツク再生回路、１
６……水晶発振器、１７……分周カウンタ、１８
……カウンタ、１９……リードオンリメモリ
（ROM）、２０……ラツチ回路、２１−（１〜５）
……出力端子。
ツト、フレーム同期パルスおよびタイムスロツト
（TS）パルスのタイムチヤート。第２図は第１図
のタイムスロツト（TS）パルス発生用従来例装
置のブロツク構成図。第３図は本発明実施例装置
のブロツク構成図。第４図は本発明実施例装置の
各部分の信号タイムチヤート。 １……フレーム同期パルス入力端子、２……再
生クロツク入力端子、３……カウンタ、４，５，
８……アンドゲート、６……インバータ、７……
フリツプフロツプ、９……オアゲート、１１……
入力端子、１２……フレーム同期用基準パターン
発生器、１３……排他的論理和ゲート、１４……
シフトレジスタ、１５……クロツク再生回路、１
６……水晶発振器、１７……分周カウンタ、１８
……カウンタ、１９……リードオンリメモリ
（ROM）、２０……ラツチ回路、２１−（１〜５）
……出力端子。
Claims (1)
- 【特許請求の範囲】 １ 親局とそれに接続される子局とよりなる時分
割多方向多重通信方式の子局の時間軸発生方式に
おいて、 受信した親局送信信号とフレーム同期基準パタ
ーンとの照合を行つてフレーム同期信号を出力す
る回路手段と、 この回路手段の出力したフレーム同期信号によ
りリセツトされ水晶発振器の出力を分周して出力
する分周器と、 この分周器の出力信号をクロツク入力としてカ
ウントしかつ上記フレーム同期信号によりリセツ
トされるカウンタと、 このカウンタの出力をアドレス指定入力とする
リードオンリメモリと を備え、 上記リードオンリメモリはあらかじめ各制御信
号の所要時間を記憶しておき上記アドレス指定入
力が進むに従つて記憶内容を順次読出すように構
成され、 このリードオンリメモリの読出す出力によりそ
の子局の信号処理を行うように構成された ことを特徴とする時分割多方向多重通信方式の時
間軸発生方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12443783A JPS6016740A (ja) | 1983-07-08 | 1983-07-08 | 時分割多方向多重通信方式の時間軸発生方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12443783A JPS6016740A (ja) | 1983-07-08 | 1983-07-08 | 時分割多方向多重通信方式の時間軸発生方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6016740A JPS6016740A (ja) | 1985-01-28 |
| JPH0225574B2 true JPH0225574B2 (ja) | 1990-06-04 |
Family
ID=14885469
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12443783A Granted JPS6016740A (ja) | 1983-07-08 | 1983-07-08 | 時分割多方向多重通信方式の時間軸発生方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6016740A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6253530A (ja) * | 1985-09-03 | 1987-03-09 | Nec Corp | Ｔｄｍａ通信装置の制御用情報発生回路 |
| JP2962886B2 (ja) * | 1991-07-19 | 1999-10-12 | 三菱電機株式会社 | Ｔｄｍａ処理装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55158748A (en) * | 1979-05-26 | 1980-12-10 | Fujitsu Ltd | Digital signal multiplexing circuit |
-
1983
- 1983-07-08 JP JP12443783A patent/JPS6016740A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS55158748A (en) * | 1979-05-26 | 1980-12-10 | Fujitsu Ltd | Digital signal multiplexing circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6016740A (ja) | 1985-01-28 |
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