JPH022291B2 - - Google Patents
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Description
【発明の詳細な説明】
[発明の技術分野]
本発明は、ハイブリツドICにおいて、セラミ
ツク多層基板上のICチツプを搭載すべき位置に
あるダイパツドが、このICチツプを正常に動作
させる電位でなかつた場合に、これをICチツプ
の搭載位置を変えることなく、所望の電位の導体
パツドに接続替えし得るハイブリツドICの変更
方法に関する。
ツク多層基板上のICチツプを搭載すべき位置に
あるダイパツドが、このICチツプを正常に動作
させる電位でなかつた場合に、これをICチツプ
の搭載位置を変えることなく、所望の電位の導体
パツドに接続替えし得るハイブリツドICの変更
方法に関する。
[発明の技術的背景とその問題点]
電子機器の小型化、軽量化が進むにつれ電子部
品の高密度実装化が一段と強く要請されるように
なつてきた。
品の高密度実装化が一段と強く要請されるように
なつてきた。
このような背景のもとで、ハイブリツドICは、
モノリシツクICでは実現が困難な大電力・高電
圧分野の各種回路や、多品種少量生産あるいは多
機能化に好適するところから、その応用分野は急
速に拡大してきている。
モノリシツクICでは実現が困難な大電力・高電
圧分野の各種回路や、多品種少量生産あるいは多
機能化に好適するところから、その応用分野は急
速に拡大してきている。
このようなハイブリツドICは、客先ニーズに
応じて開発設計を行ない、試作品を評価して必要
な修正を行ない、所期の機能が発揮されることを
確認した後、製品生産に入るのが一般的である
が、最近では開発設計から生産までの時間的余裕
が少ないことが多いため、特に少量生産品では、
試作品の試作評価と製品の生産とを平行して進行
させる必要を生ずる場合が少なくない。
応じて開発設計を行ない、試作品を評価して必要
な修正を行ない、所期の機能が発揮されることを
確認した後、製品生産に入るのが一般的である
が、最近では開発設計から生産までの時間的余裕
が少ないことが多いため、特に少量生産品では、
試作品の試作評価と製品の生産とを平行して進行
させる必要を生ずる場合が少なくない。
このような場合、試作品の評価時にICチツプ
が所期の電位とは異なる電位のダイパツド上に設
置されていることが判明した際には、従来はいち
いちセラミツク多層基板を作り直していたが、こ
れには多くの工数と時間を必要とするため、ロス
が増大する上、時間的に客先要望に応じられなく
なるおそれがあつた。
が所期の電位とは異なる電位のダイパツド上に設
置されていることが判明した際には、従来はいち
いちセラミツク多層基板を作り直していたが、こ
れには多くの工数と時間を必要とするため、ロス
が増大する上、時間的に客先要望に応じられなく
なるおそれがあつた。
[発明の目的]
本発明は背景技術における上述のような不都合
な除去すべくなされたもので、ICチツプの搭載
位置を変えることなく、ICチツプを所望の電位
の導体パツドに接続替えできるようにしたハイブ
リツドICの変更方法を提供することを目的とす
る。
な除去すべくなされたもので、ICチツプの搭載
位置を変えることなく、ICチツプを所望の電位
の導体パツドに接続替えできるようにしたハイブ
リツドICの変更方法を提供することを目的とす
る。
[発明の概要]
すなわち、本発明のハイブリツドICの変更方
法は、ICチツプの搭載面に、搭載すべき位置に
あるダイパツドの電位と異なる所望の電位をもた
せる方法において、前記ダイパツドの表面に絶縁
層を設け、この絶縁層上から所望の電位を有する
パツドへかけて導電層を設けるとともに、前記表
面に絶縁層および導電層を設けたダイパツド上
に、前記絶縁層および導電層を介してICチツプ
を搭載することを特徴とするものである。
法は、ICチツプの搭載面に、搭載すべき位置に
あるダイパツドの電位と異なる所望の電位をもた
せる方法において、前記ダイパツドの表面に絶縁
層を設け、この絶縁層上から所望の電位を有する
パツドへかけて導電層を設けるとともに、前記表
面に絶縁層および導電層を設けたダイパツド上
に、前記絶縁層および導電層を介してICチツプ
を搭載することを特徴とするものである。
[発明の実施例]
以下、図面を参照して本発明の実施例を説明す
る。
る。
第2図は、一般的なハイブリツドICにおける
ICチツプ搭載部を示すものである。
ICチツプ搭載部を示すものである。
同図において、セラミツク層1内にパターン配
線2a,2b,2cを配設したセラミツク多層基
板3には、それぞれ配線パターン2a〜2cに電
気的に接続されたボンデイングパツド4a,4b
とダイパツド5が形成されている。
線2a,2b,2cを配設したセラミツク多層基
板3には、それぞれ配線パターン2a〜2cに電
気的に接続されたボンデイングパツド4a,4b
とダイパツド5が形成されている。
ダイパツド5上にはICチツプ6が搭載され、
その端子(インナーボンデイングパツド)はボン
ド線7a,7bによりボンデイングパツド4a,
4bに接続されている。
その端子(インナーボンデイングパツド)はボン
ド線7a,7bによりボンデイングパツド4a,
4bに接続されている。
このようなハイブリツドICにおいては、ICチ
ツプの裏面は通常所定の電位に固定して使用さ
れ、誤つた電位のダイパツドに接続されると、誤
動作したり破壊することがある。
ツプの裏面は通常所定の電位に固定して使用さ
れ、誤つた電位のダイパツドに接続されると、誤
動作したり破壊することがある。
例えば、ICチツプ6がTTL素子である場合に
は、その裏面を接地電位に保つ必要があり、ま
た、ICチツプ6がC−MOS素子から成る場合に
は、その裏面を電源電位に保つ必要がある。
は、その裏面を接地電位に保つ必要があり、ま
た、ICチツプ6がC−MOS素子から成る場合に
は、その裏面を電源電位に保つ必要がある。
仮に、当初の設計ではICチツプ6としてC−
MOS素子を使用する予定であつたところ、試作
品の評価の結果、これをTTL素子にリプレース
する必要が生じたような場合には、ICチツプ6
が固着されているダイパツド5に連なる配線2b
を接地電位に変更する必要を生じる。
MOS素子を使用する予定であつたところ、試作
品の評価の結果、これをTTL素子にリプレース
する必要が生じたような場合には、ICチツプ6
が固着されているダイパツド5に連なる配線2b
を接地電位に変更する必要を生じる。
しかしながら、配線2bには他のチツプ部品が
多数接続されているため、その電位を変更するこ
とは通常不可能である。
多数接続されているため、その電位を変更するこ
とは通常不可能である。
一方、ダイパツド5の近傍に接地電位の他のダ
イパツド、ボンデイングパツド等の導体パツドが
あれば、ICチツプ6をそこに移し替えればよい
が、ハイブリツドICは実装化密度を極限値まで
高めるよう設計されているため、ICチツプ6を
移し替えできるスペースがないことの方が多い。
イパツド、ボンデイングパツド等の導体パツドが
あれば、ICチツプ6をそこに移し替えればよい
が、ハイブリツドICは実装化密度を極限値まで
高めるよう設計されているため、ICチツプ6を
移し替えできるスペースがないことの方が多い。
このような場合、本発明においては、ダイパツ
ド5からICチツプ6を一旦取外し、第1図に示
すように、ダイパツド5の表面に非導電性エポキ
シ樹脂を塗布してキユアさせ、絶縁層8を形成し
た後、その上面と、その近くになる接地電位のボ
ンデイングパツド4aと、それらの間の基板表面
に導電性エポキシ樹脂等を塗布して導電層9を形
成する。
ド5からICチツプ6を一旦取外し、第1図に示
すように、ダイパツド5の表面に非導電性エポキ
シ樹脂を塗布してキユアさせ、絶縁層8を形成し
た後、その上面と、その近くになる接地電位のボ
ンデイングパツド4aと、それらの間の基板表面
に導電性エポキシ樹脂等を塗布して導電層9を形
成する。
このようにしてダイパツド5上に接地電位の導
電層9を形成した後、その上にTTL素子等から
成るICチツプ10を搭載して導電性エポキシ樹
脂11等により接着させ、ボンド線7a,7bの
先端をICチツプ10の端子に接続する。
電層9を形成した後、その上にTTL素子等から
成るICチツプ10を搭載して導電性エポキシ樹
脂11等により接着させ、ボンド線7a,7bの
先端をICチツプ10の端子に接続する。
上述のようにすることにより、ICチツプ10
を電源電位にあるダイパツド5上に固定しなが
ら、その裏面電位を接地電位に保つことができ
る。
を電源電位にあるダイパツド5上に固定しなが
ら、その裏面電位を接地電位に保つことができ
る。
なお、以上の説明では、ダイパツド5上のIC
チツプ6としてその裏面電位を接地電位で使用す
ることが必要なTTL素子10にリプレースする
例につき説明したが、本発明はこれに限定される
ものではなく、ある電位にあるダイパツド5上に
設置されたICチツプ6の裏面を、他の任意の電
位のボンデイングパツド4a,4bに接続して使
用する場合に広く適用することができる。
チツプ6としてその裏面電位を接地電位で使用す
ることが必要なTTL素子10にリプレースする
例につき説明したが、本発明はこれに限定される
ものではなく、ある電位にあるダイパツド5上に
設置されたICチツプ6の裏面を、他の任意の電
位のボンデイングパツド4a,4bに接続して使
用する場合に広く適用することができる。
[発明の効果]
上述の如く、本発明によれば、ある電位にある
ダイパツド上に設置したICチツプの裏面電位を
所望の電位に保つことができるので、基板自体を
手直しすることなく、また、適切な電位のダイパ
ツドが近くになくとも対処することができ、従つ
て、ハイブリツドICの変更を簡単に実行するこ
とが可能となる。
ダイパツド上に設置したICチツプの裏面電位を
所望の電位に保つことができるので、基板自体を
手直しすることなく、また、適切な電位のダイパ
ツドが近くになくとも対処することができ、従つ
て、ハイブリツドICの変更を簡単に実行するこ
とが可能となる。
第1図は本発明の実施例を説明する縦断面図、
第2図は本発明の適用前の一般的なハイブリツド
ICを示す縦断面図である。 1……基板、2a〜2c……配線、3……セラ
ミツク多層基板、4a,4b……ボンデイングパ
ツド、5……ダイパツド、6,10……ICチツ
プ、7a,7b……ボンド線、8……絶縁層、9
……導電層、11……導電性エポキシ樹脂。
第2図は本発明の適用前の一般的なハイブリツド
ICを示す縦断面図である。 1……基板、2a〜2c……配線、3……セラ
ミツク多層基板、4a,4b……ボンデイングパ
ツド、5……ダイパツド、6,10……ICチツ
プ、7a,7b……ボンド線、8……絶縁層、9
……導電層、11……導電性エポキシ樹脂。
Claims (1)
- 【特許請求の範囲】 1 ICチツプの搭載面に、搭載すべき位置にあ
るダイパツドの電位と異なる所望の電位をもたせ
る方法において、前記ダイパツドの表面に絶縁層
を設け、この絶縁層上から所望の電位を有するパ
ツドへかけて導電層を設けるとともに、前記表面
に絶縁層および導電層を設けたダイパツド上に、
前記絶縁層および導電層を介してICチツプを搭
載することを特徴とするハイブリツドICの変更
方法。 2 絶縁層が非導電性エポキシ樹脂であり、導電
層が導電性エポキシ樹脂である特許請求の範囲第
1項記載のハイブリツドICの変更方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12826184A JPS617646A (ja) | 1984-06-21 | 1984-06-21 | ハイブリツドicの変更方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12826184A JPS617646A (ja) | 1984-06-21 | 1984-06-21 | ハイブリツドicの変更方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS617646A JPS617646A (ja) | 1986-01-14 |
JPH022291B2 true JPH022291B2 (ja) | 1990-01-17 |
Family
ID=14980470
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12826184A Granted JPS617646A (ja) | 1984-06-21 | 1984-06-21 | ハイブリツドicの変更方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS617646A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0558354A (ja) * | 1991-08-29 | 1993-03-09 | Iseki & Co Ltd | クロ−ラ式走行装置 |
Families Citing this family (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2002001931A1 (fr) | 2000-06-29 | 2002-01-03 | Mitsubishi Denki Kabushiki Kaisha | Module de substrat multicouche et terminal sans fil portable |
JP4662507B1 (ja) * | 2009-11-05 | 2011-03-30 | 株式会社椿本チエイン | 噛合チェーン |
-
1984
- 1984-06-21 JP JP12826184A patent/JPS617646A/ja active Granted
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0558354A (ja) * | 1991-08-29 | 1993-03-09 | Iseki & Co Ltd | クロ−ラ式走行装置 |
Also Published As
Publication number | Publication date |
---|---|
JPS617646A (ja) | 1986-01-14 |
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